JPS61180325U - - Google Patents
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- Publication number
- JPS61180325U JPS61180325U JP6444685U JP6444685U JPS61180325U JP S61180325 U JPS61180325 U JP S61180325U JP 6444685 U JP6444685 U JP 6444685U JP 6444685 U JP6444685 U JP 6444685U JP S61180325 U JPS61180325 U JP S61180325U
- Authority
- JP
- Japan
- Prior art keywords
- storage means
- turn
- auxiliary storage
- data protection
- protection circuit
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Power Sources (AREA)
Description
第１図は本考案の一実施例を示すブロツク線図
、第２図は本考案の時間差スイツチの構成及び動
作説明図、第３図はデータ保護に関する動作を示
すタイムチヤート、第４図は従来装置の一例を示
すブロツク線図である。 ２…電源装置、３…ＣＰＵ基板、４…補助記憶
手段、６…時間差スイツチ、Ｐ…割込信号。
、第２図は本考案の時間差スイツチの構成及び動
作説明図、第３図はデータ保護に関する動作を示
すタイムチヤート、第４図は従来装置の一例を示
すブロツク線図である。 ２…電源装置、３…ＣＰＵ基板、４…補助記憶
手段、６…時間差スイツチ、Ｐ…割込信号。
Claims (1)
- 補助記憶手段を有するマイクロコンピユータ応
用装置において、時間差を持つてオン、オフする
２組の接点を有する電源スイツチの、先にオフと
なる接点を割込信号に用いて一定時間後に電源断
となる情報をプロセツサに与えることを特徴とす
る補助記憶手段のデータ保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6444685U JPS61180325U (ja) | 1985-04-30 | 1985-04-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6444685U JPS61180325U (ja) | 1985-04-30 | 1985-04-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61180325U true JPS61180325U (ja) | 1986-11-11 |
Family
ID=30595539
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6444685U Pending JPS61180325U (ja) | 1985-04-30 | 1985-04-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61180325U (ja) |
-
1985
- 1985-04-30 JP JP6444685U patent/JPS61180325U/ja active Pending
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