JPS61158743U - - Google Patents
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- Publication number
- JPS61158743U JPS61158743U JP4270385U JP4270385U JPS61158743U JP S61158743 U JPS61158743 U JP S61158743U JP 4270385 U JP4270385 U JP 4270385U JP 4270385 U JP4270385 U JP 4270385U JP S61158743 U JPS61158743 U JP S61158743U
- Authority
- JP
- Japan
- Prior art keywords
- control device
- pulse
- section
- test pulse
- receiver
- Prior art date
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- Pending
Links
- 230000009977 dual effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Test And Diagnosis Of Digital Computers (AREA)
Description
第１図は制御装置の一実施例を示す電気回路図
、第２図は他の実施例を示す電気回路図、第３図
は従来例を示す電気回路図。 １……制御部を構成する論理部、２１，２２…
…２ｎ……パルス受信部としての個別ハードカウ
ンタ、５……設定部、６……試験用のパルス受信
部。
、第２図は他の実施例を示す電気回路図、第３図
は従来例を示す電気回路図。 １……制御部を構成する論理部、２１，２２…
…２ｎ……パルス受信部としての個別ハードカウ
ンタ、５……設定部、６……試験用のパルス受信
部。
Claims (1)
- 【実用新案登録請求の範囲】 １ 被計測チヤネル毎にパルス受信部を有すると
ともに、各被計測チヤネルからのパルス入力に必
要なデータ処理等を施す制御部とを有する制御装
置において、被計測チヤネル毎のパルス受信部と
別個に試験用のパルス受信部を取付け、この試験
用のパルス受信部のパルス入力端子を選択的に被
計測チヤネル毎のパルス受信部のパルス入力端子
に接続する接続部を取付けたことを特徴とする制
御装置。 ２ 試験用のパルス受信部が、設定部を介して上
記制御装置の各入力部と選択的に接続されている
上記実用新案登録請求の範囲第１項記載の制御装
置。 ３ 試験用のパルス受信部が２重構成である上記
実用新案登録請求の範囲第１項記載の制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4270385U JPS61158743U (ja) | 1985-03-25 | 1985-03-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4270385U JPS61158743U (ja) | 1985-03-25 | 1985-03-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61158743U true JPS61158743U (ja) | 1986-10-01 |
Family
ID=30553705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4270385U Pending JPS61158743U (ja) | 1985-03-25 | 1985-03-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61158743U (ja) |
-
1985
- 1985-03-25 JP JP4270385U patent/JPS61158743U/ja active Pending
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