JPS61132777U - - Google Patents
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- Publication number
- JPS61132777U JPS61132777U JP1597985U JP1597985U JPS61132777U JP S61132777 U JPS61132777 U JP S61132777U JP 1597985 U JP1597985 U JP 1597985U JP 1597985 U JP1597985 U JP 1597985U JP S61132777 U JPS61132777 U JP S61132777U
- Authority
- JP
- Japan
- Prior art keywords
- operational amplifier
- test sample
- input terminal
- printed circuit
- reference ground
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Tests Of Electronic Circuits (AREA)
Description
第１図はこの考案の実施例によるスイツチ制御
回路、第２図は従来例によるスイツチ回路を示す
。 １：定電流電源、２，４，５，６：スイツチ、
３：被測定試料、７：比較器、８：出力端子、９
：基準アース、１０：演算増幅器。
回路、第２図は従来例によるスイツチ回路を示す
。 １：定電流電源、２，４，５，６：スイツチ、
３：被測定試料、７：比較器、８：出力端子、９
：基準アース、１０：演算増幅器。
Claims (1)
- 定電流電源と基準アース間にそれぞれスイツチ
を介して被測定試料を接続し、この被測定試料の
両端子間電圧を比較する実装済プリント基板のシ
ヨート／オープンテスタにおいて、前記被測定試
料の基準アース側端子に２個の並列スイツチを接
続し、この並列スイツチの一方を演算増幅器の負
入力端子に、他方を演算増幅器の出力端子にそれ
ぞれ接続し、この演算増幅器の正入力端子に前記
基準アースと前記比較器をそれぞれ接続して構成
したスイツチ制御回路を具備させたことを特徴と
する実装済プリント基板のシヨート／オープンテ
スタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1597985U JPS61132777U (ja) | 1985-02-08 | 1985-02-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1597985U JPS61132777U (ja) | 1985-02-08 | 1985-02-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61132777U true JPS61132777U (ja) | 1986-08-19 |
Family
ID=30502318
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1597985U Pending JPS61132777U (ja) | 1985-02-08 | 1985-02-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61132777U (ja) |
-
1985
- 1985-02-08 JP JP1597985U patent/JPS61132777U/ja active Pending
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