JPS6080385A - Apc circuit - Google Patents
Apc circuitInfo
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- JPS6080385A JPS6080385A JP18961383A JP18961383A JPS6080385A JP S6080385 A JPS6080385 A JP S6080385A JP 18961383 A JP18961383 A JP 18961383A JP 18961383 A JP18961383 A JP 18961383A JP S6080385 A JPS6080385 A JP S6080385A
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- burst
- signal
- output
- gate
- comparator
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/44—Colour synchronisation
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明はビデオ信号をディジタル処理するシステムに用
いられるA P O(Automatic Pbase
0ontorol)回路に関する。DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention is directed to an APO (Automatic Pbase) used in a system for digitally processing video signals.
0ontorol) circuit.
背景技術とその問題点
入力ビデオ信号をディジタル処理するディジタルテレビ
受像機等においては、カラーバースを信号に基いて連続
波の発振出力を(4SるAPO回路もディジタル化され
ている。ディジタルテレビの場合、A20回路の出力は
例えばサブキャリアの4倍周波数(143NIHz )
のクロックパルスであって、このクロックパルスはシス
テムの入力側のA/D変換、出力側のD/A変換及びそ
の他のタイミング信号のための基準パルス(システムク
ロック)として用いられ、る。Background Art and Problems In digital television receivers and the like that digitally process input video signals, APO circuits that generate continuous wave oscillation output (4S) based on colorverse signals are also digitized.In the case of digital televisions , the output of the A20 circuit is, for example, four times the frequency of the subcarrier (143 NIHZ).
This clock pulse is used as a reference pulse (system clock) for A/D conversion on the input side, D/A conversion on the output side, and other timing signals of the system.
A20回路におけるバースト信号と発振出力との位相比
較は、ディジタル化されたビデオ信号から分離して得ら
れる第1図に示すR−Y情報に基いて行わオ9る。即ち
、A20回路が位相ロックした状態ではバースト区間の
R−Y情報のディジタル値ハ〔100000〕に等しく
なっていて、位相がずれると第1図の点線のようにこの
値よりも大または小のテイジタル値が生ずることを利用
している6位イ目検波回路は基準値(100000)と
R−Y情報とをバースト区間(バーストケートハルスB
GP(7)巾)において比較するマグニチュードコン
パレータで構成され、その出力に基いてVCO(電圧制
御発振器)の出力周波数(位相)を制御している。The phase comparison between the burst signal and the oscillation output in the A20 circuit is performed based on the RY information shown in FIG. 1, which is obtained separately from the digitized video signal. In other words, when the A20 circuit is phase-locked, the digital value of the R-Y information in the burst period is equal to [100000], and when the phase shifts, the value becomes larger or smaller than this value as shown by the dotted line in Figure 1. The 6th A detection circuit, which utilizes the generation of digital values, uses the reference value (100000) and R-Y information in the burst interval (burst Kate Hals B).
It is composed of a magnitude comparator that compares the magnitude at GP (7) width), and controls the output frequency (phase) of a VCO (voltage controlled oscillator) based on its output.
第1図のパーストゲートパルスBGPは水平同門信号か
ら遅延して作られる。ビデオ信号の伝送経路によってバ
ースト信号の同期信号に対する位相が変1W1するので
、パーストゲートパルスBGPは十分な位相余裕をとっ
て第1図の如く巾広に作られている。従ってAPO回路
の位相検波回路では、R,−T情報のペデスタル部分の
レベルもバースト位相情報として弁別することになる。The burst gate pulse BGP shown in FIG. 1 is generated with a delay from the horizontal gate signal. Since the phase of the burst signal relative to the synchronization signal changes by 1W1 depending on the transmission path of the video signal, the burst gate pulse BGP is made wide as shown in FIG. 1 with sufficient phase margin. Therefore, the phase detection circuit of the APO circuit also discriminates the level of the pedestal portion of the R and -T information as burst phase information.
このペデスタルレベルのディジタル値は本来(1000
00)(6ビツトの量子化レベルの中間値)であるから
、APO回路がロックした場合のR−Yのノく−スト情
報と全く同一であり、従って位相検波回路が誤動作して
ロック位相に誤差が生ずる虞れがある。The digital value of this pedestal level is originally (1000
00) (the intermediate value of the 6-bit quantization level), it is exactly the same as the RY node information when the APO circuit is locked, and therefore the phase detection circuit malfunctions and the locked phase is not reached. There is a risk of errors occurring.
発明の目的
本発明は上述の問題にかんがみ、R−Y信号中のバース
ト情報のみに基いて位相弁別を行ってA20回路が誤動
作することか無いようにすることを目的とする。OBJECTS OF THE INVENTION In view of the above-mentioned problems, it is an object of the present invention to perform phase discrimination based only on burst information in the RY signal to prevent the A20 circuit from malfunctioning.
発明の概要
本発明のAPO回路は、入力ビデオ信号をディジタル信
号に変換してR−Y信号及びB−Y信号を得て、ゲート
回路でもって上記R−Y信号のカラーバースト部分を抽
出し、第1のコンパレータでもって上記ゲート回路の出
力と基準値とを比較し、その出力の誤差情報に基いて電
圧制御発振器を制御するように構成さね、上記ゲート回
路に与えるゲートパルスはB−Y信号中のカラーバース
ト情報と一定レベルとを第2のコンパレータで比較して
形成されることを特徴とするものである。Summary of the Invention The APO circuit of the present invention converts an input video signal into a digital signal to obtain an RY signal and a BY signal, extracts a color burst portion of the RY signal using a gate circuit, The output of the gate circuit is compared with a reference value by a first comparator, and the voltage controlled oscillator is controlled based on the error information of the output, and the gate pulse given to the gate circuit is B-Y. It is characterized in that it is formed by comparing the color burst information in the signal with a certain level using a second comparator.
この構成によりバースト情報のみに基いてカラーバース
トとvCO出力との位相誤差を弁別することができる。With this configuration, it is possible to discriminate the phase error between the color burst and the vCO output based only on the burst information.
実施例 以下本発明を実施例に基いて説明する。Example The present invention will be explained below based on examples.
第2図は本発明を適用したディジタルテレビ受像機の要
部ブロック図で、第6図は第2図の各部の波形図である
。第2図において、アンテナ(1)かの入力信号はチュ
ーナー+21を経てVIP(3+にてビデオ信号に検波
されてからA/D変換器(4)によってディジタル信号
に変換される。ディジタル化されたビデオ信号は、Y/
C(輝度/クロマ)分離回路(5)において輝度信号Y
及びクロマ信号Cに分離される。輝度信号は後段の処理
回路に導出されると共に、クロマ信号はACC回路(6
)(自動クロマ制御回路)を通ってデモシュレータ(7
)に与えられ、R−Y信号(編1図)及びB−Y信号(
第3図A)に分離される。各1’(、−Y、B−Y信号
は、必要があわば調整又は制御を受けてから、D/A変
換器+81 +91でアナログのクロマ信号に変換され
、後段回路に導出さオ9る。FIG. 2 is a block diagram of main parts of a digital television receiver to which the present invention is applied, and FIG. 6 is a waveform diagram of each part of FIG. In Fig. 2, the input signal from the antenna (1) passes through the tuner +21, is detected as a video signal at the VIP (3+), and is converted into a digital signal by the A/D converter (4). The video signal is Y/
In the C (luminance/chroma) separation circuit (5), the luminance signal Y
and chroma signal C. The luminance signal is sent to the subsequent processing circuit, and the chroma signal is sent to the ACC circuit (6
) (automatic chroma control circuit) to the demosulator (7
), the R-Y signal (Figure 1) and the B-Y signal (
It is separated into Figure 3A). Each 1'(, -Y, B-Y signal is adjusted or controlled as necessary, and then converted to an analog chroma signal by a D/A converter +81 +91, and output to a subsequent circuit. .
第1図に示すR−Y信号は従来と同様にAPO回路のパ
ーストゲート(llilに与えられ、カーラーバースト
部分が抜きJlyられてからコンパレータOnに供給さ
れる。ゲートパルスPgは後述のようにB−Y信号のバ
ースト情報に基いて形成される。The R-Y signal shown in FIG. 1 is applied to the burst gate (llil) of the APO circuit as in the conventional case, and after the curler burst portion is extracted and Jly is applied to the comparator On. - It is formed based on the burst information of the Y signal.
コンパレータaηにお、いてはパーストゲート(Lfi
lの出力と基準イ直(100000)(ペデスタルレベ
ルに相当する)とが比較される。周知のようにクロマ信
号は重文変調されて伝送され、R,−Yについての検波
軸はバースト軸と直交している。従ってA20回路のv
a o +anの出力位相が入力ビデオ信号のカラー
バーストにロックしているさき、■−Y信号についての
バーストゲ−1−11Filの出力は上記基準値cio
oooo)と一致する。即ち、R−Yの検波出力中にバ
ースト情報は本来含まねない。In the comparator aη, the burst gate (Lfi
The output of I is compared with a reference I (100000) (corresponding to the pedestal level). As is well known, the chroma signal is transmitted after being subjected to complex modulation, and the detection axes for R and -Y are perpendicular to the burst axis. Therefore, v of A20 circuit
While the output phase of a o +an is locked to the color burst of the input video signal, the output of burst game 1-11Fil for -Y signal is the above reference value cio
oooo). That is, the burst information is not originally included in the R-Y detection output.
コンパレータaηは基準値とパーストゲート出力との大
小比較を行い、パーストゲート出力が基準値よりも高け
れば次のU/D (アップダウン)カウンタ(陶に計数
減少信号を与え、パーストゲート出力が基準値よりも低
ければ計薮増加信号を与える。U/Dカウンタ(I8)
の出力はD/A変換5(19J、ローパスフィルタ(2
(υを介して制御電圧としてVCOf21+に与えられ
、その発振周波数4 fscが制御される。V 001
2++の出力周波数(位相)の変化はバーストゲ−)
(161の出力が基準値と一致するまで行われ、安定状
態に達するc!: V CO(211の出力とカラーバ
ースト信号との位相が合致する。The comparator aη compares the reference value with the burst gate output, and if the burst gate output is higher than the reference value, the next U/D (up/down) counter (up/down) gives a counting reduction signal to the burst gate output and the burst gate output becomes the reference value. If it is lower than the value, a counter increase signal is given.U/D counter (I8)
The output is D/A converter 5 (19J), low pass filter (2
(It is given to VCOf21+ as a control voltage via υ, and its oscillation frequency 4 fsc is controlled.V 001
2++ output frequency (phase) change is burst game)
(This is carried out until the output of 161 matches the reference value and a stable state is reached c!: V CO (The output of 211 and the color burst signal match in phase.
kPc回路(7)コンパレータ(17)において基準値
とバースト情報のみとを比較するために、デモシュレー
タ(7)の出力のB−Y信号のバースト情報に基いてパ
ーストゲート(1(′N)のゲートパルスPgが形成さ
れる。B−Yについての検波軸はバースト軸と同相であ
って、第6図Aに示すようにB−Y信号中のバースト情
報はペデスタルレベルとは異なる一定値を示す。従って
このバースト情報に基いてノく一スト信号の位置を正確
に代表した第3図CのゲートパルスPgを得ることがで
きる。In order to compare only the reference value and burst information in the kPc circuit (7) comparator (17), the burst gate (1('N) gate is A pulse Pg is formed.The detection axis for BY is in phase with the burst axis, and as shown in FIG. 6A, the burst information in the BY signal exhibits a constant value different from the pedestal level. Therefore, based on this burst information, it is possible to obtain the gate pulse Pg shown in FIG. 3C, which accurately represents the position of the first burst signal.
第2図において、デモシュレータ(7)の出力のB−Y
信号はパーストゲート(10)に送ら11、第6図Bに
示すパーストゲートパルスBGPに基いてバースト部分
が抽出される。このパーストゲートパルスはビデオ信号
の伝送経路によるバースト信号の位相ずれを考J、iM
して巾広に作られている。このパーストゲートパルスは
、VIFi3+の出力のビデオ信号から同期信号を同期
分離回路(14)において分離抽出し、この同期信号を
タイミングカウンタ(15)にリセットパルスとして与
えて、このカウンタ(15)から第6図Bの位相及びパ
ルス巾を翁するパルスを取出すことにより作成すること
ができる。なおタイミングカウンタ(15)はV CO
f21)の出力4 fscを計数してビデオ信号の時間
軸に沿った各種のタイミング信号を形成している。In Fig. 2, the output B-Y of the demosimulator (7)
The signal is sent to a burst gate (10) 11, and a burst portion is extracted based on the burst gate pulse BGP shown in FIG. 6B. This burst gate pulse takes into consideration the phase shift of the burst signal due to the transmission path of the video signal.
It is made wide. This burst gate pulse is generated by separating and extracting a synchronization signal from the video signal output from the VIFi3+ in a synchronization separation circuit (14), giving this synchronization signal to a timing counter (15) as a reset pulse, and It can be created by extracting a pulse having the phase and pulse width shown in Figure 6B. Note that the timing counter (15) is V CO
The output 4 fsc of f21) is counted to form various timing signals along the time axis of the video signal.
パーストゲート(IO)の出力はコンパレータ(団に与
えられ、第6図Aに示す基準レベル1(、Lと比較さね
、基準レベルI(・Lよりも低い]く−スト部分がクリ
ップして取出される。従ってコンパレータ(10)の出
力からは、第6図Cに示すバースト信号に対応するゲー
トパルスPgが得られる。このゲートパルスは切換スイ
ッチ(13)を通ってA、 P C回路のノ(−ストゲ
ー1− (1G+に与えらねる。従って〕く−ストゲー
ト(16)はR,−Y信号中のバーストMl(分のみを
正確に抽出シ、次のコンパレータ(痒においてはペデス
タルレベルを含まないバースト情報のみに基いた正確な
位相弁別が行われる。The output of the burst gate (IO) is given to a comparator (group), and compared with reference level 1 (lower than reference level I (.L) shown in Fig. 6A), the burst portion is clipped. Therefore, from the output of the comparator (10), a gate pulse Pg corresponding to the burst signal shown in FIG. -Stogate 1- (1G+ cannot be given. Therefore, -Stogate (16) accurately extracts only the burst Ml (minute) in the R and -Y signals, and the next comparator (in case of itching, the pedestal level is Accurate phase discrimination is performed based only on burst information that is not included.
なお弱電界時やノイズが多いときには、第6図AのB−
Y(m号中のバースト情報レベルが基準レベルRLの付
近捷で上昇することがある。このような場合には、コン
パレータ(11)において基準レベルRLでクリッピン
グを行うと第3図りのようなヒゲ状のノイズパルスが発
生する。このようなノイズパルスを含んだ信号はパース
トゲートパルスPg として適さないので、この場合に
は切換スイッチ(13)を切換えてタイミングカウンタ
(15)から得られる同期信号系のパーストゲートパル
スBGP(第6図B)を使用するようにしている。In addition, when the electric field is weak or there is a lot of noise, B- in Figure 6A
The burst information level in Y(m) may rise near the reference level RL. In such a case, if clipping is performed at the reference level RL in the comparator (11), a whisker as shown in the third figure may occur. A signal containing such noise pulses is not suitable as the burst gate pulse Pg. The burst gate pulse BGP (FIG. 6B) is used.
切換スイッチ(13)のLJJ換制御は、コンパレータ
(11)の出力に基いて基準レベルRLを上回ったデー
タ数をカウンタ(12)で財政して、その数が一定以上
になったさきにイ1′lら;lする切換制御信号に基い
て行わねる。このカウンタ(12)は例えば1垂直走査
区間ごとにリセットさ11る。The LJJ switching control of the changeover switch (13) uses a counter (12) to count the number of data exceeding the reference level RL based on the output of the comparator (11), and when the number exceeds a certain level, the This is not done based on the switching control signal. This counter (12) is reset 11 every vertical scanning section, for example.
以上本発明をディジタルテレビ受像機に適用した夷M(
1例に基いて説明したが、本発明6オビデオ信号をテイ
ジタル処理する神々の装盾、例えばフレームメモリー、
フレームシンクロナイザ−、タイムベースコレクタ等に
適用するこおができる。As described above, the present invention is applied to a digital television receiver.
Although the explanation has been made based on one example, the present invention 6 uses a shield of the gods that digitally processes an audio video signal, such as a frame memory,
It can be applied to frame synchronizers, time base collectors, etc.
発明の効果
本発明は上述の如く、テイジタル情報の形で検波された
Il、 −Y信号のバースト部分と基準仙とを比較して
位相誤差を得て電圧’+ljt制御発振器を制御し、カ
ラーバーストに位相固定された発振出力を得る一方で、
B−Y信号中のバースト情報と一定レベルとを比較して
バースト部分に対応したゲートパルスを得て、このゲー
トパルスに基いてR,−Y信号中のバースト部分を抽出
し、て上記位相誤差を得るための比較を行うようにした
ものである。従って余分な情報を含捷ないバースト部分
のみのR,−Y情報に基いて位相弁別を行うことができ
、重圧制御発振器の出力をバースト位相に誤差なく正確
にロックするこさができる。Effects of the Invention As described above, the present invention compares the burst portion of the Il, -Y signal detected in the form of digital information with the reference signal to obtain a phase error and control the voltage '+ljt control oscillator, thereby generating a color burst. While obtaining a phase-locked oscillation output,
The burst information in the B-Y signal is compared with a certain level to obtain a gate pulse corresponding to the burst part, and based on this gate pulse, the burst part in the R and -Y signals is extracted, and the above-mentioned phase error is calculated. It is designed to perform a comparison to obtain the following. Therefore, phase discrimination can be performed based on the R and -Y information of only the burst portion without including unnecessary information, and the output of the heavy pressure control oscillator can be accurately locked to the burst phase without error.
第1図67rビデオ(A号から得らねたl[(、−Y情
報の波形図、第2図は本発明の芙1面例を示すディジタ
ルテレビ受像機の要部ブロック図、第6図は第2図の谷
部の波形図である。
なお図面に用いられた符号において、
(1)・・・・・・・・・・・・・・・アンテナ(2)
・・・・・・・・・・・・・・・チューナー(3) ・
・・・・・・・・・・・・・・ VIF(4)・・・・
・・・・・・・・・・・A/D変換器(5)・・・・・
・・・・・・・・・・Y10分離回路(61・・・・・
・・・・・・・・−・AOO回路(7j・・・・・・・
・・・・・・・・デモシュレータ+8)191・・・・
・・・・・・・・D/A変換器α01・・・・・・・・
・・・・・・・バーストケート(11)・・・・・・・
・・・・・・・・コンパレータ(121・・・・・・・
・・・・・・・・カウンタ(13)・・・・・・・・・
・・・・・・切換スイッチ114J・・・・・・・・・
・・・・・・同期分離回路(15)・・・・・・・・・
・・・・・・タイミングカウンタ(16)・・・・・・
・・・・・・・・・バーストケート+171・・・・・
・・・・・・・・・・コンノ1°レータ(18)・・・
・・・・・・−・・・U/Dカウンタ(19)・・・・
・・・・・・・・・・・D/A変換器(201・・・・
・・・・・・・・・・・ローパスフィルタ(21)・・
・・・・・・・・・・・・・ ■00である。
第1図
り一一皿−一一FIG. 1 is a waveform diagram of the 67r video (l[(, -Y information not obtained from issue A), FIG. 2 is a block diagram of the main parts of a digital television receiver showing an example of the first page of the present invention, FIG. is a waveform diagram of the trough in Figure 2. In the symbols used in the drawing, (1)......Antenna (2)
・・・・・・・・・・・・・・・Tuner (3) ・
・・・・・・・・・・・・・・・ VIF(4)・・・
......A/D converter (5)...
......Y10 separation circuit (61...
・・・・・・・・・−・AOO circuit (7j・・・・・・・
・・・・・・Demosimulator+8)191・・・・
......D/A converter α01...
・・・・・・Burst Kate (11)・・・・・・
......Comparator (121...
・・・・・・・・・Counter (13)・・・・・・・・・
......Choice switch 114J...
......Synchronization separation circuit (15)...
...Timing counter (16)...
・・・・・・・・・Burst Kate+171・・・・・・
......Conno 1° rater (18)...
......-...U/D counter (19)...
・・・・・・・・・・・・D/A converter (201...
......Low pass filter (21)...
・・・・・・・・・・・・ ■00. 1st plan 11 plates - 11
Claims (1)
及びB−Y信号を得る回路と、上記R−Y信号中のカラ
ーバースト部分を抽出するゲート回路と、このゲート回
路の出力と基準値とを比較する第1のコンパレータと、
この第1のコンパレータの出力の誤差情報に応じて制御
される電圧制御発振器と、上記B −Y信号のカラーバ
ースト情報と一定レベルとを比較して上記ゲート回路に
与えるゲートパルスを得る第2のコンパレータとを具備
するAPO回路。A circuit that converts an input video signal into a digital signal to obtain a R-Y signal and a B-Y signal, a gate circuit that extracts a color burst portion in the R-Y signal, and an output of this gate circuit and a reference value. a first comparator that compares
A voltage controlled oscillator controlled according to the error information of the output of the first comparator and a second comparator that compares the color burst information of the B-Y signal with a constant level to obtain a gate pulse to be applied to the gate circuit. An APO circuit comprising a comparator.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18961383A JPS6080385A (en) | 1983-10-11 | 1983-10-11 | Apc circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18961383A JPS6080385A (en) | 1983-10-11 | 1983-10-11 | Apc circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6080385A true JPS6080385A (en) | 1985-05-08 |
Family
ID=16244231
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP18961383A Pending JPS6080385A (en) | 1983-10-11 | 1983-10-11 | Apc circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6080385A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63152297A (en) * | 1986-12-17 | 1988-06-24 | Nec Home Electronics Ltd | Hue adjusting method |
US5243412A (en) * | 1990-08-09 | 1993-09-07 | Victor Company Of Japan, Ltd. | Circuit for generating a clock signal which is locked to a specific phase of a color burst signal in a color video signal |
-
1983
- 1983-10-11 JP JP18961383A patent/JPS6080385A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63152297A (en) * | 1986-12-17 | 1988-06-24 | Nec Home Electronics Ltd | Hue adjusting method |
US5243412A (en) * | 1990-08-09 | 1993-09-07 | Victor Company Of Japan, Ltd. | Circuit for generating a clock signal which is locked to a specific phase of a color burst signal in a color video signal |
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