JPS6047548A - Facsimile multiple address device - Google Patents

Facsimile multiple address device

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JPS6047548A
JPS6047548A JP58155870A JP15587083A JPS6047548A JP S6047548 A JPS6047548 A JP S6047548A JP 58155870 A JP58155870 A JP 58155870A JP 15587083 A JP15587083 A JP 15587083A JP S6047548 A JPS6047548 A JP S6047548A
Authority
JP
Japan
Prior art keywords
transferred
control unit
section
image information
control part
Prior art date
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Pending
Application number
JP58155870A
Other languages
Japanese (ja)
Inventor
Junichi Sano
佐野 淳一
Fumio Hayashi
林 文雄
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Panasonic System Solutions Japan Co Ltd
Original Assignee
Matsushita Graphic Communication Systems Inc
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Publication date
Application filed by Matsushita Graphic Communication Systems Inc filed Critical Matsushita Graphic Communication Systems Inc
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Publication of JPS6047548A publication Critical patent/JPS6047548A/en
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Abstract

PURPOSE:To realize a facsimile multiple address device superior in extendability by transferring directly the compressed data of image information stored previously in a storage part to a communication control part through a dedicated data transfer line, and transmitting it together with an added file bit for flow control. CONSTITUTION:The image information read out by an original readout part is transferred to a system control part 21 through a system bus 22, and the transferred image information is further transferred from the control part 21 to a band compression/expansion part 26 through the bus 22 to perform bank compression. The compressed data is transferred to the control part 21 through the bus 22, and transferred from the control part 21 to a storage part 27 through the bus 22 and stored. Then, the stored compressed data is transferred to the communication control part 30 through a data transfer line 32 and transmitted after the necessary file file bit for flow control is added by the flow control part 31 in the control part 30.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、ファクシミリ回報装置に関する。[Detailed description of the invention] Industrial applications The present invention relates to a facsimile communication device.

従来例の構成とその問題点 第1図は従来のファクシミリ回報装置の概略でロック図
である。この図において、1は装置各部の制御を行うシ
ステム制御部、2はこのシステム制御部と各部とを接続
するシステムバスである。
1. Configuration of Conventional Example and Its Problems FIG. 1 is a schematic lock diagram of a conventional facsimile distribution device. In this figure, 1 is a system control unit that controls each part of the apparatus, and 2 is a system bus that connects this system control unit and each part.

3は送信原稿の読取りを行う原稿読取部、4は画情報を
印刷する記録部、5は原稿読取部3の原稿送り機構や記
録部4の記録用紙送9機構などの機構を制御する機構制
御部である。原稿読取部3および記録部4はそれぞれ機
構制御部6を介してシステムバス2と接続される。6は
帯域圧縮/伸張部である。7は記憶部であり、磁気ディ
スク記憶装置8と補助記憶制御部9より構成されている
Reference numeral 3 denotes a document reading section that reads the transmitted document, 4 a recording section that prints image information, and 5 a mechanism control that controls mechanisms such as the document feeding mechanism of the document reading section 3 and the recording paper feeding mechanism 9 of the recording section 4. Department. The document reading section 3 and the recording section 4 are each connected to the system bus 2 via a mechanism control section 6. 6 is a band compression/expansion section. Reference numeral 7 denotes a storage unit, which is composed of a magnetic disk storage device 8 and an auxiliary storage control unit 9.

9は通信制御部である。9 is a communication control unit.

次に動作を説明する。原稿読取部3によって読取られた
原稿の画情報は、システムバス2を介しシステム制御部
1へ転送され、そこからシステムバス2を経由して帯域
圧縮/伸張部6へ転送され帯域圧縮を施される。画情報
の圧縮データは帯域圧縮/伸張部6よりシステムバス2
を介しシステム制御部1へ転送され、さらにシステムバ
ス2を介し記憶部7へ転送され磁気ディスク記憶装置8
に格納される。
Next, the operation will be explained. The image information of the document read by the document reading section 3 is transferred to the system control section 1 via the system bus 2, and from there is transferred via the system bus 2 to the band compression/expansion section 6 where it is subjected to band compression. Ru. Compressed data of image information is transferred from the band compression/expansion unit 6 to the system bus 2.
is transferred to the system control unit 1 via the system bus 2, and further transferred to the storage unit 7 via the system bus 2 and stored in the magnetic disk storage device 8.
is stored in

この」:うにして、複数葉の原稿が読込捷れその画情報
の圧縮データが記憶部7に格納されると、システム制御
部1は予め入力済の相手先との通信を開始しようとする
。まず通信制御部9を介して相手先と制御信号を交換し
、最小伝送時間と変調速度のネゴシェーションを行う。
In this way, when a multi-page original is read and the compressed data of its image information is stored in the storage unit 7, the system control unit 1 attempts to start communication with the destination that has been input in advance. . First, control signals are exchanged with the other party via the communication control unit 9, and negotiation of minimum transmission time and modulation speed is performed.

このネゴシェーションを終了すると、記憶部7より画像
の圧縮データを読出し、それをシステムバス2を通じて
帯域圧縮/伸張部6へ転送し半画情報に伸張させる。
When this negotiation is completed, the compressed image data is read from the storage section 7, transferred to the band compression/expansion section 6 via the system bus 2, and expanded into half-picture information.

この半画情報はシステムバス2を介しシステム制御部1
へ転送される。システム制御部1は、その半画情報を1
ラインの最小ビット数と共にシステムバス2を通じ帯域
圧縮/伸張部6へ転送する。
This half-screen information is sent to the system control unit 1 via the system bus 2.
will be forwarded to. The system control unit 1 stores the half-screen information as 1
It is transferred to the band compression/expansion unit 6 via the system bus 2 along with the minimum number of bits of the line.

帯域圧縮/伸張部6では、半画情報をCCITT勧告T
、4のMR(ModifiCd Read)方式で帯域
圧縮を行い、その符号列にCCITT勧告T、30の1
ライン最小伝送時間の条件を満足させるために必要々フ
ロー制御用フィルピットを伺加する。
The band compression/expansion unit 6 converts the half-picture information into CCITT recommendation T.
Bandwidth compression is performed using the MR (ModifyCd Read) method of , 4, and CCITT Recommendation T, 30-1 is applied to the code string.
Fill pits for flow control will be added as necessary to meet the line minimum transmission time requirements.

第2図はフィルピットの説明図である。この図の(a)
はフィルピットを付加する前のデータを示し、11はラ
イン同期信号(EOL)、12は1ラインの画情報の圧
縮データである。このEOLllと画情報の圧縮データ
2の合計伝送時間が最小伝送時間よシ短い場合、同図(
b)に示すように伝送時間が最小伝送時間以上となるよ
うにフィルピット13を付加する。このフィルピットの
ビット数Sは、最小伝送時間をA(ミリ秒)、回線の変
調速度をB(bps)、1ラインの画情報の圧縮データ
とEOLの合計ビット数をLとすると紋で表わされる。
FIG. 2 is an explanatory diagram of the fill pit. (a) in this figure
indicates data before adding fill pits, 11 is a line synchronization signal (EOL), and 12 is compressed data of one line of image information. If the total transmission time of this EOLll and compressed data 2 of image information is shorter than the minimum transmission time, the same figure (
As shown in b), fill pits 13 are added so that the transmission time is longer than the minimum transmission time. The number of bits S of this fill pit is expressed by a pattern, where A (milliseconds) is the minimum transmission time, B (bps) is the modulation speed of the line, and L is the total number of bits of compressed data and EOL of one line of image information. It will be done.

S =A x B /1o oo−L −−−−・−・
−=・(1)ただし S>0 第1図にもどって、上述のようにフィルピット6ノ′、
゛ を必要に応じて付加された圧縮データは、システムバス
2を介しシステム制御部1へ転送され、そこからシステ
ムバス2を介し通信制御部9へ転送され、送信される。
S = A x B /1ooo-L ------・-・
-=・(1) However, S>0 Returning to Figure 1, as mentioned above, fill pit 6 no',
The compressed data to which "" has been added as necessary is transferred to the system control section 1 via the system bus 2, and from there to the communication control section 9 via the system bus 2 for transmission.

」二連のように従来のファクシミリ回報装置は、記憶部
7に格納された画情報の圧縮データを帯域圧縮/伸張部
6で一旦伸張し、さらに帯域圧縮およびフロー制御用フ
ィルピットの付加を行うようになっているため、送信す
る場合にシステム制御部1、システムバス2および帯域
圧縮/伸張部6に大きな負荷がかかってしまい、拡張性
が非常に乏しい問題があった。また、このような処理を
通信を行いながら実行できるようにするためには、シス
テム制御部1や帯域圧縮/伸張部6を高速化する必要が
あり、装置の価格上昇を伴うという開本発明は−に記従
来の問題点を解消するもので、装置コストを上昇させる
ことなく拡張性に富むファクシミリ同報装置を提供する
ことを目的とする。
A conventional facsimile transmission device, such as the one with ``dual series'', first expands the compressed data of image information stored in the storage section 7 in the band compression/expansion section 6, and then performs band compression and addition of fill pits for flow control. Therefore, when transmitting, a large load is placed on the system control section 1, system bus 2, and band compression/expansion section 6, resulting in a problem of very poor expandability. In addition, in order to be able to execute such processing while communicating, it is necessary to speed up the system control unit 1 and the band compression/expansion unit 6, which increases the cost of the device. - It is an object of the present invention to provide a facsimile broadcasting device which solves the problems of the prior art and is highly expandable without increasing the cost of the device.

発明の構成 6ページ 本発明は、画情報をそのまま送信可能な符号に予め帯域
圧縮して記憶部に格納すると伴に、記憶部と通信制御部
との間にシステムバスとは独立した専用のデータ転送路
を設け、また通信制御部にフロー制御部を設け、記憶部
より画情報の圧縮データを専用のデータ転送路を通じ直
接的に通信制御部へ転送し、それにフロー制御部で必要
なフィルピットを追加して送信する構成とすることによ
って、上述の目的を達成せんとするものである。
Structure of the Invention Page 6 The present invention is characterized in that image information is band-compressed in advance into a code that can be transmitted as is and stored in a storage unit, and also dedicated data that is independent of the system bus is provided between the storage unit and the communication control unit. A transfer path is provided, and a flow control unit is provided in the communication control unit, and the compressed data of image information is directly transferred from the storage unit to the communication control unit through a dedicated data transfer path, and the flow control unit performs the necessary fill pits. The above object is attempted to be achieved by adding and transmitting the information.

実施例の説明 以下、図面を参照し本発明の実施例につき説明する。Description of examples Embodiments of the present invention will be described below with reference to the drawings.

第3図は本発明の一実施例によるファクシミリ回報装置
の概略ブロック図である。この図において、21(d、
システム制御部、22fdシステムバス、23は原稿読
取部、24は記録部、25は機構制御部、26は帯域圧
縮/伸張部である。これらは第1図の対応する部分と同
等である。但し、帯域圧縮/伸張部26はフロー制御用
フィルピットを付加する機能は持たない。27は記憶部
であシ、磁気ディスク記憶装置28と補助記憶制御部2
9から成る。3oは通信制御部である。32は記憶部2
7と通信制御部3oとの間の専用のデータ転送路である
。記憶部27は第1図の記憶部と同等であるが、データ
転送路32を通じ通信制御部3゜から直接的にアクセス
できる点が異なる。また通信制御部3oは、フロー制御
部31を有することと、データ転送路32を通じ記憶部
からデータを直接的に取り込む機能を有することを除け
ば、第1図の通信制御部と同等である。
FIG. 3 is a schematic block diagram of a facsimile communication device according to an embodiment of the present invention. In this figure, 21(d,
A system control section, 22fd system bus, 23 a document reading section, 24 a recording section, 25 a mechanism control section, and 26 a band compression/expansion section. These are equivalent to the corresponding parts in FIG. However, the band compression/expansion section 26 does not have a function of adding fill pits for flow control. 27 is a storage unit, a magnetic disk storage device 28 and an auxiliary storage control unit 2
Consists of 9. 3o is a communication control unit. 32 is storage unit 2
7 and the communication control unit 3o. The storage unit 27 is the same as the storage unit shown in FIG. 1, except that it can be accessed directly from the communication control unit 3° through the data transfer path 32. The communication control unit 3o is the same as the communication control unit shown in FIG. 1, except that it includes a flow control unit 31 and a function of directly importing data from the storage unit through the data transfer path 32.

次に動作を説明する。原稿読取部23により読取られた
画情報は、従来と同様にシステムバス22を介しシステ
ム制御部21へ転送され、システム制御部21からシス
テムバス22を介し帯域圧縮/伸張部26へ転送され、
帯域圧縮が施される。
Next, the operation will be explained. Image information read by the original reading unit 23 is transferred to the system control unit 21 via the system bus 22 as in the conventional case, and transferred from the system control unit 21 to the band compression/expansion unit 26 via the system bus 22.
Bandwidth compression is applied.

但し、この帯域圧縮はCCITT勧告T、4に示されて
いるMR方式によって行われる。帯域圧縮された画情報
の圧縮データは従来と同様にシステムバス22を介しシ
ステム制御部21へ送られ、そこからシステムバス22
を介し記憶部27へ転送され格納される。
However, this band compression is performed by the MR method shown in CCITT Recommendation T.4. The compressed data of the band-compressed image information is sent to the system control unit 21 via the system bus 22 as in the conventional case, and from there the data is sent to the system control unit 21 via the system bus 22.
The data is transferred to the storage unit 27 and stored therein.

このようにして複数葉の原稿の画情報が読取られ、その
圧縮データが記憶部2了に格納されると、システム制御
部は予め入力済の相手先との通信を開始しようとする。
When the image information of the multiple sheets of original is read in this way and the compressed data thereof is stored in the storage section 2, the system control section attempts to start communication with the destination party that has been input in advance.

まず、従来と同様なネゴシェーションを行い、相手先の
最小伝送時間を知るとともに回線の変調速度を決定する
。そしてシステム制御部21は、その最小伝送時間と変
調速度を通信制御部3oにシステムバス22を介し設定
した後、起動をかける。システム制御部30のフロー制
御部31は、最小伝送時間と変調速度に基づき1ライン
の最小ビット数およびクロックの周期を計算する。
First, a negotiation similar to the conventional method is performed to learn the minimum transmission time of the other party and to determine the modulation rate of the line. Then, the system control section 21 sets the minimum transmission time and modulation speed to the communication control section 3o via the system bus 22, and then activates the communication control section 3o. The flow control unit 31 of the system control unit 30 calculates the minimum number of bits in one line and the clock period based on the minimum transmission time and modulation rate.

また通信制御部30はデータ転送路32を介して記憶部
27をアクセスし、画情報の圧縮データを順次読込み、
フロー制御部31にて必要なフィルピットを付加した後
、相手先ファクシミリ装置へ送信する。
Further, the communication control unit 30 accesses the storage unit 27 via the data transfer path 32, sequentially reads compressed data of image information,
After adding necessary fill pits in the flow control unit 31, the data is transmitted to the destination facsimile machine.

第4図は上記フロー制御部のブロック図である。FIG. 4 is a block diagram of the flow control section.

この図において、41は記憶部27からの転送デ9 、
・ −・ 一夕が入力される端子、42はフロー制御を施した後の
データが出力される端子、43はシフトレジスタ、44
と46はANDグー)、46はORゲートである。47
はEOL検出器、48はフリ ′ツブフロップ、49は
アップ/ダウンカウンタである。5oは演算回路、61
はタイミング発生器、52は制御回路である。53はク
ロックの出力端子である。
In this figure, 41 is a transfer data 9 from the storage unit 27,
・-- A terminal to which data is input, 42 a terminal to which data after flow control is output, 43 a shift register, 44
and 46 are AND gates), and 46 is an OR gate. 47
is an EOL detector, 48 is a flip-flop, and 49 is an up/down counter. 5o is an arithmetic circuit, 61
52 is a timing generator, and 52 is a control circuit. 53 is a clock output terminal.

次に動作を説明する。システム制御部21から最小伝送
時間と変調速度が制御回路52に入力されると、この制
御回路62は1ラインの最小ビット数(EOLを含む)
とクロックの周期をめ、それらを出力63と64にそれ
ぞれ送出した状態で、出力55にパルスを出す。タイミ
ング発生器′51は出力55のパルスのタイミングで出
力54で示されるクロック周期を取り込み、そのクロッ
ク周期を持つクロックパルスの発生を開始する。
Next, the operation will be explained. When the minimum transmission time and modulation rate are input from the system control unit 21 to the control circuit 52, this control circuit 62 determines the minimum number of bits per line (including EOL).
A pulse is outputted to the output 55 with the period of the clock being set and sent to the outputs 63 and 64, respectively. The timing generator '51 takes in the clock period indicated by the output 54 at the timing of the pulse of the output 55 and starts generating a clock pulse having that clock period.

このクロックパルスは出力66より送出される。This clock pulse is sent out at output 66.

演算回路60は出力56のパルスのタイミングで出力5
3で示される最小ビット数を内部に取シ込10 ページ む。7’Jツブフロツプ48は出力55のパルスによっ
てリセットし、その反転側出力58は1117ルベルと
なる。従って、タイミング発生器51から出力されるク
ロックパルスはANDゲート45を介しシフトレジスタ
43に供給され、端子41より入力されるデータはシフ
トレジスタ上を順次右シフトされる。また、シフトレジ
スタ43から出力されるデータは、ANDゲート44を
通じ端子42に出力される。
The arithmetic circuit 60 outputs the output 5 at the timing of the pulse of the output 56.
The minimum number of bits indicated by 3 is internally inserted into 10 pages. The 7'J tube flop 48 is reset by the pulse at output 55, and its inverted output 58 is at 1117 lvl. Therefore, the clock pulse output from the timing generator 51 is supplied to the shift register 43 via the AND gate 45, and the data input from the terminal 41 is sequentially shifted to the right on the shift register. Furthermore, the data output from the shift register 43 is output to the terminal 42 through the AND gate 44.

アップ/ダウンカウンタ49は出力56のパルスが入力
されると、一旦リセットしたのちカウント動作を開始す
る。この時、フリップフロップ48の出力58は1”レ
ベルであるから、アップ/ダウ/カウンタ49はアップ
カウントを行う。
When the up/down counter 49 receives the pulse from the output 56, it is reset once and then starts counting. At this time, since the output 58 of the flip-flop 48 is at the 1'' level, the up/down/counter 49 performs up counting.

EOL検出器47はシフトレジスタ43上をシフトされ
るデータを監視し、EOI、符号を検出すると、その出
力69を1”レベルにする。第5図はEOL検出器47
の回路図である。このEOI。
The EOL detector 47 monitors the data shifted on the shift register 43, and when detecting the EOI and code, sets its output 69 to the 1" level. FIG. 5 shows the EOL detector 47.
FIG. This EOI.

検出器47は、シフトレジスタ43の上位12ビツトと
、その次のビットをインバータ6oで反転したもののN
ORをNORゲート61でめる構成である。
The detector 47 outputs N of the upper 12 bits of the shift register 43 and the next bit inverted by the inverter 6o.
The configuration is such that OR is performed using a NOR gate 61.

第4図に戻って説明を続ける。EOL検出器47の出力
59が″1nレベルになると、演算回路50はアップ/
ダウンカウンタ49の出力64に出ているカウント値P
を取り込み、次式の値Qを計算する。
Returning to FIG. 4, the explanation will be continued. When the output 59 of the EOL detector 47 reaches the "1n level," the arithmetic circuit 50 turns up/down.
The count value P appearing at the output 64 of the down counter 49
is taken in, and the value Q of the following equation is calculated.

Q=P+(EOLのビット数)−最小ビット数・・・・
・・(2) そしてQが0以上の場合は、演算回路50は出力62に
パルスを出し、アップ/ダウンカウンタ49をリセット
する。この場合、フリップフロップ48の状態は変らな
いから、シフトレジスタ43にクロックパルスが引き続
き供給され、EOL符号および後続のデータがANDゲ
ート44を介し端子42に引き続き出力される。つまシ
、フィルピットは付加されない。
Q=P+(Number of EOL bits) - Minimum number of bits...
(2) If Q is 0 or more, the arithmetic circuit 50 outputs a pulse to the output 62 and resets the up/down counter 49. In this case, since the state of flip-flop 48 does not change, clock pulses continue to be supplied to shift register 43 and the EOL code and subsequent data continue to be output to terminal 42 via AND gate 44. Bumps and fill pits are not added.

一方、Qが負の場合、演算回路5oはPの値を出力67
に出し、捷だ出力63にパルスを出す。
On the other hand, when Q is negative, the arithmetic circuit 5o outputs the value of P 67
and output a pulse to the output 63.

このパルスによりフリップフロップはセット状態となり
、その出力58は゛0″レベルになる。この為、クロッ
クパルスはANDゲート45によって抑止されシフトレ
ジスタには供給されなくなる。
This pulse sets the flip-flop and its output 58 goes to the ``0'' level.Therefore, the clock pulse is suppressed by the AND gate 45 and is no longer supplied to the shift register.

またANDゲート44の出力は“○″レベルなる。すな
わちフィルピットが端子42に出力されることになる。
Further, the output of the AND gate 44 becomes "○" level. In other words, the fill pit is output to the terminal 42.

アップ/ダウンカウンタ49は、フリップフロップ48
の出力68が“1nレベルから“○”レベルに変化する
時に、演算回路50の出力57の値Qをプリセットされ
、クロックパルスをダウンカウントする。このようにし
てQビット分のフィルピットが送出されアップ/ダウン
カウンタ49のカウント値が○になると、同カウンタは
出力65にパルスを送出する。このパルスによりフリッ
プフロップ48はリセットし、その出力58は再び11
17ルベルとなる。従って、ANDゲート45からシフ
トレジスタ43へ再ヒクロソクパルスが供給され、シフ
トレジスタ43から出力されるデータはANDゲート4
4を通じ端子42に出力されるようになる。演算回路5
oはアップ/ダウンカウンタ49の出力65にパルス3
 − が出ると、初期状態に戻る。
The up/down counter 49 is a flip-flop 48
When the output 68 of the arithmetic circuit 50 changes from the "1n level" to the "○" level, the value Q of the output 57 of the arithmetic circuit 50 is preset and the clock pulse is counted down.In this way, Q bits worth of fill pits are sent out. When the count value of the up/down counter 49 becomes O, it sends a pulse to the output 65. This pulse resets the flip-flop 48, and its output 58 becomes 11 again.
It will be 17 rubles. Therefore, a second pulse is supplied from the AND gate 45 to the shift register 43, and the data output from the shift register 43 is
4 and is output to terminal 42. Arithmetic circuit 5
o is pulse 3 at output 65 of up/down counter 49
When - appears, it returns to the initial state.

以上説明したように、記憶部27からのデータ転送とそ
れに対するフロー制御は、記憶部27および通信制御部
30により他の部分とは独立して実行される。従って、
システム制御部21や帯域圧縮/伸張部26を格別高速
化することなく、通信制御部3oのフロー制御部31や
回線制御部を増設するだけで容器に収容回線数を増加す
ることができ、拡張性が大幅に改善されると伴に、その
拡張に要するコストも減少する。さらにシステム制御部
21や帯域圧縮/伸張部26の負荷が軽くなるため、そ
の動作速度を下げることも可能であシ、これも装置コス
トの引下げに繋がる。
As described above, data transfer from the storage section 27 and flow control therefor are executed by the storage section 27 and the communication control section 30 independently from other parts. Therefore,
The number of lines accommodated in the container can be increased simply by adding the flow control unit 31 and line control unit of the communication control unit 3o without particularly increasing the speed of the system control unit 21 and the band compression/expansion unit 26. This greatly improves performance and reduces the cost of expansion. Furthermore, since the load on the system control section 21 and the band compression/expansion section 26 is reduced, it is possible to lower their operating speeds, which also leads to a reduction in device costs.

発明の効果 上述のように本発明は、通信制御部にフロー制御部を設
け、また記憶部と通信制御部との間にシステムバスとは
独立したデータ転送路を設け、記憶部に予め格納した画
情報の圧縮データを専用のデータ転送路を介し通信制御
部に直接的に転送し、それにフロー制御用フィルピット
を付加して送信14べ、−ジ するものであるから、拡張性に優れ、かつ拡張に要スる
コストが少ないファクシミリ回報装置を実現できるとい
う効果を得られる。
Effects of the Invention As described above, the present invention provides a flow control section in the communication control section, and also provides a data transfer path independent of the system bus between the storage section and the communication control section, and stores data in advance in the storage section. The compressed data of the image information is directly transferred to the communication control unit via a dedicated data transfer path, and fill pits for flow control are added to the data for transmission, so it has excellent expandability. Moreover, it is possible to realize a facsimile distribution device that requires less cost for expansion.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のファクシミリ回報装置のブロック図、第
2図はそのフロー制御の説明図、第3図は本発明の一実
施例によるファクシミリ回報装置のブロック図、第4図
はフロー制御部のブロック図、第5図はEOL検出器の
回路図である。 21・・・・・・システム制御部、 22・・・・・・
システムバス、23・・・・・・原稿読取部、26・・
・・・・帯域圧縮/伸張部、27・・・・・・記憶部、
30・・・・・・通信制御部、31・・・・・・フロー
制御部、32・・・・・・データ転送路、43・・・・
・・シフトレジスタ、47・・・・・・EOL検出器、
48・・・・・・フリップフロップ、49・・・・・・
アップ/ダウンカウンタ、5o・・・・・・演算回路、
51・・・・・・タイミング発生器、52・・・・・・
制御回路。
FIG. 1 is a block diagram of a conventional facsimile routing device, FIG. 2 is an explanatory diagram of its flow control, FIG. 3 is a block diagram of a facsimile routing device according to an embodiment of the present invention, and FIG. 4 is a flow control section diagram. The block diagram, FIG. 5, is a circuit diagram of the EOL detector. 21...System control unit, 22...
System bus, 23... Original reading section, 26...
... Bandwidth compression/expansion section, 27... Storage section,
30... Communication control unit, 31... Flow control unit, 32... Data transfer path, 43...
...Shift register, 47...EOL detector,
48...Flip-flop, 49...
Up/down counter, 5o... Arithmetic circuit,
51...timing generator, 52...
control circuit.

Claims (1)

【特許請求の範囲】 原稿読取部と、帯域圧縮部と、記憶部と、通信制御部と
、システムバスを介し、上記各部と接続されたシステム
制御部とを有し、上記通信制御部に上記記憶部との間の
専用のデータ転送路およびフロー制御部を設け、上記原
稿読取部によって読取られた画情報を上記システムバス
を介して上記システム制御部へ転送し、同システム制御
部より同画情報を上記システムバスを介し上記帯域圧縮
部へ転送して帯域圧縮を施し、それによって得られた圧
縮データを上記システムバスを介し上記システム制御部
へ転送し、同システム制御部より同圧縮データを上記シ
ステムバスを介して記憶部へ転送し格納させ、上記記憶
部に格納された圧縮データを上記データ転送路を介し上
記通信制御部へ転送し、同通信制御部で上記フロー制御
部によって必要なフロー制御用フィルピットを付加し送
信2ペン するようにして成るファクシミリ同報装置。
[Scope of Claims] A document reading section, a band compression section, a storage section, a communication control section, and a system control section connected to each of the above sections via a system bus; A dedicated data transfer path and a flow control unit are provided between the storage unit and the image information read by the document reading unit, and the image information read by the document reading unit is transferred to the system control unit via the system bus, and the image information is transferred from the system control unit to the system control unit. The information is transferred to the band compression unit via the system bus to perform band compression, the compressed data obtained thereby is transferred to the system control unit via the system bus, and the compressed data is received from the system control unit. The compressed data stored in the storage unit is transferred to the storage unit via the system bus and stored therein, and the compressed data stored in the storage unit is transferred to the communication control unit via the data transfer path. A facsimile broadcasting device with a flow control fill pit added and two transmitting pens.
JP58155870A 1983-08-25 1983-08-25 Facsimile multiple address device Pending JPS6047548A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62233973A (en) * 1986-04-02 1987-10-14 Ricoh Co Ltd Communication control equipment

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* Cited by examiner, † Cited by third party
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JPS62233973A (en) * 1986-04-02 1987-10-14 Ricoh Co Ltd Communication control equipment

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