JPS6039910A - Chip type noise elimination filter - Google Patents

Chip type noise elimination filter

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JPS6039910A
JPS6039910A JP14895983A JP14895983A JPS6039910A JP S6039910 A JPS6039910 A JP S6039910A JP 14895983 A JP14895983 A JP 14895983A JP 14895983 A JP14895983 A JP 14895983A JP S6039910 A JPS6039910 A JP S6039910A
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ferrite
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chip
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秀俊 山本
Toshio Hori
堀 俊男
Yasuo Fujiki
藤木 保男
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03HIMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
    • H03H1/00Constructional details of impedance networks whose electrical mode of operation is not specified or applicable to more than one type of network
    • H03H1/0007Constructional details of impedance networks whose electrical mode of operation is not specified or applicable to more than one type of network of radio frequency interference filters

Abstract

PURPOSE:To obtain a chip type noise elimination filter mounted directly on a printed board or the like by allowing a ferrite board to act like an inductance to a conductive path assembled between the flat ferrite boards. CONSTITUTION:Electrodes 14a, 14b of a chip capacitor 14 are soldered respectively to a wide part 13a of a middle part of the conductive path 13 and an earth electrode 17a. The other ferrite board 12 having a concaved part (not shown) to which the capacitor 14 is inserted is bonded to the major plane where the conductive path 13 of the ferrite board 11 and the earth electrode 17a are formed. Through the constitution above, the ferrite boards 11, 12 act like inductances L15 and L16 to a part reaching the wide part 13a from an input terminal 15 of the conductive path 13 and a part reaching an output terminal 16 from the wide part 13a, the L15 and the L16 are connected respectively between the input terminal 15 and the wide part 13a and between the output terminal 16 and the wide part 13a, and the chip type noise elimination filter where the capacitor 14 is connected between the wide part 13a and the earth terminal 17 is obtained.

Description

【発明の詳細な説明】 (技術分野) 本発明はチップ型ノイズ除去フィルタに関し、より詳し
くは、2枚の平板状のフェライト板にインダクタンスの
機能とケースの機能とを持たせてチップ化を図ったチッ
プ型ノイズ除去フィルタに関する。
[Detailed Description of the Invention] (Technical Field) The present invention relates to a chip-type noise removal filter, and more specifically, the present invention relates to a chip-type noise removal filter, and more specifically, it is made into a chip by giving two flat ferrite plates an inductance function and a case function. This invention relates to a chip-type noise removal filter.

(従来技術) 従来より、ノイズ除去フィルタとしては、第1図に示す
ように、中央部に孔を有する円板状のコンデンサ1を間
にして、その両側に円筒状のフェライトビーズ2.3を
同軸に配し、これらコンデンサ1およびフェライトビー
ズ2.3に貫通端子4を貫通させて全体を筒状の金属ケ
ース5の内部に収容し、上記コンデンサ1の外周壁およ
び内周壁に夫々形成された電極1aおよび1bを金属ケ
ース5および貫通端子4に夫々半田付けし、金属ケース
5の内部に樹脂6を充填したものが一般に知られている
(Prior Art) Conventionally, as shown in FIG. 1, a noise removal filter has been constructed using a disk-shaped capacitor 1 having a hole in the center, and cylindrical ferrite beads 2.3 on both sides of the capacitor 1. The capacitor 1 and the ferrite bead 2.3 are arranged coaxially, and the through terminal 4 is passed through the capacitor 1 and the ferrite bead 2.3, and the whole is housed inside a cylindrical metal case 5. It is generally known that electrodes 1a and 1b are soldered to a metal case 5 and a through terminal 4, respectively, and the metal case 5 is filled with resin 6.

上記ノイズフィルタは、(8P;2図に示すように、貫
通端子4の途中にフェライトビーズ2および3によるイ
ンダクタンスL2およびL3を形成するとともに、この
インダクタンスL2とL3との間で、上記貫通端子4を
コンデンサ1を介してアースに接続した等価回路を有し
ているが、第1図のようなノイズフィルタは、貫通型で
あるため、ノイズフィルタをプリント基板に取り付ける
のが困難で形状も犬きく、ノイズフィルタを必要とする
電子(浅器の小形高密度実装か困難であった。
(8P; As shown in Figure 2, inductances L2 and L3 are formed by ferrite beads 2 and 3 in the middle of the through terminal 4, and between these inductances L2 and L3, the through terminal 4 However, since the noise filter shown in Figure 1 is a through type, it is difficult to attach the noise filter to a printed circuit board, and the shape is also awkward. However, it was difficult to implement small, high-density electronics that required a noise filter.

(発明の目的) 本発明は従来のノイズフィルタにおける上記下・1青に
檻みてなされたものであって、その目的は、2枚の平板
状のフェライト板の間に導電路とコンデンサを組み込X
7でフェライト板を導電路に対してインダクタンスとし
て作用させるとともにノイズフィルタのケースとして機
能させることにより、上記導電路およびアース電極をフ
ェライト板の外部に引き出し、プリント基板等に実装可
能で安価なチップ型ノイズ除去フィルタを得ることであ
るー(発明の構成) このため、本発明は、平板状のフェライト板の一つの主
面に金属板からなる導電路が配置され、この導電路の途
中と上記フェライト板に設けられたアース電極との間に
チップ状コンデンサか接続され、フェライト板の上記主
面にいま一つのフェライト板が接合され、上記導電路の
両端およびアース電極が夫々入力端子、出力端子および
アース端子として2枚の上記フェライト板の外部に引き
出きれていることを特徴としている。
(Object of the Invention) The present invention has been made in consideration of the above-mentioned conventional noise filter, and its purpose is to incorporate a conductive path and a capacitor between two flat ferrite plates.
In step 7, by making the ferrite plate act as an inductance for the conductive path and also function as a case for a noise filter, the conductive path and the ground electrode are drawn out of the ferrite plate, resulting in an inexpensive chip type that can be mounted on a printed circuit board, etc. To obtain a noise removal filter (Structure of the invention) For this reason, the present invention provides a conductive path made of a metal plate on one main surface of a flat ferrite plate, and a conductive path made of a metal plate in the middle of the conductive path and the above-mentioned ferrite plate. A chip capacitor is connected between the ground electrode provided on the plate, another ferrite plate is bonded to the main surface of the ferrite plate, and both ends of the conductive path and the ground electrode are connected to the input terminal, the output terminal, and the ground electrode, respectively. It is characterized in that it can be drawn out to the outside of the two ferrite plates as a ground terminal.

(実施例) 以下、添付図面を参照して本発明の詳細な説明する。(Example) Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.

第3図および第4図において、11.12はフェライト
板、1]d!電路、14はチップコンデンサ、15は入
力端子、16は出力端子、17はアース端子であ6゜ 上記フェライト板11.12は互いにほぼ等しい寸法を
有する四角形の平板状のものであって、上記フェライト
板11.12のうち、一方のフェライト板11の一つの
主面には、第5図に示すように、導電路嵌入用四部18
が形成されCいる。
In FIGS. 3 and 4, 11.12 is a ferrite plate, 1]d! 14 is a chip capacitor; 15 is an input terminal; 16 is an output terminal; 17 is a ground terminal; Among the plates 11 and 12, one main surface of one of the ferrite plates 11 is provided with four parts 18 for inserting conductive paths, as shown in FIG.
is formed and C is formed.

この導電路嵌入用凹部18は、その両端部がフェライト
板11の上記主面の一辺に位置し、その上記両端部およ
び中間部分が他の部分よりも「11広に形成されている
Both ends of the conductive path insertion recess 18 are located on one side of the main surface of the ferrite plate 11, and the both ends and the middle part are formed 11 times wider than the other parts.

フェライト板11の上記主面にidまた、導電路嵌入用
凹部18の両端部の間に、アース電極嵌入用凹部19か
形成されている。
On the main surface of the ferrite plate 11, a ground electrode insertion recess 19 is also formed between both ends of the conductive path insertion recess 18.

上記導電路嵌入用凹部18には、導電性の良好な銅等の
金属板を上記導電路嵌入用四部18に見合う形状に打ち
抜いた導電路13が第4図に示すように嵌入坏れ、この
導電路13の両端部の延長部分をなす入力端子15およ
び出力端子16カ(夫々フェライト板11の一つの端面
および他の主面の上に折曲されている。
A conductive path 13, which is made by punching a metal plate made of copper or the like with good conductivity into a shape matching the four conductive path insertion parts 18, is inserted into the recess 18 as shown in FIG. An input terminal 15 and an output terminal 16 forming extensions of both ends of the conductive path 13 are bent onto one end surface and the other main surface of the ferrite plate 11, respectively.

同様に、上記アース電極嵌入用凹部19には、板状のア
ース電極17.aが嵌入され、このアース電極17aの
延長部分をなすアース端子17カダフエライト板11の
一つの上記端面および他の主面の上に折曲されている。
Similarly, the ground electrode insertion recess 19 has a plate-shaped ground electrode 17. a is inserted and bent onto one end surface and the other main surface of the Cadaferrite plate 11, and a ground terminal 17 forming an extension of the ground electrode 17a.

」−記導電路13の中間部の1〕広部13aおよびアー
ス電極17Hには夫々チツプコンデン−す14の?[極
14 aおよび14bが半田付けされている。
A chip capacitor 14 is connected to the wide part 13a of the middle part of the conductive path 13 and the ground electrode 17H, respectively. [Pole 14a and 14b are soldered.

フェライト板11の導電路13およびアース電4% 1
7 Hの形成側の主面には、上記チ゛ンプコンデンサ1
4を嵌入するための凹部(図示せず。)を有するいま一
つのフェライト板12が接着剤等により接合されている
Conductive path 13 of ferrite plate 11 and earth conductor 4% 1
The above-mentioned chip capacitor 1 is mounted on the main surface on the side where 7 H is formed.
Another ferrite plate 12 having a recess (not shown) into which the ferrite plate 4 is inserted is bonded with an adhesive or the like.

上記のようにすれば、第4図からも分るように、導電路
13の入力端子15から巾広部13aに到る部分、およ
び導電路13のこの巾広部13aから出力端子16に到
る部分に対して、フェライト板11.12がインダクタ
ンスl−15およびLi2トして作用し、これらインダ
クタンスL15およびI、16が、第6図に示すように
、入力端子15と」−記l〕広部13aとの間および出
力端子16と上記巾広部13aとの間に夫々接続され、
上記11広部13aとアース端子17との間にチップコ
ンデンサ14が接続されたチップ型ノイズ除去フイルタ
を得ることができる。
If the above is done, as can be seen from FIG. The ferrite plates 11 and 12 act with inductance L15 and Li2 on the input terminal 15 and the input terminal 15, as shown in FIG. connected between the wide part 13a and between the output terminal 16 and the wide part 13a,
A chip-type noise removal filter in which a chip capacitor 14 is connected between the wide portion 13a and the ground terminal 17 can be obtained.

なお、上記実施例において、フェライト板11および1
2に夫々形成されたスリットllaおよび12’aは、
上記インダクタンス1.15フ−よびI、16に寄与す
る磁束ができるだけ大きくなるようにするだめのもので
ある。すなわち、今、フェライト板11および12の内
部で、第7図に示すように、導電路13.13のまわシ
に磁束31.32が走つているものとすると、一方の導
電路13のまわりを走る磁束31のうち、最外側を走る
磁束31aはスリット11a、12aのために、フェラ
イト板11.12の内部に廻り込み、また、他方の導電
路13の1わりを走る磁束32のうち、フェライト板1
1.12の最外側を走る磁束32aも、スリット11a
、12aのために、フェライト板11.12の内部に廻
り込み、これら磁束31a 、32aは上記4電路13
.13の間に達して相互に強め合った後、各々の上記導
電路13.13側に廻シ込むことになる。
In addition, in the above embodiment, the ferrite plates 11 and 1
The slits lla and 12'a formed in 2 are
This is to ensure that the magnetic flux contributing to the inductances 1.15 and 16 is as large as possible. That is, if it is assumed that magnetic flux 31, 32 is running around the conductive paths 13, 13 inside the ferrite plates 11 and 12, as shown in FIG. Among the magnetic fluxes 31 running, the magnetic flux 31a running on the outermost side goes around inside the ferrite plate 11.12 due to the slits 11a and 12a, and of the magnetic flux 32 running on the other conductive path 13, the ferrite Board 1
The magnetic flux 32a running on the outermost side of 1.12 also flows through the slit 11a.
, 12a, these magnetic fluxes 31a, 32a go around inside the ferrite plates 11, 12, and these magnetic fluxes 31a, 32a connect to the four electric circuits 13.
.. After reaching between the conductive paths 13 and 13 and reinforcing each other, the conductive paths 13 and 13 enter the respective conductive paths 13 and 13.

磁束31.32の向きが上記とは逆となった場合も、上
記と同様の関係を得ることができる。
Even when the directions of the magnetic fluxes 31 and 32 are opposite to the above, the same relationship as above can be obtained.

従って、1′滋東31aおよび32aは他の磁束32お
よび31との干渉により弱められることはなく、導電路
13.13に作用してインダクタンスが大きくなる。
Therefore, the 1'-fields 31a and 32a are not weakened by interference with other magnetic fluxes 32 and 31, and act on the conductive path 13.13, increasing the inductance.

寸だ、上記実施例において、入力端子15.出力端子1
6およびアース端子17は、第8図に示すように、フェ
ライト板11の一端面にのみ引き出されていてもよい。
In the above embodiment, the input terminal 15. Output terminal 1
6 and the ground terminal 17 may be drawn out only to one end surface of the ferrite plate 11, as shown in FIG.

次に、本発明の他の実施例を第9図、第10図、第11
図および第12図に示す。
Next, other embodiments of the present invention are shown in FIGS. 9, 10, and 11.
and FIG. 12.

第9図に示すノイズ除去フィルタは、第3図および第4
図に示すノイズ除去フィルタにおいて、入力端子15お
よび出力端子16を夫々フェライト板11のアース端子
17の引出端面とは異なる2つの相対向する端面に引き
出してなるものである。
The noise removal filter shown in FIG. 9 is similar to that shown in FIGS.
In the noise removal filter shown in the figure, the input terminal 15 and the output terminal 16 are respectively drawn out to two opposite end faces different from the lead-out end face of the ground terminal 17 of the ferrite plate 11.

また、第10図に示すノイズ除去フィルタは、フェライ
ト板11.12のうち、フェライト板12にチップコン
デンサ14を収容する孔12bを設け、フェライト板1
2と7エライト板11との間に位置する導電路13とチ
ップコンデンサ14の電極14bとを半田付けする一方
、アース?[極17aとチップコンデンサ14の電極1
4 aとを半田付けしてなるものである。
In addition, the noise removal filter shown in FIG.
While soldering the conductive path 13 located between the 2nd and 7th elite plates 11 and the electrode 14b of the chip capacitor 14, the earth? [Pole 17a and electrode 1 of chip capacitor 14]
4a and soldered together.

以上、第9図および第10図において説明したノイズ除
去フィルタは、いずれも、第6図に示す等価回路を有す
る。
The noise removal filters described above in FIGS. 9 and 10 each have an equivalent circuit shown in FIG. 6.

一方、第11図に示すノイズ除去フィルタは、第3図お
よび第4図において説明したノイズ除去フィルタにおい
て、導電路13の各端部とアース電極17aとの間にチ
ップコンデンサ24aおよび24bを夫々接続したもの
であって、第13図に示すように、入力端子15と出力
端子16との間に導電路13に対してフェライト板11
および12によ如作用するインダクタンスL13が接続
され、入力端子15とアース端子17との間および出力
端子16とアース端子17との間に夫々チップコンデン
サ24aおよび24bが接続された等価回路を有する。
On the other hand, the noise removal filter shown in FIG. 11 is the noise removal filter explained in FIGS. 3 and 4, in which chip capacitors 24a and 24b are connected between each end of the conductive path 13 and the ground electrode 17a. As shown in FIG.
and 12 are connected, and chip capacitors 24a and 24b are connected between input terminal 15 and ground terminal 17 and between output terminal 16 and ground terminal 17, respectively.

また、第12図に示すノイズ除去フィルタは、第11図
のノイズ除去フィルタのチップコンデンサ24a 、2
4bのうち、チップコンデンサ24aを除去したもので
あって、第14図に示すように、−@12図の等価回路
においてチップコンデンサ24aを除去した等価回路を
有している。
Further, the noise removal filter shown in FIG. 12 is different from the chip capacitors 24a and 2 of the noise removal filter in FIG.
4b, the chip capacitor 24a is removed, and as shown in FIG. 14, it has an equivalent circuit in which the chip capacitor 24a is removed from the equivalent circuit of FIG.

なお本発明の上記各実施例は、いずれも本発明に対する
限定的なものではないことを付言しておく。特に各実施
例で示された導電路や端子は、板状でなく膜状であって
もよくそれらの形状も任意である。またチップコンデン
サの形状やその接続方法なども任意である。
It should be noted that the above-mentioned embodiments of the present invention are not intended to limit the present invention. In particular, the conductive paths and terminals shown in each embodiment may be in the form of a film rather than a plate, and their shapes may be arbitrary. Furthermore, the shape of the chip capacitor and its connection method are also arbitrary.

(発明の効果) 以上、詳述したことからも明らかなように、本発明は、
平板状のフェライト板の間に組み込んだ導電路に対して
フェライト板をインダクタンスとして作用させるととも
にノイズ除去フィルタのケースとして機能させるように
しだから、従来のノイズ除去フィルタのような金属ケー
スが不要となり13部品点数が少く、樹脂充填等の工程
も必要のない安価なプリント基板等に直接実装すること
のできるチップ型ノイズ除去フィルタを得ることができ
る。
(Effects of the Invention) As is clear from the detailed description above, the present invention has the following effects:
The ferrite plate acts as an inductance for the conductive path built between the flat ferrite plates, and also functions as a case for the noise removal filter, eliminating the need for a metal case like in conventional noise removal filters, reducing the number of parts to 13. It is possible to obtain a chip-type noise removal filter that can be directly mounted on an inexpensive printed circuit board or the like, and does not require processes such as resin filling.

【図面の簡単な説明】[Brief explanation of the drawing]

范1図は従来のノイズ除去フィルタの11断面図、第2
図は第1図のノイズ除去フィルタの等価回路図、@3図
は本発明に係るノイズ除去フィルタの一実施例の斜視図
、第4図は第3図のノイズ除去フィルタの分解斜視図、
第5図は第3図のノイズ除去フィルタの導電路形成側の
フェライト板の斜視図、第6図は第3図のノイズ除去フ
ィルタの等価回路図、第7図はフェライト板の動作機能
の説明図、第8図、第9図および第10図は夫々第3図
のノイズ除去フィルタの変形例の斜視図、第11図およ
び第12図は夫々本発明に係るチップ型ノイズ除去フィ
ルタの他の実施例の斜視図、第13図および@14図は
夫々@11図および第12図のチップ型ノイズ除去フィ
ルタの等価回路図である。 11.12・・フェライト板、13・・・導電路、14
・・・チップコンデンサ、14a、14b・・・電Th
、15・・・入力端子、16・・・出力端子、17・・
・アース端子、17a・・アース電極。 特許出願人 株式会社村田製作所 代−理 人 ブr理士 青 山 葆 ほか2名第1図 第2図 70
Figure 1 is a 11 cross-sectional view of a conventional noise removal filter;
The figure is an equivalent circuit diagram of the noise removal filter shown in FIG. 1, @3 is a perspective view of an embodiment of the noise removal filter according to the present invention, and FIG.
Figure 5 is a perspective view of the ferrite plate on the conductive path formation side of the noise removal filter in Figure 3, Figure 6 is an equivalent circuit diagram of the noise removal filter in Figure 3, and Figure 7 is an explanation of the operating functions of the ferrite plate. 8, 9 and 10 are respectively perspective views of modified examples of the noise removal filter shown in FIG. The perspective view of the embodiment, FIGS. 13 and 14, are equivalent circuit diagrams of the chip type noise removal filters shown in FIGS. 11 and 12, respectively. 11.12... Ferrite plate, 13... Conductive path, 14
...Chip capacitor, 14a, 14b...Electric Th
, 15...input terminal, 16...output terminal, 17...
・Earth terminal, 17a...Earth electrode. Patent Applicant Murata Manufacturing Co., Ltd. representative, Physician Aoyama Aoyama and 2 others Figure 1 Figure 2 Figure 70

Claims (1)

【特許請求の範囲】[Claims] (1)平板状のフェライト板の一つの主面に金属板から
なる4電路が配置され、この導電路の途中と上記フェラ
イト板に設けられたアース電極との間にチップ状コンデ
ンサが接続され、7エライト板の上記主面にいま一つの
フェライト板が接合され、上記導電路の両端およびアー
ス電極が夫々入力端子、出力端子およびアース端子とし
て2枚の上記フェライト板の外部に引き出されているこ
とを特徴とするチップ型ノイズ除去フィルタ。
(1) Four electrical paths made of a metal plate are arranged on one main surface of a flat ferrite plate, and a chip-shaped capacitor is connected between the conductive path and a ground electrode provided on the ferrite plate, Another ferrite plate is joined to the main surface of the 7-elite plate, and both ends of the conductive path and the ground electrode are drawn out to the outside of the two ferrite plates as an input terminal, an output terminal, and a ground terminal, respectively. A chip-type noise removal filter featuring:
JP14895983A 1983-08-15 1983-08-15 Chip type noise elimination filter Granted JPS6039910A (en)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6219816U (en) * 1985-07-19 1987-02-05
JPS6437128U (en) * 1987-08-28 1989-03-06
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