JPS603965U - デジタル信号の圧縮記録／再生回路 - Google Patents

デジタル信号の圧縮記録／再生回路

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JPS603965U
JPS603965U JP9490983U JP9490983U JPS603965U JP S603965 U JPS603965 U JP S603965U JP 9490983 U JP9490983 U JP 9490983U JP 9490983 U JP9490983 U JP 9490983U JP S603965 U JPS603965 U JP S603965U
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JP
Japan
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circuit
memory
digital signal
signal compression
compression recording
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Pending
Application number
JP9490983U
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English (en)
Inventor
道本　昭蔵
西元　幸一
Original Assignee
株式会社日立製作所
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Publication date
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  • Television Signal Processing For Recording (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、時系列的デジタル信号と基準クロック信号の
関係を示す説明図、第２図は本考案の一実施例のデータ
圧縮記録／再生の回路図、第３図は本考案の他の実施例
の回路図、第４図は本考案のさらに他の実施例の回路図
である。 １０１・・・トランジェント検出回路、１０３・・・基
準クロック発生回路、１０４・・・クロック計数回路、
１０５・・・メモリ回路、１０６・・・データカウンタ
、１０７・・・メモリ制御回路、１０８・・・出力フリ
ップフロップ回路、１０９・・・切換回路、１１０・・
・制御回路、１１１・・・遅延回路、１１２・・・遅延
回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 輪環回路の膨大な時系列信号を圧縮して記録し、また。 元の状態に再生して出力するための、基準クロック発生
    回路と、クロック計数回路と、メモリ制御回路と、メモ
    リ回路と、トランジェント検出回路と、メモリアドレス
    計数回路と、データカウンタと、出力フリップフロップ
    回路と、制御回路とよりなる回路において、 時系列信号のトランジェント間隔を基準クロックの計数
    値で表わし、メモリへ書き込み、また、読出して元の状
    態の時系列信号に再生する手段を設けたことを特徴とす
    るデジタル信号の圧縮記録／再生回路。
JP9490983U 1983-06-22 1983-06-22 デジタル信号の圧縮記録／再生回路 Pending JPS603965U (ja)

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JPS603965U true JPS603965U (ja) 1985-01-12

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