JPS6022484A - Speed controller for motor - Google Patents
Speed controller for motorInfo
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- JPS6022484A JPS6022484A JP58131686A JP13168683A JPS6022484A JP S6022484 A JPS6022484 A JP S6022484A JP 58131686 A JP58131686 A JP 58131686A JP 13168683 A JP13168683 A JP 13168683A JP S6022484 A JPS6022484 A JP S6022484A
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P23/00—Arrangements or methods for the control of AC motors characterised by a control method other than vector control
- H02P23/16—Controlling the angular speed of one shaft
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Electric Motors In General (AREA)
Abstract
Description
【発明の詳細な説明】
本発明はモータの速度制御装置に関するもので、特に経
時的に変化する速度設定値にモータ速度を追従せしめる
速度制御装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a motor speed control device, and more particularly to a speed control device that causes the motor speed to follow a speed setting value that changes over time.
ところで車両のスピードメータ等においては従来車軸と
メータ指針間にメータケーブルを布設し、上記ケーブル
はその一端を車軸に連結してこれと一体回転せしめると
ともに他端は渦電流継手を介してメータ指針に連結して
車軸の回転速度すなわち車両の走行速度に応じて上記指
針を作動せしめる構造としてある。このような構造では
メータケーブルの配設スペースを確保する必要がある上
に、ケーブル自体の疲労も問題であった。Conventionally, in vehicle speedometers, etc., a meter cable is laid between the axle and the meter pointer, and one end of the cable is connected to the axle so that it rotates integrally with the axle, and the other end is connected to the meter pointer via an eddy current joint. The pointers are connected to each other and are configured to operate in accordance with the rotational speed of the axle, that is, the traveling speed of the vehicle. In such a structure, it is necessary to secure a space for installing the meter cable, and fatigue of the cable itself is also a problem.
そこで、上記車軸の如き経時的に回転速度が変化する回
転体にモータの回転速度を精度良く追従せしめることが
できれば、速度表示用指針を渦電流継手を介して上記モ
ータに連結する構造とすることにより回転速度指示計は
よりコンパクトかつ信頼性の高いものになる。Therefore, if the rotational speed of the motor can be made to accurately follow a rotating body whose rotational speed changes over time, such as the axle, the speed display pointer should be connected to the motor via an eddy current joint. This makes the rotational speed indicator more compact and reliable.
また、上記回転速度指示計に限らず、経時的に変化する
速度設定値にモータの回転速度を精度良く追従せしめる
要請はあらゆる産業分野において大きい。Furthermore, there is a great need not only for the above-mentioned rotational speed indicator but also for all industrial fields to enable the rotational speed of a motor to accurately follow a speed setting value that changes over time.
本発明はこのような要請に鑑み、経時的に変化する速庶
設定値にきわめて精度良くモータ速度を追従せしめるこ
とが可能なモータ速度制御装置を提供することを目的と
するものである。SUMMARY OF THE INVENTION In view of these demands, it is an object of the present invention to provide a motor speed control device that allows the motor speed to extremely accurately follow a speed rise setting value that changes over time.
すなわち、本発明のモータ速度制御装置は経時的に変化
する速度設定値を発生する設定速度発生手段と、モータ
の回転速度を検出するモータ速度検出手段と、上記説定
速度とモータ速度の差を算出する速度差演算手段と、上
記モータ速度の変化量を算出するモータ加速度演算手段
と、上記速度差とモータ加速疫の荷重平均より補正量信
号を算出するとともに、該補正量信号よりモータ制御量
信号を算出して、モータの回転速度を上記設定速度に一
致せしめるべく上記制御量信号をモータに出力するモー
タ制御手段ととを具備している。That is, the motor speed control device of the present invention includes a set speed generating means for generating a speed setting value that changes over time, a motor speed detecting means for detecting the rotational speed of the motor, and a motor speed detecting means for detecting the difference between the prescribed speed and the motor speed. A speed difference calculation means for calculating, a motor acceleration calculation means for calculating the amount of change in the motor speed, a correction amount signal is calculated from the weighted average of the speed difference and the motor acceleration rate, and a motor control amount is calculated from the correction amount signal. and motor control means for calculating the signal and outputting the control amount signal to the motor in order to make the rotational speed of the motor match the set speed.
以下、図示の実施例により本発明の構成および作動を合
せて説明する。Hereinafter, the configuration and operation of the present invention will be explained with reference to illustrated embodiments.
第1図は本発明を使用した回転速度指示針の全体構成を
示すもので、図中1は設定速度発生手段たる回転速度検
出センサであり、図示しない車両の車軸等の回転体に連
結された回転軸11には周方向の4ケ所に等間隔に磁極
を形成した永久磁石12が一体的に設けてある。回転軸
11の近傍にはリードスイッチ13が配してあり、永久
磁石12の磁極の通過毎に接点が閉じて回転軸11の回
転速度に応じたパルス信号PSを発する。Fig. 1 shows the overall configuration of a rotational speed indicator using the present invention. In the figure, 1 is a rotational speed detection sensor which is a set speed generating means, and is connected to a rotating body such as an axle of a vehicle (not shown). Permanent magnets 12 having magnetic poles formed at equal intervals at four locations in the circumferential direction are integrally provided on the rotating shaft 11. A reed switch 13 is disposed near the rotating shaft 11, and a contact closes each time the magnetic pole of the permanent magnet 12 passes, generating a pulse signal PS corresponding to the rotational speed of the rotating shaft 11.
2は速度表示部である。速度表示部2には速度表示板2
1に沿って回動可能に表示用指針22が設けてあり、表
示用指針22の回転軸の端部は円板状に形成して導電板
24aとしてある。導電板24には同じく円板状の永久
磁石24bが対向せしめてあり、磁石24bと上記導電
板24bにより渦電流継手24を構成している。上記磁
石24bはホルダ25に保持され、ジョイント26を介
して回転駆動用の直流モータ3に連結してある。2 is a speed display section. The speed display section 2 has a speed display board 2
A display pointer 22 is provided so as to be rotatable along 1, and the end of the rotating shaft of the display pointer 22 is formed into a disk shape and serves as a conductive plate 24a. A disk-shaped permanent magnet 24b is also opposed to the conductive plate 24, and the magnet 24b and the conductive plate 24b constitute an eddy current joint 24. The magnet 24b is held by a holder 25 and connected via a joint 26 to a DC motor 3 for rotational driving.
磁石24bには周方向の4ケ所に等間隔に磁極が形成し
てあり、磁石24の回転に伴なって導電板24aには渦
電流を生じ、回転力が伝達される。The magnet 24b has magnetic poles formed at equal intervals at four locations in the circumferential direction, and as the magnet 24 rotates, an eddy current is generated in the conductive plate 24a, and rotational force is transmitted.
一方、上記表示用指針22の回転軸には指針22を戻り
方向に付勢するバネ23が設けてあり、指針22は駆動
用モータ3の回転速度に比例して伝達される回転力と上
記バネ23のばね力がつりあう角度位置まで回動して速
度を表示する。したがって、上記駆動用モータ3の速度
を設定速度たる上記センサ1の回転軸11の速度に常に
一致するように制御すれば、回転体の正確な速度表示が
可能である、。On the other hand, a spring 23 for biasing the pointer 22 in the return direction is provided on the rotation axis of the display pointer 22, and the pointer 22 receives the rotational force transmitted in proportion to the rotational speed of the drive motor 3 and the spring 23. It rotates to the angular position where the spring forces of 23 are balanced and the speed is displayed. Therefore, if the speed of the drive motor 3 is controlled to always match the set speed of the rotating shaft 11 of the sensor 1, accurate speed display of the rotating body is possible.
そこで、速度表示部2には上記永久磁石24bに近接し
てリードスイッチ27が設けてある。リードスイッチ2
7は磁石24bの通過毎に接点が閉じて駆動用モータ3
の回転速度に応じたパルス信号PMを発する。Therefore, a reed switch 27 is provided in the speed display section 2 in proximity to the permanent magnet 24b. reed switch 2
7 is a drive motor 3 whose contacts close each time the magnet 24b passes.
A pulse signal PM is generated according to the rotation speed of the motor.
そして、前述の回転軸速度パルス信号PSおよび上記モ
ータ速度パルス信号PMはともに制御回路4に入力され
、制御回路4は両パルス信号PS、PMを一致せしめる
べく、すなわち回転軸11の回転速度と駆動用モータ3
の回転速度を一致せしめるべくモータ駆動信号Tnを出
力する。The above-mentioned rotating shaft speed pulse signal PS and the above-mentioned motor speed pulse signal PM are both input to the control circuit 4, and the control circuit 4 adjusts the rotational speed of the rotating shaft 11 and the driving speed in order to make both pulse signals PS and PM coincide. motor 3
A motor drive signal Tn is output to match the rotational speeds of the two motors.
上記制御回路4は波形整形回路401A、401B、2
てい倍回路402A、402B、速度差検出回路403
、モータ加速度検出回路404、補正量演算回路405
、制御量演算回路406、正オフセット発生回路407
、負オフセット発生回路408、モータ駆動回路409
および上記各回路の作動を制御するタイミングパルス発
生回路410よりなる。The control circuit 4 includes waveform shaping circuits 401A, 401B, 2
Multiplier circuits 402A, 402B, speed difference detection circuit 403
, motor acceleration detection circuit 404, correction amount calculation circuit 405
, control amount calculation circuit 406, positive offset generation circuit 407
, negative offset generation circuit 408, motor drive circuit 409
and a timing pulse generation circuit 410 that controls the operation of each of the above circuits.
速度パルス信号PS、PMはそれぞれ波形整形回路40
1A、401bで波形整形された後(信号fS、fM)
、演算精度を向上せしめるために2てい倍回路402A
、402Bにて2倍の周波数を有する2てい倍信号2f
S、2fMに変換される。速度差検出回路403は上記
信号2fS、2fMの差をとり、速度差信号ΔVを発す
る。モータ加速度検出回路404は相続いて入力する信
号2fMの差をとって加速度信号αを発する。The speed pulse signals PS and PM are each provided by a waveform shaping circuit 40.
After waveform shaping with 1A and 401b (signals fS, fM)
, a doubling circuit 402A to improve calculation accuracy.
, 2x signal 2f having twice the frequency at 402B
S, 2fM. A speed difference detection circuit 403 takes the difference between the signals 2fS and 2fM and generates a speed difference signal ΔV. The motor acceleration detection circuit 404 calculates the difference between the successively input signals 2fM and generates an acceleration signal α.
補正量演算回路405では後述するように上記速度差信
号ΔVと加速度信号αより補正量11を算出し、出力す
る。制御量演算回路406は上記補正量信号11に基づ
いて制御量信号TCを発し、モータ駆動回路409では
上記制御量信号TCに各オフセット回路407、408
からのオフセット信号T+0、T−0を加えてモータ駆
動信号Tnを出力する。The correction amount calculation circuit 405 calculates a correction amount 11 from the speed difference signal ΔV and the acceleration signal α and outputs it, as will be described later. The control amount calculation circuit 406 generates a control amount signal TC based on the correction amount signal 11, and the motor drive circuit 409 applies each offset circuit 407, 408 to the control amount signal TC.
The motor drive signal Tn is output by adding offset signals T+0 and T-0 from the motor drive signal Tn.
以下、■記各回路の構成と作動を説明する。The configuration and operation of each circuit described in (1) will be explained below.
第2図には波形整形回路401Aおよび2てい倍回路4
02Aを示す。波形整形回路401Aはトランジスタに
よるスイッチング回路401aとシュミットトリガ機能
を有するNANDゲート401b(例えばRCA社製C
D4093)よりなる。図中VBは電源である。2てい
倍回路402Aは単安定マルチバイブレータ402a、
402b(例えばRCA社製CD4047)を有し、整
形回路401Aより入力した信号fSの立上りないし立
下りに同期したパルス信号a、bを発生してこれらをN
ORゲート402cに入力することにより2てい倍信号
2fSを得る。ここで、第3図(1)、(2)、(3)
、(4)に上記各信号fS、a、b、2fSの波形を示
す。FIG. 2 shows a waveform shaping circuit 401A and a doubling circuit 401A.
02A is shown. The waveform shaping circuit 401A includes a switching circuit 401a using a transistor and a NAND gate 401b having a Schmitt trigger function (for example, C
D4093). In the figure, VB is a power supply. The double multiplier circuit 402A is a monostable multivibrator 402a,
402b (for example, CD4047 made by RCA), generates pulse signals a and b synchronized with the rise or fall of the signal fS input from the shaping circuit 401A, and converts these into N
A doubled signal 2fS is obtained by inputting it to the OR gate 402c. Here, Fig. 3 (1), (2), (3)
, (4) show the waveforms of the above-mentioned signals fS, a, b, and 2fS.
なお波形成形回路401Bおよび2てい倍回路402B
も上記各回路401A、402Aと同一構成である。Note that the waveform shaping circuit 401B and the doubling circuit 402B
Also has the same configuration as each of the circuits 401A and 402A described above.
第4図には速度差検出回路403を示す。図中403a
、403bはD型フリップフロップ(例えばRCA社製
CD4013)、403c、403dは同期微分器(例
えばRCA社製CD4520)、403e、403f、
403gはプリセッタブルアップダウンカウンタ(例え
ばテキサスインスツルメンツ社製SN74LS193)
で、互いにカスケードに接続して9ビットのアップダウ
ンカウンタとしてある。403h、403i、403j
はデータラッチである。FIG. 4 shows a speed difference detection circuit 403. 403a in the diagram
, 403b is a D-type flip-flop (for example, CD4013 manufactured by RCA), 403c, 403d are synchronous differentiators (for example, CD4520 manufactured by RCA), 403e, 403f,
403g is a presettable up/down counter (for example, Texas Instruments SN74LS193)
They are connected to each other in cascade to form a 9-bit up/down counter. 403h, 403i, 403j
is a data latch.
2てい倍信号2fS、2fM(第5図(1)、(2)参
照)はカウント周期を決定するタイミングパルスSC(
第5図(3)参照)が「1」レベルを保っている間、そ
れぞれゲート403k、403lを経てフリップフロッ
プ403a、403bのD端子に入力される。上記信号
2fS、2fMはタイミングパルスS1(第5図(4)
参照)の立上リあるいは立下りのタイミングでそれぞれ
信号c、d(第5図(5)、(6)参照)としてフリッ
プフロップ403a、403bのQ端子に現われる。The 2 multiplier signals 2fS and 2fM (see Fig. 5 (1) and (2)) are the timing pulse SC (
While the signals (see FIG. 5(3)) maintain the "1" level, they are input to the D terminals of flip-flops 403a and 403b via gates 403k and 403l, respectively. The above signals 2fS and 2fM are the timing pulse S1 (Fig. 5 (4)
They appear at the Q terminals of flip-flops 403a and 403b as signals c and d (see (5) and (6) in FIG. 5), respectively, at the rising or falling timing of the signal (see FIG. 5).
微分器403c、403bは上記信号c、dが「1」レ
ベルに立上がった時に、タイミングパルスS2(第5図
(7)参照)のタイミングでパルス信号c、f(第5図
(8)、(9)参照)を出力する。上記バルス信号c、
fはそれぞれアップダウンカウンタ403e〜403g
のUP端子、DW端子に入力され、ここで両パルス信号
e、fのパルス数の差が算出される。すなわち、上記カ
ウンタ403e〜403gはカウント開始前にタイミン
グパルスCL3′(第12図(10)参照)により最上
位ビット(カウンタ403gのAi端子)を除いて0に
設定される。そして、タイミングパルスSCが「1」レ
ベルとなっている所定のカウント周期中に入力するパル
ス信号e、fをアップカウントあるいはダウンカウント
し、8ビットのパルス差信号として出力する。Differentiators 403c and 403b output pulse signals c and f (FIG. 5 (8), (9)) is output. The above pulse signal c,
f are up/down counters 403e to 403g, respectively.
The signal is input to the UP and DW terminals of the pulse signals e and f, and the difference in the number of pulses between the two pulse signals e and f is calculated here. That is, the counters 403e to 403g are set to 0 except for the most significant bit (Ai terminal of the counter 403g) by the timing pulse CL3' (see (10) in FIG. 12) before the start of counting. Then, the pulse signals e and f inputted during a predetermined count period when the timing pulse SC is at the "1" level are up-counted or down-counted and outputted as an 8-bit pulse difference signal.
上記パルス差信号はタイミングパルスCL2(第12図
(6)参照)のタイミングでデータラッチ403h、4
03iに記憶される。なお、パルス信号fのパルス数が
パルス信号eのそれよりも多い場合にはカウンタ403
gのAO端子出力が「0」レベルとなり、上記パルス差
信号は排他的論理和(EOR)ゲート403mで全て反
転せしめられるとともにデータラッチ403jのD1端
子には「1」レベル信号が入力される。The pulse difference signal is applied to the data latches 403h and 4 at the timing of the timing pulse CL2 (see FIG. 12 (6)).
03i. Note that if the number of pulses of the pulse signal f is greater than that of the pulse signal e, the counter 403
The output of the AO terminal of the data latch 403j becomes the "0" level, the pulse difference signal is completely inverted by the exclusive OR (EOR) gate 403m, and the "1" level signal is input to the D1 terminal of the data latch 403j.
上記の如き手順で、データラッチ403h〜403jか
らは1ビットの正負信号vpと8ビットの絶対値データ
信号vdよりなる速度差信号ΔVが出力される。そして
、上記正負信号vpは信号2fS>2fMのとき、すな
わち速度差信号ΔV>0の時に「0」レベルとなる。Through the above procedure, the data latches 403h to 403j output a speed difference signal ΔV consisting of a 1-bit positive/negative signal vp and an 8-bit absolute value data signal vd. The positive/negative signal vp becomes the "0" level when the signal 2fS>2fM, that is, when the speed difference signal ΔV>0.
第6図にはモータ加速度検出回路404を示す。FIG. 6 shows the motor acceleration detection circuit 404.
図中404a、404b、404c、404d、404
e、404fはプリセッタブルアップダウンカウンタ(
例えばRCA社製CD4029)で、カウンタ404a
〜404cおよびカウンタ404d〜404fはカスケ
ードに接続してそれぞれ12ビットのアップカウンタお
よび同じく12ビットのアップダウンカウンタとしてあ
る。404g、404h、404iはデータラッチ、4
04j、404kはD型フリップフロップである。404a, 404b, 404c, 404d, 404 in the figure
e, 404f are presettable up/down counters (
For example, with the RCA CD4029), the counter 404a
404c and counters 404d to 404f are connected in cascade to form a 12-bit up counter and a 12-bit up/down counter, respectively. 404g, 404h, 404i are data latches, 4
04j and 404k are D-type flip-flops.
タイミングパルスSCが「1」レベルとなる所定のカウ
ント周期中に検出回路404に入力する2てい倍信号2
fMはカウンタ404a〜404cにてカウントされる
一方、カウンタ404d404fにも入力され、ここで
直前のカウント周期中に上記カウンタ404a〜404
cでカウントされた2てい倍信号2fMとの差が算出さ
れる。2 multiplier signal 2 input to the detection circuit 404 during a predetermined count period when the timing pulse SC is at the "1" level.
While fM is counted by the counters 404a to 404c, it is also input to the counters 404d404f, where the counters 404a to 404 are counted during the immediately preceding counting period.
The difference from the doubled signal 2fM counted at c is calculated.
すなわち、カウント開始前に、直前のカウント周期中に
カウンタ404a〜404cでカウントされた2てい倍
信号2fMのカウント値がタイミングパルスCL3(第
12図(7)参照)のタイミングでカウンタ404d〜
404fにプリセットされ、今回のカウント周期中にC
p端子に入力する2てい倍信号2fMによって上記プリ
セット値がカウントダウンされる。That is, before the count starts, the count value of the doubling signal 2fM counted by the counters 404a to 404c during the immediately preceding count period is transferred to the counters 404d to 404d at the timing of the timing pulse CL3 (see (7) in FIG. 12).
404f, and C is preset during the current count cycle.
The preset value is counted down by the doubling signal 2fM input to the p terminal.
ところで、上記カウンタ404d〜404fは最初ダウ
ンカウンタとして機能するが、カウント周期中の2てい
倍信号2rMの入力パルス数がプリセット値より大きく
なるとカウンタ404fのCO端子出力が「0」rレベ
ルとなり、これに続く2てい倍信号2fMのパルスタイ
ミングでフリップフロップ404jのQ端子出力が反転
して「1」レベルとなって、これ以後カウンタ404d
〜404fはアップカウンタとして残余の入力パルスを
カウントする。このようにして、カウンタ404d〜4
04fからは直前のカウント周期中の2てい倍信号2f
Mと今回のカウント周期中のそれとのパルス差が出力さ
れ、このパルス差はタイミングパルスCL2のタイミン
グでデータラッチ404g〜404iに記憶されるとと
もに8ビットの絶対値データαdとしてて出力される。Incidentally, the counters 404d to 404f initially function as down counters, but when the number of input pulses of the doubling signal 2rM during the count period becomes larger than the preset value, the CO terminal output of the counter 404f becomes the "0" r level, and this At the pulse timing of the doubling signal 2fM that follows, the Q terminal output of the flip-flop 404j is inverted and becomes the "1" level.
~404f counts the remaining input pulses as an up counter. In this way, the counters 404d to 4
From 04f onwards, the double signal 2f during the previous count period
The pulse difference between M and that during the current count period is output, and this pulse difference is stored in the data latches 404g to 404i at the timing of the timing pulse CL2 and is output as 8-bit absolute value data αd.
一方、フリップフロップ404kはタイミングパルスC
L3のタイミングでD端子入力をQ端子、Q端子に出力
する。すなわち、カウンタ404d〜404fで算出さ
れる上記パルス差が正の場合、すなわちモータ加速度が
負の場合にはQ端子出力たる信号α−は「0」レベルと
なり、Q端子出力たる信号α+1は「1」レベルとなる
。反対に上記パルス差が負の場合、すなわちモータ加速
度が正の場合には信号α−は「1」レベル、信号α+は
「0」レベルとなる。On the other hand, the flip-flop 404k has a timing pulse C
The D terminal input is output to the Q terminal and the Q terminal at the timing of L3. That is, when the pulse difference calculated by the counters 404d to 404f is positive, that is, when the motor acceleration is negative, the signal α-, which is the Q terminal output, is at the "0" level, and the signal α+1, which is the Q terminal output, is at the "1" level. ” level. Conversely, when the pulse difference is negative, that is, when the motor acceleration is positive, the signal α- is at the "1" level and the signal α+ is at the "0" level.
なお、カウント開始前にカウンタ404a〜404cに
はタイミングパルスCL5(第12図(9)参照)のタ
イミングで0がプリセットされる。また、フリップフロ
ップ404jはタイミグパルスCL4(第12図(8)
参照)でリセットされる。Note that, before the count starts, the counters 404a to 404c are preset to 0 at the timing of the timing pulse CL5 (see FIG. 12 (9)). In addition, the flip-flop 404j receives a timing pulse CL4 (FIG. 12 (8)
(see).
上記の如き手順で、モータ加速度検出回路404からは
2ビットの正負信号α+、α−と8ビットの絶対値デー
タαdよりなる加速度信号αが出力される。この場合、
上述の如く加速度信号α>0で信号α+が「0」レベル
となり、加速度信号α<0で信号α+が「1」レベルと
なる。Through the above procedure, the motor acceleration detection circuit 404 outputs an acceleration signal α consisting of 2-bit positive/negative signals α+, α- and 8-bit absolute value data αd. in this case,
As described above, when the acceleration signal α>0, the signal α+ becomes the “0” level, and when the acceleration signal α<0, the signal α+ becomes the “1” level.
第7図には補正量演算回路405を示ず。図中405a
、405bはプリセッタブルダウンカウンタ(例えばR
CA社製CD40103)である。The correction amount calculation circuit 405 is not shown in FIG. 405a in the figure
, 405b are presettable down counters (for example, R
CD40103) manufactured by CA Corporation.
上記カウンタ405a、405bにはタイミングパルス
CL5のタイミングでそれぞれ加速度の絶対値データα
dおよび速度差の絶対値データvdがプリセツトされる
。各カウンタ405a、405bのC0端子出力は上記
プリセット時に「1」レベルとなり、プリセット値がC
K端子より入力するパルスでカウントダウンされて0に
なると「0」レベルとなる。また、カウント動作はCi
端子が「0」レベルの時のみ行なわれる。The counters 405a and 405b each have acceleration absolute value data α at the timing of the timing pulse CL5.
d and absolute value data vd of the speed difference are preset. The C0 terminal output of each counter 405a, 405b becomes "1" level during the above presetting, and the preset value is C0.
When it is counted down by the pulse input from the K terminal and reaches 0, it becomes the "0" level. Also, the counting operation is Ci
This is performed only when the terminal is at the "0" level.
したがって、カウンタ405aにプリセットされた絶対
値データαdはクロックパルスSα(第12図(1)参
照)でカウントダウンされ、カウンタ405aのCO端
子からは上記データαdとクロックパルスSαで決まる
パルス長を有するパルス信号gが出力される。また、カ
ウンタ405bにプリセットされた絶対値データvdは
クロックパルスSV(第12図(2)参照)でカウント
ダウンされ、カウンタ405bのCO端子からは上記デ
ータvdとクロックパルスSVで決まるパルス長を有す
るパルス信号hが出力される。Therefore, the absolute value data αd preset in the counter 405a is counted down by the clock pulse Sα (see FIG. 12 (1)), and a pulse having a pulse length determined by the above data αd and the clock pulse Sα is output from the CO terminal of the counter 405a. A signal g is output. Further, the absolute value data vd preset in the counter 405b is counted down by the clock pulse SV (see FIG. 12 (2)), and a pulse having a pulse length determined by the above data vd and the clock pulse SV is output from the CO terminal of the counter 405b. A signal h is output.
上記パルス信号g、hは速度差新号ΔVの正負および加
速度信号αの正負に従って加算あるいは減算されて補正
量信号Hを構成する加速補正量信号HAないし減速補正
量信号HBとして出力される。The pulse signals g and h are added or subtracted according to the positive/negative of the new speed difference ΔV and the positive/negative of the acceleration signal α, and are outputted as the acceleration correction amount signal HA or deceleration correction amount signal HB which constitute the correction amount signal H.
例えば速度差信号ΔV>0、加速度信号α>0のとき、
正負信号vpは「0」レベルであり、正負信号α+、α
−はそれぞれ「0」レベル、「1」レベルである。この
状態ではEORゲート405cの出力は0レベルであり
、カウンタ405a、405bはいずれもクロックパル
スSα、Svによるカウント動作を開始する。上記クロ
ックパルスSα、Svのパルス周期の比で定まる定数を
K1とすると、K1・vd>αdである場合、カウンタ
405aのカウントはカウンタ405bより早く終了し
、ぞのCO端子出力たるパルス信号gが「0」レベルと
なる。そして、この時点からパルス信号hの残余の部分
がEORゲート405d、ANDゲート405eを経て
加速補正量信号HAとして出力される。すなわち、この
場合にはパルス信号g、hの差すなわち、K1・vd−
αdが信号HAとして出力される。このようにして、本
演算回路405では次頁の表で示す如く速度差ΔVとモ
ータ加速度αの荷重平均として加速補正量信号HAある
いは減速補正量信号HBが算出される。上述の例は表中
m1の場合に相当する。そして、上記表中のm1、m2
、m3、m4、m5、m6は第13図の線M上の各点m
1〜m6に対応している。For example, when the speed difference signal ΔV>0 and the acceleration signal α>0,
The positive and negative signals vp are at the "0" level, and the positive and negative signals α+, α
- are "0" level and "1" level, respectively. In this state, the output of the EOR gate 405c is at 0 level, and both the counters 405a and 405b start counting operations using the clock pulses Sα and Sv. Assuming that K1 is a constant determined by the ratio of the pulse periods of the clock pulses Sα and Sv, if K1·vd>αd, the counter 405a finishes counting earlier than the counter 405b, and the pulse signal g that is the output from the CO terminal The level becomes "0". From this point on, the remaining portion of the pulse signal h passes through the EOR gate 405d and the AND gate 405e and is output as the acceleration correction amount signal HA. That is, in this case, the difference between the pulse signals g and h, that is, K1·vd-
αd is output as signal HA. In this way, the calculation circuit 405 calculates the acceleration correction amount signal HA or the deceleration correction amount signal HB as a weighted average of the speed difference ΔV and the motor acceleration α, as shown in the table on the next page. The above example corresponds to the case of m1 in the table. And m1, m2 in the above table
, m3, m4, m5, m6 are each point m on the line M in FIG.
It corresponds to 1 to m6.
図中線M、Rはそれぞれモータ3(第1図参照)および
回転軸11の回転速度の経時変化を示すものである。Lines M and R in the figure indicate changes over time in the rotational speeds of the motor 3 (see FIG. 1) and the rotating shaft 11, respectively.
第8図には制御量演算回路406を示す。図中406a
、406b、406cはアップダウンカウンタ(例えば
テキサスインスツルメンツ社製SN74LS193)で
、これらはカスケードに接続して12ビットのフローテ
ィングカウンタとしである。406d、406eはプリ
セッタブルダウンカウンタ(例えばRCA社製CD40
103)であり、これもカスケードに接続して12ビッ
トのダウンカウンタとしてある。FIG. 8 shows the control amount calculation circuit 406. 406a in the diagram
, 406b, and 406c are up/down counters (for example, SN74LS193 manufactured by Texas Instruments), which are connected in cascade to form a 12-bit floating counter. 406d and 406e are presettable down counters (for example, RCA CD40
103), which is also connected in cascade to form a 12-bit down counter.
上記補正量演算回路405からの補正量信号HA、HB
が入力するとこの間ANDゲート406fあるいは40
6gが開きクロックパルスSp1(第12図(3)参照
)がカウンタ406a〜406cに入力する。そして、
信号HAの入力時にはカウンタ406A〜406cはア
ップカウントされ、信号HBの時にはダウンカウントさ
れる。Correction amount signals HA and HB from the correction amount calculation circuit 405
is input, during this time the AND gate 406f or 40
6g is opened and a clock pulse Sp1 (see FIG. 12 (3)) is input to the counters 406a to 406c. and,
The counters 406A to 406c count up when the signal HA is input, and count down when the signal HB is input.
上記カウンタ406a〜406cの出力はタイミングパ
ルスSf(第12図(12)参照)のタイミングでカウ
ンタ406d、406eにプリセットされる。このプリ
セット値はANDゲート406hを経て入力するクロッ
クパルスSp2(第12図(4)参照)によりダウンカ
ウントされ、カウンタ406eのCO端子からは上記プ
リセット値に比例したパルス長を有する制御量信号Tc
が出力される。The outputs of the counters 406a to 406c are preset to the counters 406d and 406e at the timing of the timing pulse Sf (see (12) in FIG. 12). This preset value is counted down by a clock pulse Sp2 (see FIG. 12 (4)) inputted via an AND gate 406h, and a control amount signal Tc having a pulse length proportional to the preset value is output from the CO terminal of the counter 406e.
is output.
ここで、クロックパルスSp1、Sp2のパルス周期の
比で決定される定数をK2とすると、上記制御量信号T
Cは以下の式で表わされる。Here, if K2 is a constant determined by the ratio of the pulse periods of clock pulses Sp1 and Sp2, then the control amount signal T
C is expressed by the following formula.
TC=TC−1+K2・HA・・・・・・(1)あるい
は
TC=TC−1−K2・HB・・・・・・(2)上式(
1)、2)中、TC−1は前回の制御量信号である。TC=TC-1+K2・HA・・・・・・(1) or TC=TC-1−K2・HB・・・・・・(2) Above formula (
In 1) and 2), TC-1 is the previous control amount signal.
なお、上記回路406において、カウンタ406a〜4
06cは電源投入時リセットパルスSRによって0にセ
ットされる。上記カウンタ406a〜406cはまたA
NDゲート406i、406jを閉じることにより0以
下および4095以上のカウントが禁止されている。Note that in the circuit 406, counters 406a to 4
06c is set to 0 by the reset pulse SR when the power is turned on. The counters 406a to 406c are also A
By closing the ND gates 406i and 406j, counting below 0 and above 4095 is prohibited.
第9図には正オフセット回路407および負オフセット
回路408を示す。図中407a、408aはいずれも
単安定マルチバイブレータ(例えばRCA社製CD40
47)である。FIG. 9 shows a positive offset circuit 407 and a negative offset circuit 408. In the figure, 407a and 408a are both monostable multivibrators (for example, RCA CD40
47).
マルチバイブレータ407aはタイミングパルスSt(
第12図(11)参照)の立下りのタイミングで所定の
パルス長を有する正オフセット信号T+0を出力する。The multivibrator 407a receives a timing pulse St(
A positive offset signal T+0 having a predetermined pulse length is output at the falling timing (see FIG. 12 (11)).
また、マルチバイブレータ408aは上記オフセット信
号T+0の立下りのタイミングで所定のパルス長を有す
る負オフセット信号T−0を出力する。Furthermore, the multivibrator 408a outputs a negative offset signal T-0 having a predetermined pulse length at the falling timing of the offset signal T+0.
第10図にはモータ駆動回路409を示す。図中409
aはモータ駆動用IC(例えば三菱電機社製M5454
3L)である。FIG. 10 shows a motor drive circuit 409. 409 in the diagram
a is a motor drive IC (for example, M5454 manufactured by Mitsubishi Electric)
3L).
リセットパルスSRは電源投入時以外は「1」レベルと
なっており、制御両信号TCおよび正オフセットパルス
新号T+0は駆動用IC409aのI1端子に入力し、
負オフセットパルス信号T−0はI2端子に入力する。The reset pulse SR is at the "1" level except when the power is turned on, and both control signals TC and the new positive offset pulse T+0 are input to the I1 terminal of the driving IC 409a.
The negative offset pulse signal T-0 is input to the I2 terminal.
これにより、駆動用モータ3(第1図参照)に接続され
た上記駆動用IC409aのO1端子、O2端子間には
モータ駆動信号Tnが現れる。そして、この信号Tnは
上記信号TC、T+0が入力している時には電流がO1
端子よりO2端子へ流れ、また上記信号T−0が入力し
ている時には電流がO2端子よりO1端子に流れるよう
な信号である。モータ3はO1端子よりO2端子へ流れ
る電流によってバネ23(第1図参照)のばね力に抗す
る正回転方向へ駆動せしめられ、O2端子よりO1端子
へ流れる電流によって逆回転方向へ駆動せしめられる。As a result, a motor drive signal Tn appears between the O1 terminal and the O2 terminal of the drive IC 409a connected to the drive motor 3 (see FIG. 1). This signal Tn has a current of O1 when the above-mentioned signal TC and T+0 are input.
This signal causes current to flow from the terminal to the O2 terminal, and when the above signal T-0 is input, current flows from the O2 terminal to the O1 terminal. The motor 3 is driven in the forward rotation direction against the spring force of the spring 23 (see Figure 1) by the current flowing from the O1 terminal to the O2 terminal, and is driven in the reverse rotation direction by the current flowing from the O2 terminal to the O1 terminal. .
第11図には上記各種のクロックパルスあるいはタイミ
ングパルスを発生するタイミングパルス発生回路410
を示す。FIG. 11 shows a timing pulse generation circuit 410 that generates the various clock pulses or timing pulses mentioned above.
shows.
図中410aは標準パルス発生器(例えば諏訪精工舎製
8640B)で、スイッチ群410bの設定によって任
意の周波数の基準クロックパルスを発生する。410c
、410fは分周器(例えばRCA社製CD4040)
、410dは1/10分周器(例えばRCA社製CD4
017)、410eはパルス発生器(例えばRCA社製
CD4017)、410gはトリガ発生器(例えばRC
A社製CD4017)、410hはクロック発生器(例
えばRCA社製CD4017)である。410iはコン
デンサ、ダイオード、バッファより構成されるリセット
パルスSR発生回路である。In the figure, 410a is a standard pulse generator (for example, 8640B manufactured by Suwa Seikosha), which generates a reference clock pulse of an arbitrary frequency by setting a switch group 410b. 410c
, 410f is a frequency divider (for example, RCA CD4040)
, 410d is a 1/10 frequency divider (for example, RCA CD4
017), 410e is a pulse generator (for example, RCA CD4017), 410g is a trigger generator (for example, RC
CD4017 manufactured by Company A), 410h is a clock generator (for example, CD4017 manufactured by RCA Company). 410i is a reset pulse SR generation circuit composed of a capacitor, a diode, and a buffer.
上記の如き構成を有し、かつ作動をなす制御回路4(第
1図参照)より出力される上記モータ駆動信号Tnによ
りモータ3の回転速度は常に設定速度たる回転軸11の
回転速度に正確に追従せしめられ、この結果表示用指針
22は回転軸11が連結された回転体の回転速度を正確
に指示する。The rotational speed of the motor 3 is always kept exactly at the rotational speed of the rotating shaft 11, which is the set speed, by the motor drive signal Tn outputted from the control circuit 4 (see FIG. 1) having the configuration and operation as described above. The result display pointer 22 accurately indicates the rotational speed of the rotating body to which the rotating shaft 11 is connected.
すなわち、モータ駆動信弓Tnは上式(1)、(2)に
示す制御信号TCにて構成され、この制御量信号TCは
上表に示すように各条件に応じて算出される補正量信号
HA、HBにより補正される。そして、上記補正量信号
HA、HBにおいて、速庶差絶対値データvdはモータ
3の速度をすばやく回転軸11の速度に追従せしめる応
答性に寄与する量であり、また加速度絶対値データαd
はモータ3の速度変化をおさえてその安定性に寄与する
量である。そしてこのような補正量信号HA、HBによ
り逐次補正される制御量信号TCのパルスデューテイに
応じて駆動用直流モータ3は加減速され、その回転速度
が正確に制御される。That is, the motor-driven beam bow Tn is composed of the control signal TC shown in the above equations (1) and (2), and this control amount signal TC is a correction amount signal calculated according to each condition as shown in the above table. Corrected by HA and HB. In the correction amount signals HA and HB, the velocity difference absolute value data vd is a quantity that contributes to the responsiveness of making the speed of the motor 3 quickly follow the speed of the rotating shaft 11, and the acceleration absolute value data αd
is an amount that suppresses speed changes of the motor 3 and contributes to its stability. The driving DC motor 3 is accelerated or decelerated in accordance with the pulse duty of the control amount signal TC which is successively corrected by the correction amount signals HA and HB, and its rotational speed is accurately controlled.
なお、モータ駆動信号Tnに含まれるオフセットパルス
信号T+0、T−0は直接制御性には関与しないが、モ
ータ3にディザをかける効果を有し、モータ3を超低速
域で始動可能とする。Although the offset pulse signals T+0 and T-0 included in the motor drive signal Tn are not directly involved in controllability, they have the effect of applying dither to the motor 3, allowing the motor 3 to be started in a very low speed range.
また、リードスイッチに代えて光電式センサ等を使用し
てももちろん良い。Furthermore, a photoelectric sensor or the like may of course be used in place of the reed switch.
このように、本発明のモータ速度制御装置を回転速度支
持針に使用すれば、速度表示用指針を回転体の回転速度
に正確に追従する駆動用モータで作動せしめることがで
きるから、表示用指針と回転体間にメータケーブルを布
設する必要はなく、したがってこの為のスペースが不要
である上に、ケーブルの疲労もなくきわめて信頼性が高
いものとなる。そして、駆動用モータの回転速度領域は
メータケーブルに比してかなり広くとれるから表示用指
針の支持精度も向上する。In this way, if the motor speed control device of the present invention is used for the rotational speed support needle, the speed display pointer can be operated by the drive motor that accurately follows the rotational speed of the rotating body, so the display pointer can There is no need to lay a meter cable between the rotor and the rotary body, so there is no need for space for this, and there is no cable fatigue, resulting in extremely high reliability. Furthermore, since the rotational speed range of the drive motor can be considerably wider than that of the meter cable, the accuracy of supporting the display pointer is also improved.
なお、上記実施例では制御回路をハード回路で構成した
が、これをマイクロコンピュータに置き代えることもも
ちろん可能である。In the above embodiment, the control circuit is constructed of a hardware circuit, but it is of course possible to replace this with a microcomputer.
また、定数K1、K2は実際にモータの制御挙動を確認
して最適値を選択する。Furthermore, the optimum values for the constants K1 and K2 are selected by actually checking the control behavior of the motor.
以上の如く、本発明のモータ速度制御装置はきわめて優
れた性能、効果を発揮するものである。As described above, the motor speed control device of the present invention exhibits extremely excellent performance and effects.
第1図は本発明のモータ速度制御装置を使用しに回転速
度指示計の全体構成図、第2図は波形整形回路および2
てい倍回路の回路図、第3図は各種信号のタイムチャー
ト、第4図は速度差検出回路の回路図、第5図は各種信
号のタイムチャート、第6図ないし第11図はそれぞれ
モータ加速度検出回路、補正量演算回路、制御量演算回
路、オフセット信号発生回路、モータ駆動回路、タイミ
ングパルス発生回路の各回路図、第12図は各種信号の
タイムチャート、第13図は回転軸速度およびモータ速
度の経時変化を示す図である。
1・・・・・・回転体速度検出センサ(設定速度発生手
段)
3・・・・・・モータ
27・・・・・・モータ速度検出用リードスイッチ40
3・・・・・・速度差検出回路
404・・・・・・モータ加速度検出回路405・・・
・・・補正量演算回路
406・・・・・・制御量演算回路
第4図
△V
第5図
(9) A
第9回
第10図
第11図
夕10
第12図
(1)且F咀旧旧+Sべ
(2) 5v
(3)旧」月IJI丁/Sp+
(4)−置J工口J’l)”51)2
(5) 7−下)Sc
(6) −り一−−−−−−−−−1oオCL2(7)
上−−−)C10
(11) J−1−「]rst
(+2) Sf
第13図Fig. 1 is an overall configuration diagram of a rotation speed indicator using the motor speed control device of the present invention, and Fig. 2 shows a waveform shaping circuit and two
The circuit diagram of the multiplier circuit, Figure 3 is the time chart of various signals, Figure 4 is the circuit diagram of the speed difference detection circuit, Figure 5 is the time chart of various signals, and Figures 6 to 11 are the motor acceleration. Circuit diagrams of the detection circuit, correction amount calculation circuit, control amount calculation circuit, offset signal generation circuit, motor drive circuit, and timing pulse generation circuit, Figure 12 is a time chart of various signals, and Figure 13 is the rotating shaft speed and motor FIG. 3 is a diagram showing changes in speed over time. 1... Rotating body speed detection sensor (setting speed generation means) 3... Motor 27... Reed switch 40 for motor speed detection
3...Speed difference detection circuit 404...Motor acceleration detection circuit 405...
... Correction amount calculation circuit 406 ... Controlled amount calculation circuit Fig. 4 △V Fig. 5 (9) A 9th Fig. 10 Fig. 11 E 10 Fig. 12 (1) and F Tsui Old and old + Sbe (2) 5v (3) Old' Month IJI Ding/Sp+ (4)-Oki J Koguchi J'l)'51) 2 (5) 7-Bottom) Sc (6) -Riichi-- ---------1o CL2 (7)
Upper---) C10 (11) J-1-']rst (+2) Sf Fig. 13
Claims (2)
発生手段と、モータの回転速度を検出するモータ速度検
出手段と、上記設定速度とモータ速度の差を算出する速
度差演算手段と、上記モータ速度の変化量を算出するモ
ータ加速度演算手段と、上記速度差とモータ加速度の荷
重平均より補正量信号を算出するとともに該補正信号よ
りモータ制御量信弓を算出して、モータの回転速度を上
記設定速度に一致せしめるべく上記制御量信号をモータ
に出力するモータ制御手段とを具備するモータ速度制御
装置。(1) a set speed generating means for generating a speed set value that changes over time, a motor speed detecting means for detecting the rotational speed of the motor, and a speed difference calculation means for calculating the difference between the set speed and the motor speed; A motor acceleration calculation means for calculating the amount of change in the motor speed, and a correction amount signal calculated from the weighted average of the speed difference and the motor acceleration, and a motor control amount signal calculated from the correction signal, and the rotational speed of the motor and motor control means for outputting the control amount signal to the motor so that the motor speed matches the set speed.
dと第1の制御定数K1よりK1・vdを算出するとと
もに、これとモータ加速度αの絶対値αdとの和K1・
vd+αdあるいは差|K1・vd−αd|を算出して
速度差ΔVとモータ加速度αの荷重平均となし、これら
をモータ加速用補正信号HAあるいはモータ減速用補正
量信号HBとして出力する補正量演算手段と、上記補正
量信号HA、HBと第2の制御定数K2よりK2・HA
、K2・HBを算出し、直前のモータ制御量信号をTC
−1として、TC−1+K2・HAあるいはTC−1−
K2・HBを新たなモータ制御量信号TCとなし、これ
をモータに出力する制御量演算手段とを具備している特
許請求の範囲第1項記載のモータ速度制御装置。(2) The motor control means controls the absolute value v of the speed difference ΔV.
K1·vd is calculated from d and the first control constant K1, and the sum K1·vd of this and the absolute value αd of the motor acceleration α is calculated.
A correction amount calculation means that calculates vd+αd or the difference |K1·vd−αd|, takes it as a weighted average of the speed difference ΔV and the motor acceleration α, and outputs these as a correction signal HA for motor acceleration or a correction amount signal HB for motor deceleration. Then, from the above correction amount signals HA, HB and the second control constant K2, K2・HA
, K2・HB, and convert the previous motor control amount signal to TC.
-1, TC-1+K2・HA or TC-1-
2. The motor speed control device according to claim 1, further comprising control amount calculation means for converting K2·HB into a new motor control amount signal TC and outputting this to the motor.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58131686A JPS6022484A (en) | 1983-07-19 | 1983-07-19 | Speed controller for motor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58131686A JPS6022484A (en) | 1983-07-19 | 1983-07-19 | Speed controller for motor |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6022484A true JPS6022484A (en) | 1985-02-04 |
Family
ID=15063842
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58131686A Pending JPS6022484A (en) | 1983-07-19 | 1983-07-19 | Speed controller for motor |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6022484A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6468550A (en) * | 1987-09-07 | 1989-03-14 | Tomotake Nakahira | Double solenoid needle selector in knitting machine |
-
1983
- 1983-07-19 JP JP58131686A patent/JPS6022484A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6468550A (en) * | 1987-09-07 | 1989-03-14 | Tomotake Nakahira | Double solenoid needle selector in knitting machine |
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