JPS6019180B2 - Variable scan scanning method for facsimile - Google Patents

Variable scan scanning method for facsimile

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Publication number
JPS6019180B2
JPS6019180B2 JP6343680A JP6343680A JPS6019180B2 JP S6019180 B2 JPS6019180 B2 JP S6019180B2 JP 6343680 A JP6343680 A JP 6343680A JP 6343680 A JP6343680 A JP 6343680A JP S6019180 B2 JPS6019180 B2 JP S6019180B2
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JP
Japan
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information
line
circuit
switch
document
Prior art date
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Expired
Application number
JP6343680A
Other languages
Japanese (ja)
Other versions
JPS56161775A (en
Inventor
聡 江藤
淳一 小林
健二 谷本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujifilm Business Innovation Corp
Original Assignee
Fuji Xerox Co Ltd
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Publication date
Application filed by Fuji Xerox Co Ltd filed Critical Fuji Xerox Co Ltd
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Publication of JPS6019180B2 publication Critical patent/JPS6019180B2/en
Expired legal-status Critical Current

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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N1/00Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
    • H04N1/04Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
    • H04N1/17Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa the scanning speed being dependent on content of picture

Description

【発明の詳細な説明】 本発明は、ファクシミリに於いて原稿の行間余白部等を
副走査方向に早送りして送受信を行ない、通信時間の短
縮を図るようにした可変走査読取方式に関するものであ
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a variable scan reading method in which facsimiles are sent and received by fast forwarding the line-to-line margins, etc. of a document in the sub-scanning direction, thereby reducing communication time. .

従来の可変走査読取方式においては、固体素子を用いて
原稿の余白部分を読み取った時には、1ライン〜数ライ
ンおきにホワイトラインスキップが行なわれるようにさ
れているのが普通である。
In the conventional variable scanning reading system, when a solid-state element is used to read the margins of a document, white line skipping is usually performed every one to several lines.

この場合、ホワイトラインスキップ中は原稿が早送りさ
れ、黒情報が検出されると原稿の送りが停止される。そ
して、1ライン分の原稿情報が読まれる。このような従
来の可変走査読取方式においては、ホワイトラインスキ
ップ中に読まれた黒情報鯵る者巻絹健診義ぎ鰍弊ぞ議に
、ホワイトラインスキップ中に黒情報を発見して原稿の
送りを止めるまでには若干の時間の遅れがある。
In this case, the document is rapidly forwarded during white line skipping, and when black information is detected, the document feeding is stopped. Then, one line of document information is read. In such a conventional variable scan reading method, black information read during white line skipping is detected during white line skipping and black information is read during white line skipping. There is a slight time delay before the feed stops.

言いかえれば、原稿が停止した位置は検出された黒情報
の先端から若干進んでいる。このため、従来の可変走査
読取方式においては、ホワイトラインスキップから黒情
報に変った時の黒情報の頭の部分が欠落して読み取られ
るという欠点があった。本発明の目的は、前記した従来
技術の欠点を除去し、ホワイトラインスキップから黒情
報の読み出し1こ変った時の原稿欠落を防止するように
したファクシミリの可変走査論取方式を提供することに
ある。
In other words, the position where the document stopped is slightly ahead of the leading edge of the detected black information. For this reason, in the conventional variable scan reading method, there is a drawback that when the white line skip changes to the black information, the beginning of the black information is omitted and read. SUMMARY OF THE INVENTION An object of the present invention is to provide a facsimile variable scanning scanning system that eliminates the drawbacks of the prior art described above and prevents missing documents when reading black information from white line skipping. be.

第1図は本発明の可変走査論取方式の一実施例を示すブ
ロック図である。
FIG. 1 is a block diagram showing an embodiment of the variable scanning logic system of the present invention.

図において、1は固体走査イメージセンサ、2は読み取
制御回路、3は第1のゲート回路、4は第1の記憶回路
、5は第2の記憶回路、6は第2のゲート回路、7は記
憶制御回路である。また、第2図は上記の本発明の一実
施例を説明するための説明図であり、8は原稿とこの原
稿を1ラインずつ走査する固体走査イメージセンサと関
係を示す原稿部、1川ま固体イメージセンサから読み取
られた情報が記憶される記憶回路部を示す。
In the figure, 1 is a solid-state scanning image sensor, 2 is a read control circuit, 3 is a first gate circuit, 4 is a first memory circuit, 5 is a second memory circuit, 6 is a second gate circuit, and 7 is a This is a memory control circuit. FIG. 2 is an explanatory diagram for explaining one embodiment of the present invention described above, and numeral 8 denotes a manuscript portion showing the relationship between a manuscript and a solid-state scanning image sensor that scans the manuscript line by line; 2 shows a storage circuit section in which information read from a solid-state image sensor is stored.

原稿部8において、9a,9bは原稿の黒を示す。In the original portion 8, 9a and 9b indicate black of the original.

また、A,,A2,B,,……,日,,日2は固体イメ
ージセンサが原稿を走査する軌跡を示し、実線は1ライ
ン中に黒情報があり、副走査送りが間欠的になされた時
、点線は1ライン中に黒情報がなく、1〜数ラインのホ
ワイトラインスキップがなされたときの軌跡を示す。一
方、記憶回路部10において、■は第1の記憶回路4を
示し、■は第2の記憶回路5を示す。また斜線が施され
ている記憶回路は、黒情報の書き込みが存在することを
示す。次に第1図と第2図により、本実施例の動作を説
明する。
In addition, A,,A2,B,...,day,,day2 shows the locus of the solid-state image sensor scanning the document, and the solid line indicates that there is black information in one line, and sub-scanning is performed intermittently. The dotted line shows the trajectory when there is no black information in one line and one to several white lines are skipped. On the other hand, in the memory circuit section 10, ■ indicates the first memory circuit 4, and ■ indicates the second memory circuit 5. Furthermore, a memory circuit with diagonal lines indicates that black information is written therein. Next, the operation of this embodiment will be explained with reference to FIGS. 1 and 2.

固体走査イメージセンサ1は読取制御回路2からの制御
信号に基づいて、1ラインずつ原稿から情報を読み出す
。読み出された原稿情報はゲート回路3、スイッチS,
をへて第1、第2の記憶回路4,5のうちどちらか一方
に記憶される。この記憶回路4,5はそれぞれ1ライン
分の記憶容量をもっている。スイッチS,,S2は、読
取制御回路2から送られてくる1ライン中に黒信号があ
るかないかという情報に基づいて記憶制御回路7から発
せられる信号によって互に逆相になるように切り換えら
れる。このため、例えば、第1の記憶回路4にデータが
記憶されているときには第2の記憶回路5から以前に記
憶されたデータが読み出される。第1、第2・の記憶回
路4,5への書き込みと読み出しは記憶制御回路7から
の制御信号によって制御される。記憶回路4,5の出力
側には、スイッチS2とは別のスイッチS3が設けられ
ており、スイッチS3はスイッチS,と同相になるよう
に切り換えられる。また、ゲート回路6は走査されてい
る1ライン中に黒情報があるときには開いて情報を適し
、1ライン中に黒情報がないときには閉じて情報を通さ
ないように、記憶制御回路7からの信号により制御され
る。今、第2図の原稿部8に示されているように、固体
イメージセンサ1によって原稿の1ラインA,が読まれ
たとすると、その情報は記憶回路4に記憶される。
The solid-state scanning image sensor 1 reads information from a document line by line based on a control signal from a reading control circuit 2. The read document information is sent to the gate circuit 3, switch S,
The data is then stored in one of the first and second storage circuits 4 and 5. The memory circuits 4 and 5 each have a memory capacity for one line. The switches S, , S2 are switched to have opposite phases by a signal issued from the storage control circuit 7 based on information sent from the reading control circuit 2 as to whether there is a black signal in one line. . Therefore, for example, when data is stored in the first storage circuit 4, previously stored data is read from the second storage circuit 5. Writing and reading into the first and second memory circuits 4 and 5 are controlled by control signals from the memory control circuit 7. A switch S3 separate from the switch S2 is provided on the output side of the memory circuits 4 and 5, and the switch S3 is switched to be in phase with the switch S. In addition, the gate circuit 6 is opened when there is black information in one line being scanned and allows the information to pass through, and is closed when there is no black information in one line to prevent the information from passing through. controlled by Now, if one line A of the document is read by the solid-state image sensor 1 as shown in the document portion 8 of FIG. 2, that information is stored in the memory circuit 4.

このラインA,中には悪情報があるので、記憶制御回路
7からゲート6へゲート6を開くような制御信号が送出
される。これによって、第1の記憶回路4に一旦記憶さ
れた情報は続いて読まれるラインA2の情報と同期して
ゲート回路3の入力側に回り込み、該ラインんの情報と
加え合わされる。そして、ラインA,とラインんの情報
を足し合わせた情報(第2図の■)が第1の記憶回路4
に記憶される。この後、スイッチS,,S2,S3は前
述のような位相関係で切り換えられ、原稿から読み出さ
れた情報は第2の記憶回路5に記憶され、第1の記憶回
路4に記憶されたデータAは読み出される。
Since there is bad information in this line A, a control signal is sent from the storage control circuit 7 to the gate 6 to open the gate 6. As a result, the information once stored in the first memory circuit 4 is routed to the input side of the gate circuit 3 in synchronization with the information on the line A2 that is subsequently read, and is added to the information on the line A2. Then, the information (■ in Fig. 2) that is the sum of the information on lines A and N is stored in the first memory circuit 4.
is memorized. Thereafter, the switches S,, S2, and S3 are switched in the above-mentioned phase relationship, and the information read from the original is stored in the second storage circuit 5, and the data stored in the first storage circuit 4 is stored in the second storage circuit 5. A is read.

次に原稿が送られてラインBを読み取る。この時、1ラ
イン中に黒情報が読み出されないと、次のラインからは
1〜数ラインおきにホワイトラインスキップされる。こ
の間の白情報は第2の記憶回路5に記憶される。ホワイ
トラインスキップをしている間に原稿から黒情報が読み
出されると、その情報が第2の記憶回路5に書き込まれ
ると共に原稿の送りは停止され、原稿を停止した状態で
ラインG,が読まれる。ラインF,の情報は前記と同様
に第2のゲート6を通って第1のゲート3の入力側にラ
インG,の情報と同期して回り込み、該ラインG,の情
報と足し合わされて、第2の記憶回路5に書き込まれる
。続いて、スイッチS,,S2,S3は再び元の状態に
なるように切り換えられる。
Next, the original is sent and line B is read. At this time, if black information is not read out in one line, white lines are skipped every one to several lines from the next line. The white information during this period is stored in the second storage circuit 5. When black information is read from the original while white line skipping is being performed, that information is written into the second memory circuit 5 and the feeding of the original is stopped, and line G is read with the original stopped. . Similarly to the above, the information on line F passes through the second gate 6 and enters the input side of the first gate 3 in synchronization with the information on line G, and is added to the information on line G. The data is written into the storage circuit 5 of No. 2. Subsequently, the switches S, , S2, and S3 are switched back to their original states.

そして、原稿から読み出されたライン日,,馬の情報は
前記と同様に同期して足し合わされて第1の記憶回路4
に書き込まれる。一方、この時第2の記憶回路5に書き
込まれていたラインF,とラインG,とを足し合わせた
情報(F,十G,)は記憶回路5から読み出される。本
実施例では、上記の説明から明らかなように、従来の方
式では捨てられていたラインF,の情報がラインG,の
情報と重畳されて記憶回路に記憶される。
Then, the line date and horse information read from the manuscript are summed up in the same manner as above and stored in the first memory circuit 4.
will be written to. On the other hand, information (F, 10G,), which is the sum of lines F and G that were written in the second memory circuit 5 at this time, is read out from the memory circuit 5. In this embodiment, as is clear from the above description, the information on line F, which was discarded in the conventional method, is superimposed with the information on line G and stored in the storage circuit.

以上のように、本発明によれば、ホワイトラインスキッ
プをしている時に検出された黒情報は次の原稿情報と足
し合わされるので、ホワイトラインスキップから黒情報
に変った時の黒情報の頭の部分が欠落することはない。
As described above, according to the present invention, the black information detected during white line skipping is added to the next document information, so when the white line skip changes to black information, the black information is There is no part missing.

図面の簡単な説明第1図は本発明の一実施例のブロック
図、第2図は前記実施例の動作の説明図である。
BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a block diagram of an embodiment of the present invention, and FIG. 2 is an explanatory diagram of the operation of the embodiment.

1・・・・・・固体走査イメージセンサ、2・・・・・
・読取制御回路、3,6・・・・・・ゲート回路、4,
5・・・・・・記憶回路、7・・・・・・記憶制御回路
、8・・・・・・原稿部、10・・・・・・記憶回路部
1... Solid state scanning image sensor, 2...
・Reading control circuit, 3, 6... Gate circuit, 4,
5... Memory circuit, 7... Memory control circuit, 8... Manuscript section, 10... Memory circuit section.

〆毅」4の 豹2脇〆毅” 4 Leopard 2 sides

Claims (1)

【特許請求の範囲】[Claims] 1 黒情報が存在する原稿部分は、副走査送りを間欠的
に行なつて1ライン1ラインを順次読み、黒情報を有し
ない白地の原稿部分は、副走査送りを高速に行ない、1
〜数ラインおきにホワイトラインスキツプを行うように
したフアクシミリの可変走査読取方式において、原稿等
から読み出された1ラインの情報が一方の入力端子に入
力される論理和回路、該論理和回路の出力側に接続され
た第1のスイツチ、該第1のスイツチにより前記論理和
回路との接読を切り換えられる第1と第2の記憶回路、
該第1、第2の記憶回路の出力側に設けられ、該第1の
スイツチに接続されていない方の記憶回路に接続される
情報読み出し用の第2のスイツチ、該第1、第2の記憶
回路の出力側に設けられ、該第1のスイツチに接続され
ている方の記憶回路に接続される第3のスイツチ、およ
び該第3のスイツチと該論理和回路の他方の入力端子と
の間に接続されているゲート回路を具備し、前記ホワイ
トラインスキツプ中に読み出された黒情報を含む1ライ
ンの情報を前記第1のスイツチに接続されている側の記
憶回路に書き込み、その後、該1ラインの情報を該ゲー
ト回路を通して該論理和回路の他方の入力端子に回り込
ませ、該1ラインの情報を原稿の送りを停止した後の次
の1ライン分の原稿情報に同期的に重畳して前記第1の
スイツチに接続されている側の同じ記憶回路に書き込む
ようにしたことを特徴とするフアクシミリの可変走査読
取方式。
1. For parts of the document where black information exists, sub-scanning is performed intermittently to read each line one by one, and for white manuscript parts that do not have black information, sub-scanning is performed at high speed.
~In a facsimile variable scan reading system that skips white lines every few lines, an OR circuit in which one line of information read from a document, etc. is input to one input terminal; a first switch connected to the output side of the first switch; first and second memory circuits whose direct reading with the OR circuit is switched by the first switch;
a second switch for reading information provided on the output side of the first and second memory circuits and connected to the memory circuit that is not connected to the first switch; a third switch provided on the output side of the storage circuit and connected to the storage circuit connected to the first switch; and a connection between the third switch and the other input terminal of the OR circuit. a gate circuit connected between the two switches, writes one line of information including black information read during the white line skip to the memory circuit connected to the first switch; , the information of the one line is routed through the gate circuit to the other input terminal of the OR circuit, and the information of the one line is synchronously transmitted to the next line of document information after stopping the feeding of the document. A variable scan reading system for a facsimile machine, characterized in that data is written in the same memory circuit on the side connected to the first switch in a superimposed manner.
JP6343680A 1980-05-15 1980-05-15 Variable scan scanning method for facsimile Expired JPS6019180B2 (en)

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