JPS60158311U - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPS60158311U JPS60158311U JP4509184U JP4509184U JPS60158311U JP S60158311 U JPS60158311 U JP S60158311U JP 4509184 U JP4509184 U JP 4509184U JP 4509184 U JP4509184 U JP 4509184U JP S60158311 U JPS60158311 U JP S60158311U
- Authority
- JP
- Japan
- Prior art keywords
- input terminal
- bias
- amplifier circuit
- negative input
- positive input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来の単一電源による演算増幅器を用いた正相
増幅回路、第２図は本考案の単一電源による演算増幅器
を用いた正相増幅回路で、１−１．１−２：入力端子、
２−１．２−２：電源端子、３−１．３−２：出力端子
、４：演算増幅器、５：信号源、６：バイアス端子。
増幅回路、第２図は本考案の単一電源による演算増幅器
を用いた正相増幅回路で、１−１．１−２：入力端子、
２−１．２−２：電源端子、３−１．３−２：出力端子
、４：演算増幅器、５：信号源、６：バイアス端子。
Claims (1)
- 単一電源による演算増幅器を用いた増幅回路において演
算増幅器のプラス入力端子の直流バイアスをマイナス入
力端子の直流バイアスと共用するために、単一電源によ
り抵抗分割した直流バイアス点よりプラス入力端子へ抵
抗を介して結合するとともに前記抵抗分割した直流バイ
アス点より帰還増幅器利得を決定する抵抗の一つを介し
てマイナス入力端子に接続することによりプラス入力端
子、マイナス入力端子に同一直流バイアス電圧を供給す
ることを特徴とする増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4509184U JPS60158311U (ja) | 1984-03-30 | 1984-03-30 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4509184U JPS60158311U (ja) | 1984-03-30 | 1984-03-30 | 増幅回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60158311U true JPS60158311U (ja) | 1985-10-22 |
Family
ID=30558277
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4509184U Pending JPS60158311U (ja) | 1984-03-30 | 1984-03-30 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60158311U (ja) |
-
1984
- 1984-03-30 JP JP4509184U patent/JPS60158311U/ja active Pending
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