JPS60145771A - Horizontal deflecting circuit - Google Patents

Horizontal deflecting circuit

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Publication number
JPS60145771A
JPS60145771A JP223484A JP223484A JPS60145771A JP S60145771 A JPS60145771 A JP S60145771A JP 223484 A JP223484 A JP 223484A JP 223484 A JP223484 A JP 223484A JP S60145771 A JPS60145771 A JP S60145771A
Authority
JP
Japan
Prior art keywords
current
transistor
generated
resonance
voltage
Prior art date
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Pending
Application number
JP223484A
Other languages
Japanese (ja)
Inventor
Junichiro Tsurumaru
鶴丸 純一郎
Yukimichi Okamura
岡村 行通
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP223484A priority Critical patent/JPS60145771A/en
Publication of JPS60145771A publication Critical patent/JPS60145771A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To make ringing generated in fly-back voltage and resonance current small by providing a device that suppresses abrupt change of current of resonance current and improving high frequency nonlinearity of deflecting current. CONSTITUTION:When a transistor 2 makes switching action by a square wave signal generator 1, high voltage is generated in primary side of a transformer T1, and large current flows in secondary side winding. This current saturates a transistor 3. Then, the latter half of deflecting current I'D is let flow in a deflecting yoke 6. After sweeping for a fixed period, the transistor 3 becomes off, and fly-back voltage A' is generated. Resonance current I'R repeats oscillation for a fixed period influenced by dynamic characteristic when a damper diode 5 is on. To suppress this oscillation in an early stage, an inductance element 7 is inserted in a resonance capacitor 4 in series.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、電磁偏向型CRTを表示手段とするモニタデ
ィスプレーに使用する水平偏向回路に関するものである
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a horizontal deflection circuit used in a monitor display using an electromagnetic deflection type CRT as display means.

従来例の構成とその問題点 第1図は従来の水平偏向回路を示している。以下にこの
従来例の構成について第1図とともに説明する。
Conventional Structure and Problems Therein FIG. 1 shows a conventional horizontal deflection circuit. The configuration of this conventional example will be explained below with reference to FIG. 1.

第1図において、1はトランジスタ2をスイっ・チング
させるための方形波信号発生器であり、水平同期パルス
によって決定される一定の周期を有する。T1 は次段
スイッチングトランジスタ3をスイッチングさせるに充
分なベース電流を供給する変圧器である。スイッチング
トランジスタ3のコレクタは偏向ヨーク6に接続されて
いる。コンデンサ4は、偏向ヨーク6のインダクタンス
と共振回路を形成している。ダイオード6はカソードを
スイッチングトランジスタ3のコレクタと接続し、アノ
ード側は接地されている。
In FIG. 1, 1 is a square wave signal generator for switching transistor 2, which has a constant period determined by the horizontal synchronization pulse. T1 is a transformer that supplies enough base current to switch the next-stage switching transistor 3. The collector of the switching transistor 3 is connected to the deflection yoke 6. The capacitor 4 forms a resonant circuit with the inductance of the deflection yoke 6. The diode 6 has its cathode connected to the collector of the switching transistor 3, and its anode side grounded.

次に上記従来例の動作について説明する。第1図におい
て、トランジスタ2がスイッチング動作をすると変圧器
T1 の1次側に大きなフライバック電圧を発生する。
Next, the operation of the above conventional example will be explained. In FIG. 1, when transistor 2 performs a switching operation, a large flyback voltage is generated on the primary side of transformer T1.

この発生電圧のピーク−ビーク値をV p を電流の値
をip、2次側電圧をV s を電流を18.に圧器、
T1 の巻線比をn:1とし理想変圧器と考えた場合 なる関係が成立する。この結果、2次側における’t 
l& td・1s=ni となり、偏向ヨークに供給す
るp 偏向電流を発生させるに足るトランジスタ3のベース電
流が得られる。変圧器T1は、この様に二種の電圧−電
流変換器の働きをし、簡単な構成で大電流ケ得ることが
出来る。
The peak-to-peak value of this generated voltage is V p , the current value is ip, the secondary side voltage is V s and the current is 18. pressure gauge,
When the turns ratio of T1 is n:1 and it is considered as an ideal transformer, the following relationship holds true. As a result, 't' on the secondary side
l&td·1s=ni, and a base current of the transistor 3 sufficient to generate a p deflection current to be supplied to the deflection yoke is obtained. The transformer T1 thus functions as two types of voltage-current converters, and can obtain a large current with a simple configuration.

次に、2QインチCRTの偏向電流を例に+−ス電流が
どれ程の値となるかを考えてみる0水平方向管面両端間
を掃引させるに要する偏向電流を工pとし、偏向ヨーク
6のインダクタンスをLとすると、 なる関係から、L、TDが決められた値をもっていると
するとTが小さくなる。つまり偏向周波数があがってく
るにつれて供給電圧vp を高くすることが要求される
0このことは、フライバック電圧が大きくなることを意
味し、したがってトランジスタ3には高耐圧しかも大電
流に耐え得るという大きな制約条件がかせられるoより
を1OA。
Next, let us consider the value of the +/- current using the deflection current of a 2Q-inch CRT as an example. 0 Let the deflection current required to sweep between both ends of the screen in the horizontal direction be p, and the deflection yoke 6 Let L be the inductance of . From the following relationship, if L and TD have predetermined values, T will be small. In other words, as the deflection frequency increases, it is required to increase the supply voltage vp.0 This means that the flyback voltage increases, and therefore, the transistor 3 has a high withstand voltage and a large current capacity. 1OA from o where constraints are imposed.

フライバック電圧を1.ooov程度とすると、トラン
ジスタとしては、せいぜいhFBH= 10程度であり
、したがってベース電流は最小限 (ID/2)/hB−E=sA/10=O,esAを必
要とする。このため変圧器を用いたスイッチング駆動方
式は有力な手段となり得るのである。
Set the flyback voltage to 1. If it is about ooov, then hFBH = about 10 at most as a transistor, and therefore the base current requires a minimum of (ID/2)/hB-E=sA/10=O, esA. For this reason, a switching drive system using a transformer can be an effective means.

次に、発生したフライバック電圧は■c電位を中心とし
た正弦波電圧であるが、Q電位をクロスし負方向に向か
い始めるとダンパダイオード6がオンとなり始め、偏向
電流Ipのほぼ前半部を偏向ヨークに流す働きをする。
Next, the generated flyback voltage is a sine wave voltage centered on the c potential, but when it crosses the Q potential and begins to go in the negative direction, the damper diode 6 starts to turn on, and almost the first half of the deflection current Ip is turned on. It functions to direct the flow to the deflection yoke.

同時に、フライバック電圧は第2図のAに示す様にほぼ
零電位以上の波形におさえられる。トランジスタ3およ
びダンパダイオード5はフライバック電圧発生期間中は
オフであり、共振コンデンサ4及び偏向ヨーク6の間で
共振電流工Rを流している。
At the same time, the flyback voltage is suppressed to a waveform of approximately zero potential or higher, as shown in A of FIG. The transistor 3 and damper diode 5 are off during the flyback voltage generation period, allowing a resonant current R to flow between the resonant capacitor 4 and the deflection yoke 6.

しかしながら、第2図に示す様な波形は理想的な動作に
おいてあてはまるものであり、現実的には第3図に示す
様にフライバック電圧A及び共振電流工RI/′i、リ
ンギングを生じ、偏向電流よりにもその影響が現れる。
However, the waveform shown in Fig. 2 is applicable in ideal operation, and in reality, as shown in Fig. 3, the flyback voltage A and the resonant current RI/'i cause ringing and deflection. The effect is also apparent in the current.

結果として管面上に表示されたパターンの左端(水平掃
引の始まる側)付近でたて稿が見えることになる。特に
、水平偏向周波数の高いモニタディスプレー装置におい
ては、この現象が顕著に表れる。これは、先に述べた様
な高いフライバック電圧と大電流に耐え得る高速のダン
パダイオードの性能に左右されるものであり、理想的な
高速ダンパダイオードが存在しない限りこの現象を取り
除くことは従来では困難であった。
As a result, a vertical draft can be seen near the left end of the pattern displayed on the screen (the side where the horizontal sweep starts). This phenomenon is particularly noticeable in monitor display devices with a high horizontal deflection frequency. This depends on the performance of a high-speed damper diode that can withstand high flyback voltages and large currents as mentioned earlier, and unless an ideal high-speed damper diode exists, it is conventionally impossible to eliminate this phenomenon. It was difficult.

発明の目的 本発明は上記従来例の欠点を除去するものであり、フラ
イバック電圧及び共振電流に発生するリンギングを小さ
くおさえ管面の画質を向上させることを目的とする。
OBJECTS OF THE INVENTION The present invention eliminates the drawbacks of the above-mentioned conventional examples, and aims to improve the image quality of the tube surface by suppressing the ringing generated in the flyback voltage and resonance current.

発明の構成 本発明は上記目的を達成するために、共振電流の急激な
電流変化ケおさえる手段を設け、偏向電流の高周波ノン
リニアリティを改善する効果を得るものである。
Structure of the Invention In order to achieve the above object, the present invention provides means for suppressing rapid current changes in the resonance current, thereby obtaining the effect of improving high-frequency nonlinearity of the deflection current.

実施例の説明 以下に本発明の実施例の構成について図面とともに説明
する。
DESCRIPTION OF EMBODIMENTS The structure of an embodiment of the present invention will be described below with reference to the drawings.

第4図において、1はトランジスタ2ffニスイツチン
グさせる方形波信号発生器であり、トランジスタ2のコ
レクタには変圧器T1が接続されている。変圧器T1 
の2次側はトランジスタ3のベースに接続されている。
In FIG. 4, reference numeral 1 denotes a square wave signal generator for switching transistor 2ff, and a transformer T1 is connected to the collector of transistor 2. transformer T1
The secondary side of is connected to the base of transistor 3.

これらについては第1図に示す従来例と何ら変わるとこ
ろはない。トランジスタ3のコレクタには偏向ヨーク6
、共振コンデンサ4の一方およびダンパダイオード6の
カソードが接続されている。偏向ヨーク6の他方は供給
電源■cにつながり、偏向ヨーク6へ流れる電流値ID
/を決定する。ダンパダイオード5のアノードは接地さ
れている。また共振コンデンサ4の他方はインダクタン
ス素子7を介して接地されている0 次に、上記実施例の動作について説明する。第4図にお
いて、方形波信号発生器1によってトランジスタ2がス
イッチング動作を行うと、変圧器T1の1次側に発生す
る高い電圧によって2次側巻線に大電流が流れる1この
電流はトランジスタ3を飽和させるに充分な順方向、又
カットオフに至らしめるに充分な逆方向電流でなければ
ならない。トランジスタ3がオンとなると、第6図に示
す様な偏向電流ID′の後半部を偏向ヨーク6に流す。
There is no difference in these respects from the conventional example shown in FIG. A deflection yoke 6 is attached to the collector of the transistor 3.
, one of the resonant capacitors 4 and the cathode of the damper diode 6 are connected. The other side of the deflection yoke 6 is connected to the power supply ■c, and the current value ID flowing to the deflection yoke 6 is
/Determine. The anode of damper diode 5 is grounded. The other end of the resonant capacitor 4 is grounded via the inductance element 7. Next, the operation of the above embodiment will be explained. In FIG. 4, when the transistor 2 performs a switching operation by the square wave signal generator 1, a large current flows through the secondary winding due to the high voltage generated on the primary side of the transformer T1. There must be enough forward current to saturate the current, and enough reverse current to bring it to cutoff. When the transistor 3 is turned on, the latter half of the deflection current ID' as shown in FIG. 6 flows through the deflection yoke 6.

一定期間掃引の後トランジスタ3がオフとなり、フライ
バック電圧A′が発生する。従来例で述べた様に、フラ
イバック電圧が終了すると共振電流IR′は零になるの
であるが、ダンパダイオード6のオン時の動特性が影響
してフライバック電圧A′が零電位より負方向へオーバ
ーシュートし、その後減衰曲線を描いてほぼ零電位に収
束するため現実には一定期間振動を繰り返す。
After sweeping for a certain period of time, transistor 3 is turned off and flyback voltage A' is generated. As mentioned in the conventional example, when the flyback voltage ends, the resonant current IR' becomes zero, but due to the influence of the dynamic characteristics of the damper diode 6 when it is on, the flyback voltage A' becomes more negative than zero potential. The voltage overshoots, and then draws a damping curve and converges to almost zero potential, so in reality it repeats oscillations for a certain period of time.

この振動を早期に、しかも絶対的な振動振幅をできるか
ぎりおさせる目的で共振コンデンサ4に直列にインダク
タンス素子7を挿入する。この結果、共振電流IR′は
第6図に示す様に振動振幅及 4び振動時間が非常に小
さくなり、偏向電流のスタート側における高周波ノンリ
ニアリティは大幅に改善される。
An inductance element 7 is inserted in series with the resonant capacitor 4 in order to reduce this vibration as early as possible and to reduce the absolute vibration amplitude as much as possible. As a result, the vibration amplitude and vibration time of the resonant current IR' become extremely small as shown in FIG. 6, and the high frequency nonlinearity on the start side of the deflection current is greatly improved.

なお、インダクタンス素子7のインダクタンスL1は、
偏向ヨークのそれに比較して充分小さくとる必要がある
。又、共振電流工R′及びフライバック電圧A′に不要
のパルスが発生するが、フライバック発生期間中のもの
であり、ティスプレー期間中の偏向電流には何ら影響を
あたえるものではない。
Note that the inductance L1 of the inductance element 7 is
It needs to be sufficiently small compared to that of the deflection yoke. Further, although unnecessary pulses are generated in the resonant current generator R' and the flyback voltage A', they occur during the flyback generation period and do not affect the deflection current during the display period.

発明の効果 本発明は上記の様に構成されており、以下に示す効果が
得られるものである。すなわち、共振電流のフライバッ
ク終了後の振動を小さくかつ急激に零に収束させるため
、偏向電流の掃引開始近辺O高周波ノンリニアリティが
改善され、CRTKディスプレーされた映像の左端付近
(水平掃引のはじまる側)におけるたて稿模様がなくな
り、画質向上の効果を得る。
Effects of the Invention The present invention is constructed as described above, and provides the following effects. In other words, in order to make the vibration after the end of the flyback of the resonant current small and sharply converge to zero, the high-frequency nonlinearity near the start of the deflection current sweep is improved, and the high frequency nonlinearity is improved near the left end of the image on the CRTK display (the side where the horizontal sweep starts). ), the vertical pattern is eliminated and the image quality is improved.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の水平偏向回路の回路図、第2図及び第3
図−は第1図の各部の波形図、第4図は本発明の一実施
例の回路図、第5図は第4図の各部O波形図である。 2.3・・・・・・スイッチング用トランジスタ、4・
・・・・・共振コンデンサ、6・・・・・・ダンパダイ
オード、6・・・・・・偏向ヨーク、7・“・バインダ
クタンス素子、T1・・・・・・変圧器。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名@+
図 属 2 図 第 3 図
Figure 1 is a circuit diagram of a conventional horizontal deflection circuit, Figures 2 and 3 are
4 is a circuit diagram of an embodiment of the present invention, and FIG. 5 is a waveform diagram of each part in FIG. 4. 2.3...Switching transistor, 4.
... Resonance capacitor, 6 ... Damper diode, 6 ... Deflection yoke, 7 ... Bin inductance element, T1 ... Transformer. Name of agent Patent attorney Toshio Nakao and 1 other person @+
Figure 2 Figure 3

Claims (1)

【特許請求の範囲】[Claims] 水平偏向用出力トランジスタと、この出力トランジスタ
のコレクタと カソード側が接続され、アノード側が接
地されたダンパダイオードと、一端が上記出力トランジ
スタのコレクタと接続され、他端がインダクタンス素子
を介して接地された共振コンデンサとで構成された水平
偏向回路0
An output transistor for horizontal deflection, a damper diode whose collector and cathode sides are connected to each other and whose anode side is grounded, and a resonance whose one end is connected to the collector of the output transistor and whose other end is grounded via an inductance element. Horizontal deflection circuit 0 consisting of a capacitor
JP223484A 1984-01-10 1984-01-10 Horizontal deflecting circuit Pending JPS60145771A (en)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5045234A (en) * 1973-08-28 1975-04-23

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5045234A (en) * 1973-08-28 1975-04-23

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