JPS60119154A - Remote control circuit - Google Patents

Remote control circuit

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JPS60119154A
JPS60119154A JP22656683A JP22656683A JPS60119154A JP S60119154 A JPS60119154 A JP S60119154A JP 22656683 A JP22656683 A JP 22656683A JP 22656683 A JP22656683 A JP 22656683A JP S60119154 A JPS60119154 A JP S60119154A
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JP
Japan
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voltage
line
circuit
relay
signal
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Pending
Application number
JP22656683A
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Japanese (ja)
Inventor
Yusaku Matsubara
松原 勇作
Shinichi Obara
小原 信一
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Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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    • GPHYSICS
    • G08SIGNALLING
    • G08CTRANSMISSION SYSTEMS FOR MEASURED VALUES, CONTROL OR SIMILAR SIGNALS
    • G08C19/00Electric signal transmission systems
    • G08C19/02Electric signal transmission systems in which the signal transmitted is magnitude of current or voltage
    • G08C19/025Electric signal transmission systems in which the signal transmitted is magnitude of current or voltage using fixed values of magnitude of current or voltage

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  • General Physics & Mathematics (AREA)
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Abstract

PURPOSE:To simplify circuit constitution and to constitute the circuit of economical parts by changing a sending level for each key to send a signal, and on the receiving side, discriminating the level and actuating a relay corresponding to the depressed key. CONSTITUTION:A keyboard 1 in a transmission part 1 is connected to a voltage discriminating circuit 2 in a receiving part through two lines l1, l2 and the output of the voltage discriminating circuit 2 is connected to a relay part 3. The voltage Vcc and one terminal of switches S1-Sn of the keyboard 1 is connected to the line l respectively. A level detecting integrated circuit 6 in the voltage discriminating circuit 2 receives a signal from the keyboard through the line l2. When the switch S2 is depressed, 3.8V voltage is sent to the line l2 and the level detecting integrated circuit 6 sends a signal through a line l4. Consequently, a relay 13 receives the signal through the line l4 and is driven to control an electric apparatus or the like corresponding to the relay 13.

Description

【発明の詳細な説明】 技術分野 本発明は電気機器などの遠隔操作を行なう遠隔制御回路
に関する。
DETAILED DESCRIPTION OF THE INVENTION Technical Field The present invention relates to a remote control circuit for remotely controlling electrical equipment and the like.

背景技術 先行技術の遠隔制御回路は予め設定した電圧を送る送信
部と、その電圧を受信する受信部とから構成される。そ
の受信部は送信部より送られてきた電圧レベルを検出し
、電気機器などの制御を行なう。このような遠隔制御回
路は受信部の電圧弁別回路が複雑であり、簡単には構成
できない欠点があった。
BACKGROUND ART A prior art remote control circuit is comprised of a transmitter that sends a preset voltage and a receiver that receives the voltage. The receiving section detects the voltage level sent from the transmitting section and controls electrical equipment. Such a remote control circuit has a drawback that the voltage discrimination circuit of the receiving section is complicated and cannot be easily constructed.

目 的 本発明の目的は上類の技術的課題を解決し、回路構成が
簡単で低価格の部品で構成することができる遠隔制御回
路を提供することである。
Purpose An object of the present invention is to solve the above-mentioned technical problems and to provide a remote control circuit that has a simple circuit configuration and can be constructed from low-cost components.

実施例 @1図は本発明の一実施例の全体の構成を示すブロック
図である。送信部のキーボード1は2本のラインe1,
12によって受信部の電圧弁別回路2に接続される。そ
の電圧弁別回路2の出力は、リレ一部3に接続される。
Embodiment @1 FIG. 1 is a block diagram showing the overall configuration of an embodiment of the present invention. The keyboard 1 of the transmitter has two lines e1,
12, it is connected to the voltage discrimination circuit 2 of the receiving section. The output of the voltage discrimination circuit 2 is connected to the relay part 3.

第2図は、第1図に示すキーボードJの詳細な電気回路
図である。ライン11には、電圧V c cが与えられ
る。そのラインl!1には、スイッチ81〜Snの一方
端子がそれぞれ接続される。スイッチS1の他方の端子
は、ライン12に接続される。スイッチ82〜Snの各
他方端子は、抵抗R2〜Rnを介してライン12に接続
される。ラインl!2に送出される電圧は、スイッチ5
2=Snに接続される抵抗R1= Rnの各抵抗値のち
がいによって異なったものとなる。
FIG. 2 is a detailed electrical circuit diagram of the keyboard J shown in FIG. Line 11 is provided with a voltage Vcc. That line! 1 is connected to one terminal of each of the switches 81 to Sn. The other terminal of switch S1 is connected to line 12. The other terminals of switches 82-Sn are connected to line 12 via resistors R2-Rn. Line l! The voltage delivered to switch 2 is
2=Resistance connected to Sn=R1=It varies depending on the resistance value of Rn.

第3図は第1図に示す受信部の電圧弁別回路2の一実施
例の電気回路図である。ライン11には、電圧V c 
cが与えられる。レベル検出用集積回路(商品名AN6
876)6には、抵抗5を介して基準電圧が与えられる
。レベル検出用集積回路6は、ラインl!2を介してキ
ーボード1からの信号を受信する。またl!2は、抵抗
4を介して接地される。レベル検出用集積回路6の出力
のライン13〜17には、抵抗7〜11を介して電圧V
 c cが与えられる。
FIG. 3 is an electrical circuit diagram of one embodiment of the voltage discrimination circuit 2 of the receiving section shown in FIG. 1. Line 11 has a voltage V c
c is given. Integrated circuit for level detection (product name AN6
876) 6 is supplied with a reference voltage via a resistor 5. The level detection integrated circuit 6 is connected to the line l! 2 receives signals from the keyboard 1. See you again! 2 is grounded via a resistor 4. A voltage V is applied to output lines 13 to 17 of the level detection integrated circuit 6 via resistors 7 to 11.
c c is given.

第4図は第3図に示すレベル検出用集積回路6の等価回
路図である。ライン12に与えられた入力電圧が1゜5
8〜2゜02Vのとき、ライン17に出力信号が現れる
。入力電圧が2゜11〜2゜69Vのとき、ラインr6
に出力信号が現れる。また入力電圧力2.64〜3,3
6 Vノとき、ラインl!5ニ出力信号が現れ、入力電
圧が3.57〜4,03 Vのときラインl!4に出力
信号が現れる。また入力電圧が4.1V以上のとき、ラ
インl!3に出力信号が現れる。第3図において、抵抗
4は電圧整合用の抵抗であり、抵抗7〜IIはプルアッ
プ用の抵抗である。
FIG. 4 is an equivalent circuit diagram of the level detection integrated circuit 6 shown in FIG. 3. The input voltage applied to line 12 is 1°5
At 8-2°02V, an output signal appears on line 17. When the input voltage is between 2°11 and 2°69V, line r6
An output signal appears. Also input voltage power 2.64~3.3
6 When V, line l! 5D output signal appears, line l! when the input voltage is 3.57-4,03 V. An output signal appears at 4. Also, when the input voltage is 4.1V or higher, line l! An output signal appears at 3. In FIG. 3, resistor 4 is a voltage matching resistor, and resistors 7 to II are pull-up resistors.

第5図は第1図に示すリレ一部3の一実施例の電気回路
図である。ライン、e4はリレー12のトグル端子TI
に接続される。ラインt!4は、リレー13のトグル端
子T2に接続される。ライン15は、リレー14のトグ
ル端子T3に接続され、ラインe6はリレー15のトグ
ル端子T4に接続される。以上のような回路構成で、ラ
イン13〜J6に与えられた信号によってリレー12〜
15がそれぞれ駆動される。たとえば、第2図に示すキ
ーボード1のスイッチS2を押したときを想定してこの
回路の動作を説明する。スイッチS2を押したときライ
ンe2に:3゜8Vの電圧が送出され、その電圧を受信
した第3図のレベル検出用集積回路6はライン14から
信号を送出する。したがって第514に示すリレー13
はラインt!4を介してその信号を受信し、駆動される
。それによってリレー13に対応した電気機器などの制
御が行なわれる。ただし前述のリレー12〜15は、集
積回路を内蔵しているリレーであって、TTL()ラン
ジスタeトランジスターロジック)などのレベルの出力
で直接駆動することができる。また入力端子を選ぶこと
によって各種の機能が得られる。
FIG. 5 is an electrical circuit diagram of one embodiment of the relay part 3 shown in FIG. 1. line, e4 is the toggle terminal TI of relay 12
connected to. Line t! 4 is connected to the toggle terminal T2 of the relay 13. Line 15 is connected to toggle terminal T3 of relay 14, and line e6 is connected to toggle terminal T4 of relay 15. With the above circuit configuration, relays 12 to 12 are connected by signals given to lines 13 to J6.
15 are respectively driven. For example, the operation of this circuit will be explained assuming that the switch S2 of the keyboard 1 shown in FIG. 2 is pressed. When the switch S2 is pressed, a voltage of 3.8 V is sent to the line e2, and the level detection integrated circuit 6 of FIG. Therefore, relay 13 shown in No. 514
is line t! 4 and is driven. As a result, electrical equipment and the like corresponding to the relay 13 are controlled. However, the above-mentioned relays 12 to 15 are relays containing integrated circuits, and can be directly driven by an output at a TTL (transistor e transistor logic) level. Also, various functions can be obtained by selecting the input terminal.

。第6図は、第1図に示す受信部の電圧弁別回路2の他
の実施例の電気回路図である。この回路は、電気機器を
13個制御するものである。ライン12は抵抗19を介
して接地され、また抵抗2oを介してツェナーダイオー
ド26のカソードに接続される。レベル検出用集積回路
16〜18は、前述の第3図のレベル検出用集積回路6
と同じ回路構成を有するものである。ツェナーダイオー
ド26のカソードは、ラインe21を介してレベル検出
用集積回路j6に接続されろう抵抗21は、レベル検出
用集積回路16の基準電圧を与えるものである。ツェナ
ーダイオード26のアノードとツェナーダイオード25
のカソードとは接続され、その接続点はライン/22を
介してレベル検出用集積回路17に接続される。抵抗2
2はレベル検出用集積回路】7の基準電圧を与えるもの
である。
. FIG. 6 is an electric circuit diagram of another embodiment of the voltage discrimination circuit 2 of the receiving section shown in FIG. This circuit controls 13 electrical devices. Line 12 is grounded through resistor 19 and connected to the cathode of Zener diode 26 through resistor 2o. The level detection integrated circuits 16 to 18 are the level detection integrated circuit 6 of FIG.
It has the same circuit configuration as . The cathode of the Zener diode 26 is connected to the level detection integrated circuit j6 via the line e21, and the resistor 21 provides a reference voltage for the level detection integrated circuit 16. Anode of Zener diode 26 and Zener diode 25
The connection point is connected to the level detection integrated circuit 17 via line /22. resistance 2
Reference numeral 2 denotes a level detection integrated circuit 7 which provides a reference voltage.

ツェナーダイオード25のアノードは抵抗24を介して
接地され、またツェナーダイオード25のアノードはラ
インe23を介してレベル検出用集積回路18に接続さ
れる。抵抗23は、レベル検出用集積回路18の基準電
圧を与えるものである。
The anode of the Zener diode 25 is grounded via a resistor 24, and the anode of the Zener diode 25 is connected to the level detection integrated circuit 18 via a line e23. The resistor 23 provides a reference voltage for the level detection integrated circuit 18.

レベル検出用集積回路16〜18は、前述のように1.
58〜4.1Vの範囲の入力電圧を5段階に弁別する。
The level detection integrated circuits 16 to 18 are configured in 1. as described above.
The input voltage in the range of 58 to 4.1V is discriminated into five levels.

ツェナーダイオード25および26によって、レベル検
出用集積回路16は0〜411vの範囲をレベル弁別し
て5つの出力を送出する。レベル検出用集積回路17は
、4.7〜8.8vの範囲をレベル弁別して5つの出力
を送出する。レベル検出用集積回路】8は、9.4〜1
3,5Vの電圧をレベル弁別して5つの出力を送出する
。ただしレベル検出用集積回路16とレベル検出用集積
回路17との最−上位出力は、その最上位出力の上位の
出力と重なるので5)<3−2=13の出力が得られる
。抵抗19は入力電圧整合用の抵抗であって、抵抗20
はツェナーダイオード25および26の保護用の抵抗で
ある。抵抗21〜23は、レベル検出用集積回路16〜
18の出力電流調整用の抵抗である。抵抗24は負荷抵
抗である。なおプルアップ抵抗の図示は省略する。この
ような動作によって、ライン18〜/20から電気機器
を13台制御する信号がそれぞれ送出される。
The level detecting integrated circuit 16 uses the Zener diodes 25 and 26 to discriminate levels in the range of 0 to 411 volts and sends out five outputs. The level detection integrated circuit 17 discriminates levels in the range of 4.7 to 8.8V and sends out five outputs. Level detection integrated circuit】8 is 9.4 to 1
It discriminates the level of 3.5V voltage and sends out 5 outputs. However, since the most significant outputs of the level detection integrated circuit 16 and the level detection integrated circuit 17 overlap with the output above the most significant output, an output of 5)<3-2=13 is obtained. The resistor 19 is a resistor for input voltage matching, and the resistor 20
is a resistor for protecting Zener diodes 25 and 26. The resistors 21 to 23 are connected to the level detection integrated circuits 16 to 23.
18 resistors for adjusting the output current. Resistor 24 is a load resistance. Note that illustration of the pull-up resistor is omitted. Through these operations, signals for controlling 13 electrical devices are sent from lines 18 to /20, respectively.

第7図は、第1図の電圧弁別回路2のさらに他の実施例
の電気回路図である。ラインl!■には電圧Vccが与
えられる。レベル検出用集積回路27には、抵抗30を
介して基準電圧が与えられる。
FIG. 7 is an electrical circuit diagram of still another embodiment of the voltage discrimination circuit 2 of FIG. Line l! A voltage Vcc is applied to (2). A reference voltage is applied to the level detection integrated circuit 27 via a resistor 30.

キーボード1からの信号社、ライン12および抵抗29
を介してレベル検出用集積回路27に与えられる。ライ
ン/2は、抵抗28を介して接地される。レベル検出用
集積回路27の出力は、抵抗31〜35を介してライン
/!1にそれぞれ接続される。またレベル検出用集積回
路27の出力は、コンデンサ41〜45を介して出力の
ライン/24〜/28にそれぞれ接続される。またライ
ン124〜l!28は、抵抗36〜40を介しライン1
1にそれぞれ接続される。このレベル検出用集積回路2
7の出力は、コンデンサ41〜45および抵抗36〜4
1で形成される各微分回路でパルス信号に変換され、ラ
インl!24〜l!28に送出される。このような回路
は、電気機器が電源オフで、常に出力がオフになるよう
パルス制御8が行なわれる。すなわちキーボード1のキ
ーを押す毎にオン/オフ動作をくり返すトグル操作に有
効である。
Signal from keyboard 1, line 12 and resistor 29
The signal is applied to the level detection integrated circuit 27 via. Line /2 is grounded via resistor 28. The output of the level detection integrated circuit 27 is connected to the line /! through resistors 31 to 35. 1, respectively. Further, the outputs of the level detection integrated circuit 27 are connected to output lines /24 to /28 via capacitors 41 to 45, respectively. Line 124~l again! 28 is connected to line 1 through resistors 36-40.
1, respectively. This level detection integrated circuit 2
The output of 7 is connected to capacitors 41-45 and resistors 36-4.
1 is converted into a pulse signal by each differentiating circuit formed by line l! 24~l! 28. In such a circuit, pulse control 8 is performed so that the output is always off when the electrical equipment is powered off. That is, this is effective for toggle operations in which on/off operations are repeated every time a key on the keyboard 1 is pressed.

第8図は、第1図の電圧弁別回路2の他の実施例の電気
回路図である。第8図において、第7図の構成に対応す
るものは同一の参照符を付す。ライン12は抵抗46を
介してトランジスタ48のペースに接続され、またライ
ン12は抵抗29を介してトランジスタ48のコレクタ
に接続される。
FIG. 8 is an electric circuit diagram of another embodiment of the voltage discrimination circuit 2 of FIG. 1. In FIG. 8, components corresponding to those in FIG. 7 are given the same reference numerals. Line 12 is connected through resistor 46 to the pace of transistor 48, and line 12 is connected through resistor 29 to the collector of transistor 48.

トランジスタ48のベースとエミッタとにはコンデンサ
47が接続される。トランジスタ48のエミッタは接地
され、ライン!!2は抵抗28を介して接地され、また
抵抗29を介してレベル検出用集積回路27に接続され
る。ライン11には電圧Vccが与えられ、ラインI!
1は抵抗30を介してレベル検出用集積回路27に接続
される。レベル検出用集積回路27の各出力は抵抗31
〜35を介してライ/l!1にそれぞれ接続される。こ
のようにトランジスタ48を接続すれば、第7図に示す
微分用の抵抗36〜40およびコンデンサ41〜45を
省略することができ、コンデンサ46および47の調整
で適切なパルス幅を得ることができる。すなわちライン
f2に与えられる入力信号は抵抗46を介してコンデン
サ47を充電し、それによってトランジスタ48を導通
させる。したがってレベル検出用集積回路27にはパル
ス状の信号が与えられ、その出力もパルス状の信号が送
出される。これによってレベル検出用集積回路27の出
力は被制御リレーに直結することができる。第8図に示
C回路は5つの場合の出力を示しているが、このような
回路は出力数が多い場合程効果的である。
A capacitor 47 is connected between the base and emitter of the transistor 48. The emitter of transistor 48 is grounded and connected to line! ! 2 is grounded via a resistor 28 and connected to the level detection integrated circuit 27 via a resistor 29. A voltage Vcc is applied to line 11, and line I!
1 is connected to the level detection integrated circuit 27 via a resistor 30. Each output of the level detection integrated circuit 27 is connected to a resistor 31
Rye/l through ~35! 1, respectively. By connecting the transistor 48 in this way, the differentiating resistors 36 to 40 and capacitors 41 to 45 shown in FIG. 7 can be omitted, and an appropriate pulse width can be obtained by adjusting the capacitors 46 and 47. . That is, the input signal applied to line f2 charges capacitor 47 via resistor 46, thereby causing transistor 48 to conduct. Therefore, a pulsed signal is given to the level detection integrated circuit 27, and its output is also sent out as a pulsed signal. This allows the output of the level detection integrated circuit 27 to be directly connected to the controlled relay. Although the circuit C shown in FIG. 8 shows outputs in the case of five outputs, such a circuit is more effective when the number of outputs is larger.

第9図は、本発明の一実施例の停電検出回路51Aを、
含む電気回路図である。ラインl!lには、電圧Vcc
が与えられる。またラインl!lは、抵抗51および抵
抗52を介して接地される。抵抗51と抵抗52との接
続点は、トランジスタ56のベースに接続される。また
ラインI!1は、z゛イオード53アノードに接続され
る。ダイオード53のカソードは、コンデンサ54の一
端、抵抗55の一端、抵抗58の一端、およびIC(集
積回路)リレー59の各端子Sにそれぞれ接続される。
FIG. 9 shows a power failure detection circuit 51A according to an embodiment of the present invention.
It is an electrical circuit diagram including. Line l! l has a voltage Vcc
is given. Line l again! l is grounded via resistor 51 and resistor 52. A connection point between resistor 51 and resistor 52 is connected to the base of transistor 56. Line I again! 1 is connected to the z-diode 53 anode. The cathode of the diode 53 is connected to one end of a capacitor 54, one end of a resistor 55, one end of a resistor 58, and each terminal S of an IC (integrated circuit) relay 59, respectively.

ICリレー59には、ダイオード53を介して電圧Vc
cが与えられる。コンデンサ54の他端は接地され、抵
抗55の他端はトランジスタ56のコレクタに接続され
る。トランジスタ57のコレクタは抵抗58の他端に接
続され、そのベースはトランジスタ56のコレクタに接
続される。
The voltage Vc is applied to the IC relay 59 via the diode 53.
c is given. The other end of capacitor 54 is grounded, and the other end of resistor 55 is connected to the collector of transistor 56. The collector of transistor 57 is connected to the other end of resistor 58, and its base is connected to the collector of transistor 56.

トランジスタ56および57のエミッタは、それぞれ接
地される。トランジスタ57のコレクタは、ICリレー
59〜62の各端子Rに接続される。
The emitters of transistors 56 and 57 are each grounded. A collector of transistor 57 is connected to each terminal R of IC relays 59 to 62.

ラインf30〜ラインl!33には、第1図に示す電圧
弁別回路2からの信号がそれぞれ与えられる。
Line f30~line l! 33 are respectively given signals from the voltage discrimination circuit 2 shown in FIG.

ラインl!30は、ICリレー59の端子Tに接続され
、ライン/31はICリレー60の端子Tに接続される
。ライン1!32はICリレー61の端子Tに接続され
、ライン!!33はICリレー62の端子Tに接続され
る。
Line l! 30 is connected to terminal T of IC relay 59, and line /31 is connected to terminal T of IC relay 60. Line 1!32 is connected to terminal T of IC relay 61, and line !32 is connected to terminal T of IC relay 61. ! 33 is connected to terminal T of IC relay 62.

第10図は第9図に示すI CIJシレー9〜62の等
価回路図である。端子Tにパルス信号を与える毎に、2
巻線ラッチングリレーL1oはトグル動作であるオン/
オフ動作する。端子Mにパルス信号を与えると、そのパ
ルス信号がある間だけ2巻線ラッチングリレーLIOは
オン動作する。端子Sにパルス信号を与えると、2巻線
ラッチングリレーLIOはオン動作する。端子Tにパル
ス信号を与えると、2巻線ラッチングリレーLIOはオ
フ動作する。
FIG. 10 is an equivalent circuit diagram of ICIJ circuits 9 to 62 shown in FIG. Every time a pulse signal is applied to terminal T, 2
The wire-wound latching relay L1o has a toggle operation of ON/OFF.
Works off. When a pulse signal is applied to terminal M, two-winding latching relay LIO is turned on only while the pulse signal is present. When a pulse signal is applied to terminal S, two-winding latching relay LIO is turned on. When a pulse signal is applied to terminal T, two-winding latching relay LIO is turned off.

このようにトグル動作をするリレーはラッチングタイプ
が多いが、ラッチングリレーは停電時復帰しない欠点が
ある。これを防ぐために第9図に示す停電検出回路51
Aが設けられる。ライン11に与えられる電圧V c 
cが低下すると、トランジスタ56がオフし、トランジ
スタ57がオンする。これによりトランジスタ57のコ
レクタ電圧は、Ovになる。トランジスタ57のコレク
タはICリレー59〜62の各端子Rに接続されている
ので、ICリレー59〜62は全てリセット(オフ)さ
れる。コンデンサ54は、電源オフ時各ICリレー59
〜62を動作させる電荷を蓄えておくためのものである
。ダイオード53はその電荷の電源への逆流を防ぐため
のものであり、抵抗5]、、52はトランジスタ56に
適切な動作電圧を与えるためのものである。
Many relays that toggle like this are of the latching type, but latching relays have the disadvantage that they do not recover in the event of a power outage. To prevent this, a power failure detection circuit 51 shown in FIG.
A is provided. Voltage applied to line 11 V c
When c decreases, transistor 56 is turned off and transistor 57 is turned on. As a result, the collector voltage of the transistor 57 becomes Ov. Since the collector of transistor 57 is connected to each terminal R of IC relays 59-62, all IC relays 59-62 are reset (turned off). The capacitor 54 connects each IC relay 59 when the power is turned off.
This is for storing electric charge for operating the circuits 62 to 62. The diode 53 is for preventing the charge from flowing back to the power supply, and the resistors 5, 52 are for providing an appropriate operating voltage to the transistor 56.

第11図は、本発明の一実施例のパワーオンリセット回
路97を含む電気回路図である。ラインe41〜/44
には、第1図に示す電圧弁別回路2からの信号が与えら
れる。ラインI!41はR8T型クリップフロップ81
の端子Tに接続され、ラインl!42はR8T型フリッ
プフロップ82の端子Tに接続される。ラインI!43
はR8T型フリップフロップ83の端子Tに接続され、
ラインe44はR8T型フリップフロップ84の端子T
に接続される。R8T型フリップフロップ81〜84の
各端子Sには、電圧Vccが与えられる。
FIG. 11 is an electrical circuit diagram including a power-on reset circuit 97 according to an embodiment of the present invention. Line e41~/44
is given a signal from the voltage discrimination circuit 2 shown in FIG. Line I! 41 is R8T type clip flop 81
is connected to the terminal T of the line l! 42 is connected to the terminal T of the R8T type flip-flop 82. Line I! 43
is connected to the terminal T of the R8T type flip-flop 83,
Line e44 is the terminal T of the R8T type flip-flop 84.
connected to. A voltage Vcc is applied to each terminal S of the R8T type flip-flops 81-84.

パワーオンリセット回路97において、電圧VcCはコ
ンデンサ93および抵抗94を介して接地され、コンデ
ンサ93と抵抗94との接続点はダイオード95のカソ
ードとNOTゲート96の入力端子とに接続される。ダ
イオード95のアノードは接地される。NOTゲート9
6の出力端子は、R8T型フリップフロップ81〜84
の各端子Rに接続される。R8T型フリップフロップ8
1の端子Qはドライバ回路85を介してリレー89に接
続され、R8T型フリップフロップ82の端子Qはドラ
イバ回路86を介してリレー90に接続される。R8T
型フリップフロップ83の端子Qはドライバ回路87を
介してリレー91に接続され、R8T型フリップフロッ
プ84の端子Qはドライバ回路88を介してリレー92
に接続される。
In power-on reset circuit 97, voltage VcC is grounded via capacitor 93 and resistor 94, and the connection point between capacitor 93 and resistor 94 is connected to the cathode of diode 95 and the input terminal of NOT gate 96. The anode of diode 95 is grounded. NOT gate 9
6 output terminals are R8T type flip-flops 81 to 84.
is connected to each terminal R of. R8T type flip-flop 8
Terminal Q of R8T type flip-flop 82 is connected to relay 90 via driver circuit 86 . R8T
The terminal Q of the R8T type flip-flop 83 is connected to the relay 91 via the driver circuit 87, and the terminal Q of the R8T type flip-flop 84 is connected to the relay 92 via the driver circuit 88.
connected to.

この回路の動作も前記第10図で説明したように、R8
T型フリップフロップ81〜84の各端子Tにパルス信
号を与えると、リレー89はオン/オフするトグル動作
をする。R8T型フリップフロップ81〜84の端子R
に与えられるリセット信号によって、リレー89〜92
はそれぞれすセット(オフ)される。パワーオンリセッ
ト回路97は、電源オン時コンデンサ93および抵抗9
4の時定数により、NOTゲート96からリセット信号
が送出される。これによって電源オン時にリレー89〜
92はオフされる。
The operation of this circuit is also as explained in FIG.
When a pulse signal is applied to each terminal T of the T-type flip-flops 81 to 84, the relay 89 performs a toggle operation of turning on and off. Terminals R of R8T type flip-flops 81 to 84
Relays 89 to 92 are activated by a reset signal given to
are set (off). The power-on reset circuit 97 includes a capacitor 93 and a resistor 9 when the power is turned on.
A time constant of 4 causes the NOT gate 96 to send a reset signal. By this, when the power is turned on, the relay 89 ~
92 is turned off.

なお以−1=説明した実施例におけるラッチングリレー
などは、オン/オフ動作をさせる端子の接続を入れ換え
て、オン/オフ動作を逆になるようにしてもよい。
In the latching relay and the like in the embodiments described below, the on/off operation may be reversed by switching the connections of the terminals that perform the on/off operation.

効 果 以上のように本発明によれば、回路構成が簡単になり、
低価格にもつながる。
Effects As described above, according to the present invention, the circuit configuration is simplified and
This also leads to lower prices.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例の全体の構成を示すブロック
図、第2図は第1図のキーボード1の電気回路図、第3
図は第2図の電圧弁別回路2の一実施例の電気回路図、
第4図は第3図のレベル検出用集積回路6の等価回路図
、第5図は第1図のリレ一部3の一実施例の電気回路図
、第6図は第1図の電圧弁別回路2の他の実施例の電気
回路図、第7図は第1図の電圧弁別回路2のさらに他の
実施例の電気回路図、第8図は電圧弁別回路2の他の実
施例の電気回路図、第9図は本発明の一実施例の停電検
出回路51Aを含む電気回路図、第10図は第9図の集
積回路リレー59〜62の等価回路図、第11図は本発
明の一実施例のパワーオンリセット回路97を含む電気
回路図である。 1・・・キーボード、2・・・電圧弁別回路、3・・・
リレ一部、6・・・レベル検出用集積回路、25.2’
6・・・ツェナダイオード、36〜40.46・・・抵
抗、41〜45.47・・・コンデンサ、48・・・ト
ランジスタ、51A・・・停電検出回路、97・・・パ
ワーオンリセット回路、l 1+ l 2・・・ライン
代理人 弁理士 西教圭一部 第1図 第2図 第3図 lI 6 図 第7図 第8図 8 第9図 第10図 11図
FIG. 1 is a block diagram showing the overall configuration of an embodiment of the present invention, FIG. 2 is an electric circuit diagram of the keyboard 1 shown in FIG. 1, and FIG.
The figure is an electric circuit diagram of an embodiment of the voltage discrimination circuit 2 shown in FIG.
4 is an equivalent circuit diagram of the level detection integrated circuit 6 of FIG. 3, FIG. 5 is an electric circuit diagram of an embodiment of the relay part 3 of FIG. 7 is an electric circuit diagram of another embodiment of the voltage discrimination circuit 2 shown in FIG. 1; FIG. 8 is an electric circuit diagram of another embodiment of the voltage discrimination circuit 2 of FIG. The circuit diagram, FIG. 9 is an electric circuit diagram including a power failure detection circuit 51A according to an embodiment of the present invention, FIG. 10 is an equivalent circuit diagram of integrated circuit relays 59 to 62 of FIG. 9, and FIG. FIG. 2 is an electrical circuit diagram including a power-on reset circuit 97 according to one embodiment. 1...Keyboard, 2...Voltage discrimination circuit, 3...
Relay part, 6... Level detection integrated circuit, 25.2'
6... Zener diode, 36-40.46... Resistor, 41-45.47... Capacitor, 48... Transistor, 51A... Power failure detection circuit, 97... Power-on reset circuit, l 1+ l 2...Line agent Patent attorney Kei Nishi Part Figure 1 Figure 2 Figure 3 Figure lI 6 Figure 7 Figure 8 Figure 8 Figure 9 Figure 10 Figure 11

Claims (5)

【特許請求の範囲】[Claims] (1)キーに個別的に対応した予め設定されたルの信号
を送出するキー人力手段と、そのキー人力手段からの信
号の予め設定されたレベル範囲、と応じてレベル弁別し
出力信号を送出する電圧弁別手段と、その電圧弁別手段
からの個別的に対応した信号によって駆動するスイッチ
手段とを含む遠隔制御回路において、 前記電圧弁別手段を集積回路で構成することを特徴とす
る遠隔制御回路。
(1) A key human power means that sends a preset signal corresponding to each key individually, and a level discrimination based on a preset level range of the signal from the key human power means and sends an output signal. What is claimed is: 1. A remote control circuit comprising a voltage discriminating means for discriminating voltage, and a switching means driven by individually corresponding signals from the voltage discriminating means, characterized in that the voltage discriminating means is constituted by an integrated circuit.
(2)前記キー人力手段からの信号レベルを定電圧素子
の直列回路により分割し、その分割された信号をそれぞ
れレベル弁別する複数の電圧弁別手段を有することを特
徴とする特許請求の範囲第1項記載の遠隔制御回路。
(2) The first aspect of the present invention is characterized in that the signal level from the key human power means is divided by a series circuit of constant voltage elements, and a plurality of voltage discrimination means are provided for discriminating the level of each of the divided signals. Remote control circuit as described in section.
(3)前記電圧弁別手段の出力信号を微分回路で微分し
、パルス信号に変換してからスイッチ手段に与えること
を特徴とする特許請求の範囲第1項記載の遠隔制御回路
(3) The remote control circuit according to claim 1, wherein the output signal of the voltage discrimination means is differentiated by a differentiating circuit, converted into a pulse signal, and then applied to the switch means.
(4)停電を検出し、前記スイッチ手段を動作前の状態
に戻す停電検出手段を有することを特徴とする特許請求
の範囲第1項記載の遠隔制御回路。
(4) The remote control circuit according to claim 1, further comprising power failure detection means for detecting a power failure and returning the switch means to the state before operation.
(5)電源投入時、前記スイッチ手段を動作前の状態に
戻すパワーオンリセット手段を有することを特徴とする
特許請求の範囲第1項記載の遠隔制御回路。
(5) The remote control circuit according to claim 1, further comprising power-on reset means for returning the switch means to the state before operation when the power is turned on.
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