JPS5991031U - エンフアシス回路 - Google Patents

エンフアシス回路

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Publication number
JPS5991031U
JPS5991031U JP18820382U JP18820382U JPS5991031U JP S5991031 U JPS5991031 U JP S5991031U JP 18820382 U JP18820382 U JP 18820382U JP 18820382 U JP18820382 U JP 18820382U JP S5991031 U JPS5991031 U JP S5991031U
Authority
JP
Japan
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emphasis circuit
transistor
cut
transistors
operates
Prior art date
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Granted
Application number
JP18820382U
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English (en)
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JPS643224Y2 (ja
Inventor
町田　征彦
福田　督也
Original Assignee
ソニー株式会社
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Publication date
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  • Television Signal Processing For Recording (AREA)
  • Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
  • Networks Using Active Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図及び第２図は従来のプリエンファシス回路の接続
図及びその特性を示すグラフ、第３図及び第４図は従来
のディエンファシス回路を一例のブロック図及びその他
の例の接続図、第５図はこの考案の一実施例の接続図、
第６図はこの考案の他の実施例の接続図、第７図及び第
８図はこの考案に使用できる非線形インピーダンス素子
の一例及び他の例の接続図である。 １・・・・・・記録信号の入力端子、２・・・・・・記
録信号の出力端子、４・・・・・・電源端子、８・・・
・・・共振及び非線形回路、９・・・・・・再生信号の
入力端子、１０・・・・・・再生信号の出力端子、１２
・・・・・・ＮＰＮ　）ランジスタ、１３・・・・・・
ＰＮＰトランジスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 相補的な特性を有する２個のトランジスタの一方のトラ
    ンジスタのコレクタと他方のトランジスタのエミッタと
    が結合され、この結合点に時定数素子が接続され、上記
    一方のトランジスタがプリエンファシス回路として動作
    する場合は、上記他方のトランジスタがカットオフし、
    上記他方のトランジスタがディエンファシス回路として
    動作す・　　る場合は、上記一方の１〜ランジスタがカ
    ットオフするように、切替えられることを特徴とするエ
    ンファシス回路。
JP18820382U 1982-12-13 1982-12-13 エンフアシス回路 Granted JPS5991031U (ja)

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JP18820382U JPS5991031U (ja) 1982-12-13 1982-12-13 エンフアシス回路

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JPS5991031U true JPS5991031U (ja) 1984-06-20
JPS643224Y2 JPS643224Y2 (ja) 1989-01-27

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