JPS5967787A - Hard copying machine - Google Patents

Hard copying machine

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Publication number
JPS5967787A
JPS5967787A JP57177818A JP17781882A JPS5967787A JP S5967787 A JPS5967787 A JP S5967787A JP 57177818 A JP57177818 A JP 57177818A JP 17781882 A JP17781882 A JP 17781882A JP S5967787 A JPS5967787 A JP S5967787A
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JP
Japan
Prior art keywords
color
line buffer
circuit
stored
signal
Prior art date
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Pending
Application number
JP57177818A
Other languages
Japanese (ja)
Inventor
Koichiro Jinnai
陣内 孝一郎
Kazumi Ishima
和己 石間
Tadashi Ito
正 伊東
Toshibumi Kato
俊文 加藤
Takanao Koike
孝尚 小池
Toshiharu Murai
俊晴 村井
Takao Fukazawa
深沢 孝男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
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Filing date
Publication date
Application filed by Ricoh Co Ltd filed Critical Ricoh Co Ltd
Priority to JP57177818A priority Critical patent/JPS5967787A/en
Publication of JPS5967787A publication Critical patent/JPS5967787A/en
Pending legal-status Critical Current

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  • Ink Jet (AREA)
  • Particle Formation And Scattering Control In Inkjet Printers (AREA)
  • Digital Computer Display Output (AREA)
  • Television Signal Processing For Recording (AREA)

Abstract

PURPOSE:To attain the hard copy of a still picture of a TV signal to a color ink jet recorder, by providing the 1st buffer memory possible for write in high speed and the 2nd buffer memory accessible in a low speed, and synchronizing the TV signal and the ink jet recorder. CONSTITUTION:Converted C, M, Y signals are coded in response to the level of an input signal with 6-bit A/D converting circuits 3a-3c and stored at each color in the 1st memories 4a-4c. The Y, M, C signals are converted into Y, M, C, BLK dot information by designating the matrix pattern and stored in the 2nd line buffer memories 10a-10d at each color. When the dot information for one line's share is stored, a carriage mounting the Y, M, C, BLK heads (not shown) is run and the print control is attained in response to the content of line buffer. When the printing is finished, the data transfer processing from the 1st line buffer to the 2nd line buffer is attained during the carriage return.

Description

【発明の詳細な説明】 技術分野 本発明は、TV信号の静止画を記録するハードコピー装
置、より詳細には、ハードコピー装置としてカラーイン
クジェット記録装置を用いた場合におけるTV信号とイ
ンクジェット記録装置間の同Iυ」化に関する。
Detailed Description of the Invention Technical Field The present invention relates to a hard copy device that records still images of a TV signal, and more particularly, to a hard copy device that records still images of a TV signal. Concerning the conversion of

従来技術 TV信号をデジタル化する場合、縦、横比を1対1にす
るためには、IHを12.85MHzでサンプリングす
る必要がある。一方、このTV信号の静止画をカラーイ
ンクジェット記録装置で7・−トコピーする場合、イン
クジェット記録装置の励振周波数は通常66KHz程度
であるから、TV信号とインクジェット記録装置の同期
化が問題となる。
When digitizing a conventional TV signal, IH must be sampled at 12.85 MHz in order to have a 1:1 aspect ratio. On the other hand, when a still image of the TV signal is copied by a color inkjet recording device, the excitation frequency of the inkjet recording device is usually about 66 kHz, so synchronization of the TV signal and the inkjet recording device becomes a problem.

目的 本発明は、上述のごとき従来技術の問題点を解決し、T
V信号の静止画をカラーインクジェット記録装置にてノ
・−トコピーし得るようにしたものである。
Purpose The present invention solves the problems of the prior art as described above, and
This allows a still image of the V signal to be note-copied using a color inkjet recording device.

実施例 第1図及び第2図は、本発明の一実施例を説明するため
の電気回路図で、図中、1は色再生回路、2は色変換回
路、3a〜3CはA/D変換回路、4a〜4cはバッフ
ァメモリー、5は色分離回路、6はコントロール回路、
7a〜7Cは中間補正回路、8はマトリックス選択回路
、9a〜9dはマトリックスバターン、10a〜10 
dはライン・くラフアメモリ−,11はクロックツζル
ス発生器、12は分周回路、13はパルス−サイン波変
換回路、14は増幅器、15は位相検索回路、16は荷
′亀回路、17はD/A変換回路、18は増幅器である
。なお、第2図において、パルス−サイン波変換回路1
3及び増幅器14はBLKヘッドに関してのみ記載され
ているが、C−Yヘッドも同、嵌にh・構成されており
、また、位相検索回路15乃至増幅器18はC荷電電極
に関してのみ記載されているが、BLK−M荷電電極に
対しても同様に構成されていることは容易に理解されよ
う。
Embodiment FIGS. 1 and 2 are electrical circuit diagrams for explaining an embodiment of the present invention, in which 1 is a color reproduction circuit, 2 is a color conversion circuit, and 3a to 3C are A/D conversion circuits. circuits, 4a to 4c are buffer memories, 5 is a color separation circuit, 6 is a control circuit,
7a to 7C are intermediate correction circuits, 8 is a matrix selection circuit, 9a to 9d are matrix patterns, 10a to 10
d is a line/clamp memory, 11 is a clock pulse generator, 12 is a frequency dividing circuit, 13 is a pulse-to-sine wave conversion circuit, 14 is an amplifier, 15 is a phase search circuit, 16 is a load circuit, and 17 is a The D/A conversion circuit 18 is an amplifier. In addition, in FIG. 2, the pulse-sine wave conversion circuit 1
3 and amplifier 14 are described only for the BLK head, but the C-Y head also has the same configuration, and the phase search circuit 15 to amplifier 18 are described only for the C charged electrode. It will be readily understood that the configuration is similar for the BLK-M charging electrode.

次に、上記第1図及び第2図の動作について説明する。Next, the operations shown in FIGS. 1 and 2 will be explained.

(1)1本実施例においては、TVの一画素は、プリン
ター上に4×4のドツトマトリックスで表現される。
(1) In this embodiment, one pixel of the TV is expressed as a 4×4 dot matrix on the printer.

(2)、Jず、TV信号から同期信号が分間され、色■
」う生回路1によってR(赤)、G(緑)、B(宵)の
信号が分91#、される。
(2), the synchronization signal is separated from the TV signal, and the color
91#, R (red), G (green), and B (evening) signals are generated by the decoder circuit 1.

(3)5次いで、色変換回路2によって前記RXG %
Bの信号がそれぞれ補色の関係にあるC(シアンχM(
マゼンタ)、Y(イエロー)の信号に変換される。
(3) 5 Then, the color conversion circuit 2 converts the RXG%
C (cyan χM(
(magenta) and Y (yellow) signals.

(4)、変換されたC、M、Yの信号は6ビツトのN勺
変換回路3a〜3Cにより、入力信号のレベルに応じて
コード化される。ただし、この時の変換周波数は12.
85 MHzである。
(4) The converted C, M, and Y signals are encoded by the 6-bit Nx conversion circuits 3a to 3C according to the level of the input signal. However, the conversion frequency at this time is 12.
85 MHz.

(5)、上記コード化された信号は、第1ノ(ツファメ
モIJ −4B〜4Cに各色毎に記憶される。
(5) The above coded signals are stored in the first part (Tsufamemo IJ-4B to 4C) for each color.

(6)、記憶された内容は、読み出し信号によって読み
出され、読み出された6ビツト×3のコードは中間調補
正回路7a〜7dでインクジェットのマトリックス特性
に合った補正が加えられ、4ピツトのコードに変換され
る。
(6) The stored contents are read out by a readout signal, and the readout 6-bit x 3 code is subjected to correction in accordance with the matrix characteristics of the inkjet in halftone correction circuits 7a to 7d, and is then converted into a 4-bit code. is converted to the code of

(7)、Y、M、Cの各4ビツトコードは、マトリック
ス選択回路8に送られる。このマトリックス選択回路は
ROMで構成されておp、4X3=1−2ビツトのアド
レスによって所定のマトリックスノくターンのアドレス
が出力されるようになっている。
(7), Y, M, and C 4-bit codes are sent to the matrix selection circuit 8. This matrix selection circuit is constituted by a ROM, and is configured to output the address of a predetermined matrix turn using a 4.times.3=1-2 bit address.

即ち、Y、M、Cの各4ビツトのレベルに応じて所定の
マトリックスパターン9a〜9dが選択されることにな
る(このマトリックスパターンの単色の場合の例を第3
図に示す)。この選択されたマトリックスパターンの組
合せによって色が表現され、例えば、YXM、Cが等量
である場合にはBLK(黒)のマトリックスパターンが
選択され、黒が印字される。
That is, predetermined matrix patterns 9a to 9d are selected according to the levels of each of the four bits of Y, M, and C (an example of a single color matrix pattern is shown in the third example).
(shown in figure). A color is expressed by a combination of the selected matrix patterns. For example, if YXM and C are equal in amount, a BLK (black) matrix pattern is selected and black is printed.

(8)、Y、M、Cの信号は、マトリックスパターンを
指定することによって、Y、MXC,BLKのドツト情
報に変換され、各色毎に第2ラインバツフアメモIJ 
−10a〜10 dに各色毎に格納される。
(8) The Y, M, and C signals are converted into Y, MXC, and BLK dot information by specifying a matrix pattern, and a second line buffer memory IJ is created for each color.
-10a to 10d are stored for each color.

この時、4×4のマトリックスの縦4ドツトがパラレル
に第2ラインバツフアに記憶される。これが8ライン分
(TV信号で)格納されると、第2ラインバツフア上で
は32ドツト×1行分のデータが格納されたことになる
。この時の第1ラインバツフアの睨み出し周波数は16
.5KHzとな9、中間調補正回路及びマトリックス回
路は低速駆動が可能となり、ROIVtが安価となる。
At this time, the four vertical dots of the 4×4 matrix are stored in parallel in the second line buffer. When this data is stored for 8 lines (as a TV signal), data for 32 dots x 1 line is stored on the second line buffer. The glare frequency of the first line buffer at this time is 16
.. At 5 KHz, the halftone correction circuit and matrix circuit can be driven at low speed, resulting in low cost ROI.

(9)、1行分のドツト情報が格納されると、Y、M。(9) When one line of dot information is stored, Y, M.

C,BLKのヘッドを搭載した図示しないキャリッジが
走行じ、ラインバッファの内容に応じて印字制御が行な
われる。
A carriage (not shown) carrying C and BLK heads moves, and printing is controlled according to the contents of the line buffer.

(10) 、この印字動作中は、第1ラインバツフアは
印字に寄与しないので、この間に、TV信号をA/D変
換し、変換したデータを第1ラインバツフアに格納する
(10) During this printing operation, the first line buffer does not contribute to printing, so during this period, the TV signal is A/D converted and the converted data is stored in the first line buffer.

01)、印字動作が終了すると、キャリッジリターン中
に第1ラインバツフアから第2ラインバツフアへのデー
タ転送処理が行なわれる。
01), when the printing operation is completed, data transfer processing from the first line buffer to the second line buffer is performed during carriage return.

効果 以上の説明から明らかなように、本発明によると、高速
のラインバッファは640X8ライン分で構成でき、低
速のラインバッファのみ2560X32の構成となシ、
安価となる。また、中間調補正回路乃至マトリックス回
路までの処理スピードが低速で済むため、安価となる。
Effects As is clear from the above explanation, according to the present invention, the high-speed line buffer can be configured with 640×8 lines, and the low-speed line buffer can be configured with 2560×32 lines.
It will be cheaper. In addition, since the processing speed from the halftone correction circuit to the matrix circuit is low, the cost is low.

更には、TV信号とプリンターとの同期を確実に行なう
ことができる。
Furthermore, it is possible to reliably synchronize the TV signal and the printer.

また、プリンターの待ち時間がないので、印字スビード
が低下することもない等の利点がある。
Furthermore, since there is no waiting time for the printer, there are advantages such as no reduction in printing speed.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図及び第2図は、本発明の一実施例を説明するため
の′螺気回路図、第3図は、マトリックスパターンの一
例を示す図である。 1・・・色町生回路、2・・色変換回路、3a〜3c・
・・A/D変換回路、4a〜4c ・バッファメモリ、
5・・・色分離回路、6・・コントロール回路、7a〜
7c・中間調補正回路、8・・マ) IJラックス択回
路、9a〜9d・・マトリックスパターン発生回路、1
0 a〜10 d・・・ラインバッファ、11・・クロ
ックパルス発振器、12・分周回路、13・・パルス−
サイン波変換回路、14 ・増幅器、15・・位相検索
回路、16・荷電回路、17・D/A変換回路、18・
・・増幅器。 特許出願人   株式会社リコー 第 j 図 第2図 529− 43 図 第1頁の続き 0発 明 者 村井俊晴 東京都大田区中馬込1丁目3番 6号株式会社リコー内 0発 明 者 深沢孝男 東京都大田区中馬込1丁目3番 6号株式会社リコー内
1 and 2 are spiral circuit diagrams for explaining an embodiment of the present invention, and FIG. 3 is a diagram showing an example of a matrix pattern. 1... Iromachi raw circuit, 2... Color conversion circuit, 3a to 3c.
・・A/D conversion circuit, 4a to 4c ・Buffer memory,
5... Color separation circuit, 6... Control circuit, 7a~
7c・Halftone correction circuit, 8...Ma) IJ Lux selection circuit, 9a-9d...Matrix pattern generation circuit, 1
0 a to 10 d... Line buffer, 11... Clock pulse oscillator, 12... Frequency divider circuit, 13... Pulse -
Sine wave conversion circuit, 14・Amplifier, 15・Phase search circuit, 16・Charging circuit, 17・D/A conversion circuit, 18・
··amplifier. Patent Applicant Ricoh Co., Ltd. Figure 2 Figure 2 529-43 Continued from Figure 1 Page 0 Inventor Toshiharu Murai Inside Ricoh Co., Ltd., 1-3-6 Nakamagome, Ota-ku, Tokyo Inventor Takao Fukasawa Tokyo Inside Ricoh Co., Ltd., 1-3-6 Nakamagome, Ota-ku, Tokyo

Claims (1)

【特許請求の範囲】[Claims] TV信号の静止画像を記録するノ・−トコピー装置にお
いて、両速で書込み可能な第1バツフアメモリーと、低
速でアクセス可能な第2バツフアメモリーとを有し、印
字動作中は前記第1バツフアメモリーに南込み、印字動
作終了後、前記第1バツフアメモリーから第2バツフア
メモリーへデータを転送するようにしたことを特徴とす
るノ・−トコピー装置。
A notebook copying device for recording still images of TV signals has a first buffer memory that can be written at both speeds and a second buffer memory that can be accessed at a low speed. A notebook copying apparatus characterized in that data is transferred from said first buffer memory to a second buffer memory after the printing operation is completed.
JP57177818A 1982-10-10 1982-10-10 Hard copying machine Pending JPS5967787A (en)

Priority Applications (1)

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JP57177818A JPS5967787A (en) 1982-10-10 1982-10-10 Hard copying machine

Applications Claiming Priority (1)

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JPS5967787A true JPS5967787A (en) 1984-04-17

Family

ID=16037631

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JP (1) JPS5967787A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4752823A (en) * 1984-06-12 1988-06-21 Nippon Avionics Co., Ltd. Image recording apparatus for generating a still image from a video signal

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4752823A (en) * 1984-06-12 1988-06-21 Nippon Avionics Co., Ltd. Image recording apparatus for generating a still image from a video signal

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