JPS5967042U - タイマ装置 - Google Patents

タイマ装置

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Publication number
JPS5967042U
JPS5967042U JP16083182U JP16083182U JPS5967042U JP S5967042 U JPS5967042 U JP S5967042U JP 16083182 U JP16083182 U JP 16083182U JP 16083182 U JP16083182 U JP 16083182U JP S5967042 U JPS5967042 U JP S5967042U
Authority
JP
Japan
Prior art keywords
time limit
limit circuit
timer device
thyristor
parallel
Prior art date
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Pending
Application number
JP16083182U
Other languages
English (en)
Inventor
雅一 田口
Original Assignee
オムロン株式会社
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Filing date
Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来のタイマ装置を示す回路図、第2図はこの
考案の実施例であるタイマ装置を示す回路図、第3図は
従来および同実施例のタイマ装置における保持電流値一
温度特性図、第4図は従来のタ、イマ装置におけるブレ
ークオーバ電圧−オフ電圧上昇率特性図、第5図は同実
施例のタイマ装置における合成抵抗の抵抗値一温度特性
を示す抵抗値一温度特性図である。 1・・・限時回路、2・・・SCR,R3・・・固定抵
抗、7・・・サーミスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 限時回路と、その限時回路に並列に接続されるとともに
    、ゲート端子がその限時回路の出力端子に接続されたサ
    イリスタと、そのサイリスタのゲートと主電極との間に
    接続された保持電流設定用固定抵抗とを備え、前記限時
    回路のタイムアツプ時に前記サイリスタがオンになるこ
    とにより、前記限時回路に直列に接続した負荷に一定電
    流が供給されるタイマ装置において、前記保持電流設定
    用固定抵抗にサーミスタを並列接続したことを特徴とす
    るタイマ装置。
JP16083182U 1982-10-23 1982-10-23 タイマ装置 Pending JPS5967042U (ja)

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JP16083182U JPS5967042U (ja) 1982-10-23 1982-10-23 タイマ装置

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JP16083182U JPS5967042U (ja) 1982-10-23 1982-10-23 タイマ装置

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JPS5967042U true JPS5967042U (ja) 1984-05-07

Family

ID=30353636

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