JPS5956597U - digital clock - Google Patents

digital clock

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Publication number
JPS5956597U
JPS5956597U JP15193182U JP15193182U JPS5956597U JP S5956597 U JPS5956597 U JP S5956597U JP 15193182 U JP15193182 U JP 15193182U JP 15193182 U JP15193182 U JP 15193182U JP S5956597 U JPS5956597 U JP S5956597U
Authority
JP
Japan
Prior art keywords
display
day
segments
supplied
minute
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP15193182U
Other languages
Japanese (ja)
Inventor
秦 茂樹
清水 竹彦
Original Assignee
カルソニックカンセイ株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by カルソニックカンセイ株式会社 filed Critical カルソニックカンセイ株式会社
Priority to JP15193182U priority Critical patent/JPS5956597U/en
Publication of JPS5956597U publication Critical patent/JPS5956597U/en
Pending legal-status Critical Current

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Landscapes

  • Electric Clocks (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来例におけるデジタル表示器を示した正面図
、第2図はその表示器を駆動するための駆動回路のブロ
ック図、第3図及び第4図はその表示器による時刻モー
ド及びストップウォッチモード選択時における表示の一
例を示した正面図、第5図はこの考案からなる一実施例
におけるデジタル表示器を示した正面図、第6図はその
表示器を駆動するための駆動回路の要部ブロック図、第
7図及び第8図はその表示器による時刻モード及びスト
ップウォッチモード選択時における表示の一例を示した
正面図、第9図はこの考案からなる他の実施例における
デジタル表示器を示した正面図、第10図はその表示器
を駆動するため駆動回路の要部ブロック図、第11図及
び第12図はその表示器による時刻モード及びストップ
ウォッチモード選択時における表示の一例を示す正面図
である。
Fig. 1 is a front view of a conventional digital display, Fig. 2 is a block diagram of a drive circuit for driving the display, and Figs. 3 and 4 show the time mode and stop mode of the display. FIG. 5 is a front view showing an example of the display when watch mode is selected, FIG. 5 is a front view showing a digital display in an embodiment of this invention, and FIG. A block diagram of the main parts, FIGS. 7 and 8 are front views showing an example of the display when the time mode and stopwatch mode are selected, and FIG. 9 is a digital display in another embodiment of this invention. 10 is a block diagram of the main part of the drive circuit for driving the display, and FIGS. 11 and 12 are examples of the display when time mode and stopwatch mode are selected by the display. FIG.

Claims (3)

【実用新案登録請求の範囲】[Scope of utility model registration request] (1)月・日・時・分又は分・秒を選択的に表示可能な
数字式表示部21と、少なくとも7個のセグメントから
なり7曜又は10分の1秒台を選択的に表示可能なセグ
メント式表示部28゜29とを有するデジタル表示器1
を備え、かつ前記数字式表示部21に分・秒表示信号が
供給されるストップウォッチモードが選択されていると
きに、前記セグメント式表示部28.29に曜日表示信
号に代えて10分の1秒台表示信号を選択供給する制御
回路91.91’を備えたことを特徴とするデジタル時
計。
(1) A numeric display section 21 that can selectively display the month, date, hour, minute or minute and second, and is made up of at least 7 segments and can selectively display the 7th day of the week or 1/10th of a second. A digital display 1 having a segment type display section 28° 29
and when the stopwatch mode is selected in which minute and second display signals are supplied to the numerical display section 21, a tenth display signal is displayed on the segment display sections 28 and 29 instead of the day of the week display signal. A digital timepiece characterized by comprising a control circuit 91,91' for selectively supplying a seconds display signal.
(2)前記セグメント式表示部28は互に同形の9個の
セグメントからなり、かつ前記制御回路91は、前記数
字式表示部21に月・日表示信号が供給される日付モニ
ド又は時・分表示信号が供給される時刻モードが選択さ
れているときに前記9個のセグメントのうち7個のセグ
メントで曜日表示を行うと共に、前記数字式表示部21
に分・秒表示信号が供給されるストップウォッチモード
が選択されているときに前記9個のセグメント全部で1
0分−の1秤台表示を行うことを特徴とする実用新案登
録請求の範囲第1項記載のデジタル時計。
(2) The segment type display section 28 is composed of nine segments of the same shape, and the control circuit 91 is configured to display a date monitor or an hour/minute display signal to which month/day display signals are supplied to the numerical display section 21. When the time mode in which the display signal is supplied is selected, seven of the nine segments display the day of the week, and the numerical display section 21
When the stopwatch mode is selected, in which the minutes and seconds display signals are supplied to the
The digital clock according to claim 1 of the utility model registration, characterized in that it displays a scale stand displaying 0 minutes.
(3)前記セグメント式表示部29は互に異なる2種類
の大きさ又は形状に区分された7個のセグメントからな
り、かつ前記制御回路91′は、前記数字式表示部21
に月・日表示信号が供給される日付モード又は時・分表
示信号が供給される時刻モードが選択されているときに
前記7個のセグメントで曜日表示を行うと共に、前記数
字式表示部21に分・秒表示信号が供給されるストップ
咬オツチモードが選択されているときに、前記7個のセ
グメントのうちの一方の種類のセグメントを10分の1
秒の複数倍の秒数に応対させ他方の種類のセグメントを
10分の1、秒に対応させることにより、7個のセグメ
ント全部又は一部で10分の1秤台表示を行うことを特
徴とする実用新案登録請求の範囲第1項記載のデジタル
時計。     ゛
(3) The segment type display section 29 is composed of seven segments divided into two different sizes or shapes, and the control circuit 91' is connected to the numerical display section 21.
When the date mode in which month/day display signals are supplied or the time mode in which hour/minute display signals are supplied is selected, the seven segments display the day of the week, and the numerical display section 21 displays the day of the week. When a stop button mode is selected in which a minute/second display signal is supplied, one type of segment among the seven segments is set to 1/10.
The feature is that by making the other type of segment correspond to a number of seconds that is multiple times a second and making the other type of segment correspond to a tenth of a second, all or some of the seven segments can be displayed as a tenth of a scale. A digital watch according to claim 1 of the utility model registration claim.゛
JP15193182U 1982-10-06 1982-10-06 digital clock Pending JPS5956597U (en)

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JP15193182U JPS5956597U (en) 1982-10-06 1982-10-06 digital clock

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JP15193182U JPS5956597U (en) 1982-10-06 1982-10-06 digital clock

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Publication Number Publication Date
JPS5956597U true JPS5956597U (en) 1984-04-13

Family

ID=30336542

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JP15193182U Pending JPS5956597U (en) 1982-10-06 1982-10-06 digital clock

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