JPS5953539U - 表示装置 - Google Patents

表示装置

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JPS5953539U
JPS5953539U JP14862182U JP14862182U JPS5953539U JP S5953539 U JPS5953539 U JP S5953539U JP 14862182 U JP14862182 U JP 14862182U JP 14862182 U JP14862182 U JP 14862182U JP S5953539 U JPS5953539 U JP S5953539U
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JP
Japan
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shift register
integer
display device
loop
series
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Application number
JP14862182U
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JPH0240592Y2 (ja
Inventor
近藤　郡治
Original Assignee
日本ビクター株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の表示装置の回路を示す回路図、第２図イ
および第２図口は従来の表示装置の発光　　　　・素子
の配置を示す図、第３図は表示装置に用いられるシフト
レジスタの出力のタイミングダイヤグラム、第４図は本
考案の第１実施例の回路を示す回路図、第５図はその発
光素子の配置を示す図、第６図は本考案の第２実施例の
回路を示す回路図、第７図はその発光素子の配置を示す
図である。 １・・・シフトレジスタ、２・・・電源端子、Ｑ□〜Ｑ
。 ・・・シフトレジスタ出力端子、Ｒ□、Ｒ２，Ｒ３・・
・抵抗、Ｄ１〜Ｄ１□・・・発光ダイオード。

Claims (1)

    【実用新案登録請求の範囲】
  1. 時系列的にＮビットのデジタル信号を出力するシフトレ
    ジスタと、ループ状に略等間隔で配置され、ループ上に
    Ｎ個（但し、Ｎは４以上の整数）毎に配置されたＭ個（
    但し、Ｍは２以上の整数）からなる群がそれぞれ前記シ
    フトレジスタの同一出力端子に直列接続され、前記シフ
    トレジスタの出力により同時点灯し、前記Ｍ個からなる
    群ごとに順次点滅するＮｘＭ個の発光素子とからなる表
    示装置。
JP14862182U 1982-09-30 1982-09-30 表示装置 Granted JPS5953539U (ja)

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JP14862182U JPS5953539U (ja) 1982-09-30 1982-09-30 表示装置

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JP14862182U JPS5953539U (ja) 1982-09-30 1982-09-30 表示装置

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Publication Number Publication Date
JPS5953539U true JPS5953539U (ja) 1984-04-07
JPH0240592Y2 JPH0240592Y2 (ja) 1990-10-30

Family

ID=30330145

Family Applications (1)

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JP14862182U Granted JPS5953539U (ja) 1982-09-30 1982-09-30 表示装置

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5413247A (en) * 1977-06-30 1979-01-31 Ibm Zero offset compensator

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5413247A (en) * 1977-06-30 1979-01-31 Ibm Zero offset compensator

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Publication number Publication date
JPH0240592Y2 (ja) 1990-10-30

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