JPS5947890B2 - Channel selection device - Google Patents

Channel selection device

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JPS5947890B2
JPS5947890B2 JP13294877A JP13294877A JPS5947890B2 JP S5947890 B2 JPS5947890 B2 JP S5947890B2 JP 13294877 A JP13294877 A JP 13294877A JP 13294877 A JP13294877 A JP 13294877A JP S5947890 B2 JPS5947890 B2 JP S5947890B2
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channel selection
channel
circuit
output terminal
tuning
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和昭 真弓
良明 大松
恭弘 安細
義一 坪井
和美 河島
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Matsushita Electric Industrial Co Ltd
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  • Channel Selection Circuits, Automatic Tuning Circuits (AREA)

Description

【発明の詳細な説明】 本発明は、カウンタを用いて選局チャンネルを選択する
ようにした選局装置に関し、共通の回路素子を用いて順
次選局動作にも直接選局動作もすることができる装置を
提供するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a channel selection device that uses a counter to select a channel, and is capable of performing both sequential channel selection and direct channel selection using common circuit elements. The purpose is to provide a device that can do this.

テレビジョン受像機において選局チャンネルを選択する
方式として、選局時にカウンタにパルスを加えてこれを
計数させ、その計数出力によって可変抵抗器を選択して
選局電圧を切り換える方式のものがある。
As a method for selecting a channel in a television receiver, there is a method in which a pulse is applied to a counter at the time of channel selection, the pulse is counted, and a variable resistor is selected based on the counted output to switch the channel selection voltage.

このような装置においては、その選局動作の態様として
、現在選局しでいるチャンネルから順次1チヤンネルづ
つアップ方向もしくはダウン方向にチャンネルを切換え
る順次選局と、現在選局しているチャンネルに関係なく
次に選局したいチャンネルを直接指定して選択する直接
選局との2つが考えられ、用途に応じていずれかを選択
的に使用する必要がある。
In such a device, the mode of channel selection operation is sequential tuning, in which channels are switched up or down one channel at a time, starting from the currently tuned channel, and channel selection is performed in a sequential manner, in which channels are switched up or down one channel at a time, starting from the currently tuned channel. There are two possible methods: direct channel selection, in which you directly specify and select the channel you want to tune next, and it is necessary to selectively use one of them depending on the purpose.

ところが、この2つの選局動作はカウンタの制御態様が
異なるので通常にはそれぞれに応じた別々の回路を独立
しで構成する必要があり、そのために回路素子等の品種
数が増加してコスト高になってしまうものと考えられて
いた。
However, since these two channel selection operations require different counter control methods, it is usually necessary to configure separate circuits for each operation, which increases the number of types of circuit elements and increases costs. It was thought that it would become

そこで本発明は、かかる問題点を解決してほとんどの部
分に共通の回路素子を用いて直接選局にも順次選局にも
するこそのできる選局装置を提供することを目的とする
ものである。
SUMMARY OF THE INVENTION An object of the present invention is to solve these problems and provide a channel selection device that can perform both direct channel selection and sequential channel selection using common circuit elements in most parts. be.

このため、本発明においては、選局時に選局スインチが
操作されたときに最初に第1の出力端子から1個のパル
スを発生し、続いて第2の出力端子から選局すべきチャ
ンネルに応じた個数のパルスを発生するようにした制御
パルス発生回路をマイクロコンピュータ等によって作成
して、直接選局用には第1の出力端子からのパルスで選
局用の王道カウンタをリセットし、その後第2の出力端
子からのパルスを計数するようにして希望チャンネルを
直接選局できるようにし、順次選局用には第1、第2の
出力端子からのパルスを可逆カウンタのアップカウント
用入力端子とダウンカウント用入力端子に加えて順次1
チャンネル分づつ選局チャンネルを切換えることができ
るようにしたことを特徴とするものである。
Therefore, in the present invention, when the channel selection switch is operated during channel selection, one pulse is first generated from the first output terminal, and then one pulse is generated from the second output terminal to the channel to be selected. A control pulse generation circuit that generates the corresponding number of pulses is created using a microcomputer, etc., and for direct channel selection, the standard counter for channel selection is reset with the pulse from the first output terminal, and then The pulses from the second output terminal are counted to enable direct selection of the desired channel, and for sequential tuning, the pulses from the first and second output terminals are input to the reversible counter's up-count input terminal. 1 in addition to the down-count input terminal
This system is characterized in that the selected channels can be switched channel by channel.

以下、本発明の一実施例について図面を参照しつつ詳細
に説明する。
Hereinafter, one embodiment of the present invention will be described in detail with reference to the drawings.

第1図は直接選局用に結線した場合のブロック線図、第
2図は順次選局用に結線した場合のブロック線図である
FIG. 1 is a block diagram when wires are connected for direct channel selection, and FIG. 2 is a block diagram when wires are wired for sequential channel selection.

両者の同一部分には同一符号を付して説明する。The same parts in both will be described with the same reference numerals.

またここではリモートコントロールによって選局制御す
る場合の実施例について説明するが、受像機本体に選局
スイッチを設ける場合にも全く同様である。
Further, although an embodiment in which channel selection is controlled by remote control will be described here, the same applies to a case where a channel selection switch is provided on the receiver body.

まず、図において、1はカウンタ方式の選局回路であり
、アップ方向にもダウン方向にも計数可能な2進チビツ
トの可逆カウンタ2と、この可逆カウンタ2の計数出力
を2進−n進変換するデコーダ3と、選局したいチャン
ネルの数だけの選局電圧をプリセットした可変抵抗器群
等からなる選局電圧プリセット回路4とを備え、可逆カ
ウンタ2の計数出力をデコーダ3で変換してそれに応じ
て選局電圧プリセット回路4から1つの選局電圧を選択
的に取り出し、これを電子チューナ(図示せず)の可変
容量ダイオードに加えることによってチャンネル選局を
行なうようになされている。
First, in the figure, 1 is a counter type channel selection circuit, which includes a binary chibit reversible counter 2 that can count in both the up and down directions, and the count output of this reversible counter 2 is converted from binary to n-ary. The decoder 3 is equipped with a decoder 3 to perform tuning, and a tuning voltage presetting circuit 4 consisting of a group of variable resistors etc. in which tuning voltages corresponding to the number of channels desired to be tuned are preset. In response, one channel selection voltage is selectively taken out from the channel selection voltage preset circuit 4 and applied to a variable capacitance diode of an electronic tuner (not shown) to perform channel selection.

可逆カウンタ2としてリングカウンタを用いればデコー
ダ3を省略することができる。
If a ring counter is used as the reversible counter 2, the decoder 3 can be omitted.

この選局回路1自体には公知のものを使用することがで
きる。
A publicly known channel selection circuit 1 can be used as the channel selection circuit 1 itself.

一方、5はリモートコントロールによってチャ。On the other hand, 5 is controlled by remote control.

ンネル選局を指令するための送信器で、指令用のスイッ
チ群6を備え、そのいずれのスイッチが操作されたかに
応じてパルスコード化変調した赤外光あるいは超音波等
のリモートコントロール信号を発射する。
This is a transmitter for commanding channel selection, and is equipped with a switch group 6 for command, and emits a remote control signal such as pulse-coded modulated infrared light or ultrasonic waves depending on which switch is operated. do.

このリモートコントロール信号ヲPINフォトダイオー
ドやマイクロフォン等の受信素子7で受信し、同調増幅
回路8で所定変調帯域のもののみを抽出して増幅し、さ
らに、波形整形回路9で検波・スライス等して所定のパ
ルスコードの波形に整形する。
This remote control signal is received by a receiving element 7 such as a PIN photodiode or a microphone, extracted and amplified only in a predetermined modulation band by a tuned amplifier circuit 8, and then detected and sliced by a waveform shaping circuit 9. The waveform is shaped into a predetermined pulse code.

このパルスコード信号は制御パルス信号発生回路10に
その制御用の信号として入力する。
This pulse code signal is input to the control pulse signal generation circuit 10 as a control signal.

制御パルス信号発生回路10は、入力されたパルスコー
ド信号を識別するコード識別回路11と、所定フォーマ
ットを実行するためのプログラムが書き込まれているR
OM12と、その所定フォーマットに従って演算処理を
行なう演算処理回路13とを内蔵したマイクロコンピュ
ータ(たとえば払下電子工業(掬製MN1404)等に
よって構成する。
The control pulse signal generation circuit 10 includes a code identification circuit 11 that identifies an input pulse code signal, and an R circuit in which a program for executing a predetermined format is written.
It is constituted by a microcomputer (for example, MN1404 manufactured by Kyoshita Denshi Kogyo Co., Ltd., manufactured by Kyoiku Co., Ltd.), which incorporates an OM 12 and an arithmetic processing circuit 13 that performs arithmetic processing according to a predetermined format.

ここでは、この制御パルス発生回路10として、チャン
ネル指令用の選局スイッチ羅6のいずれかが操作されて
パルスコード信号が発生されたときに、まず第1の出力
端子14から第3図Aのような1個のパルスを発生し、
続いて、第2の出力端子15から選局すべきチャンネル
に応じた個数の第3図B1゜B12・・・・・・・・・
B2のようなパルスを発生するように、ROM12に書
き込むプログラムを設定しておく。
Here, as the control pulse generation circuit 10, when one of the channel selection switches 6 for channel command is operated and a pulse code signal is generated, the control pulse generation circuit 10 first outputs the signal from the first output terminal 14 as shown in FIG. 3A. Generates one pulse like
Next, from the second output terminal 15, the number of channels corresponding to the channel to be selected is outputted from the second output terminal 15 as shown in FIG.
A program written in the ROM 12 is set so as to generate a pulse like B2.

ここで、B1はチャンネル1指令用の選局スイッチ6□
が操作されたときの出力パルスで0個、B12はチャン
ネル12指令用の選局スイッチ61□が操作されたとき
の出力パルスで1個・・・・・・、B2はチャンネル2
指令用の選局スイッチ62が操作されたときの出力パル
ス11個、というように定めている。
Here, B1 is the channel selection switch 6□ for channel 1 command.
0 output pulses when is operated, B12 is 1 output pulse when the channel selection switch 61□ for channel 12 command is operated, B2 is channel 2
It is determined that 11 output pulses are generated when the command selection switch 62 is operated.

もちろん、このときのチャンネル・・・・・・・・・1
2は選局電圧プリセット回路4における選局チャンネル
の配列順序を示すものであり、放送チャンネルの第1チ
ヤンネル・・・・・・と対応しでいなくてもよい。
Of course, the channel at this time...1
2 indicates the arrangement order of the selected channels in the selected channel voltage preset circuit 4, and does not have to correspond to the first channel of the broadcast channel.

また、ここではパルスA、B1□・・・・・・B2のパ
ルス幅と間隔ヲ異ならせでいるが、これは順次選局時の
操作性と直接選局時の速度とをともに満足するようにし
、また、動作を確実にさせるように配慮したものであっ
て、同一パルス幅、同一間隔であっても差支えない。
In addition, here, the pulse widths and intervals of pulses A, B1□...B2 are made different, but this is done so as to satisfy both the operability in sequential channel selection and the speed in direct channel selection. Moreover, it is designed to ensure reliable operation, and the pulse width and interval may be the same.

このような動作フォーマットは、コード識回路11でリ
モートコントロール信号のパルスコードを識別し、それ
に応じて演算処理回路13で異なったパルスを発生する
ようなプログラムをROM12に予め書き込んでお・く
ことによって容易に実現することができる。
Such an operation format is achieved by writing in advance in the ROM 12 a program in which the code identification circuit 11 identifies the pulse code of the remote control signal and the arithmetic processing circuit 13 generates different pulses accordingly. This can be easily achieved.

そして、第1図に示す直接選局のための装置においては
、この制御パルス発生回路10の第1の出力端子14を
選局回路2の′リセット端子16に接続し、第2の出力
端子15をいずれか一方のカウント入力端子二二ではカ
ウントダウン入力端子17に接続する。
In the device for direct tuning shown in FIG. 1, the first output terminal 14 of the control pulse generation circuit 10 is connected to the reset terminal 16 of the tuning circuit 2, and the second output terminal is connected to the countdown input terminal 17 at one of the count input terminals 22.

そして可逆カウンタ2はリセット状態ではチャンネル1
を選局するように設定しておく。
And reversible counter 2 is channel 1 in the reset state.
Set it to tune in.

このようにすれば、たとえばチャンネル5の選局時には
、選局スイッチ65が操作されると制御パルス発生回路
10の第1の出力端子14からの出力パルスAによって
まず可逆カウンタ2がリセットされ、続いて第2の出力
端子14がらの8個のパルスB5によって8チャンネル
分だけダウン方向に計数することによってチャンネル5
が選局される。
In this way, when tuning channel 5, for example, when the tuning switch 65 is operated, the reversible counter 2 is first reset by the output pulse A from the first output terminal 14 of the control pulse generation circuit 10, and then the reversible counter 2 is reset. channel 5 by counting down by 8 channels using 8 pulses B5 from the second output terminal 14.
is selected.

他のチャンネルについても全く同様である。The same applies to other channels.

第4図に第1図の制御信号発生回路10のマイクロコン
ピュータによる処理手順のフローチャートを示す。
FIG. 4 shows a flowchart of the processing procedure performed by the microcomputer in the control signal generation circuit 10 of FIG.

電源投入時に、まずフロースタートしく20)、マイク
ロコンピュータのRAMの初期値設定をする(21)。
When the power is turned on, the flow starts (20) and initial values of the microcomputer's RAM are set (21).

第1図中の波形整形回路9がらの信号の有無を判断しく
22)、入力信号があればチャンネル選択信号かどうか
判定しく23)、チャンネル選択信号でなければ他の処
理(この特許では関係ないので説明は省略する)をして
入力検出プログラムへ戻る(25)。
The purpose is to determine the presence or absence of a signal from the waveform shaping circuit 9 in FIG. Therefore, the explanation will be omitted) and return to the input detection program (25).

チャンネル選択信号であれば、チャンネルリセット信号
即ち第3図に示す信号Aを出力する(24)。
If it is a channel selection signal, a channel reset signal, that is, signal A shown in FIG. 3 is output (24).

次いで、その入力がチャンネル選択が「チャンネル1」
(以後、CHlと示す)を指示するものであるか判別し
て(26)、そうであればそのまま入力検出プログラム
(22)ヘジャンプし、そうでなければrCH2,指示
かどうか判別しく2カ、rCH2,指示信号であればチ
ャンネルダウンパルスをN個出力するためのNを「11
」に設定しく30)、ダウンパルスをN個出力する(3
4)。
Then that input is set to channel selection "Channel 1"
(hereinafter referred to as CHl) (26); if so, jump directly to the input detection program (22); if not, rCH2; , if it is an instruction signal, N for outputting N channel down pulses is set to "11".
” and output N down pulses (30).
4).

rcH2J指示信号でなければrcH3J指示信号かど
うか判別しく28)、rcH3J指示信号であればNを
「10」に設定する(31)。
If it is not an rcH2J instruction signal, it is determined whether it is an rcH3J instruction signal (28), and if it is an rcH3J instruction signal, N is set to "10" (31).

以下同様にしてrcH4J指示信号であればNを「9」
に、rcH5J指示信号であればNを「8」に、rcH
6,指示信号であればNを「7」に、rCH7,指示信
号であればNを「6」に、rCH8,指示信号であれば
Nを「5」に、rcH9J指示信号であればNを「4」
に、「CHlo」指示信号であればNを「3」に、「C
Hll」指示信号であればNを「2」に、各々設定しく
30)〜(32)、「CHll」指示信号か否かの設定
でrcHllJでない場合には残るのはrcH12,指
示信号のみであるからNを「1」に設定する(33)。
Similarly, if it is an rcH4J instruction signal, set N to "9".
If it is the rcH5J instruction signal, set N to "8", rcH
6. If it is an instruction signal, set N to "7", rCH7, if it is an instruction signal, set N to "6", rCH8, if it is an instruction signal, set N to "5", if it is an rcH9J instruction signal, set N to "5". "4"
If it is a “CHlo” instruction signal, set N to “3” and “C
If it is a "CHll" instruction signal, set N to "2", respectively (30) to (32), and if it is not rcHllJ in the setting of whether it is a "CHll" instruction signal, only rcH12 and the instruction signal remain. to set N to "1" (33).

それらの出力をもとにしてチャンネルダウンN個出力手
段によってチャンネルダウンパルスを、出力し、入力検
出ヘジャンプする(34)。
Based on these outputs, channel down pulses are outputted by N channel down output means, and a jump is made to input detection (34).

即ち、このようにして、第3図のB2〜B1□なるチャ
ンネルダウンパルスを出力する。
That is, in this way, channel down pulses B2 to B1□ in FIG. 3 are output.

一方、第2図に示す順次選局のための装置においては、
第1図と全く同じ選局回路1、制御パルス発生回路10
その他の回路素子を用いるが、選局指令用の選局スイッ
チ群6には選局スイッチ61゜6□1のみを使用し、さ
らに、制御パルス発生回路10の第1の出力端子14を
選局回路1の可逆カウンタ2のカウントダウン入力端子
17に接続し、第2の出力端子15をカウントアツプ入
力端子18に接続するように、接続のみを一部変更する
On the other hand, in the device for sequential channel selection shown in Fig. 2,
Tuning circuit 1 and control pulse generation circuit 10 exactly the same as in Fig. 1
Although other circuit elements are used, only the tuning switch 61゜6□1 is used as the tuning switch group 6 for the tuning command, and the first output terminal 14 of the control pulse generation circuit 10 is used for tuning. Only the connections are partially changed so that the count-down input terminal 17 of the reversible counter 2 of the circuit 1 is connected, and the second output terminal 15 is connected to the count-up input terminal 18.

このようにすると、選局時に選局スイッチ1が操作され
れば第1の出力端子14からの1個のパルスAによって
可逆カウンタ2がダウン方向に1チヤンネル分だけ計数
するので(このとき第2の出力端子15からのパルスB
1は0個である、(1つ下のチャンネルを選局すること
ができる。
In this way, when the tuning switch 1 is operated during tuning, the reversible counter 2 counts down one channel by one pulse A from the first output terminal 14 (at this time, the second Pulse B from output terminal 15 of
1 is 0 (You can select the channel one below.

逆に選局スイッチ6□1が端作されると、第1の出力端
子14からの1個のパルスによって可逆カウンタ2がダ
ウン方向に1チヤンネル分だけ計数するが、続いて第2
の出力端子15からの2個のパルスBllによって2チ
ャンネル分だけアップ方向に計数し、結局1チャンネル
分だけ上のチャンネルを選局することができる。
Conversely, when the tuning switch 6□1 is turned off, the reversible counter 2 counts down by one channel by one pulse from the first output terminal 14, but then the second
By means of two pulses Bll from the output terminal 15 of , it is possible to count up by two channels, and eventually select a channel up by one channel.

従って、このときには選局スイッチ61゜6.1の2個
によりアップ方向とダウン方向の順次選局を実現するこ
とができることになる。
Therefore, in this case, sequential tuning in the up direction and down direction can be realized using the two tuning switches 61.degree. 6.1.

もちろん、第1、第2の出力端子14.15とカウント
アツプ入力端子17、カウントダウン入力端子18との
接続を逆にすれば選局方向は反対になる。
Of course, if the connections between the first and second output terminals 14 and 15 and the count-up input terminal 17 and count-down input terminal 18 are reversed, the direction of channel selection will be reversed.

このようにしで、この装置においては用いる回路素子を
ほとんど全て共通にしてその一部の接続を変えるだけで
直接選局と順次選局とを自由に選択することができ、用
途に応じていずれかに接続することができる。
In this way, in this device, almost all of the circuit elements used are common, and by simply changing some of the connections, it is possible to freely select between direct tuning and sequential tuning. can be connected to.

そして、回路素子を両者に共用することができることに
より、それらの品種を少なくして量産効果を向上するこ
とができ、コストを大幅に低減することができる。
Since the circuit elements can be shared by both, it is possible to reduce the number of these types, improve the mass production effect, and significantly reduce costs.

特にマイクロコンピュータを用いて制御パルス発生回路
10を作成する場合には2種のプログラムのものを作成
するよりも1つのプログラムで共用できることのコスト
ダウン効果が大きい。
Particularly, when creating the control pulse generation circuit 10 using a microcomputer, the cost reduction effect of being able to use one program in common is greater than creating two types of programs.

また、リモートコントロール用送信器5やその他の部分
も共用できるので、プリント基板自体も共用することが
でき、その出力端子14.15とカウンタ2との接続部
分をジャンパー線等で変更できるようにしておくだけで
両機能の切り換えを行なうことができるという効果もあ
る。
In addition, since the remote control transmitter 5 and other parts can be shared, the printed circuit board itself can also be used, and the connection between the output terminals 14 and 15 and the counter 2 can be changed using jumper wires, etc. Another advantage is that you can switch between the two functions just by leaving it on.

さらに、このように直接選局と順次選局の2つの機能を
達成するようにしても制御パルス発生回路10からの出
力端子は共通の2個のみでよいので、これをIC素子で
構成した場合にも端子ピンを数を増加させる必要がなく
、設計上きわめて有効である。
Furthermore, even if the two functions of direct tuning and sequential tuning are achieved in this way, only two common output terminals are required from the control pulse generation circuit 10, so if this is configured with an IC element. Also, there is no need to increase the number of terminal pins, which is extremely effective in terms of design.

以上詳述したように本発明においては、選局スイッチが
操作されたときに最初に第1の出力端子から1個のパル
スを発生し、続いて第2の出力端子から選局すべきチャ
ンネルに応じた個数のパルスを発生するようにした制御
パルス発生回路を用い、直接選局用に用いる場合には第
1の出力端子のパルスで選局回路の可逆カウンタをリセ
ットし第2の出力端子のパルスを計数し、順次選局用に
用いる場合には第1、第2の出力端子のパルスで可逆カ
ウンタをカウントダウン方向とカウントアツプ方向とに
計数するようにしたので、選局回路や制御パルス発生回
路およびそのリモートコントロール部分等の入力部分な
どほとんど全ての回路素子と接続関係を共通にしたまま
で、2つの選局機能のいずれかを選択することができ、
用いる回路素子の共通化による品種類の削減によってコ
ストを大幅に低減することができる優れた選局装置を得
ることができるものである。
As detailed above, in the present invention, when the channel selection switch is operated, one pulse is first generated from the first output terminal, and then one pulse is generated from the second output terminal to the channel to be selected. When using a control pulse generation circuit that generates a corresponding number of pulses, when used for direct tuning, the reversible counter of the tuning circuit is reset by the pulse of the first output terminal, and the reversible counter of the tuning circuit is reset by the pulse of the second output terminal. When pulses are counted and used for sequential tuning, the pulses from the first and second output terminals are used to count the reversible counter in the countdown and up directions, making it easy to use the tuning circuit and control pulse generation. You can select one of the two tuning functions while keeping almost all the circuit elements and connections the same, such as the circuit and the input parts such as the remote control part.
It is possible to obtain an excellent channel selection device that can significantly reduce costs by reducing the variety of products by standardizing the circuit elements used.

【図面の簡単な説明】 第1図および第2図は本発明の実施例における選局装置
のブロック線図、第3図は同装置の動作を説明するため
の波形図、第4図は第1図中のマイクロコンピュータの
処理手順を示すフローチャートである。 1・・・・・・選局回路、2・・・・・・カウンタ、3
・・・・・・デコーダ、4・・・・・・選局電圧プリセ
ット回路、5・・・・・・送信器、6・・・・・・選局
スイッチ群、7・・・・・・受信素子、8・・・・・・
同調増幅回路、9・・・・・・波形整形回路、10・・
・・・・制御パルス発生回路、11・・・・・・コード
識別回路、12・・・・・・ROM、 13・・・・・
・洩算処理回路、14.15・・・・・・第1、第2の
出力端子、16・・・・・・リセット端子、17・・・
・・・カウントダウン入力端子、18・・・・・・カウ
ントダウン入力端子。
[BRIEF DESCRIPTION OF THE DRAWINGS] FIGS. 1 and 2 are block diagrams of a channel selection device in an embodiment of the present invention, FIG. 3 is a waveform diagram for explaining the operation of the device, and FIG. 4 is a waveform diagram for explaining the operation of the device. 1 is a flowchart showing the processing procedure of the microcomputer in FIG. 1...Tuning selection circuit, 2...Counter, 3
... Decoder, 4 ... Tuning voltage preset circuit, 5 ... Transmitter, 6 ... Tuning switch group, 7 ... Receiving element, 8...
Tuned amplifier circuit, 9... Waveform shaping circuit, 10...
... Control pulse generation circuit, 11 ... Code identification circuit, 12 ... ROM, 13 ...
・Elimination calculation processing circuit, 14.15...First and second output terminals, 16...Reset terminal, 17...
...Countdown input terminal, 18...Countdown input terminal.

Claims (1)

【特許請求の範囲】 1 カウントパルスを計数する可逆カウンタを有し、こ
の可逆カウンタの計数出力に応じて選局電圧を選択して
電子チューナに加えることによりチャンネル選局を行う
ようになされている選局回路と、選局スイッチが操作さ
れた選局時に最初に第1の出力端子から1個のパルスを
発生し、続いせ第2の出力端子から選局すべきチャンネ
ルに応じた個数のパルスを発生する制御パルス発生回路
とを備え、この制御パルス発生回路の第1の出力端子を
上記可逆カウンタのリセット端子に、第2の出力端子を
上記可逆カウンタのいずれが一方のカウント入力端子に
それぞれ接続し、もしくは上記制御パルス発生回路の第
1の出力端子を上記可逆カウンタの一方のカウント入力
端子に、第2の出力端子を上記可逆カウンタの他方のカ
ウント入力端子にそれぞれ接続するようにしたことを特
徴とする選局装置。 2 制御パルス発生回路をマイクロコンピュータにより
構成したことを特徴とする特許請求の範囲第1項記載の
選局装置。
[Claims] 1. A reversible counter that counts count pulses is provided, and channel selection is performed by selecting a channel selection voltage according to the count output of the reversible counter and applying it to an electronic tuner. When a channel selection circuit is operated and a channel selection switch is operated, one pulse is first generated from the first output terminal, and then the number of pulses corresponding to the channel to be selected is generated from the second output terminal. and a control pulse generation circuit that generates the reversible counter, the first output terminal of the control pulse generation circuit is connected to the reset terminal of the reversible counter, and the second output terminal is connected to one of the count input terminals of the reversible counter. or the first output terminal of the control pulse generation circuit is connected to one count input terminal of the reversible counter, and the second output terminal is connected to the other count input terminal of the reversible counter. A channel selection device featuring: 2. The channel selection device according to claim 1, wherein the control pulse generation circuit is configured by a microcomputer.
JP13294877A 1977-11-05 1977-11-05 Channel selection device Expired JPS5947890B2 (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6237789U (en) * 1985-08-26 1987-03-06

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