JPS5927593U - 表示リセツト回路 - Google Patents

表示リセツト回路

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JPS5927593U
JPS5927593U JP12184882U JP12184882U JPS5927593U JP S5927593 U JPS5927593 U JP S5927593U JP 12184882 U JP12184882 U JP 12184882U JP 12184882 U JP12184882 U JP 12184882U JP S5927593 U JPS5927593 U JP S5927593U
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JP
Japan
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signal
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Pending
Application number
JP12184882U
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English (en)
Inventor
東篠　昭典
Original Assignee
日本電気株式会社
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Publication date
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  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は表示装置をつけた１チツプマイクロコンピユー
タのブロック図、第２図は表示装置にＬ−ＥＤを使用し
ダイレクトにドライブした例を示すブロック図、第３図
は本考案の実施例のブロック図、第４図は第３図の表示
信号出力ゲート回路の波形図〈第５図は第３図のＮｃｈ
−オープンドレインの電気特性図である。 １・・・桁表示信号出力端子、２・・・文字表示信号出
力端子、３・・・表示装置、４・・・１チツプマイクロ
コンピユータ、５・・・外部リセット端子、６・・・リ
セット信号発生回路、７・・・リセット信号、８・・・
遅延回路、９・・・遅延リセット信号、１０・・・桁表
示ソース信号、１１・・・文字表示ソース信号、１２・
・・桁表示信号出力回路、１３・・・文字表示信号出力
回路、１４・・・トランジスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. リセット信号発生回路と、前記発生回路から発生される
    第１のリセット信号を遅延する遅延回路と、第１のリセ
    ット信号と第１の表示信号により制御される第１の表示
    信号出力端子と、前記遅延回路により遅延された第２の
    リセット信号と第２の表示信号により制御される第２の
    表示信号出力端子とを有し、前記の第゛１、第２の表示
    信号出力端子をタイミングの異なる前記第１、第２のリ
    セット信号によりリセットすることを特徴とする表示リ
    セット回路。
JP12184882U 1982-08-11 1982-08-11 表示リセツト回路 Pending JPS5927593U (ja)

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JP12184882U JPS5927593U (ja) 1982-08-11 1982-08-11 表示リセツト回路

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JPS5927593U true JPS5927593U (ja) 1984-02-21

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