JPS59231970A - System for changing magnification of picture for image input device - Google Patents

System for changing magnification of picture for image input device

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JPS59231970A
JPS59231970A JP10621583A JP10621583A JPS59231970A JP S59231970 A JPS59231970 A JP S59231970A JP 10621583 A JP10621583 A JP 10621583A JP 10621583 A JP10621583 A JP 10621583A JP S59231970 A JPS59231970 A JP S59231970A
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period
sampling
image
output signal
signal
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Nobuhisa Yamazaki
信久 山崎
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Usac Electronic Ind Co Ltd
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Usac Electronic Ind Co Ltd
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    • G06T3/40Scaling of whole images or parts thereof, e.g. expanding or contracting
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N1/00Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
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    • H04N1/3935Enlarging or reducing with modification of image resolution, i.e. determining the values of picture elements at new relative positions

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Abstract

PURPOSE:To obtain optional variable magnification and also to prevent deteri oration in picture quality by sampling a quantizing signal of an envelope in a fixed period, collecting the signal for the fixed period and applying sampling to the selected quantizing signal in the period in response to a desired magnification. CONSTITUTION:An output envelope signal of a comparator 5 is sampled by a sub-clock having a period of 1/2 and outputted from an AND circuit 6. A judging circuit 7 collects this sampling value series is collected at each period the same as the sampling period of an FF 8 so as to judge a correct sampling vlaue from the result of collection by means of majority decision. A comparator 12 outputs a value of logical ''1'' when the count value of a counter 11 is larger than a compared value 1.5 and outputs a value of logical ''0'' when smaller. Thus, the logical output signal is applied to the FF 8 and sampled by a main clock having a period of 1.5 time in order to obtain a display signal displaying the shrinked picture of 1/1.5 time and a desired picture display output signal is obtained.

Description

【発明の詳細な説明】 本発明は、イメージ入力装置の画像倍率変換方式、特に
被走査対象物の欠けまたは汚れに起因する誤り情報によ
って画像縮小時に画質が低下することのないようにした
イメージ入力装置の画像倍率変換方式に関するものであ
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention provides an image magnification conversion method for an image input device, particularly an image input device that prevents image quality from deteriorating during image reduction due to erroneous information caused by chipping or dirt on an object to be scanned. This relates to the image magnification conversion method of the device.

CCD、BBD等のイメージセンサを用いたイメージ入
力装置において、被走査対象となる原稿の制約上あるい
は出力機器の制約上、出力画像の拡大、縮小を任意に行
うことが望まれる場合がある。拡大または縮小を行う方
法として、イメージセンサからの量子化出力信号の隣接
するパルス状信号のピーク値の変化は一般に緩慢である
という点に着目し、イメージセンサの量子化出力信号か
ら包絡線を抽出し、この包結線を量子化した後。
In an image input device using an image sensor such as a CCD or a BBD, it may be desired to arbitrarily enlarge or reduce the output image due to limitations of the original to be scanned or limitations of the output device. As a method for enlarging or reducing, we focus on the fact that the peak values of adjacent pulsed signals of the quantized output signal from the image sensor generally change slowly, and extract the envelope from the quantized output signal of the image sensor. And after quantizing this envelope.

所望画像倍率に応じたサンプリング周期、即ちル倍の拡
大画像を得る場合にはイメージセンサのパルス状出力信
号の周期の1 / n倍の周期で、 l/n倍の縮小画
像を得る場合にはル倍の周期でサンプリングして所望倍
率の画像を表示する量子化画像出力信号を得ることが考
えられる。
The sampling period corresponds to the desired image magnification, that is, when obtaining a 1 times enlarged image, the period is 1/n times the period of the pulsed output signal of the image sensor, and when obtaining a 1/n times reduced image. It is conceivable to obtain a quantized image output signal that displays an image at a desired magnification by sampling at a period twice as large as 1.

しかし、この方式によれば被走査対象物たとえば原稿に
欠け、汚れが存在する場合、サンプリング時にこれら欠
け、汚れに対応する包絡線部分をサンプリングすると誤
った情報が得られる。その結果、特に画像縮小時には画
質が低下するという不都合が生じる。この事情を、第1
図に基づいてさらに詳細に説明する。
However, according to this method, if the object to be scanned, such as a document, has chips or stains, incorrect information will be obtained if the envelope portion corresponding to the chips or stains is sampled at the time of sampling. As a result, there arises an inconvenience that the image quality deteriorates, especially when the image is reduced. This situation is the first
This will be explained in more detail based on the figures.

第1図(ロ)は、複数個の画素(ビット)よ構成る1次
う・fンイメージセンサの量子化出力信号から抽出した
包絡線を示す。この包絡線は、原稿の汚れに相当する立
下シ部1と、原稿の欠けに相当する立上シ部2とを有し
ているものとして示されている。このような包絡線を、
たとえば2階調の画像を得るためにスライスレベルVB
  で区分して量子化し、第1図(h)に示すようなサ
ンプリングクロックでサンプリングすると第1図(C)
に示すような2値の画像表示出力信号が得られる。
FIG. 1(b) shows an envelope extracted from a quantized output signal of a primary image sensor composed of a plurality of pixels (bits). This envelope is shown as having a falling edge 1 corresponding to a stain on the document and a rising edge 2 corresponding to a chip in the document. An envelope like this,
For example, to obtain a two-tone image, slice level VB
Figure 1 (C) is obtained by dividing and quantizing the data and sampling it with a sampling clock as shown in Figure 1 (h).
A binary image display output signal as shown in is obtained.

この信号中、論理”0“部分3および論理″1°。In this signal, logic "0" part 3 and logic "1°.

部外4は、包絡線の非所望な立下シ部1および立上シ部
2をサンプリングしたことによって生じた部分である。
The outside 4 is a portion generated by sampling the undesired falling edge 1 and rising edge 2 of the envelope.

したがって、これら部分3および4は誤シ情報であり、
このような誤シ情報が画像出力信号中に含まれると、′
特に画像縮小時に画質が低下するという問題が生じる。
Therefore, these parts 3 and 4 are false information,
If such erroneous information is included in the image output signal,
In particular, a problem arises in that the image quality deteriorates when the image is reduced.

本発明は、このような問題を解決するため、前記包絡線
を量子化して得られた量子化信号を、イメージセンサの
、Jルス状信号の周期1.  の少なくとも捧倍以下の
周期でサンプリングし、得られたサンプリング値を一定
期間毎に集計し、この一定期間内で個数の多い方のサン
プリング値を選択することによシ前記誤シ情報を排除し
た量子化信号を得、この量子化信号を新ためて所望画像
倍率に応じたサンプリング周期でサンプリングすること
によって画像縮小時に画質が低下することのない画像出
力信号が得られるイメージ入力装置の画像倍率変換方式
・を提供することを目的としている。
In order to solve this problem, the present invention converts the quantized signal obtained by quantizing the envelope into a period 1. The above-mentioned erroneous information was eliminated by sampling at a frequency that is at least twice as long as Image magnification conversion for an image input device that obtains a quantized signal and samples the quantized signal at a sampling period corresponding to a desired image magnification to obtain an image output signal that does not degrade image quality when reducing the image. The purpose is to provide a method.

以下2本発明を図面に基いて詳細に説明する。The following two inventions will be explained in detail based on the drawings.

第2図は1本発明方式の一実施例を示す回路図である。FIG. 2 is a circuit diagram showing an embodiment of the method of the present invention.

この実施例は、縮小倍率がl / 1.5倍でかつ2階
調の画像を表示する画像出力信号を得る場合を示す。ま
た、第3図は第2図図示の回路の動作を説明するための
信号波形図である。−第2図において、5は量子化部を
構成するコンノぞレータ、6は第1サンプリング部を構
成するAND回路、7は判断回路部、8は第2サンプリ
ング部を構成するフリップフロップ、9は分局器。
This embodiment shows a case where an image output signal is obtained with a reduction ratio of 1/1.5 times and a two-tone image. Further, FIG. 3 is a signal waveform diagram for explaining the operation of the circuit shown in FIG. 2. - In FIG. 2, 5 is a converter constituting the quantization section, 6 is an AND circuit constituting the first sampling section, 7 is a judgment circuit section, 8 is a flip-flop constituting the second sampling section, and 9 is a flip-flop constituting the second sampling section. Branch unit.

lOは遅延回路でおる。lO is a delay circuit.

たとえば周期が1. 0ノ々ルス状信号列よ構成る1次
ラインセンサの量子化出力信号から抽出した包絡線を第
3図(α)に示す。この包絡線は、原稿の汚れに相当す
る立下り部1と、原稿の欠けに相当する立上)部2とを
有しているものとする。この包絡線を、スライスレベル
v8  で区分して量子化するためにコンパレータ5の
十人カ端子に供給する。
For example, the period is 1. FIG. 3 (α) shows the envelope extracted from the quantized output signal of the primary line sensor, which is composed of a zero-noise signal train. It is assumed that this envelope has a falling portion 1 corresponding to dirt on the document and a rising portion 2 corresponding to chipping of the document. This envelope is supplied to the ten terminals of the comparator 5 in order to be divided and quantized at the slice level v8.

このコンパレータの一入力端子には前記スライスレベル
vs  が供給されている。コン・ぐレータ5は。
The slice level vs is supplied to one input terminal of this comparator. Congreta 5 is.

包絡線の値をスライスレベルv8  と比較し、スライ
スレベルよシ大きいと論理l+1”を発生し、スライス
レベルよシ小さいと論理“ol+を発生する。
The value of the envelope is compared with the slice level v8, and if it is larger than the slice level, a logic l+1 is generated, and if it is smaller than the slice level, a logic ``ol+'' is generated.

コンパレータ5の出力信号を、第3図(b)に示す。The output signal of the comparator 5 is shown in FIG. 3(b).

この信号中、論理”01部分1′および論理”1“部分
2′は包絡線の上記非所望な立下シ部lおよび立上シ部
2に対応している。
In this signal, the logic "01" portion 1' and the logic "1" portion 2' correspond to the undesired falling edge 1 and rising edge 2 of the envelope.

コンパレータ5の出力信号をAND回路6の一方の入力
端子に供給し、このAND回路の他方の入力端子には、
イメージセンナのパルス状出方信号の周期1.  の1
/2以下の周期、たとえば1/2to  (0周Mのサ
ブクロックを供給する。このサブクロックを、第3図(
c)に示す。AND回路6では。
The output signal of the comparator 5 is supplied to one input terminal of an AND circuit 6, and the other input terminal of this AND circuit is
Period of pulsed output signal of image sensor 1. 1
A sub-clock with a cycle of /2 or less, for example 1/2 to (0 cycles M) is supplied. This sub-clock is
Shown in c). In AND circuit 6.

コンノぐレータ5からの量子化出力がサブクロックでサ
ンプリングされて、その出力端子には第3図(4に示す
ようなサンプリング値列が得られる。このサンプリング
値列は、第3図(イ)において左側がら1111100
111・・・・・・ となる。このサンプリング値列に
おいて、”00″部IMおよび゛11″部2′ は包絡
線の立下シ部1および立上回部2に起因する誤シ情報で
ある。これら情報を誤υであると判断して除去するため
には1判断回路部7は。
The quantized output from the converter 5 is sampled at the subclock, and a sampling value sequence as shown in Fig. 3 (4) is obtained at its output terminal. 1111100 from the left side
111...... becomes. In this sampling value sequence, the "00" part IM and the "11" part 2' are false information caused by the falling edge part 1 and the rising edge part 2 of the envelope.If these pieces of information are false υ, In order to judge and remove, 1 judgment circuit section 7 is required.

前記サンプリング値列を、後述する第2サンプリング部
の7リツプフロツプ8におけるサンプリング周期と同じ
期藺毎に、即ち1.5to 毎に集計し。
The sampling value sequence is aggregated every period that is the same as the sampling period of the 7-lip-flop 8 of the second sampling section, which will be described later, that is, every 1.5to.

その集計結果から多数決によって前記期間内における正
しいサンプリング値を判断する。第3図ωには、第3図
(のに示すサンプリング値列を前記期間1.5to  
毎に集計した結果を示す。数字は、前記期間毎における
サンプリング値11“の個数を表わしている。前記期間
内におけるサンプリング値の全個数は3個であるから、
多数決によシサンプリング値”11の個数が2個以上の
場合には。
Based on the total results, the correct sampling value within the period is determined by majority vote. FIG. 3 ω shows the sampling value sequence shown in FIG.
The results are shown for each period. The numbers represent the number of sampling values 11'' in each period. Since the total number of sampling values in the period is three,
If the number of sampled values ``11'' is 2 or more by majority vote.

その期間内の正しいサンプリング値を@ I I+と。The correct sampling value within that period is @I I+.

サンプリング値ll01′の個数が2個以上の場合に1
    はその期間内の正しいサンプリング値をl □
 lと判断し、その正しいサンプリング値を出力する。
1 if the number of sampling values ll01' is 2 or more
is the correct sampling value within that period l □
1 and outputs the correct sampling value.

以上の動作を実行するため1判断回路部マは。In order to execute the above operations, 1 judgment circuit section Ma is used.

カウンタ11とコンパレータ12とをそなえている。カ
ウンタ11は、AND回路6からのサンプリング値″1
”を表わすノクルスの個数を計数する。
A counter 11 and a comparator 12 are provided. The counter 11 receives the sampling value "1" from the AND circuit 6.
” Count the number of noculus representing “.

このカウンタは、第3図(#)に示すような周期が1.
5to  のリセットパルスでリセットされ、計数“零
“に復帰される。その結果、カウンタ11は。
This counter has a period of 1.5 as shown in FIG. 3 (#).
It is reset by the 5to reset pulse and the count is returned to "zero". As a result, the counter 11.

第3図ωに示す計数値を時系列的に出力する。この計数
値をコンパレータ12の十入力端子に供給し、コン・ぞ
レータ12の一入力端子には各計数値の多数決をとるた
め比較値1.5を供給する。コン・ぐレータ12は、カ
ウンタ11からの計数値が比較値1.5よシも大きいと
論理1111′を発生し、比較値よシも小さいと論理1
01を発生する。コンパレータ12の出力信号を、第3
図(グ)に示す。明らかなように、この出力信号は、第
3図(h)に示す量子化信号から非所望な誤シ情報部分
1′および2′が除去されたものに相当している。この
出力信号をフリップフロップ8に供給し、1/1.5倍
の縮小画像を表示する量子化画像出力信号を得るために
The count values shown in FIG. 3 ω are output in time series. This count value is supplied to the ten input terminal of the comparator 12, and a comparison value of 1.5 is supplied to one input terminal of the comparator 12 in order to take a majority vote of each count value. The converter 12 generates a logic 1111' when the count value from the counter 11 is greater than the comparison value 1.5, and generates a logic 1111' when the count value from the counter 11 is also smaller than the comparison value.
Generates 01. The output signal of the comparator 12 is
Shown in Figure (g). As is clear, this output signal corresponds to the quantized signal shown in FIG. 3(h) with the undesired erroneous information portions 1' and 2' removed. This output signal is supplied to the flip-flop 8 to obtain a quantized image output signal for displaying a 1/1.5 times reduced image.

1.5to  の周期を有するメインクロックでサンプ
リングする。このようにして得られた画像出力信号は、
誤り情報゛を含んでいないことは明らかである。
Sampling is performed using the main clock having a period of 1.5to. The image output signal obtained in this way is
It is clear that it does not contain any erroneous information.

前記メインクロックの周期は、カウンタ11をリセット
するリセットパルス〔第3図(C)〕の周期と同一であ
る。本実施例では、このメインクロックヲ、コンノぞレ
ータ5の出力信号をサンプリングするのに用いた周期が
1/2toのサブクロックを分周器9において1/3に
分周することによって得、さらに前記リセットパルスを
2以上のようにして得られたメインクロックを遅延回路
1oによって一定時間遅延させることによって得ること
ができる。遅延させる理由は、カウンタ11のリセット
時刻をAND回路6のパルス発生時刻とずらして、カウ
ンタの計数動作を適正にするためである。
The period of the main clock is the same as the period of the reset pulse (FIG. 3(C)) that resets the counter 11. In this embodiment, this main clock is obtained by dividing the sub-clock whose period is 1/2 to 1/3, which was used to sample the output signal of the converter 5, into 1/3 in the frequency divider 9. This can be obtained by delaying the main clock obtained by using two or more reset pulses by a delay circuit 1o for a certain period of time. The reason for the delay is to shift the reset time of the counter 11 from the pulse generation time of the AND circuit 6 to make the counting operation of the counter appropriate.

以上のようにして得られたフリップフロップ8からの画
像出力信号を、たとえばマイクロコンピュータにおいて
処理し1表示装置において縮小された良好な画質の画像
を表示することができる。
The image output signal from the flip-flop 8 obtained as described above is processed by, for example, a microcomputer, and a reduced image of good quality can be displayed on one display device.

上述したように本発明方式によれば、被走査対象物の汚
れまたは欠けに起因する誤シ情報を除去した量子化信号
をサンプリングするため画像を縮小する際に画質が低下
することなく鮮明な画像を得ることができる。また、イ
メージセンサの量子化出力からいったん包絡線を抽出し
、この包絡線から所望倍率に応じたサンプリング周期で
サンプリングするから可変倍率を任意に選択することが
可能となる。また、簡単な電子回路で構成することがで
きるので安価な変換方式を得ることができる。
As described above, according to the method of the present invention, a quantized signal from which erroneous information caused by dirt or chipping of the object to be scanned is removed is sampled, so a clear image can be obtained without deteriorating the image quality when reducing the image. can be obtained. Furthermore, since an envelope is once extracted from the quantized output of the image sensor and sampling is performed from this envelope at a sampling period according to a desired magnification, it is possible to arbitrarily select a variable magnification. Furthermore, since it can be configured with a simple electronic circuit, an inexpensive conversion system can be obtained.

以上は1本発明を説明するために特に簡単な実婢例に基
づいて説明したが1本発明は前記実施例にのみ限定され
るものではなく、当業者であれば本発明の範囲内で種々
の変形、変更が可能なことは勿論である。
Although the above has been explained based on a particularly simple practical example in order to explain the present invention, the present invention is not limited only to the above-mentioned embodiment, and those skilled in the art will be able to use various examples within the scope of the present invention. Of course, modifications and changes are possible.

たとえば、3階調以上の画像を表示する画像出力信号を
得るためには、第2図図示の回路を並列段もうけること
によって達成することができる。
For example, in order to obtain an image output signal for displaying an image with three or more gradations, this can be achieved by providing parallel stages of the circuit shown in FIG.

また、誤シ情報を判断するためには第1サンプリング回
路部でのサンプリング周期を、イメージセンサのパルス
状出力信号の周期の1/2以下としなければならないが
2判断部での判断精度を高めるためにはサンプリング周
期を小さくして得られるサンプリング値を多くするのが
望ましい。また。
In addition, in order to judge erroneous information, the sampling period in the first sampling circuit section must be set to 1/2 or less of the period of the pulsed output signal of the image sensor, but this increases the judgment accuracy in the second judgment section. In order to achieve this, it is desirable to reduce the sampling period and increase the number of sampling values obtained. Also.

メインクロックはサブクロックを分周して得る外に、別
個のメインクロック発生回路をもうけることもできる。
In addition to obtaining the main clock by frequency-dividing the sub-clock, it is also possible to provide a separate main clock generation circuit.

さらに1本発明は1次ラインセンサだけでなく2次元エ
リア七ンサにも適用できることは明らかでおる。
Furthermore, it is clear that the present invention can be applied not only to a primary line sensor but also to a two-dimensional area sensor.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は原稿の欠けまたは汚れに起因する誤シ情報の発
生を説明するための信号波形図、第2図は本発明方式の
一実施例を示すブロック回路図。 第3図は第2図図示の回路の動作を説明するための信号
波形図である。 図中、5はコンパレータ、6はAND回路、マは判断回
路部、8はフリップフロップ、9は分周器、10は遅延
回路、11はカウンタ、12はコンパレータをそれぞれ
示す。 特許出願人   ユーザツク電子工業株式会社代理人弁
理士     森  1)    寛(外2名) づ〉デ1ルブ゛20・ソ2 第1図 第 2 図
FIG. 1 is a signal waveform diagram for explaining the generation of erroneous information due to chipping or staining of a document, and FIG. 2 is a block circuit diagram showing an embodiment of the method of the present invention. FIG. 3 is a signal waveform diagram for explaining the operation of the circuit shown in FIG. 2. In the figure, 5 is a comparator, 6 is an AND circuit, M is a judgment circuit, 8 is a flip-flop, 9 is a frequency divider, 10 is a delay circuit, 11 is a counter, and 12 is a comparator. Patent applicant: Usatsuk Electronic Industry Co., Ltd. Representative Patent Attorney Mori 1) Hiroshi (and 2 others)

Claims (1)

【特許請求の範囲】 イメージセンサから一定の周期1.  で発生するパル
ス状信号から抽出した包絡線から1/ル(rLは整数)
倍率の縮小画像を表示する量子化画像出力信号を得るイ
メージ入力装置の画像倍率変換方式において、前記包絡
線を量子化する量子化部と。 この量子化部からの量子化出力信号をl/2t。 以下のサンプリング周期でサンプリングする第1サンプ
リング回路部と、この第1サンプリング回路部からのサ
ンプリング値を期間3to毎に寒計し。 集計された前記期間毎のサンプリング値から多数決によ
シ前記期間毎に正しいサンプリング値を判断して出力す
る判断回路部と、この判断回路部からの出力信号を前記
期間と同一の周期ntoでサンプリングする第2サンプ
リング回路部とをそなえ。 被走査対象物の欠けまたは汚れに起因する誤シ情報を前
記判断回路部によって除去することによシ。 画像縮小時に画質が低下することのない量子化画像出力
信号を得るようにしたことを特徴とするイメージ入力装
置の画像倍率変換方式。
[Claims] From the image sensor at a constant period 1. 1/L (rL is an integer) from the envelope extracted from the pulsed signal generated by
In an image magnification conversion method of an image input device that obtains a quantized image output signal for displaying a scaled-down image, a quantization unit quantizes the envelope. The quantized output signal from this quantizer is l/2t. A first sampling circuit section samples at the following sampling period, and the sampling value from this first sampling circuit section is measured every 3 to periods. A judgment circuit unit that judges and outputs the correct sampling value for each period by majority vote from the aggregated sampling values for each period; and a judgment circuit unit that samples the output signal from this judgment circuit unit at the same period nto as the period. A second sampling circuit section is provided. The judgment circuit section removes erroneous information caused by chipping or dirt on the object to be scanned. An image magnification conversion method for an image input device, characterized in that a quantized image output signal is obtained without deterioration in image quality during image reduction.
JP10621583A 1983-06-14 1983-06-14 System for changing magnification of picture for image input device Granted JPS59231970A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
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US5600347A (en) * 1993-12-30 1997-02-04 International Business Machines Corporation Horizontal image expansion system for flat panel displays

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57138262A (en) * 1981-02-20 1982-08-26 Fuji Xerox Co Ltd Conversion system for main scanning line density

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