JPS5920352U - 電子式計算機 - Google Patents

電子式計算機

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JPS5920352U
JPS5920352U JP7988883U JP7988883U JPS5920352U JP S5920352 U JPS5920352 U JP S5920352U JP 7988883 U JP7988883 U JP 7988883U JP 7988883 U JP7988883 U JP 7988883U JP S5920352 U JPS5920352 U JP S5920352U
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JP7988883U
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伸太郎 橋本
中西　東作
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シャープ株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例である電卓の外観を示す平面
図、第２図は同実施例の内部回路の概略構成を示すブロ
ック図、第３図は同実施例の説明に供するフローチャー
ト、第４図は同実施例の説明に供する回路図、第５図ａ
、　　ｂ及び第６図は本゛　考案の他の実施例の説明に
供する図である。 符号、６：キー人力部、７：表示部、ＲＯＭ二制御部、
ｃｐｕ、中央演算処理装置、ＲＡＭ　：データ記憶部、
ＤＳＰ：表示駆動回路、ｐ、、　Ｐ２ニスタテイック型
フリップフロップ、ＰＳＴＩ、２：パワースイッチ　　
　−トランジスタ、Ｂ：電池。

Claims (1)

    【実用新案登録請求の範囲】
  1. キー人力部、出力部、制御部、演算部、揮発性データ記
    憶部、入出力インターフェースを備えたキー制御式ディ
    ジタル演算装置に於て、キー人力部又は演算部よりの制
    御信号に基いて、その記憶状態が設定され、少なくとも
    第１の記憶状態、第２の記憶状態をとる状態記憶手段と
    、該状態記憶手段の出力に基き制御され、該手段が第１
    の記憶状態のときには、デー汐記憶装置のみを動作状態
    にし、該手段が第２の記憶状態のときには、データ記憶
    装置を含む他の内部回路すべてを動作状態にする側御回
    路とを設けたことを特徴とするキー制御式ディジタル演
    算装置。
JP7988883U 1983-05-26 1983-05-26 電子式計算機 Expired JPS6025623Y2 (ja)

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JP7988883U JPS6025623Y2 (ja) 1983-05-26 1983-05-26 電子式計算機

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JP7988883U JPS6025623Y2 (ja) 1983-05-26 1983-05-26 電子式計算機

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Publication Number Publication Date
JPS5920352U true JPS5920352U (ja) 1984-02-07
JPS6025623Y2 JPS6025623Y2 (ja) 1985-08-01

Family

ID=30209881

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JPS6025623Y2 (ja) 1985-08-01

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