JPS59178760U - 演算増幅器の出力電圧制限回路 - Google Patents

演算増幅器の出力電圧制限回路

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JPS59178760U
JPS59178760U JP5228184U JP5228184U JPS59178760U JP S59178760 U JPS59178760 U JP S59178760U JP 5228184 U JP5228184 U JP 5228184U JP 5228184 U JP5228184 U JP 5228184U JP S59178760 U JPS59178760 U JP S59178760U
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JP
Japan
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operational amplifier
output voltage
voltage
limiting circuit
voltage limiting
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JP5228184U
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勉 山田
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三菱電機株式会社
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  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
  • Control Of Voltage And Current In General (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来の演算増幅器の出力電圧制限回路の構成
を示す電気回路図、第２図は、他の従来例の電気回路図
、第３図は、第１図の回路の出力電圧制限特性を示す特
性図、第４図は、第２図の回路の出力電圧制限特性を示
す特性図、第５図は、本考案の一実施例による出力電圧
制限回路の電気回路図、第６図は、同回路の出力電圧制
限特性を示す特性図である。 ３・・・演算増幅器の入力抵抗、４・・・演算増幅器の
フィードバック抵抗、５・・・演算増幅器、１２゜１３
・・・ＦＥＴ、　１４．１５・・・制限電圧設定器、１
６〜１９・・・入力抵抗、２０．２１・・・演算増幅器
。 第３図 第５図

Claims (1)

    【実用新案登録請求の範囲】
  1. 演算増幅器と、この演算増幅器の入出力端子間に接続さ
    れたフィードバック抵抗と、このフィードバック抵抗に
    並列に接続された電界効果形トランジスタと、仕意の電
    圧を発生する制限電圧設定器と、この制限電圧設定器の
    発生電圧と上記演算増幅器の出力電圧とを比較し、上記
    演算増幅器の出力電圧が上記制限電圧設定器の発生電圧
    の絶対値よりも大きくなった時にスイッチングする演算
    増幅器からなる検出器とを備え、上記検出器のス、　イ
    ツチング時に上記電界効果形トランジスタを導通させて
    上記演算増幅器の出力電圧を制限することを特徴とする
    演算増幅器の出力電圧制限回路。
JP5228184U 1984-04-09 1984-04-09 演算増幅器の出力電圧制限回路 Granted JPS59178760U (ja)

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