JPS59131291A - マルチウエイスピ−カ装置用チヤンネル・デバイデイング・アンプ - Google Patents
マルチウエイスピ−カ装置用チヤンネル・デバイデイング・アンプInfo
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- JPS59131291A JPS59131291A JP58005659A JP565983A JPS59131291A JP S59131291 A JPS59131291 A JP S59131291A JP 58005659 A JP58005659 A JP 58005659A JP 565983 A JP565983 A JP 565983A JP S59131291 A JPS59131291 A JP S59131291A
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- Japan
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- circuit
- speaker
- delay
- signal
- speakers
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04R—LOUDSPEAKERS, MICROPHONES, GRAMOPHONE PICK-UPS OR LIKE ACOUSTIC ELECTROMECHANICAL TRANSDUCERS; DEAF-AID SETS; PUBLIC ADDRESS SYSTEMS
- H04R3/00—Circuits for transducers, loudspeakers or microphones
- H04R3/12—Circuits for transducers, loudspeakers or microphones for distributing signals to two or more loudspeakers
- H04R3/14—Cross-over networks
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- Health & Medical Sciences (AREA)
- General Health & Medical Sciences (AREA)
- Otolaryngology (AREA)
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Acoustics & Sound (AREA)
- Signal Processing (AREA)
- Circuit For Audible Band Transducer (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、入力信号を二つ以上の周波数帯域に分割し
、各帯域にそれぞれ専用のパワーアンプと単体スピーカ
とを用いるマルチウェイ・スピーカ装置用チャンネル・
デバイディング・アンプに関し、特に、各単体スピーカ
の音響中心を一致させるため、チャンネル・ディバイデ
ィング・アンプに遅延回路を設けるようにしたものであ
る。
、各帯域にそれぞれ専用のパワーアンプと単体スピーカ
とを用いるマルチウェイ・スピーカ装置用チャンネル・
デバイディング・アンプに関し、特に、各単体スピーカ
の音響中心を一致させるため、チャンネル・ディバイデ
ィング・アンプに遅延回路を設けるようにしたものであ
る。
一般に、マルチウェイ・スピーカ装置に用いられる単体
スピーカは、第１図に示すように同一バックル面１に配
置されている。このようなマルチウェイ・スピーカ装置
２は、バックル面ｌが平面となるため、複数個の単体ス
ピーカ３．４を設けることによっても各単体スピーカ３
．４の指向特性は劣化しない長所がある。
スピーカは、第１図に示すように同一バックル面１に配
置されている。このようなマルチウェイ・スピーカ装置
２は、バックル面ｌが平面となるため、複数個の単体ス
ピーカ３．４を設けることによっても各単体スピーカ３
．４の指向特性は劣化しない長所がある。
ところが、マルチウェイ・スピーカ装置に用いられる各
単体スピーカは０．たとえば第１図における低音用の単
体スピーカ４、高音用の単体スピーカ３と言うように受
は持つ再生周波数帯域に応じて形状、寸法が異なってお
り、そのためバックル面１から見た音響中心（等制約な
音源の位ｋ）１ｗ、ｔｔは一般に等しくならない。すな
わち、第１図では１１＞１のである。
単体スピーカは０．たとえば第１図における低音用の単
体スピーカ４、高音用の単体スピーカ３と言うように受
は持つ再生周波数帯域に応じて形状、寸法が異なってお
り、そのためバックル面１から見た音響中心（等制約な
音源の位ｋ）１ｗ、ｔｔは一般に等しくならない。すな
わち、第１図では１１＞１のである。
第２図は第１図のマルチウェイ・スピーカ装置 。
１０位相特性を示したものである。第２図において、４
ａは低音用の単体スピーカ４の位相特性、３ａは高音用
の単体スピーカ３の位相特性を示す。
ａは低音用の単体スピーカ４の位相特性、３ａは高音用
の単体スピーカ３の位相特性を示す。
上記のように１１）２−であるから、高音用の単体スピ
ーカ３の位相遅れは低音用の単体スピーカ４の位相遅れ
より大きくなる。したがって各単体スピーカ３，４を組
み合わせた場合は、第２図の実線で示すように階段状の
位相特性を示し、良好な音響再生が得られない。
ーカ３の位相遅れは低音用の単体スピーカ４の位相遅れ
より大きくなる。したがって各単体スピーカ３，４を組
み合わせた場合は、第２図の実線で示すように階段状の
位相特性を示し、良好な音響再生が得られない。
第３図は、従来から考えられているこの解決策の一例を
示したもので、各単体スピーカ３．４の音響中心を一致
させるために高音用の単体スピーカ３を前方に移動させ
たものである。
示したもので、各単体スピーカ３．４の音響中心を一致
させるために高音用の単体スピーカ３を前方に移動させ
たものである。
このようなマルチウェイ・スピーカ装置２の位相特性は
、各単体スピーカ３．４の群遅延が一致するために、第
４図の特性のように一つの直線となる。
、各単体スピーカ３．４の群遅延が一致するために、第
４図の特性のように一つの直線となる。
しかし、第３図から明らかなように、各単体スピーカ３
．４は同一バッフル面１に並ばないため、各単体スピー
カ３．４の指向特性が劣化する。
．４は同一バッフル面１に並ばないため、各単体スピー
カ３．４の指向特性が劣化する。
この発明は、上記従来の諸点に鑑みなされたもので、チ
ャンネルデバイディング・アンプの少なくとも一つ以上
のチャンネルに定遅延形全域通過回路を設けて各単体ス
ピーカの音響中心を一致させることにより、各単体スピ
ーカを同一バツフル面上に保ったまま、指向特性を劣化
させることなく各単体スピーカの音響中心を一致させる
ことのできるマルチウェイ・スピーカ装置用チャンネル
・デバイディング・アンプを提供することを目的とする
。
ャンネルデバイディング・アンプの少なくとも一つ以上
のチャンネルに定遅延形全域通過回路を設けて各単体ス
ピーカの音響中心を一致させることにより、各単体スピ
ーカを同一バツフル面上に保ったまま、指向特性を劣化
させることなく各単体スピーカの音響中心を一致させる
ことのできるマルチウェイ・スピーカ装置用チャンネル
・デバイディング・アンプを提供することを目的とする
。
以下、図面に基づいてこの発明のマルチウェイスピーカ
装置用チャンネル・デバイディング・アンプの実施例に
ついて詳細に説明する。第５図はこの発明の一実施例の
基本構成をブロック図で示したものである。
装置用チャンネル・デバイディング・アンプの実施例に
ついて詳細に説明する。第５図はこの発明の一実施例の
基本構成をブロック図で示したものである。
第５図においては、２ウエイスピーカ装置を例示してい
るが、３ウ工イ以上のスピーカ装置でも内容はまったく
同一なので、ここでは２ウエイスピーカ装置にとって説
明する。
るが、３ウ工イ以上のスピーカ装置でも内容はまったく
同一なので、ここでは２ウエイスピーカ装置にとって説
明する。
第５図において、第１図および第３図と同一部分には同
一符号を付して述べることにする。マルチウェイスピー
カ装置２を駆動するためのチャンネル・デバイディング
アンプ５は帯域分割回路６、遅延回路７、そしてパワー
アンプ８の三つの部分から構成されており、以下のよう
な機能を持っている。
一符号を付して述べることにする。マルチウェイスピー
カ装置２を駆動するためのチャンネル・デバイディング
アンプ５は帯域分割回路６、遅延回路７、そしてパワー
アンプ８の三つの部分から構成されており、以下のよう
な機能を持っている。
帯域分割回路６は高域通過フィルタ６ａと低域通過フィ
ルタ６ｂとにより構成されており、この高域通過フィル
タ６ａと低域通過フィルタ６ｂには入力信号９が入力さ
れるようになっている。
ルタ６ｂとにより構成されており、この高域通過フィル
タ６ａと低域通過フィルタ６ｂには入力信号９が入力さ
れるようになっている。
高域通過フィルタ６ａの出力端からは高音用の単体スピ
ーカ３への信号１０ａを出力して遅延回路７０冗遅延形
全域通過回路７ａに入力するようになっている。
ーカ３への信号１０ａを出力して遅延回路７０冗遅延形
全域通過回路７ａに入力するようになっている。
同様にして、低域通過フィルタ６ｂの出力端からは低音
用の単体スピーカ４への信号１０ｂを出力して遅延回路
７の定遅延形全域通過回路７ｂに入力するようになって
いる。
用の単体スピーカ４への信号１０ｂを出力して遅延回路
７の定遅延形全域通過回路７ｂに入力するようになって
いる。
上記から明らかなように、遅延回路７は二つの定遅延形
全域通過回路？ａ、７ｂから構成されており、この二つ
の定遅延形全域通過回路７ａ、７ｂからの出力はそれぞ
れパワーアンプ８の高音用の単体スピーカ３、低音用の
単体スピーカ４を駆動するためのパワーアンプ８ａ、８
ｂに出力するようになっている。
全域通過回路？ａ、７ｂから構成されており、この二つ
の定遅延形全域通過回路７ａ、７ｂからの出力はそれぞ
れパワーアンプ８の高音用の単体スピーカ３、低音用の
単体スピーカ４を駆動するためのパワーアンプ８ａ、８
ｂに出力するようになっている。
次に、以上のように構成されたこの発明のマルチウェイ
・スピーカ装置用チャンネルデバイディング・アンプの
動作について説明する。
・スピーカ装置用チャンネルデバイディング・アンプの
動作について説明する。
まず、入力信号９は帯域分割回路６に供給されて、高域
通過フィルタ６ａ、低域通過フィルタ６ｂにより高音用
の単体スピーカ３への信号１０ａおよび低音用の単体ス
ピーカ４への信号１０ｂに分割される。次にこれらの信
号１０ａ、１０ｂは遅延回路７として用いる定遅延形全
域通過回路７ａ。
通過フィルタ６ａ、低域通過フィルタ６ｂにより高音用
の単体スピーカ３への信号１０ａおよび低音用の単体ス
ピーカ４への信号１０ｂに分割される。次にこれらの信
号１０ａ、１０ｂは遅延回路７として用いる定遅延形全
域通過回路７ａ。
７ｂに加えられ、ここで、各単体スピーカ３，４の音響
中心の差異を補正するのに必要な遅延が与えられ、最後
に各単体スピーカ３，４を駆動するためのパワーアンプ
８ａ、ｇｂに入力される。
中心の差異を補正するのに必要な遅延が与えられ、最後
に各単体スピーカ３，４を駆動するためのパワーアンプ
８ａ、ｇｂに入力される。
第５図において、各単体スピーカ３，４を同一バッフル
面ｌ上に保った状態で、音響中心の距離差を△ｔとする
と△ｌは △１＝１１−１ω ・・・・・・・・・・・・・・・
・・・・・・ （１）であるから、△ｔを補正するため
の遅延時間の補正ｉｉ１ ｔ ？は ｔｙ＝△ｌ／ｃ ・・・・・・・・・・・・・・・
・・・・・・・・・ （２）となる。ただし、Ｃは音速
である。
面ｌ上に保った状態で、音響中心の距離差を△ｔとする
と△ｌは △１＝１１−１ω ・・・・・・・・・・・・・・・
・・・・・・ （１）であるから、△ｔを補正するため
の遅延時間の補正ｉｉ１ ｔ ？は ｔｙ＝△ｌ／ｃ ・・・・・・・・・・・・・・・
・・・・・・・・・ （２）となる。ただし、Ｃは音速
である。
したがって、低音用の単体スピーカ４の遅延回路７の定
遅延形全域通過回路７ａにｔｙを与えれば、音響中心の
差異の問題は解決され、しかも各単体スピーカ３，４を
同一バッフル面１上に保つことができるので、指向特性
の劣化はない。
遅延形全域通過回路７ａにｔｙを与えれば、音響中心の
差異の問題は解決され、しかも各単体スピーカ３，４を
同一バッフル面１上に保つことができるので、指向特性
の劣化はない。
また、この例の場合には高音用の単体スピーカ３の定遅
延形全域通過回路７ａには遅延を与える必要がないので
、定遅延形全域通過回路７ａを省略することができる。
延形全域通過回路７ａには遅延を与える必要がないので
、定遅延形全域通過回路７ａを省略することができる。
逆に、１１ ＜１ωとなった場合は定遅延形全域通過回
路７ａＫ遅延を与えることにより、音響中心を一致させ
ることができるから、定遅延形全域通過回路７ｂを省略
することができる。
路７ａＫ遅延を与えることにより、音響中心を一致させ
ることができるから、定遅延形全域通過回路７ｂを省略
することができる。
さらに、３ウ工イ以上のスピーカ装置では、どれか最も
位相遅れの大きい単体スピーカの音響中心に他の単体ス
ピーカの音響中心が一致するように各定遅延形全域通過
回路の遅延時間を選択すればよい。
位相遅れの大きい単体スピーカの音響中心に他の単体ス
ピーカの音響中心が一致するように各定遅延形全域通過
回路の遅延時間を選択すればよい。
このようにすることによって、各単体スピーカ３．４を
同一バッフル面ｌ上に保ったまま音響中心を一致させる
ことが可能となる。
同一バッフル面ｌ上に保ったまま音響中心を一致させる
ことが可能となる。
なお、第５図においては、帯域分割回路６の出力信号が
遅延回路７に入力される形となっているが、この順序は
逆になってもよいことは勿論である。
遅延回路７に入力される形となっているが、この順序は
逆になってもよいことは勿論である。
次に、遅延回路７として用いる定遅延形全域通過回路７
ａ、７ｂの内容と遅延時間の与え方に一ついて説明する
。この発明に用いる定遅延形全域通過回路７ａ、７ｂは
１２次のような伝達関数Ｈｎ （Ｓ）をもつ全域通過回
路群の中のいずれか一つである。
ａ、７ｂの内容と遅延時間の与え方に一ついて説明する
。この発明に用いる定遅延形全域通過回路７ａ、７ｂは
１２次のような伝達関数Ｈｎ （Ｓ）をもつ全域通過回
路群の中のいずれか一つである。
Ｈｎ （Ｓ）＝Ｋ −（ｎ ｎ （ｏ）／Ｂ ｎ （Ｓ
） １−（３）ただしＫは定数、Ｓは基準化複素周波数
であり、Ｂｎ（Ｓ）は次式であられされる多項式である
。
） １−（３）ただしＫは定数、Ｓは基準化複素周波数
であり、Ｂｎ（Ｓ）は次式であられされる多項式である
。
（３）式において、ｎ ”＝ １〜５について具体的に
伝達関数を示すと次の（５）〜（９）式のようになる。
伝達関数を示すと次の（５）〜（９）式のようになる。
Ｈ＋ （Ｓ）＝Ｋ・−１９１・・・・・・・・・・・・
・・・・・・・・・・・・（５）Ｓ＋２ □ｘ ＜ｓ）＝え、」２ Ｕ−影±１７− １１１０
．５１０１１０１８．１８８．（６）８”＋６８＋１２ 一８″＋１２８”−６０針士り−−（７）” （Ｓ）−
Ｋ” Ｓ３＋１２８” ＋６Ｏ８＋１２０第６図はｎ
＝ １〜．５についてＨｎ（Ｓ）の群遅延特性を基準
化周波数Ｘについて示したものである。ここでＸとＳの
関係は次の通りである。
・・・・・・・・・・・・（５）Ｓ＋２ □ｘ ＜ｓ）＝え、」２ Ｕ−影±１７− １１１０
．５１０１１０１８．１８８．（６）８”＋６８＋１２ 一８″＋１２８”−６０針士り−−（７）” （Ｓ）−
Ｋ” Ｓ３＋１２８” ＋６Ｏ８＋１２０第６図はｎ
＝ １〜．５についてＨｎ（Ｓ）の群遅延特性を基準
化周波数Ｘについて示したものである。ここでＸとＳの
関係は次の通りである。
５＝ｊｘ＝ｊ（ｕＪ／両） ・・・・・・・・・・・
・・・・ （１０）ただし、ωは角周波数、〃０は基準
となる角周波数である。
・・・・ （１０）ただし、ωは角周波数、〃０は基準
となる角周波数である。
第６図かられかるようにＨｎ（ｊｘ）の群遅延特性は低
周波数帯域程平坦で、しかも平坦な領域はｎが増加する
程高周波帯域に拡大する。
周波数帯域程平坦で、しかも平坦な領域はｎが増加する
程高周波帯域に拡大する。
したがって、周波数帯域を制限し、群遅延特性の平坦な
領域のみを用いるとすれば、上記のＨｎ＜Ｓ＞は全域通
過回路であるから、そのまま遅延回路としての機能をも
ち、結局、各単体スピーカ間の音響中心の差異を補正す
ることができる。
領域のみを用いるとすれば、上記のＨｎ＜Ｓ＞は全域通
過回路であるから、そのまま遅延回路としての機能をも
ち、結局、各単体スピーカ間の音響中心の差異を補正す
ることができる。
次に、定遅延形全域通過回路の具体的な構成法と遅延時
間の与え方について述べる。いま、（５）弐〜（９）式
において、Ｈｎ（Ｓ）を１次形および２次形の全域通過
回路の積という形で表現すると次のｕＩＪ式〜０９式の
ようになる。
間の与え方について述べる。いま、（５）弐〜（９）式
において、Ｈｎ（Ｓ）を１次形および２次形の全域通過
回路の積という形で表現すると次のｕＩＪ式〜０９式の
ようになる。
−８＋２
Ｈ＋ （Ｓ ）＝Ｋ・−１畳−・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・［１１１Ｓ２
−６８＋１２ Ｈ２（Ｓ）−に−１１ｉ石Ｔ・・・・・・・・・・・・
・・・・・・・・・・・・ｕ力Ｉ（３（Ｓ）や。、ｄ悸
Ｍ−４１１７−１゜Ｓ＋４．６４４３７１ ８４（Ｓ）ゆえ、ム１，５８±汀針几す９且？Ｓ” ＋
１１．５８４８４Ｓ＋３６．５６０５２、−欧」■旦獲
翠ＩＡ、１−災１２９．．．。
・・・・・・・・・・・・・・・・・・・［１１１Ｓ２
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・・・・・・・・・・・・ｕ力Ｉ（３（Ｓ）や。、ｄ悸
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１１．５８４８４Ｓ＋３６．５６０５２、−欧」■旦獲
翠ＩＡ、１−災１２９．．．。
Ｓ” ＋８．４１５１５ＢＳ＋４５．９５１２０山（８
）＊え、二旦士Ｌ２９−３４ｆｉ？Ｓ＋７．２９３４７
？ Ｓ” −９，２９８６９７Ｓ＋７２．６２５２６” ’
ｇ’−範０°−９ Ａ−ｅ ｒｑ ｓ−＋−ｒ ２，６
２ ｓ 狂”’ ”第７図（ａ）−第７図（ｅ）はＫを
１とし、）（ｓ（Ｓ）〜Ｈ１ｌ（Ｓ）についてａ（至）
式〜Ｑ５式であられされる定遅延形全域通過回路を、リ
アクタンス素子のみから構成される１次形および２次形
の対称格子形回路を複数個縦続接続してなる回路と負荷
抵抗Ｒとで構成したものである。
）＊え、二旦士Ｌ２９−３４ｆｉ？Ｓ＋７．２９３４７
？ Ｓ” −９，２９８６９７Ｓ＋７２．６２５２６” ’
ｇ’−範０°−９ Ａ−ｅ ｒｑ ｓ−＋−ｒ ２，６
２ ｓ 狂”’ ”第７図（ａ）−第７図（ｅ）はＫを
１とし、）（ｓ（Ｓ）〜Ｈ１ｌ（Ｓ）についてａ（至）
式〜Ｑ５式であられされる定遅延形全域通過回路を、リ
アクタンス素子のみから構成される１次形および２次形
の対称格子形回路を複数個縦続接続してなる回路と負荷
抵抗Ｒとで構成したものである。
同図において、Ｈｓ（Ｓ）とＨ２（Ｓ）は示していない
が、これは両者がそれぞれ１つの構成単位としての形を
とるため対称格子形回路を複数個縦続接続してなる回路
とはならないからである。第７図（ＩＬ）において素子
定数は次の通りである。
が、これは両者がそれぞれ１つの構成単位としての形を
とるため対称格子形回路を複数個縦続接続してなる回路
とはならないからである。第７図（ＩＬ）において素子
定数は次の通りである。
第７図（ｂ）における素子定数は次の通りである。
第７図＜Ｃ）における素子定数は次の通りである。
いま、必要な遅延時間の補正量をｔｇとすると、ｔｇと
０との関係は ｕＱ＝１／１ｇ ・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・ Ｖ饋で与えられるか
ら、第７図（ａＪ〜第７図（Ｃ）において負荷抵抗Ｒを
決めれば、ｔｇを与える定遅延形全域通過回路の素子定
数はＱＱ式〜（１８１式により容易に決定される。
０との関係は ｕＱ＝１／１ｇ ・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・ Ｖ饋で与えられるか
ら、第７図（ａＪ〜第７図（Ｃ）において負荷抵抗Ｒを
決めれば、ｔｇを与える定遅延形全域通過回路の素子定
数はＱＱ式〜（１８１式により容易に決定される。
以上詳述したように、この発明のマルチウェイスピーカ
装置用チャンネル・デバイディング・アンプによれば、
リアクタンス素子のみから構成される１次形および２次
形の対称格子形回路を複数個縦続接続してなる回路と負
荷抵抗とで構成される定遅延形全域通過回路を遅延回路
としてチャンネル・デバイディング・アンプ中に設けた
ので、各単体スピーカを同一バッフル面上に保ったまま
、各単体スピーカに任意の遅延を与えることができる。
装置用チャンネル・デバイディング・アンプによれば、
リアクタンス素子のみから構成される１次形および２次
形の対称格子形回路を複数個縦続接続してなる回路と負
荷抵抗とで構成される定遅延形全域通過回路を遅延回路
としてチャンネル・デバイディング・アンプ中に設けた
ので、各単体スピーカを同一バッフル面上に保ったまま
、各単体スピーカに任意の遅延を与えることができる。
したがって、各単体スピーカの音響中心の差異を容易に
補正することができ、指向特性を劣化させることなく、
自然な音質を得ることができる。
補正することができ、指向特性を劣化させることなく、
自然な音質を得ることができる。
第１図は従来のマルチウェイ・スピル力装置における単
体スピーカの配置の一例を示す図、第２図は第１図のマ
ルチウェイ・スピーカ装置の低音用スピーカと高音用ス
ピーカの位相特性を示す図、第３図は単体スピーカの配
置をずらすことによって音響中心を一致させた従来のス
ピーカ装置を示す図、第４図は第３図のスピーカ装置の
位相特性をボす図、第５図はこの発明のマルチウェイス
ピーカ装置用チャンネル・デバイディング・アンプの一
実施例の構成を示すブロック図、第６図はこの発明のマ
ルチウェイスピーカ装置用チャンネル・デバイディング
・アンプに用いる定遅延全域通過回路の基準化周波数対
群遅延時間の関係を示す特性図、第７図（ａ）〜第７図
（ｃＪはリアクタンス素子のみから構成される１次形お
よび２次形の対称格子形回路を複数個縦続接続してなる
回路と負荷抵抗Ｒとで構成される定遅延形全域通過回路
の−例を示す回路図である。 １・・・・・・バッフル面、２・・・・・・マルチウェ
イ・スピーカ装置、３・・・・・・高音用の単体スピー
カ、４・・・・・・低音用の単体スピーカ、５・・・・
・・チャンネル・デバイディング・アンプ、６・・・・
・・分割回路、６ａ・・・・・・高域通過フィルタ、６
ｂ・・・・・・低域通過フィルタ、７・・・・・・遅延
回路、７ａ、７ｂ・・・・・・定遅延形全域通過回路、
８，８ａ、８ｂ・・・・・・パワーアンプ、９・・・・
・・入力信号、１０ａ・・・・・・高音用の単体スピー
カへの信号、１０ｂ・・・・・・低音用の単体スピーカ
への信号。 なお、図中同一符号は同一または相当部分を示す。 代理人 葛 野 信 −（ほか１名） 昭和 年 月 日 ９，１゛許庁長宮殿 １、事ｆ１の表示 特願昭５８−５６５９号２ 発
明の名称 マルチウェイスピーカ装置用チャンネル
・デバイディング・アンプ コ３．補正をする者 代表者片１１１仁八部 ６、補正の内容 （１）明細書第４頁１７行目に［ピーカ装置にとって」
とあるを「ビーカ装置を例にとって」と補正する。 （２）同第８頁１５行目に「Ｈｎ（Ｓ）＝Ｋ・（Ｂｎ（
０）／（３）同第８頁１８行目に「Ｂｎ（Ｓ）＝Σ１＝
１ （４）同第１０頁１行目〜第１３頁２０行目を別紙のと
おり補正する。 したがって、周波数帯域を制限し、群遅延特性の平坦な
領域のみを用いるとすれば、上記のＨｎ（Ｓ）は全域通
過回路であるから、そのまま遅延回路としての機能をも
ち、結局、各単体スピーカ間の音響中心の差異を補正す
ることができる。 次に、定遅延形全域通過回路の具体的な構成法と遅延時
間の与え方について述べる。いま、（５）弐〜（９）式
において、Ｈｎ （Ｓ）を１次形および２次形の全域通
過回路の積という形で表現すると次のαυ式〜ａ！９式
のようになる。 Ｈ４（Ｓ）キＫ・□・ Ｓ”＋１１．６８４８４８＋３６．５６０５２Ｓ’＋１
３．４０７８３８＋５７．０８９９２第７図（ａ）〜第
７図（ｃ）はＫを１とり、Ｈ５（Ｓ）〜Ｈ５（Ｓ）につ
いてＨ式〜０５式であられされる定遅延形全域通過回路
を、リアクタンス素子のみから構成される１次形および
２次形の対称格子形回路を複数個縦続接続してなる回路
と負荷抵抗Ｒとで構成したものである。 同図において、Ｈｌ （Ｓ）とＨ２（ｓ）は示していな
いが、これは両者がそれぞれ１つの構成単位としての形
をとるため対称格子形回路を複数個縦続接続してなる回
路とはならないからである。第７図（ａ）において素子
定数は次の通りである。 Ｌ、＝ ０．２１５３１４４ Ｒ／ω０第７図（ｂ）に
おける素子定数は次の通りである。 第７図（ｅ）における素子定数は次の通りである。 いま、必要な遅延時間の補正量をｔｇとすると、ｔｇと
ω。との関係は ωｏ−１／ ｔｇ ・・・・・・・・・・
・・・・・・・・・・・α鴨で与えられるから、第７図
（ａ）〜第７図（ｃ）において負荷抵抗Ｒを決めれば、
ｔｇを与える定遅延形全域通過回路の素子定数はＱＩｌ
Ｏ式〜Ｑ１式により容易に決定される。 以上詳述したように、この発明のマルチウェイスピーカ
装置用チャンネル・デバイディング・アンプによれば、
リアクタンス素子のみから構成される１次形および２次
形の対称格子形回路を複数個縦続接続してなる回路と負
荷抵抗とで構成される定遅延形全域通過回路を遅延回路
としてチャンネル・デバイディング・アンプ中に設けた
ので各単体スピーカを同一バッフル面上に保ったまま、
各単体スピーカに任意の遅延を与えることかできる。
体スピーカの配置の一例を示す図、第２図は第１図のマ
ルチウェイ・スピーカ装置の低音用スピーカと高音用ス
ピーカの位相特性を示す図、第３図は単体スピーカの配
置をずらすことによって音響中心を一致させた従来のス
ピーカ装置を示す図、第４図は第３図のスピーカ装置の
位相特性をボす図、第５図はこの発明のマルチウェイス
ピーカ装置用チャンネル・デバイディング・アンプの一
実施例の構成を示すブロック図、第６図はこの発明のマ
ルチウェイスピーカ装置用チャンネル・デバイディング
・アンプに用いる定遅延全域通過回路の基準化周波数対
群遅延時間の関係を示す特性図、第７図（ａ）〜第７図
（ｃＪはリアクタンス素子のみから構成される１次形お
よび２次形の対称格子形回路を複数個縦続接続してなる
回路と負荷抵抗Ｒとで構成される定遅延形全域通過回路
の−例を示す回路図である。 １・・・・・・バッフル面、２・・・・・・マルチウェ
イ・スピーカ装置、３・・・・・・高音用の単体スピー
カ、４・・・・・・低音用の単体スピーカ、５・・・・
・・チャンネル・デバイディング・アンプ、６・・・・
・・分割回路、６ａ・・・・・・高域通過フィルタ、６
ｂ・・・・・・低域通過フィルタ、７・・・・・・遅延
回路、７ａ、７ｂ・・・・・・定遅延形全域通過回路、
８，８ａ、８ｂ・・・・・・パワーアンプ、９・・・・
・・入力信号、１０ａ・・・・・・高音用の単体スピー
カへの信号、１０ｂ・・・・・・低音用の単体スピーカ
への信号。 なお、図中同一符号は同一または相当部分を示す。 代理人 葛 野 信 −（ほか１名） 昭和 年 月 日 ９，１゛許庁長宮殿 １、事ｆ１の表示 特願昭５８−５６５９号２ 発
明の名称 マルチウェイスピーカ装置用チャンネル
・デバイディング・アンプ コ３．補正をする者 代表者片１１１仁八部 ６、補正の内容 （１）明細書第４頁１７行目に［ピーカ装置にとって」
とあるを「ビーカ装置を例にとって」と補正する。 （２）同第８頁１５行目に「Ｈｎ（Ｓ）＝Ｋ・（Ｂｎ（
０）／（３）同第８頁１８行目に「Ｂｎ（Ｓ）＝Σ１＝
１ （４）同第１０頁１行目〜第１３頁２０行目を別紙のと
おり補正する。 したがって、周波数帯域を制限し、群遅延特性の平坦な
領域のみを用いるとすれば、上記のＨｎ（Ｓ）は全域通
過回路であるから、そのまま遅延回路としての機能をも
ち、結局、各単体スピーカ間の音響中心の差異を補正す
ることができる。 次に、定遅延形全域通過回路の具体的な構成法と遅延時
間の与え方について述べる。いま、（５）弐〜（９）式
において、Ｈｎ （Ｓ）を１次形および２次形の全域通
過回路の積という形で表現すると次のαυ式〜ａ！９式
のようになる。 Ｈ４（Ｓ）キＫ・□・ Ｓ”＋１１．６８４８４８＋３６．５６０５２Ｓ’＋１
３．４０７８３８＋５７．０８９９２第７図（ａ）〜第
７図（ｃ）はＫを１とり、Ｈ５（Ｓ）〜Ｈ５（Ｓ）につ
いてＨ式〜０５式であられされる定遅延形全域通過回路
を、リアクタンス素子のみから構成される１次形および
２次形の対称格子形回路を複数個縦続接続してなる回路
と負荷抵抗Ｒとで構成したものである。 同図において、Ｈｌ （Ｓ）とＨ２（ｓ）は示していな
いが、これは両者がそれぞれ１つの構成単位としての形
をとるため対称格子形回路を複数個縦続接続してなる回
路とはならないからである。第７図（ａ）において素子
定数は次の通りである。 Ｌ、＝ ０．２１５３１４４ Ｒ／ω０第７図（ｂ）に
おける素子定数は次の通りである。 第７図（ｅ）における素子定数は次の通りである。 いま、必要な遅延時間の補正量をｔｇとすると、ｔｇと
ω。との関係は ωｏ−１／ ｔｇ ・・・・・・・・・・
・・・・・・・・・・・α鴨で与えられるから、第７図
（ａ）〜第７図（ｃ）において負荷抵抗Ｒを決めれば、
ｔｇを与える定遅延形全域通過回路の素子定数はＱＩｌ
Ｏ式〜Ｑ１式により容易に決定される。 以上詳述したように、この発明のマルチウェイスピーカ
装置用チャンネル・デバイディング・アンプによれば、
リアクタンス素子のみから構成される１次形および２次
形の対称格子形回路を複数個縦続接続してなる回路と負
荷抵抗とで構成される定遅延形全域通過回路を遅延回路
としてチャンネル・デバイディング・アンプ中に設けた
ので各単体スピーカを同一バッフル面上に保ったまま、
各単体スピーカに任意の遅延を与えることかできる。
Claims (1)
- 複数個の単体スピーカを設けてなるマルチウェイ・スピ
ーカ装置において、前記各単体スピーカの音響中心を一
致させるため、少なくとも一つ以上のチャンネルにリア
クタンス素子のみから構成される１次形および２次形の
対称格子形回路を複数個縦接続してなる回路と、前記縦
続接続しでなル・デバイディンｌアンプ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58005659A JPS59131291A (ja) | 1983-01-17 | 1983-01-17 | マルチウエイスピ−カ装置用チヤンネル・デバイデイング・アンプ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58005659A JPS59131291A (ja) | 1983-01-17 | 1983-01-17 | マルチウエイスピ−カ装置用チヤンネル・デバイデイング・アンプ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59131291A true JPS59131291A (ja) | 1984-07-28 |
Family
ID=11617235
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58005659A Pending JPS59131291A (ja) | 1983-01-17 | 1983-01-17 | マルチウエイスピ−カ装置用チヤンネル・デバイデイング・アンプ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59131291A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6348113B1 (en) | 1998-11-25 | 2002-02-19 | Cabot Corporation | High purity tantalum, products containing the same, and methods of making the same |
-
1983
- 1983-01-17 JP JP58005659A patent/JPS59131291A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6348113B1 (en) | 1998-11-25 | 2002-02-19 | Cabot Corporation | High purity tantalum, products containing the same, and methods of making the same |
| US6893513B2 (en) | 1998-11-25 | 2005-05-17 | Cabot Corporation | High purity tantalum, products containing the same, and methods of making the same |
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