JPS59129228U - Pll回路 - Google Patents

Pll回路

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Publication number
JPS59129228U
JPS59129228U JP2298183U JP2298183U JPS59129228U JP S59129228 U JPS59129228 U JP S59129228U JP 2298183 U JP2298183 U JP 2298183U JP 2298183 U JP2298183 U JP 2298183U JP S59129228 U JPS59129228 U JP S59129228U
Authority
JP
Japan
Prior art keywords
bias
voltage
circuit
vco
pll circuit
Prior art date
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Pending
Application number
JP2298183U
Other languages
English (en)
Inventor
孝 船田
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP2298183U priority Critical patent/JPS59129228U/ja
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Pending legal-status Critical Current

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Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案による安定バイアス回路を有するPLL
回路の一実施例を示すブロック図である。 1・・・位相比較器、2・・・低域フィルタ、3・・・
ラグリードフィルタ、4・・・V6O13・・・安定バ
イアス回路、7・・・バイアス用フィルタ、lC4・・
・位相比較部、IC3・・・バイアス電圧発生回路、I
C6・・・電圧発生用バッファ、IC7・・・バイアス
電圧発生用バッファ、RVl・・・オフセット調整用可
変抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. 参照周波数入力信号とVCOの発振出力の周波数および
    位相を比較しその誤差に応じた平均出力電圧を発生する
    電圧発生回路を備えた位相比較器と、この位相比較器の
    出力電圧を低域フィルタを通して入力しこれを増幅して
    上記VCOの入力電圧として供給する演算増幅器と、上
    記VCOの出力に接続され上記参照周波数入力信号の入
    力しない自走時にはVCOの上記電圧発生回路と同等の
    平均出力電圧を発生するバイアス電圧発生回路よりバイ
    アス用フィルタを通して上記演算増幅器にバイアス電圧
    を供給する安定バイアス回路とからなるPLL回路。
JP2298183U 1983-02-21 1983-02-21 Pll回路 Pending JPS59129228U (ja)

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Publication Number Publication Date
JPS59129228U true JPS59129228U (ja) 1984-08-30

Family

ID=30154073

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JP2298183U Pending JPS59129228U (ja) 1983-02-21 1983-02-21 Pll回路

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61143341U (ja) * 1985-02-26 1986-09-04

Cited By (1)

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JPS61143341U (ja) * 1985-02-26 1986-09-04

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