JPS591200U - メモリ回路 - Google Patents

メモリ回路

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Publication number
JPS591200U
JPS591200U JP9701782U JP9701782U JPS591200U JP S591200 U JPS591200 U JP S591200U JP 9701782 U JP9701782 U JP 9701782U JP 9701782 U JP9701782 U JP 9701782U JP S591200 U JPS591200 U JP S591200U
Authority
JP
Japan
Prior art keywords
memory circuit
memory
power source
main power
control circuit
Prior art date
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Pending
Application number
JP9701782U
Other languages
English (en)
Inventor
小宮　祐次
Original Assignee
日本電気株式会社
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Publication date
Application filed by 日本電気株式会社 filed Critical 日本電気株式会社
Priority to JP9701782U priority Critical patent/JPS591200U/ja
Publication of JPS591200U publication Critical patent/JPS591200U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来のＣＭＯＳメモリ回路図、第２図は本考
案の一実施例によるＣＭＯＳメモリ回路図である。 １・・・ｉ・・ＴＴＬからＣＭＯＳメモリ選択信号発生
回路、２・・・・・・ＣＭＯＳメモリ、３・・・・・・
バッテリ、４・・・・・・主電源、５・・・・・・抵抗
、６・・・・・・１の出力端子、７・・・・・・２の制
御入力端子、８・・・・・−ＣＭＯ３から成るＣＭＯＳ
メモリ選択信号発生回路、１１・・・・・・主電源オフ
信号、１２・・・・・−ＣＭＯＳメモリ選択要求信号、
１３・・・・・、ＣＭＯＳメモリ選択信号。

Claims (1)

    【実用新案登録請求の範囲】
  1. メモリ、主電源、補助電源および前記主電源のオフ時に
    前記メモリを非選択にする側御回路とを−有し、該制御
    回路はＣＭＯ３素子で構成されている事を特徴とするメ
    モリ回路。
JP9701782U 1982-06-28 1982-06-28 メモリ回路 Pending JPS591200U (ja)

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JP9701782U JPS591200U (ja) 1982-06-28 1982-06-28 メモリ回路

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JP9701782U JPS591200U (ja) 1982-06-28 1982-06-28 メモリ回路

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Publication Number Publication Date
JPS591200U true JPS591200U (ja) 1984-01-06

Family

ID=30230952

Family Applications (1)

Application Number Title Priority Date Filing Date
JP9701782U Pending JPS591200U (ja) 1982-06-28 1982-06-28 メモリ回路

Country Status (1)

Country Link
JP (1) JPS591200U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04113896U (ja) * 1991-03-19 1992-10-06 日本碍子株式会社 瓦焼成用支持具

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH04113896U (ja) * 1991-03-19 1992-10-06 日本碍子株式会社 瓦焼成用支持具

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