JPS59119884A - Semiconductor light-emitting device - Google Patents

Semiconductor light-emitting device

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JPS59119884A
JPS59119884A JP22836382A JP22836382A JPS59119884A JP S59119884 A JPS59119884 A JP S59119884A JP 22836382 A JP22836382 A JP 22836382A JP 22836382 A JP22836382 A JP 22836382A JP S59119884 A JPS59119884 A JP S59119884A
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JP
Japan
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layer
active layer
region
active
semiconductor
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Application number
JP22836382A
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Japanese (ja)
Inventor
Ichiro Ushijima
牛嶋 一郎
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Publication of JPS59119884A publication Critical patent/JPS59119884A/en
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
    • H01S5/20Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01SDEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00Semiconductor lasers
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    • H01S5/22Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers having a ridge or stripe structure
    • H01S5/223Buried stripe structure
    • H01S5/2231Buried stripe structure with inner confining structure only between the active layer and the upper electrode

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  • Semiconductor Lasers (AREA)

Abstract

PURPOSE:To prevent the generation of a crystal defect in an active layer by dividing an upper clad layer into two, extremely thinning the thickness of a lower layer being directly in contact with the active layer and removing a region, which does not correspond to a stripe region of an upper layer. CONSTITUTION:A lower clad layer 12, the active layer 13, the upper clad layer first layer 14' in approximately 0.3mum thickness and a layer 14'' as the upper clad layer second layer in approximately 2mum thickness are formed on the surface of a substrate 11, an upper confining layer 14 is left, and the layer 14'' is removed. A current limiting layer 15 is buried and formed at a growth temperature of approximately 550 deg.C. The upper clad first layer 14' functions as a protective layer during the growth period to directly protect the active layer 13 from a thermal atmosphere, and a thermal deterioration is prevented.

Description

【発明の詳細な説明】 (1)発明の技術分野 本発明は半導体発光装置に関する。特に、横方向のキャ
リア閉じ込め効果が大きくしきい値電流が小さい利点を
有する埋め込み型半導体レーザの改良に関する。
DETAILED DESCRIPTION OF THE INVENTION (1) Technical Field of the Invention The present invention relates to a semiconductor light emitting device. In particular, the present invention relates to improvements in buried semiconductor lasers which have the advantage of having a large lateral carrier confinement effect and a small threshold current.

(2)技術の背景 半導体レーザにおいては、しきい値電流が小さく横方向
モードが単一化され安定していることが望ましい。その
ために活性層には結晶欠陥を有しないことが是非必要で
あり、その他、上下方向(電流通路に沿う方向)には極
めて薄い活性層をこれより屈折率の小さく互いに異なる
尋電型を有する上下のクラッド層をもって挾んだ構造と
して再結合領域を限定するとともに光を閉じ込め、一方
、横方向には電流通路を光軸に沿う限られた領域に限定
して再結合領域に限定していた。この要請を満足する構
造として埋め込みへテロ構造の半導体レーザが知られて
いる。
(2) Background of the Technology In a semiconductor laser, it is desirable that the threshold current be small and the lateral mode be unified and stable. For this purpose, it is absolutely necessary that the active layer has no crystal defects, and in addition, it is necessary to provide an extremely thin active layer in the vertical direction (direction along the current path) with a lower refractive index and a different dielectric type. The structure is sandwiched between two cladding layers to limit the recombination region and confine the light, while in the lateral direction the current path is limited to a limited region along the optical axis to limit the recombination region. A buried heterostructure semiconductor laser is known as a structure that satisfies this requirement.

(3)従来技術と問題点 従来技術における埋め込みダブルへテロ構造の半導体レ
ーザの概念的層構造の一例を第1図に示す。図は光軸方
向端面、すなわち、光の放出される方向から見た側面図
で−ある。図において、1は半導体基板であり1,2は
バッファ層兼下部クラッド層であり、3は活性層であり
、4は上部クラッド層であり、5は埋め込み層である。
(3) Prior Art and Problems An example of the conceptual layer structure of a buried double heterostructure semiconductor laser in the prior art is shown in FIG. The figure is a side view viewed from the end face in the optical axis direction, that is, from the direction in which light is emitted. In the figure, 1 is a semiconductor substrate, 1 and 2 are buffer layers and lower cladding layers, 3 is an active layer, 4 is an upper cladding layer, and 5 is a buried layer.

かかる埋め込み構造の半導体レーザにあっては、上下方
向には再結合領域と光との双方が限定され、横方向には
再結合領域が有効に限定されて、(イ)しきい値電流の
低減、(ロ)横方向モードの安定化の双方に大きな効果
を有するが、ただ、埋め込み型である関係上、エツチン
グ工程とそれに続(結晶成長過程とにおいて活性層の端
面が熱雰囲気に曝され熱劣化を発生して結晶欠陥を発生
しやすく、リーク電流等の原因となり、しきい値電流が
増加するという欠点がある。
In a semiconductor laser with such a buried structure, both the recombination region and the light are limited in the vertical direction, and the recombination region is effectively limited in the horizontal direction, resulting in (a) reduction of threshold current. (b) It has a great effect on stabilizing the lateral mode, but because it is a buried type, the end face of the active layer is exposed to a hot atmosphere during the etching process and the subsequent (crystal growth process). It has the drawback that it is prone to deterioration and crystal defects, which causes leakage current and increases the threshold current.

(4)発明の目的 本発明の目的は、この欠点を解消することにあり、埋め
込みへテロ構造を有する半導体発光装置において、活性
層に結晶欠陥が発生することなく、リーク電流等が流れ
ることが防止されており、その結果、しきい値電流が低
く、横方向モードが単一であり、安定な半導6体発光装
置を提供することにある。
(4) Purpose of the Invention The purpose of the present invention is to eliminate this drawback, and in a semiconductor light emitting device having a buried heterostructure, leakage current etc. can flow without generating crystal defects in the active layer. The object of the present invention is to provide a stable six-semiconductor light-emitting device with a low threshold current, a single lateral mode, and a stable semiconductor light-emitting device.

(5)発明の構成 上記の目的は、活性層を挟んで上部クラッド層と下部ク
ラッド層とを有し、光軸に沿って形成されたストライプ
領域に電流通路が制限されてなる半導体発光装置におい
て、前記上部クラッド層は、前記活性層上に展延し前記
活性層より大きなバントキャップを有する半導体薄層よ
りなる下層と、該下層上に展延し前記活性層より大きな
バンドギャップを有し前記下層とは選択的にエツチング
されうる半導体よりなる上層とよりなり、該・上層の前
記ストライプ領域に対応しない領域と前記下層との間に
は逆方向pn接合を有することにより達成される。
(5) Structure of the Invention The above object is to provide a semiconductor light emitting device which has an upper cladding layer and a lower cladding layer with an active layer in between, and in which a current path is restricted to a stripe region formed along the optical axis. , the upper cladding layer comprises a lower layer consisting of a thin semiconductor layer extending over the active layer and having a larger band gap than the active layer; and a lower layer comprising a thin semiconductor layer extending over the lower layer and having a larger band gap than the active layer. The lower layer consists of an upper layer made of a semiconductor that can be selectively etched, and this is achieved by having a reverse pn junction between the lower layer and a region of the upper layer that does not correspond to the stripe region.

埋め込み構造の半導体レーザの活性層に結晶欠陥が発生
することを防止するためには、その製造工程において活
性層が熱雰囲気と接触することを防止すればよい。その
ための手段として、埋め込み層が活性層に到達しないよ
うに形成する方法が考えられるが、ただ、この構造にお
いては、埋め込み層が本来的な意味を失うこととなる。
In order to prevent crystal defects from occurring in the active layer of a semiconductor laser with a buried structure, it is sufficient to prevent the active layer from coming into contact with a thermal atmosphere during the manufacturing process. As a means for this purpose, a method of forming the buried layer so that it does not reach the active layer is conceivable, but in this structure, the buried layer loses its original meaning.

そこで、本発明においては、上部クラッド層を2分割し
て活性層に直接接触する下層を上部クラッド層第1層、
直接接触しない上層を上部クラッド層第2層とし、第1
層の厚さを極めて薄(しておき、更に、第2層のストラ
イプ領域に対応しない領域を除去して、この領域に第1
層の上面と接して逆方向pn接合が形成することとなる
ような電流制限層を形成して電流通路をストライプ領域
に限定し、横方向には極めて挟い、例えば、2〜3  
[um]程度の領域においてのみ再結合がなされるよう
にし、この発光領域の横方向に対する制限をもって横方
向、モードの単一化と安定化とが実現されている。
Therefore, in the present invention, the upper cladding layer is divided into two, and the lower layer that directly contacts the active layer is the first upper cladding layer.
The upper layer that is not in direct contact with the upper cladding layer is the second layer, and the upper cladding layer is the second layer.
The thickness of the layer is kept very thin (and then the areas that do not correspond to the striped areas of the second layer are removed and the first layer is applied to this area).
A current limiting layer is formed such that a reverse p-n junction is formed in contact with the top surface of the layer to confine the current path to the striped region and is very sandwiched laterally, e.g.
Recombination is made to occur only in a region of about [um], and by limiting the lateral direction of this light emitting region, unification and stabilization of the mode in the lateral direction is realized.

この構造においては、上部クラッド層第1層が十分薄く
、ストライプに対応しない領域においては電流制限層が
活性層上面と極めて接近した領域まで及んでおり、ここ
に逆方向のpn接合が存在するため、従来技術に劣らず
電流をストライプ領域に限定する機能が発輝される。ま
た、この上部クラッド層第1層は、閉じ込め層成長工程
においては、活性層を熱雰囲気から保護する保護層とし
て機能し、活性層の熱劣化を有効に防止するため、結果
として、リーク電流等の発生する可能性が従来技術に比
してはるかに低減するという非常に大きな効果を有する
In this structure, the first layer of the upper cladding layer is sufficiently thin, and in regions that do not correspond to stripes, the current limiting layer extends to a region very close to the top surface of the active layer, where a pn junction exists in the opposite direction. , the ability to limit the current to the stripe region is as good as that of the prior art. In addition, this first upper cladding layer functions as a protective layer that protects the active layer from the thermal atmosphere during the confinement layer growth process, and effectively prevents thermal deterioration of the active layer, resulting in leakage current, etc. This has a very large effect in that the possibility of this occurring is much reduced compared to the conventional technology.

なお、上記の構成において、上部クラッド層第1層を除
去する工程にはウェットエツチング法が適しており、こ
のエツチングを制御して第1層のみを確実に除去するた
め第1層は、第2層のエツチングに使用されるエッチャ
ントに対し、エツチング選択性を有する、すなわち、エ
ッチされないような異種の半導体をもって形成されるこ
とが望ましい。但し、第1層の本来有すべき機能である
クラッド効果を十分に発揮させるために、第2層と同様
、活性層よりバンドギャップの値が大きく、かつ、屈折
率の小さい半導体であることが必要である。
In the above structure, a wet etching method is suitable for the step of removing the first layer of the upper cladding layer, and in order to control this etching and reliably remove only the first layer, the first layer is removed from the second layer. It is desirable to form a dissimilar semiconductor that has etch selectivity to the etchant used to etch the layer, ie, is not etched. However, in order to fully exhibit the cladding effect, which is the original function of the first layer, it is necessary to use a semiconductor with a larger bandgap value and a lower refractive index than the active layer, similar to the second layer. is necessary.

(6)発明の実施例 以下図面を参照しつつ、本発明の一実施例に係る半導体
発光装置について説明し、本発明の構成と特有の効果と
を明らかにする。
(6) Embodiments of the Invention A semiconductor light emitting device according to an embodiment of the present invention will be described below with reference to the drawings, and the structure and unique effects of the present invention will be clarified.

一例として、インジウムガリウムヒ素リン(InGaA
sP) /インジウムガリウムリン(InGaP)系の
埋め込みダブルへテロ構造のストライプ型半導体レーザ
の製造工程について述べる。
As an example, indium gallium arsenide phosphide (InGaA
The manufacturing process of a buried double heterostructure striped semiconductor laser based on sP)/indium gallium phosphide (InGaP) will be described.

第2図参照 n型不純物を1018CC,n3 ]程度含有するn型
ガリウムヒ素(nQaAs )よりなり厚さが300〔
μ+n)程度である基板11の(100)面上に、78
0°C程度の成長温度をもってなす液相エピタキシャル
成長法(以下1、LPE法という。)を使用して、(イ
)n型不純物を1018〔CIn−3〕程度含有するイ
ンジウムガリウムリン(n I n Ga P)よりな
り厚さが2〔μ+n)程度テするバッファ層兼下部クラ
ッド層12、(ロ)アンドープのインジウムガリウムヒ
素リン(InGaAsP)よりなり厚さ0.1〜0.2
〔μ+n〕程度の活性層13、(ハ)n型不純物を2 
X 1018[CIn ”、、]程度含有するp型イン
ジウムガリウムヒ素リン(p In Ga As P 
)よりなり、厚さが0.3〔μ+n)程度である上部ク
ラッド層第1層14’ 、 (−)n型不純物を2×1
018〔CIn−3〕程度含有するp型インジウムガリ
ウム・リン(panGap)よりなり厚さが2  (、
a+n〕程度である上部クラッド層第2層となる層14
″を順次形成する。;この積層体において、活性層のP
Lピーク波長は7.200 (X )であるため、下部
クラッド層12及び上部クラッド層第2層をなす半導体
の混晶比はPLピーク波長が6.500 (A)、また
上部クラッド層第1層の混晶比はPLピーク波長が6.
500 (A)よりわずかに長波長となるように決定さ
れている。
Refer to Figure 2. It is made of n-type gallium arsenide (nQaAs) containing about 1018 CC, n3 of n-type impurities and has a thickness of 300 mm.
78 μ+n) on the (100) plane of the substrate 11.
Using a liquid phase epitaxial growth method (hereinafter referred to as 1, LPE method) at a growth temperature of about 0°C, (a) indium gallium phosphide (nI n (b) a buffer layer/lower cladding layer 12 made of GaP) and having a thickness of about 2 [μ+n]; (b) made of undoped indium gallium arsenide phosphide (InGaAsP) and having a thickness of 0.1 to 0.2
Active layer 13 of about [μ+n], (c) n-type impurity of 2
p-type indium gallium arsenide phosphide (p In Ga As P
) and has a thickness of about 0.3 [μ+n], and (-)n type impurity is added 2×1.
It is made of p-type indium gallium phosphide (panGap) containing about 018 [CIn-3] and has a thickness of 2 (,
layer 14, which becomes the second layer of the upper cladding layer, having a thickness of about a+n]
In this laminate, P of the active layer is sequentially formed.
Since the L peak wavelength is 7.200 (X), the mixed crystal ratio of the semiconductors forming the lower cladding layer 12 and the upper cladding layer 2 is such that the PL peak wavelength is 6.500 (A), and the upper cladding layer 1 The mixed crystal ratio of the layer is such that the PL peak wavelength is 6.
The wavelength is determined to be slightly longer than 500 (A).

第3図参照 上記の積層体の上面のストライプに対応する領域に、公
知の手法をもって二酸化シリコン(Si02)よりなり
幅が5〔μ+n)程度のエツチングマスク(図示せず。
Refer to FIG. 3. An etching mask (not shown) made of silicon dioxide (Si02) and having a width of about 5 [μ+n] is formed using a known method in the region corresponding to the stripe on the upper surface of the above-mentioned laminate.

)を形成したのち、塩酸(H(、’l)をエッチャント
としてなすウェットエツチング法を使用して上部閉じ込
め層第2層となる層14  のメサエッチングを行ない
、ストライプに対応する領域全域に光軸に沿って延びる
上部閉じ込め層14を残留し、その他の領域から層14
″を除去し、フ ッ酸(HF)をもってエツチングマス
クを除去する。
), the layer 14, which will become the second upper confinement layer, is mesa-etched using a wet etching method using hydrochloric acid (H(,'l) as an etchant), and the optical axis is formed in the entire region corresponding to the stripe. Leaving the upper confinement layer 14 extending along the
'' and then remove the etching mask using hydrofluoric acid (HF).

この工程において、3元混晶である層14″は塩酸(H
el)によってエッチされるが、4元混晶である層14
′はエッチされないため、エツチング工程を極めて正確
に制御することが可能となる。
In this step, the layer 14'', which is a ternary mixed crystal, is made of hydrochloric acid (H
layer 14 which is etched by el) but is a quaternary mixed crystal;
' is not etched, allowing very precise control of the etching process.

第4図参照 再びLPE法を使用し、成長温度55000程度をもっ
て、n型不純物を8 X 10”(CIn ” )程度
含有するn型ガリウムヒ素(nQaAs)よりなる電流
制限層15を埋め込み形成する。電流制限層15の厚さ
は、ストライプに対応しない領域では1.5〔μ+n)
程度であり、ストライプに対応する領域、すなわち、上
部閉じ込め層第2層の上部では、はとんど成長しないた
め、0.2〔μ+n〕程度となる。またこの工程におい
て、電流制限層15の成長期間中、上部クラッド層第1
fA14’が保護層として機能して活性層13が直接熱
雰囲気に曝されることなく、安全に保護され、熱劣化等
の不利益を受けることが有効に防止される。
Referring to FIG. 4, a current limiting layer 15 made of n-type gallium arsenide (nQaAs) containing about 8×10''(CIn'') of n-type impurities is buried and formed using the LPE method again at a growth temperature of about 55,000. The thickness of the current limiting layer 15 is 1.5 [μ+n] in the region not corresponding to the stripe.
In the region corresponding to the stripe, that is, on the upper part of the second upper confinement layer, it hardly grows, so it is about 0.2 [μ+n]. Also, in this step, during the growth period of the current limiting layer 15, the upper cladding layer 1
fA14' functions as a protective layer, so that the active layer 13 is safely protected without being directly exposed to a thermal atmosphere, and disadvantages such as thermal deterioration are effectively prevented.

なお、ストライプに対応しない領域において電流制限層
15と上部クラッド層第1層14′との界面は、極めて
接近しており、ここに逆方向のpn接合が存在するので
、活性層13は左右に展延しておるにもかかわらず電流
はストライプ領域1く有効、に限定されるため、再結合
がなされる領域の横方向の幅は2〜3  [、cg+n
)程度となり、横モードの単一化と安定化が挺現される
In addition, in the region not corresponding to the stripe, the interface between the current limiting layer 15 and the first upper cladding layer 14' is extremely close to each other, and since a pn junction in the opposite direction exists here, the active layer 13 is Despite the spread, the current is effective only in one stripe region, so the lateral width of the recombination region is 2 to 3 [, cg+n
), and the transverse mode is unified and stabilized.

第5図参照 上記の工程終了後、電流制限層15のストライプに対応
する領域に公知の方法を匣用して亜鉛(Zn)を101
8(can ” )程度の濃度に拡散し、電流制限層1
5をp型導電領域(破線をもって囲まれた領域)16に
転換し、さらに、上面に正電極17、基板11の下面に
負電極18をそれぞれ形成し、埋め込み構造の半導体レ
ーザを完成する。
Refer to FIG. 5 After the above steps are completed, zinc (Zn) is applied to the area corresponding to the stripes of the current limiting layer 15 using a known method.
The current limiting layer 1 is diffused to a concentration of approximately
5 is converted into a p-type conductive region (region surrounded by a broken line) 16, and a positive electrode 17 and a negative electrode 18 are formed on the upper surface and the lower surface of the substrate 11, respectively, to complete a buried structure semiconductor laser.

なお本実施例では、インジウムガリウムヒ素リン(In
GaAsP)よりなる活性層を有する半導体レーザにつ
いて述べたが、活性層をなす半導体ハコれに限定されず
、ガリウムアルミニウムヒ素(GaAIAs) 、ガリ
ウムヒ素(GaAs)等でも、同様の効果が得られるこ
とが確認された。
In this example, indium gallium arsenide phosphide (In
Although we have described a semiconductor laser having an active layer made of gallium aluminum arsenide (GaAsP), the active layer is not limited to a semiconductor layer, and similar effects can be obtained with gallium aluminum arsenide (GaAIAs), gallium arsenide (GaAs), etc. confirmed.

更に層12.13.14′、14″の成長法としては、
本実施例に述べたLPE法の他に気相エピタキシャル成
長法(VPE法)、分子線エビクキソー法(MBE法)
、有機金属気相成長法(M (J CV D法)等を使
用しても全く差しつかえない。又、層14″のメサエッ
チの方向、あるいは形状等も本実施例に限定されるもの
ではないことはいうまでもない。
Furthermore, the growth method for layers 12, 13, 14', 14'' is as follows:
In addition to the LPE method described in this example, the vapor phase epitaxial growth method (VPE method), the molecular beam eviction method (MBE method)
There is no problem in using a metal-organic chemical vapor deposition method (M (JCVD method), etc. Also, the direction or shape of the mesa etch of the layer 14'' is not limited to this example. Needless to say.

(7)発明の詳細 な説明せるとおり、本発明によれば、埋め込みへテロ構
造を有する半導体発光装置において、活性層に結晶欠陥
が発生することな(、リーク電流等が流れる(とが防止
されており、その結果、しきい値電流が低く、横方向モ
ードが単一であり、安定な半導体発光装置を提供するこ
とができる。
(7) As described in detail, according to the present invention, in a semiconductor light emitting device having a buried heterostructure, crystal defects are prevented from occurring in the active layer (and leakage current and the like are prevented from flowing). As a result, a stable semiconductor light emitting device with a low threshold current and a single lateral mode can be provided.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は、従来技術における埋め込みダブルへ・テロ構
造の半導体レーザの概念的層構成の一例を示す図であり
、第2図乃至第5図は本発明の一実施例に係る埋め込み
ダブルへテロ構造の半導体レーザの製造工程における各
主要工程完了後の基板側面図である。なお第1図乃至第
5図は全て光軸方向端面、すなわち光の放出される方向
から見た側面図である。 1.11・・・・・・基板(nGaAs) 、2.12
・・・・・・ノく・ソファ層兼下部りラッ゛ド層(nI
nGaP) 、3.13・・・・・・活性層(アンドー
プInGaAsP’) 、 4・・・・・・上部クラッ
ド層(pInGaP)、14・・・・・・上部クラッド
層第2層(pInGap) 、14’−−上部クラッド
層第1層(pInGaAsP)、15・・・・・・電流
制限層、(nGaAs) 、16・・・・・・p型導電
領域、17・・・・・・正電極、18・・・・・・負電
極。
FIG. 1 is a diagram showing an example of the conceptual layer structure of a semiconductor laser having a buried double heterostructure in the prior art, and FIGS. FIG. 3 is a side view of the substrate after completion of each main step in the manufacturing process of the semiconductor laser of the structure. Note that FIGS. 1 to 5 are all side views seen from the end face in the optical axis direction, that is, from the direction in which light is emitted. 1.11...Substrate (nGaAs), 2.12
・・・・・・Nok・sofa layer and lower layer (nI
nGaP), 3.13... Active layer (undoped InGaAsP'), 4... Upper cladding layer (pInGaP), 14... Upper cladding layer 2nd layer (pInGap) , 14'--first upper cladding layer (pInGaAsP), 15... current limiting layer, (nGaAs), 16... p-type conductive region, 17... positive Electrode, 18... Negative electrode.

Claims (2)

【特許請求の範囲】[Claims] (1)活性層を挟んで上部クラッド層と下部クラッド層
とを有し、光軸に沿って形成されたストライプ領域に電
流通路が制限されてなる半導体先光装置において、前記
上部クラッド層は、前記活性層上に展延し前記活性層よ
り大きなバンドギャップを有する半導体薄層よりなる下
層と、該下層上に展延し前記活性層より大きなバンドギ
ャップを有し前記下層とは選択的にエツチングされうる
半導体よりなる上層とよりなり、該上層の前記ストライ
プ領域に対応しない領域には、前記活性層よりも小さな
バンドギャップを有する半導体層が前記下層上に展延す
ることを特徴とする半導体発光装置。
(1) In a semiconductor optical device having an upper cladding layer and a lower cladding layer with an active layer in between, and in which a current path is restricted to a stripe region formed along the optical axis, the upper cladding layer is a lower layer consisting of a thin semiconductor layer extending over the active layer and having a larger bandgap than the active layer; and a lower layer comprising a thin semiconductor layer extending over the lower layer and having a larger bandgap than the active layer; an upper layer made of a semiconductor that can be used as an active layer, and a semiconductor layer having a bandgap smaller than that of the active layer extends over the lower layer in a region of the upper layer that does not correspond to the stripe region. Device.
(2)前記上部クラッド層上層の前記ストライプ領域に
対応しない領域と該クラッド層下層との間には、逆方向
pn接合を有することを特徴とする特許請求の範囲第(
1)項記載の半導体発光装置。
(2) A reverse pn junction is provided between the region of the upper layer of the upper cladding layer that does not correspond to the stripe region and the lower layer of the cladding layer.
The semiconductor light emitting device according to item 1).
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* Cited by examiner, † Cited by third party
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