JPS59116551A - Speed signal detector - Google Patents

Speed signal detector

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JPS59116551A
JPS59116551A JP22592082A JP22592082A JPS59116551A JP S59116551 A JPS59116551 A JP S59116551A JP 22592082 A JP22592082 A JP 22592082A JP 22592082 A JP22592082 A JP 22592082A JP S59116551 A JPS59116551 A JP S59116551A
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JP
Japan
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outputs
output
phase
circuit
circuits
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Application number
JP22592082A
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Japanese (ja)
Inventor
Hisashi Kinoshita
木下 久
Shinobu Kake
忍 懸
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
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Publication of JPS59116551A publication Critical patent/JPS59116551A/en
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    • GPHYSICS
    • G01MEASURING; TESTING
    • G01PMEASURING LINEAR OR ANGULAR SPEED, ACCELERATION, DECELERATION, OR SHOCK; INDICATING PRESENCE, ABSENCE, OR DIRECTION, OF MOVEMENT
    • G01P3/00Measuring linear or angular speed; Measuring differences of linear or angular speeds
    • G01P3/42Devices characterised by the use of electric or magnetic means
    • G01P3/44Devices characterised by the use of electric or magnetic means for measuring angular speed
    • G01P3/46Devices characterised by the use of electric or magnetic means for measuring angular speed by measuring amplitude of generated current or voltage

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Indicating Or Recording The Presence, Absence, Or Direction Of Movement (AREA)

Abstract

PURPOSE:To reduce ripple of a speed signal while improving the response with the removal of high frequency components by differentiating and then differentiating and inverting outputs in two phases as input of a double phase type rotary encoder to be converted into four signals to synthesize them trimming near the maximum or the minimum thereof. CONSTITUTION:Outputs of a double phase type rotary encoder are supplied into input terminals 1a and 1b and in the normal rotation, A0 advances by 90 deg. with respect to B0. The outputs are respectively differentiated with differentiation circuits 2 and 3. They are inverted with inversion circuits 4 and 5 and outputs thereof A1, B1 and -A1 and -B1 are supplied to an analog switch 6. Inputs A0 and B0 are added with an addition circuit 7 and the input A0 inverted with an inversion circuit 9 is added to the input B0 with an addition circuit 8. Then, outputs C1 and C2 are converted into a pulse by identifying a code with pulse conversion circuits 10 and 11 and a binary counter 12 has four outputs of S1-S4. The outputs are trimmed and synthesized when each high level comes out to produce an output V1. An output of the analog switch 6 is treated with an LPF 13 to remove high frequency components.

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は、工作機械およびロボット等の速度制御を必要
とする動力源の速度センサとして使用される速度信号検
出装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a speed signal detection device used as a speed sensor for a power source that requires speed control, such as a machine tool or a robot.

(従来例の構成とその問題点) 一般に、産業用ロボットなどの機械的な制御を行なうサ
ーボ系において、系の動作の安定化および応答性を向上
させるためには速度ループが必要である。そこで、従来
は速度信号検出器として直流タフジェネレータを設置し
て速度信号を検出していた。ところが、直流タコジェネ
レータには整流ブラシがあるため、保守点検が必要とな
り、取り扱いが煩雑であった。また、位置決め制御を行
なうサーボ系では、位置信号検出用のロータリエンコー
ダ等を併せて設置する必要がるシ、高価なものとなって
いた。
(Conventional configuration and its problems) Generally, in a servo system that performs mechanical control of an industrial robot or the like, a velocity loop is required to stabilize the system's operation and improve responsiveness. Therefore, conventionally, a DC tough generator was installed as a speed signal detector to detect the speed signal. However, since DC tachogenerators have rectifying brushes, maintenance and inspection are required and handling is complicated. Further, in a servo system that performs positioning control, it is necessary to also install a rotary encoder or the like for detecting a position signal, which makes the system expensive.

その他の従来の速度信号検出装置として、位置信号検出
用のロークリエンコーダのパルス出力をf/υ変換する
ことにより速度信号を得るものもあるが、この場合、変
速幅の大きい速度制御において、応答性を上げると低速
時に速度48号のリップルが太きぐなシ、また、低速時
のリップルを平滑して低減すると応答性が悪くなる等の
欠点があった。
Other conventional speed signal detection devices obtain speed signals by f/υ conversion of the pulse output of a low-resolution encoder for detecting position signals, but in this case, in speed control with a large speed change range, the response Increasing the performance caused the ripples at speed 48 to become thicker at low speeds, and smoothing and reducing the ripples at low speeds resulted in poor responsiveness.

(発明の目的) 本発明は、上記従来例の欠点に鑑みてなされたもので、
検出I7た速度信号のリップルが少なく且つ応答性がよ
く、しかも安価な速度信号検出装置を提供するものであ
る。
(Object of the invention) The present invention has been made in view of the drawbacks of the above-mentioned conventional examples, and
It is an object of the present invention to provide a speed signal detection device which has less ripples in a detected speed signal, has good responsiveness, and is inexpensive.

(発明の構成) 上記目的を達成するために、本発明は、二相式O−クリ
エンコーダの二相の出力を入力とし、との二相の人力を
それぞれ微分および微分して反転して11つの信号に変
換し、スイッチング回路において、前記の二相の入力を
演鏝−および論理処理した信号に従って、前記の4つの
信号の各々の最大値または最小値付近をトリミングして
合成し、その後高周波成分を除去するように構成したも
のである。
(Structure of the Invention) In order to achieve the above object, the present invention inputs the two-phase output of a two-phase O-cli encoder, differentiates and inverts the two-phase human power of In a switching circuit, the vicinity of the maximum or minimum value of each of the four signals is trimmed and synthesized according to the signal obtained by calculating and logically processing the two-phase input. It is designed to remove components.

(実施例の説明) 以下、図面によシ本発明の実施例を詳細に説明する。第
1図は、本発明の一実施例の構成を示す図で、1aおよ
び1bはそれぞれ二相式ロータリエンコーダの出力が供
給される入力端子、2および3はそれぞれ微分回路、4
および5はそれぞれ反転回路、6はアナログスイッチ、
7および8はそれぞれ加算回路、9は反転回路、JOお
よび11はそれぞれパルス変換回路、12はバイナリカ
ウンタ、13はローパスフィルタである。
(Description of Embodiments) Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. FIG. 1 is a diagram showing the configuration of an embodiment of the present invention, where 1a and 1b are input terminals to which the output of a two-phase rotary encoder is supplied, 2 and 3 are differentiating circuits, and 4
and 5 are inverting circuits, 6 is an analog switch,
7 and 8 are adder circuits, 9 is an inversion circuit, JO and 11 are pulse conversion circuits, 12 is a binary counter, and 13 is a low-pass filter.

次に、本実施例の正回転時の動作を、各部の出力波形を
示す第2図(A)とともに説明する。振幅が一定で且つ
互いに90°の位相差を有する二相の正弦波(捷たは三
角波)を出力する二相式ロータリエンコーダの出力が入
力端子1aおよび1bに供給されていて、入力端子1a
および150入力をそれぞれAOおよび130とすると
、正回転の場合、A。
Next, the operation of this embodiment during forward rotation will be explained with reference to FIG. 2(A) showing the output waveforms of each part. The output of a two-phase rotary encoder that outputs a two-phase sine wave (square or triangular wave) having a constant amplitude and a phase difference of 90° from each other is supplied to input terminals 1a and 1b.
and 150 inputs are respectively AO and 130, then in the case of forward rotation, A.

はBoに対して900位相が進んでいる。この入力A。is ahead of Bo by 900 phases. This input A.

およびB。を微分回路2および3でそれぞれ微分してそ
の出力を各々A1およびB1とし、AIおよびB1をさ
らに反転回路・1および5でそれぞれ反転してその出力
をA、および互1とし、これらの出力AI。
and B. are differentiated by differentiating circuits 2 and 3, and the outputs are respectively A1 and B1, and AI and B1 are further inverted by inverting circuits 1 and 5, respectively, and the outputs are A and 1, and these outputs AI .

Bl +  AIおよびB1をアナログスイッチ6に供
給する。また、人力AoとBoとを加算回路7で加毅2
してその出力をC1とし、入力Aoを反転回路9で反転
1.fcものと入力Boとを加勢−回路8で加pしてそ
の出力をC2とする。そして、C1およびC2をそれぞ
れパルス変換回路1oおよびjlで符号を判別すること
によシバルスに変換し、その出方を各々D、およびB2
としてバイナリカウンタ12に供給する。バイナリカウ
ンタ12はs、 l  B2 p B3およびB4の・
1つの出力を有していて、パルス変換回路・ 】0およ
び」1の出力DJおよびB2を入力として、論理Q I
fによシDlおよびB2の両者がローの時に出力S】が
ハイ、DlがハイでB2がローの時に出力S2がハイ、
DIおよびB2の両者がハイの時に出力S3  がハイ
、DIがa−でB2がハイの時に出力S、1がハイにな
り、これらの出力をアナログスイッチ6に供給する。こ
こでアナログスイッチ6は、微・分回路2お」:び3と
反転回路4および5の各々の出力AI *  Bl p
 Alおよび11が供給されていて、バイナリカウンタ
12の出力”’I、S2+  ”3およびB4によシ、
それぞれA1を81、B1を82、A、をB3、B1を
B4の各ハイの出力時にトリミングし、合成して出力v
1を出力する。このアナログスイッチ6の出力をローパ
スフィルタ13で高周波成分を除去して、回転速度に比
例したリップルのない出力V(、が得られる。
Bl + AI and B1 are supplied to analog switch 6. In addition, the human power Ao and Bo are added by adding circuit 7.
The output is set as C1, and the input Ao is inverted by the inverting circuit 9. The fc signal and the input Bo are added by the booster circuit 8, and the output is set as C2. Then, C1 and C2 are converted into cibars by determining the signs in pulse conversion circuits 1o and jl, respectively, and their output is expressed as D and B2, respectively.
The signal is supplied to the binary counter 12 as follows. The binary counter 12 is s, l B2 p B3 and B4.
The pulse conversion circuit has one output, and outputs DJ and B2 of ]0 and "1 are input, and the logic Q I
According to f, when both Dl and B2 are low, the output S] is high; when Dl is high and B2 is low, the output S2 is high;
When both DI and B2 are high, the output S3 is high, and when DI is a- and B2 is high, the output S1 is high, and these outputs are supplied to the analog switch 6. Here, the analog switch 6 outputs each output AI*Blp of the differential/divider circuits 2 and 3 and the inverting circuits 4 and 5.
Al and 11 are supplied, and the outputs of binary counter 12 "'I, S2+" 3 and B4,
A1 is trimmed at 81, B1 is 82, A is trimmed at each high output, B1 is trimmed at each high output of B4, and the output is synthesized and output v
Outputs 1. A low-pass filter 13 removes high-frequency components from the output of the analog switch 6 to obtain a ripple-free output V(,) proportional to the rotational speed.

ここで、第2図体)K示すように、入力A、とB。Here, inputs A and B are shown in the second figure).

とを加算回路7で加算することにょシ、その出力C】は
入力Aoi/i:対して45°位相が遅れ、従ってパル
ス変換回路10の出力D1も入力AOに対して45°位
相が遅れている。同様に、パルス変換回路11の出力D
2も入力Boに対して45°位相が遅れ、DJに対して
90°位相が遅れている。このため、バイナリカウンタ
12の出力SJ h 、、B2 y  ””3およびs
4は、−周jυ」の間に81から84にそれぞれ900
の間ずつハイの出力が順次生じ、また、SIはAQに対
して45°位相が進んでいる。この時、微分回路2おJ
:び3の出力A1および131は、入力A、およびB。
The output C] is delayed in phase by 45 degrees with respect to the input Aoi/i, and therefore the output D1 of the pulse conversion circuit 10 is also delayed in phase by 45 degrees with respect to the input AO. There is. Similarly, the output D of the pulse conversion circuit 11
2 also has a 45° phase delay with respect to input Bo and a 90° phase delay with respect to DJ. Therefore, the outputs of the binary counter 12 SJ h , , B2 y ""3 and s
4 is 900 respectively from 81 to 84 during -period jυ''
A high output is generated sequentially for each period, and SI has a 45° phase lead with respect to AQ. At this time, the differential circuit 2
The outputs A1 and 131 of : and 3 are inputs A and B.

に対してそれぞれ90°位相が進んでいるので、アナ戸
ゲスイソチロにおいて、AI r  Bl 、A1およ
びB1 を1. IJ ミンクする位置は、各々の正弦
波のJv大値に対して±45°の範囲である。従って、
最大値付近だけをトリミングした4つの出力を合成する
ことにより、回転速度に比例した交流電圧から、応答性
がよく、シかもリップルの少ない回転速度に比例した正
の直流電圧v1が得られる。このVlはリップルが少な
いとはいえ約30%のりノズル電圧を含んでいる。そこ
で、二相式ロータリエンコーダは一回転あたり数百から
数千パルスを発生し、その出力AOおよびB、の周波数
は二相式−一クリエンコーダの回転数の数百から数千倍
であり、しかもV、のリップル周波数&′:LAoおよ
びB。の4倍とナリ、非常に高い周波数となるので、ロ
ーパスフィルタ】3により、応答性を損なうことなく簡
単にリップル電圧を除去することができる。
Since the phase is advanced by 90° with respect to each other, AI r Bl , A1 and B1 are set to 1. The IJ minking position is within a range of ±45° with respect to the Jv maximum value of each sine wave. Therefore,
By combining four outputs with only the vicinity of the maximum value trimmed, a positive DC voltage v1 proportional to the rotation speed with good responsiveness and less ripple can be obtained from the AC voltage proportional to the rotation speed. Although this Vl has little ripple, it includes about 30% of the nozzle voltage. Therefore, a two-phase rotary encoder generates several hundred to several thousand pulses per revolution, and the frequency of its outputs AO and B is several hundred to several thousand times the number of rotations of a two-phase one-crystal encoder. Moreover, the ripple frequency &′ of V: LAo and B. The ripple voltage can be easily removed using the low-pass filter [3] without impairing the response.

捷だ、二相式ロータリエンコーダの回転方向が逆方向に
変化した場合、その出力AOおよびもの位相はBQがA
Qに対して90°進み、本実施例は第2図(B)に示す
ように、自動的に微分回路2および3と反転回路4およ
び5の各出力Alt  ”]+  Alおよび百1のト
リミング位置が変化して各々の最小値付近をトリミング
するので、正回転の場合に正の電圧を出力していたのに
対して、逆回転の場合は負の電圧を出力し、回転方向に
応じて出力電圧の極性が変化するように構成されてV、
る。
However, if the rotation direction of the two-phase rotary encoder changes to the opposite direction, the output AO and phase of the output BQ will change to A.
90° with respect to Q, and in this embodiment, as shown in FIG. As the position changes and trimming is performed around each minimum value, in the case of forward rotation, a positive voltage was output, but in the case of reverse rotation, a negative voltage is output, and the voltage changes depending on the direction of rotation. V configured such that the polarity of the output voltage changes;
Ru.

なお、二相式ロータリエンコーダの出力が三角波の場合
においても、本実施例は同様の効果を有している。
Note that this embodiment has similar effects even when the output of the two-phase rotary encoder is a triangular wave.

(発明の効果) 以上説明したように、本発明は、二相式ロータリエンコ
ーダの出力を入力として、回転方向によって極性が異な
り、且つ回転速度に比例したリップルのないしかも応答
性のよい直流電圧を検出することができる。また、位置
決め制御に用いられるザーボ系においては、直流ジェネ
レータを不要にするため、保守点検の必要がなくなり且
つコストの低減を可能にするものである。
(Effects of the Invention) As explained above, the present invention uses the output of a two-phase rotary encoder as an input, and generates a ripple-free and responsive DC voltage that differs in polarity depending on the rotational direction and is proportional to the rotational speed. can be detected. Further, in the servo system used for positioning control, since a DC generator is not required, there is no need for maintenance and inspection, and costs can be reduced.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は、本発明の一実施例の構成を示すフロンク図、
第2図は、第1図の各部の出力θし形を示す図である。 2.3  ・・微分回路、 6+ 5+ 9  ・・・
反転回路、6・・ −アナ「jゲスインチ、7,8  
・・・ 加算回路、10.11  ・・・・・・・パル
ス変換回路、12−山バイナリカウンタ、33・・・・
・ ローパスフィルタ。 特お出願人 松下電器産業株式会社 Vo oH−一一一一一 斐 2図 B1 Vo巨−一一一 手続補正書(自発) 収入印L(金K11 円 昭和59年1月6日 q、)°許庁長篇 若 杉 和 夫  殿1、事件の表
示   特願昭57−225’120号3、補正をする
者 事件との関係   出j、;□」゛1人住  所   
 大阪R’N門真市大手門真】006番地各二  称 
  (sa2)松下1L2−産業)宋人会社代1..名
          山   下   俊   Iま4
、代理人〒105 (1所  東京都港区11−1.1新1iffia J
月3番3号5、補11:、により増加する発明の数  
 0(2)  明細書第4頁第18行の「(または三角
波)」を削除する。 (3)同第8頁第12行から第13行寸での「三角波」
の前に「疑似正弦波lた(−」を加入する。 (4)同第9頁第1行の「直流ジェネレータ」を「直流
タコジェイ・シンータ」に訂正する。 以  上 二”I’ +i’;、、l′I氷/l)範囲を記載した
4りJ−4特+j’F Jl求の範すJl 4Ji 1福が一定で且つ互いに900の位相差を有す
る二相のIT−1弦波、疑1′す正弦波!たけ三角波を
それぞ7を出力する二相式ロークリエンコーダの出力を
入力とし%:iBe二相の入力をそれぞ7′L做分する
第1および第2の微分回路と、前記第1および第2の微
分回路の出力をそれぞれ反転する第1および第2の反転
回路と、i′lj記二相の人力を加算する第1の加譜回
路と、前記二相の人力を一相のみ反転回路により反転し
た後加算する第2の加算回路と、前記第1および第2の
加算回路の出力により一周期の間に4種類の出力を順次
出力する論jFJi回路と、AiJ言己論理回路の4桶
類の出力により111記第1および第2の微分回路と^
f)記載1および第2の反転回路の各出ブ2の最大値ま
たは最小値の側近をそれぞれ[・リミノグして合成する
スイッチング回路と、前記スイッグ″ング回路の出力の
高周波成分を除去するフィルタ回路とからなり、前記二
相式ロータリエンコーダの出力から、回転方向(lこよ
って極性が異なり且つ回転速度に比例した直流電圧を検
出することを特徴とする速度信号検出装置。
FIG. 1 is a front view showing the configuration of an embodiment of the present invention;
FIG. 2 is a diagram showing the output θ curves of each part in FIG. 1. 2.3... Differential circuit, 6+ 5+ 9...
Inverting circuit, 6... -Anna "j guess inch, 7,8
...Addition circuit, 10.11 ...Pulse conversion circuit, 12-mountain binary counter, 33...
・Low pass filter. Special Applicant Matsushita Electric Industrial Co., Ltd. Vo oH-11111-2 Diagram B1 Vo-111 procedural amendment (voluntary) Revenue stamp L (K11 yen January 6, 1980 q) ° Compilation of Director-General Kazuo Wakasugi 1, Indication of the case Patent Application No. 1987-225'120 3, Relationship with the case of the person making the amendment Exit, ;□''゛1 person address
Osaka R'N Kadoma City Ote Kadoma] 006 number two names each
(sa2) Matsushita 1L2-Industry) Song Ren Company Dai 1. .. Name Shun Yamashita Ima4
, Agent 〒105 (1 location 11-1.1 Shin 1iffia J, Minato-ku, Tokyo)
Month 3 No. 3 No. 5, Supplement 11: The number of inventions increases due to
0(2) Delete "(or triangular wave)" on page 4, line 18 of the specification. (3) “Triangular wave” on page 8, line 12 to line 13
Add "pseudo sine wave lta (-)" in front of . (4) Correct "DC generator" in the first line of page 9 to "DC Takojay Sinter". Above two "I' + i';,,l'I ice/l) 4-line J-4 special + j'F Jl-specified range Jl 4Ji 1-phase IT-1 string with a constant value and a phase difference of 900 from each other The input is the output of a two-phase low-resolution encoder that outputs a sine wave, a sine wave, and a triangular wave. a differentiating circuit, first and second inverting circuits that invert the outputs of the first and second differentiating circuits, respectively, a first adding circuit that adds the two phases of human power indicated by i'lj; A second adder circuit that inverts two-phase human power using an inverter circuit and then adds it, and a theory that sequentially outputs four types of outputs during one cycle using the outputs of the first and second adder circuits. 111 first and second differentiating circuits by the outputs of the circuit and the four buckets of the AiJ logic circuit.
f) A switching circuit that performs reminogging and synthesis of the maximum or minimum value of each output 2 of the first and second inverting circuits, and a filter that removes high frequency components of the output of the switching circuit. A speed signal detection device comprising a circuit, and detects a DC voltage whose polarity differs depending on the rotation direction (l) and is proportional to the rotation speed from the output of the two-phase rotary encoder.

Claims (1)

【特許請求の範囲】[Claims] 振111′、4が一定で且つ互い[90’の位相差を有
する二相の三角波まだは正弦波をそれぞれ出力する二相
式ロータリエンコーダの出力を入力とし、前記二相の入
力をそれぞれ微分する第1および第2の微分回路と、前
記第1および第2の微分回路の出力をそれぞれ反転する
第1および第2の反転回路と、前記二相の入力を加算す
る第1の加算回路と、前記二相の入力を一相のみ反転回
路によシ反転した後加算する第2の加算回路と、前記第
1および第2の加算回路の出力により一周期の間に4種
類の出力をIli次出力出力論理回路と、前記論理回路
の4種類の出力によシ前記第1および第2の微分回路と
前記第17および第2の反転回路の各出力の最大値また
は最小値の付近をそれぞれトリミングして合成するスイ
ッチング回路と、前記スイッチング回路の出力の高周波
成分を除去するフィルタ回路とからなシ、前記二相式ロ
ータリエンコーダの出力から、回転方向によって極性が
異なシ且つ回転速度に比例した直流電圧を検出すること
を特徴とする速度信号検出装置。
The output of a two-phase rotary encoder that outputs a two-phase triangular wave or a sine wave with constant amplitudes 111' and 4 and a phase difference of [90' from each other is input, and the two-phase inputs are differentiated. first and second differentiating circuits, first and second inverting circuits that invert the outputs of the first and second differentiating circuits, respectively, and a first adding circuit that adds the two-phase inputs; A second adder circuit inverts only one phase of the two-phase inputs using an inverter circuit, and then adds the two-phase inputs, and outputs from the first and second adder circuits produce four types of outputs during one cycle. According to the output logic circuit and the four types of outputs of the logic circuit, the vicinity of the maximum value or minimum value of each output of the first and second differentiating circuits and the seventeenth and second inverting circuits is trimmed, respectively. and a filter circuit that removes high-frequency components from the output of the switching circuit, and a DC current whose polarity differs depending on the rotational direction and which is proportional to the rotational speed from the output of the two-phase rotary encoder. A speed signal detection device characterized by detecting voltage.
JP22592082A 1982-12-24 1982-12-24 Speed signal detector Pending JPS59116551A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH053693A (en) * 1991-06-25 1993-01-08 Victor Co Of Japan Ltd Speed controller for moving body

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JPH053693A (en) * 1991-06-25 1993-01-08 Victor Co Of Japan Ltd Speed controller for moving body

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