JPS5894124U - ノンリニアプリエンフアシス回路 - Google Patents

ノンリニアプリエンフアシス回路

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JPS5894124U
JPS5894124U JP18893581U JP18893581U JPS5894124U JP S5894124 U JPS5894124 U JP S5894124U JP 18893581 U JP18893581 U JP 18893581U JP 18893581 U JP18893581 U JP 18893581U JP S5894124 U JPS5894124 U JP S5894124U
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JP
Japan
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amplifier
emphasis circuit
range amplifier
clipping
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JP18893581U
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JPS6213262Y2 (ja
Inventor
賢二 権藤
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三菱電機株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のノンリニアプリエンファシス回路の回路
図、第２図はＶＴＲにおけるノンリニアプリエンファシ
ス回路のＶＨ５規格の特性図、第３図は本考案のノンリ
ニアプリエンファシス回路の一実施例を示す回路図、第
４図ないし第６図は本考案の他の実施例の回路図である
。 図において、８．　９．　１０．　１２．　１３．　１
Ｂ。 ２０．２１．２２は抵抗、１４．１５はダイオード、１
１，１６，２１，２３．２４はトランジスタ、１７．２
２は定電流源、１９はコンデンサ、Ａ′は入力端子、Ｂ
′は出力端子である。 第１図

Claims (1)

    【実用新案登録請求の範囲】
  1. 全域増幅器と、高域増幅器と、電圧発生手段と、前記全
    域増幅器と前記高域増幅器の出力加算器と、前記電圧発
    生手段出力と前記高域増幅器出力の電位差が所定のレベ
    ルになったとき、前記高域増幅器出力をクリップする双
    方向性クリップ手段を備え、前記電圧発生手段出力と前
    記高域増幅器動作点間電位差を前記クリップ手段作動レ
    ベル以下に設定してなるノンリニアプリエンファシス回
    路。
JP18893581U 1981-12-17 1981-12-17 ノンリニアプリエンフアシス回路 Granted JPS5894124U (ja)

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JP18893581U JPS5894124U (ja) 1981-12-17 1981-12-17 ノンリニアプリエンフアシス回路

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JPS5894124U true JPS5894124U (ja) 1983-06-25
JPS6213262Y2 JPS6213262Y2 (ja) 1987-04-06

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ID=30103096

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