JPS588232U - デイジタル−アナログ変換装置 - Google Patents

デイジタル−アナログ変換装置

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JPS588232U
JPS588232U JP10059781U JP10059781U JPS588232U JP S588232 U JPS588232 U JP S588232U JP 10059781 U JP10059781 U JP 10059781U JP 10059781 U JP10059781 U JP 10059781U JP S588232 U JPS588232 U JP S588232U
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JP
Japan
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digital
analog converter
exceeds
operational amplifier
resolution capability
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JP10059781U
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Inventor
剛 斉藤
Original Assignee
日立電子株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はもとのＤＡ変換器装置のブロック図、第２図及
び第３図は本考案の実施例を示すブロック図、第４図は
定電圧発生回路の一例を示すブロック図、第５図は定電
流発生回路の一例を示すブロック図である。 １、ＤＡ変換器、２：演算増幅器、３：定電流発生器、
４：定電圧発生器、５：ＣＭＯＳインバータ、Ａｌ〜Ａ
ｌｉ：ＤＡ変換器入力、ｌ　ｏ、ＤＡ変換器出力電流、
Ｒ：演算増幅器帰還抵抗、Ａ９〜Ａｎ：付加した下位ビ
ットの入力、１つ：付加した定電流発生回路−の出力電
流、−■ｎ：付加した定電圧発生回路の出力電圧、Ｒ′
　：演算増幅器入力抵抗、Ｒ１−Ｒ４：定電圧発生回路
の分圧用抵抗、Ｒ５−Ｒ６：定電流発生回路の電流制限
用抵抗、■〜■：分圧点、ＩＡ　９−１．１ｎ：制限電
流、Ｅｏ：演算増幅器出力。

Claims (1)

    【実用新案登録請求の範囲】
  1. ディジタル−アナログ変換器出力と演算増幅器を接続し
    たディジタル−アナログ変換装置におい゛　　て、ディ
    ジタル−アナログ変換器の分解能力を越えるディジタル
    入力の下位ビットに前記分解能力を越える数のインバー
    タより成る定電圧発生回路又は定電流発生回路を付加し
    たことを特徴とするディジタル−アナログ変換装置。
JP10059781U 1981-07-08 1981-07-08 デイジタル−アナログ変換装置 Pending JPS588232U (ja)

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JPS588232U true JPS588232U (ja) 1983-01-19

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