JPS5863633U - 時計制御回路 - Google Patents

時計制御回路

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Publication number
JPS5863633U
JPS5863633U JP15772381U JP15772381U JPS5863633U JP S5863633 U JPS5863633 U JP S5863633U JP 15772381 U JP15772381 U JP 15772381U JP 15772381 U JP15772381 U JP 15772381U JP S5863633 U JPS5863633 U JP S5863633U
Authority
JP
Japan
Prior art keywords
circuit
data
control circuit
storage means
clock control
Prior art date
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Pending
Application number
JP15772381U
Other languages
English (en)
Inventor
新谷　和夫
Original Assignee
日本電気株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の時計回路制御方式を示す構成図、第２図
は本考案の一実施例を示す回路図である。 尚、図において、１・・・・・・時計回路、２・・・・
・・データ処理回路からの時刻設定データの伝送路、３
・・・・・・時計回路へのデータ書き込み信号、４・・
・・・・時計回路に対するデータ読み出し信号、５・・
・・・・時計回路からのデータ書き込み許可信号、６・
曲・時計回路からのデータ読み出し許可信号、７・・・
・・・時計回路からの読み出しデータの伝送路、８番・
・・ファーストインファーストアウトシフトレジスタ、
９・・・・・・時計回路個有のタイミング制御回路、１
０・・・・・・ファーストインファーストアウトシフト
レジスタからの出力データの伝送路、１１・・・・・・
ファーストインファーストアウトシフトレジスタへのデ
ータ書キ込み信号、１２・・・・・・ファーストインフ
ァーストアウトシフトからのデータ読み出し信号、１３
・・・・・・データ処理回路からの書き込み指定信号、
１４・・・・・・データ処理回路からの読み出し指定信
号、１５・・・・・・データ処理回路に対するデータ読
み出し許可信号、である。

Claims (1)

    【実用新案登録請求の範囲】
  1. データ処理回路からの時刻設定データと時計回路からの
    時刻データを一担記憶するファーストインファーストア
    ウトシフトレジスタで構成される記憶手段と、この記憶
    手段から前記時計回路に時刻設定データを書き込む為の
    タイミング制御及び前記時計回路から前記記憶手段に時
    刻データを読み出す為のタイミング制御を行うタイミン
    グ制御手段とを具備してなることを特徴とする時計制御
    回路。
JP15772381U 1981-10-23 1981-10-23 時計制御回路 Pending JPS5863633U (ja)

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JP15772381U JPS5863633U (ja) 1981-10-23 1981-10-23 時計制御回路

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JP15772381U JPS5863633U (ja) 1981-10-23 1981-10-23 時計制御回路

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JPS5863633U true JPS5863633U (ja) 1983-04-28

Family

ID=29950235

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JP15772381U Pending JPS5863633U (ja) 1981-10-23 1981-10-23 時計制御回路

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