JPS585142U - アナログ演算回路 - Google Patents

アナログ演算回路

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Publication number
JPS585142U
JPS585142U JP9742281U JP9742281U JPS585142U JP S585142 U JPS585142 U JP S585142U JP 9742281 U JP9742281 U JP 9742281U JP 9742281 U JP9742281 U JP 9742281U JP S585142 U JPS585142 U JP S585142U
Authority
JP
Japan
Prior art keywords
arithmetic
circuit
analog
calculation
calculation circuit
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Pending
Application number
JP9742281U
Other languages
English (en)
Inventor
藤原　登
Original Assignee
芝浦メカトロニクス株式会社
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Filing date
Publication date
Application filed by 芝浦メカトロニクス株式会社 filed Critical 芝浦メカトロニクス株式会社
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Publication of JPS585142U publication Critical patent/JPS585142U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はアナログ演算回路の従来例を示す回路図、第２
図は本考案の一実施例を示す回路図、第３図は第２図の
実施例において使用する演算シーケンス信号のタイムチ
ャートである。 １〜３・・・・・・アナログ乗算器、６・・・・・・ア
ナログ乗除算器、７・・・・・・制御回路、８・・・・
・・入力ゲート回路、９〜１２・・・・・・ピークホー
ルド回路、１３．１５・・・・・・ゲート回路、１４・
・・・・・アナログ加算器。 第３図

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の演算項からなる演算式を演算するアナログ演算回
    路において、アナログ演算器と、演算すべき演算項を時
    分割的に指示する演算シーケンス信号を発生する制御回
    路と、上記演算シーケンス信号により各演算項の演算入
    力を上記アナログ演算器に与える入力ゲート回路と、各
    演算項の演算値出力を一時記憶するピークホールド回路
    と、このピークホールド回路の出力を上記演算シーケン
    ス信号の指示により上記入力ゲート回路に帰還するゲー
    ト回路と、最終の演算出力を記憶し出力するピークホー
    ルド回路とを具備してなるアナログ演算回路。
JP9742281U 1981-06-29 1981-06-29 アナログ演算回路 Pending JPS585142U (ja)

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JP9742281U JPS585142U (ja) 1981-06-29 1981-06-29 アナログ演算回路

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JPS585142U true JPS585142U (ja) 1983-01-13

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ID=29892229

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