JPS5850458B2 - oscillation device - Google Patents

oscillation device

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JPS5850458B2
JPS5850458B2 JP7551078A JP7551078A JPS5850458B2 JP S5850458 B2 JPS5850458 B2 JP S5850458B2 JP 7551078 A JP7551078 A JP 7551078A JP 7551078 A JP7551078 A JP 7551078A JP S5850458 B2 JPS5850458 B2 JP S5850458B2
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JP
Japan
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transistor
power supply
circuit
capacitor
voltage
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JP7551078A
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Japanese (ja)
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JPS553230A (en
Inventor
光保 小田部
文夫 神谷
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Toshiba Denzai KK
Original Assignee
Toshiba Denzai KK
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Publication date
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Publication of JPS553230A publication Critical patent/JPS553230A/en
Publication of JPS5850458B2 publication Critical patent/JPS5850458B2/en
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/24Automatic control of frequency or phase; Synchronisation using a reference signal directly applied to the generator

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【発明の詳細な説明】 本発明は、交流電源に同期した発振出力を得られるとと
もに、交流電源に重畳された雑音等によって発振位相が
変化することのない発振装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an oscillation device that can obtain an oscillation output synchronized with an AC power supply and whose oscillation phase does not change due to noise superimposed on the AC power supply.

従来、第1図示の発振装置が提案されている。Conventionally, an oscillation device shown in FIG. 1 has been proposed.

1は交流電源であり、この電源1に全波整流装置2が接
続されている。
1 is an AC power source, and a full-wave rectifier 2 is connected to this power source 1.

この整流装置2の出力端子間には抵抗3を介して定電圧
素子4が接続されており、整流電圧を定電圧化すなわち
台形波状の電圧にする。
A constant voltage element 4 is connected between the output terminals of the rectifier 2 via a resistor 3, and the rectified voltage is made into a constant voltage, that is, a trapezoidal waveform voltage.

そして、この定電圧素子4と並列にし張発振回路5が接
続されている。
A tension oscillation circuit 5 is connected in parallel with this constant voltage element 4.

このし張発振回路5は、抵抗6および抵抗7の分圧回路
と、トランジスタおよびコンデンサ90時定数回路と、
ゲートを前記分圧回路の分圧点に接続しアノードを前記
時定数回路のトランジスタ8およびコンデンサ9の接続
点に接続したPUTIOと、このPUTIOのカソード
に設げられたパルストランス11とからなるものである
This constant oscillation circuit 5 includes a voltage dividing circuit of a resistor 6 and a resistor 7, a time constant circuit of a transistor and a capacitor 90,
It consists of a PUTIO whose gate is connected to the voltage dividing point of the voltage dividing circuit and whose anode is connected to the connection point of the transistor 8 and capacitor 9 of the time constant circuit, and a pulse transformer 11 provided at the cathode of this PUTIO. It is.

前記時定数回路のトランジスタ80ベースには制御信号
が入力され、導通度合を変化されることによって、時定
数回路の時定数を変えるものである。
A control signal is input to the base of the transistor 80 of the time constant circuit, and the degree of conduction is changed to change the time constant of the time constant circuit.

また、時定数回路のトランジスタ8およびコンデンサ9
の接続点と整流装置2の正極との間に接続した抵抗12
はコンデンサ9の充電の直線性を改善するものである。
Also, the transistor 8 and capacitor 9 of the time constant circuit
A resistor 12 connected between the connection point and the positive electrode of the rectifier 2
improves the linearity of charging the capacitor 9.

このように構成された従来装置は、PUTIOのゲート
には分圧回路の分圧点の電圧すなわち台形波状の電圧が
加わり、アノードには時間とともに立上る時定数回路の
コンデンサ90両端電圧が加わる。
In the conventional device configured in this manner, the voltage at the voltage dividing point of the voltage dividing circuit, that is, the trapezoidal waveform voltage, is applied to the gate of PUTIO, and the voltage across the capacitor 90 of the time constant circuit, which rises with time, is applied to the anode.

そして、PUTloのアノードの電位がゲートの電位に
対し所定の値に達すると、PUTloは導通して、パル
ストランス11からパルスを出力するものである。
When the anode potential of PUTlo reaches a predetermined value relative to the gate potential, PUTlo becomes conductive and the pulse transformer 11 outputs a pulse.

また、PUTIOのゲートには台形波状の電圧が加わり
、この電圧は交流電源1の半サイクルに同期して零電位
にまで低下するから、この零電位になったとぎにはPU
Tloが確実に導通し時定数回路のコンデンサ9の充電
電荷を放電させる。
In addition, a trapezoidal waveform voltage is applied to the gate of PUTIO, and this voltage drops to zero potential in synchronization with the half cycle of AC power supply 1, so once it reaches this zero potential, the PU
Tlo is reliably conductive and the charge in the capacitor 9 of the time constant circuit is discharged.

したがって、コンデンサ9は交流電源1の各半サイクル
毎に充電を開始されるので、PUTIOは交流電源1の
各半サイクルの一定の位相で導通しパルストランス11
からパルスを出力できるものである。
Therefore, since the capacitor 9 starts charging every half cycle of the AC power supply 1, PUTIO conducts at a constant phase of each half cycle of the AC power supply 1, and the pulse transformer 11
It can output pulses from.

しかしながら、この従来装置は交流電源1等に雑音が重
畳されていると、この雑音がそのまま台形波状の電圧に
含まれてPUTloのゲートに加わる。
However, in this conventional device, if noise is superimposed on the AC power supply 1 or the like, this noise is directly included in the trapezoidal voltage and is applied to the gate of PUTlo.

このため、たとえば交流電源1に電圧を低下させる極性
のパルス雑音が重畳されていれば、PUTloのゲート
電位は前記雑音のため瞬間的に低下するから、このとき
コンデンサ9がある程度充電されていると、PUTlo
が導通してしまうものであった。
For this reason, for example, if polar pulse noise that lowers the voltage is superimposed on the AC power supply 1, the gate potential of PUTlo will drop instantaneously due to the noise, so if the capacitor 9 is charged to some extent at this time. ,PUTlo
was conductive.

したがって、パルストランス11から所定の位相より早
い位相でパルスを出力してしまい、所定の位相でのパル
ス出力を得られない欠点があった。
Therefore, there is a drawback that the pulse transformer 11 outputs a pulse at a phase earlier than a predetermined phase, making it impossible to obtain a pulse output at a predetermined phase.

なお、このような欠点は、PUTIOのゲート・カソー
ド間に雑音バイパス用のコンデンサを接続することによ
って解消できるが、その反面ゲートに加わる台形波状の
電圧が平滑されてしまうので、前述したような交流電源
1の各半サイクルに同期したパルス出力を得られなくな
ってしまうものであった。
Note that this drawback can be overcome by connecting a noise bypass capacitor between the gate and cathode of PUTIO, but on the other hand, the trapezoidal waveform voltage applied to the gate will be smoothed, so the AC This made it impossible to obtain a pulse output synchronized with each half cycle of the power supply 1.

本発明は、このような従来装置の欠点を解消するために
なされたもので、交流電源に同期したパルス出力を得ら
れるとともに、雑音によってパルス出力位相が変化する
ことのない発振装置を提供することを目的とするもので
ある。
The present invention has been made in order to eliminate such drawbacks of conventional devices, and provides an oscillation device that can obtain a pulse output synchronized with an AC power supply and whose pulse output phase does not change due to noise. The purpose is to

以下本発明の実施例を図を参照して説明する。Embodiments of the present invention will be described below with reference to the drawings.

第2図は第1の実施例を示すものである。FIG. 2 shows the first embodiment.

20は交流電源、21は全波整流装置、22は抵抗、2
3は定電圧素子で、これらは第1図と同じ構成である。
20 is an AC power supply, 21 is a full-wave rectifier, 22 is a resistor, 2
Reference numeral 3 denotes a constant voltage element, which has the same configuration as in FIG.

つぎに、24は平滑直流電源で、この電源24にし張発
振回路25が接続されている。
Next, 24 is a smoothed DC power supply, and a tension oscillation circuit 25 is connected to this power supply 24.

このし、張発振回路25は、前記平滑直流電源24に接
続された抵抗26および抵抗27からなる分圧回路と、
前記定電圧素子23に並列接続されたトランジスタ28
およびコンデンサ29からなる時定数回路と、ゲートを
前記分圧回路の分圧点に接続しアノードを前記時定数回
路のトランジスタ28およびコンデンサ29の接続点に
接続したPUT30と、このPUT30のカソードに接
続したパルストランス31とからなるものである。
In addition, the tension oscillation circuit 25 includes a voltage dividing circuit including a resistor 26 and a resistor 27 connected to the smoothed DC power supply 24;
A transistor 28 connected in parallel to the constant voltage element 23
and a time constant circuit consisting of a capacitor 29, a PUT 30 whose gate is connected to the voltage dividing point of the voltage dividing circuit and whose anode is connected to the connection point of the transistor 28 and the capacitor 29 of the time constant circuit, and a cathode of this PUT 30. It consists of a pulse transformer 31.

すなわち、前記PUT30のゲートには台形波状の電圧
ではなく、平滑された直流電圧が加わるものである。
That is, a smoothed DC voltage is applied to the gate of the PUT 30 instead of a trapezoidal voltage.

また、抵抗32はコンデンサ29の充電の直線性を改善
するために、全波整流装置21の正極と前記コンデンサ
29との間に設けられたものである。
Further, the resistor 32 is provided between the positive electrode of the full-wave rectifier 21 and the capacitor 29 in order to improve the linearity of charging the capacitor 29.

つぎに、33はエミッタ・コレクタを抵抗34と直列接
続され、前記平滑直流電源24に並列接続すれた第1の
トランジスタであって、ベースを前記定電圧素子24に
並列接続された抵抗35および抵抗36の直列回路の中
間点に接続され、前記台形波状の電圧すなわち前記交流
電源1に同期して導通を制御されるものである。
Next, 33 is a first transistor whose emitter and collector are connected in series with a resistor 34 and connected in parallel to the smoothed DC power supply 24, and a resistor 35 and a resistor whose base is connected in parallel to the constant voltage element 24. It is connected to the intermediate point of 36 series circuits, and conduction is controlled in synchronization with the trapezoidal waveform voltage, that is, the AC power supply 1.

また、3Tはエミッタ・コレクタを抵抗38と直列接続
し、前記時定数回路のコンデンサ29に並列接続した第
2のトランジスタである。
Further, 3T is a second transistor whose emitter and collector are connected in series with the resistor 38 and connected in parallel with the capacitor 29 of the time constant circuit.

そして、この第2のトランジスタ37のベースは前記第
1のトランジスタ33のコレクタに接続されており、前
記第1のトランジスタ33の不導通時には導通し、導通
時には不導通になるものである。
The base of the second transistor 37 is connected to the collector of the first transistor 33, and is conductive when the first transistor 33 is non-conductive and non-conductive when the first transistor 33 is conductive.

したがって、前記第2のトランジスタ37が導通してい
るときには、時定数回路のコンデンサ29の充電電荷が
、コンデンサ29−抵抗38−第2のトランジスタ37
コンデンサ29の閉回路を通って放電する。
Therefore, when the second transistor 37 is conductive, the charge in the capacitor 29 of the time constant circuit is changed from the capacitor 29 to the resistor 38 to the second transistor 37.
It is discharged through the closed circuit of capacitor 29.

なお、39は前記第1のトランジスタ33のエミッタ・
コレクタに並列接続した抵抗である。
Note that 39 is the emitter of the first transistor 33.
This is a resistor connected in parallel to the collector.

また、前記時定数回路のトランジスタ28のベースには
制御信号を供給されて、時定数回路の時定数を変化され
るものである。
Further, a control signal is supplied to the base of the transistor 28 of the time constant circuit to change the time constant of the time constant circuit.

つぎに、第3図を参照して作用を説明する。Next, the operation will be explained with reference to FIG.

第3図においてイは交流電源1の電圧、中主定電圧素子
240両端電圧、ハは第1のトランジスタ33のエミッ
タ・コレクタ間電圧、二は第2のトランジスタ37のエ
ミッタ・コレクタ間電圧、ホはコンデンサ29の電圧を
示すものである。
In FIG. 3, A is the voltage of the AC power supply 1, middle is the voltage across the main constant voltage element 240, C is the emitter-collector voltage of the first transistor 33, and 2 is the emitter-collector voltage of the second transistor 37. indicates the voltage of the capacitor 29.

PUT30のゲートには分圧回路の分圧点の電圧すなわ
ち平滑された直流電圧が加わり、アノードにはトランジ
スタ28あるいは抵抗32を介して充電されるコンデン
サ290両端電圧が加わる。
The voltage at the voltage dividing point of the voltage dividing circuit, that is, the smoothed DC voltage is applied to the gate of the PUT 30, and the voltage across the capacitor 290 charged via the transistor 28 or the resistor 32 is applied to the anode.

そして、ア、・−ドの電位がゲートの電位に対し所定の
値にまで達したときPUT30は導通し、パルストラン
ス31からパルスを出力する。
Then, when the potentials of A, .

一方、第1のトランジスタ330ベースには第3図口に
示すような台形波状の電圧が加わり、第3図へに示すよ
うに、前記台形波状の電圧が充分な値であるときは第1
のトランジスタ33は導通しており、トランジスタを導
通させるのに不充分な低い電圧になると、第1のトラン
ジスタ33は不導通になるものである。
On the other hand, a trapezoidal waveform voltage as shown at the beginning of FIG. 3 is applied to the base of the first transistor 330, and as shown in FIG.
The first transistor 33 is conductive, and the first transistor 33 becomes non-conductive when the voltage becomes low enough to make the transistor conductive.

そして、第2のトランジスタ37は第3図二に示すよう
に第1のトランジスタ33が導通しているときは不導通
であり、第1のトランジスタ33が不導通であるとき導
通するものであるから、前記第1のトランジスタ33が
不導通になったときすなわち前記台形波状の電圧が零付
近にまで低下したとき、導通して前記時定数回路のコン
デンサ29を短絡する。
The second transistor 37 is non-conductive when the first transistor 33 is conductive, and conductive when the first transistor 33 is non-conductive, as shown in FIG. When the first transistor 33 becomes non-conductive, that is, when the trapezoidal wave voltage drops to near zero, it becomes conductive and short-circuits the capacitor 29 of the time constant circuit.

したがって、コンデンサ29の充電電荷は第3図示に示
すように第2のトランジスタ37が導通している間に、
この第2のトランジスタ37を通して放電してしまうの
である。
Therefore, the charge in the capacitor 29 is accumulated while the second transistor 37 is conducting, as shown in the third diagram.
Discharge occurs through this second transistor 37.

このため、時定数回路のコンデンサ29は交流電源1の
半サイクル毎に充電を開始されて、一定の位相でPUT
30を導通することができるものである。
Therefore, the capacitor 29 of the time constant circuit starts charging every half cycle of the AC power supply 1, and PUT is output at a constant phase.
30 can be electrically connected.

また、交流電源20に雑音が重畳されていても、PUT
30ゲートには平滑直流電源24の分圧された電圧が加
えられるものであるから、ゲート電位は何んら雑音によ
る悪影響を受けることがないものである。
Furthermore, even if noise is superimposed on the AC power supply 20, the PUT
Since the divided voltage of the smoothed DC power supply 24 is applied to the gate 30, the gate potential is not adversely affected by noise.

たとえば、平滑直流電源24を交流電源20から得る場
合でも、平滑コンデンサによって雑音を吸収することが
できるのである。
For example, even when the smoothed DC power source 24 is obtained from the AC power source 20, noise can be absorbed by the smoothing capacitor.

さらに、PUT30のゲート・カソード間に雑音バイパ
ス用のコンデンサを接続することによって、パルス雑音
によるゲート電位の変動を防止できるものである。
Furthermore, by connecting a noise bypass capacitor between the gate and cathode of PUT 30, fluctuations in gate potential due to pulse noise can be prevented.

もちろん、この場合も、交流電源20に同期したパルス
出力を得られることは前記の説明から容易に理解できる
ことである。
Of course, it is easy to understand from the above description that in this case as well, a pulse output synchronized with the AC power supply 20 can be obtained.

なお、本実施例においては、交流電源20にパルス雑音
が重畳されていると、台形波状の電圧にもこの雑音が含
まれるから、この雑音によって第1のトランジスタ33
が瞬間的に不導通になることがあり、この間第2のトラ
ンジスタ37が導通してコンデンサ29に短絡すること
がある。
In this embodiment, if pulse noise is superimposed on the AC power supply 20, this noise will also be included in the trapezoidal waveform voltage.
may momentarily become non-conductive, and during this time the second transistor 37 may become conductive and short-circuit to the capacitor 29.

しかしながら、パルス雑音によって前記のように第2の
トランジスタ37が導通するのは極めて短時間であるた
め、これによってコンデンサ29が放電するのはわずか
であるから、PUT30の導通位相にはほとんど影響が
ないものである。
However, since the second transistor 37 becomes conductive due to the pulse noise as described above, the capacitor 29 is only slightly discharged due to this, so it has almost no effect on the conduction phase of the PUT 30. It is something.

第4図は位相制御による定電圧装置に適用した実施例を
示すものである。
FIG. 4 shows an embodiment applied to a constant voltage device using phase control.

第2図と同じ部分には同一符号を付して説明を省略する
Components that are the same as those in FIG. 2 are given the same reference numerals and explanations will be omitted.

40は位相制御用のトライアックで、交流電源20と負
荷4またとえば電球との間に設けられており、その制御
極はし張発振回路25のパルストランス31の出力巻線
に接続されている。
A triac 40 for phase control is provided between the AC power supply 20 and the load 4, such as a light bulb, and its control pole is connected to the output winding of the pulse transformer 31 of the oscillator circuit 25.

46は負荷電圧検出用の変圧器で、1次巻線を前記負荷
41に並列接続している。
46 is a transformer for detecting load voltage, and its primary winding is connected in parallel to the load 41.

また、2次巻線は整流装置47に接続されている。Further, the secondary winding is connected to a rectifier 47.

そして、この整流装置47の出力は制御信号発生装置4
8に入力される。
The output of this rectifier 47 is then output from the control signal generator 4.
8 is input.

この制御信号発生装置48は、平滑回路60、時定数回
路70、誤差増幅器80等既知の回路を有してなるもの
であり、検出された負荷電圧と基準電圧とを比較して前
記両軍圧の誤差を少なくする制御信号を出力するもので
ある。
The control signal generator 48 includes known circuits such as a smoothing circuit 60, a time constant circuit 70, and an error amplifier 80, and compares the detected load voltage with a reference voltage to calculate the voltage between the two sides. This outputs a control signal that reduces the error.

この制御信号はし張発振回路25の時定数回路のトラン
ジスタ28のベースに入力し、時定数回路の時定数を変
化するものである。
This control signal is input to the base of the transistor 28 of the time constant circuit of the reinforcement oscillation circuit 25, and changes the time constant of the time constant circuit.

つぎに作用を説明する。Next, the effect will be explained.

し張発振回路25は、制御信号発生装置48からの制御
信号によって決定される時定数回路の時定数に応じてパ
ルスを出力し、トライアック40を導通させる。
The tension oscillation circuit 25 outputs a pulse according to the time constant of the time constant circuit determined by the control signal from the control signal generator 48, and makes the triac 40 conductive.

したがって、負荷41には位相制御された交流電力が供
給されるものである。
Therefore, the load 41 is supplied with phase-controlled AC power.

そして、この負荷41の電圧は変圧器46によって検出
され基準電圧と比較されて、負荷41の電圧が一定にな
るように制御するものである。
The voltage of this load 41 is detected by a transformer 46 and compared with a reference voltage, thereby controlling the voltage of the load 41 to be constant.

したがって、本実施例においては負荷41である電球か
らは一定の光出力を得られるのである。
Therefore, in this embodiment, a constant light output can be obtained from the light bulb, which is the load 41.

本実施例における発振動作は第2図示の実施例と同様で
あるので、説明を省略する。
The oscillation operation in this embodiment is the same as that in the embodiment shown in the second figure, so a description thereof will be omitted.

ところで、本実施例のように位相制御された電力により
負荷41を付勢するものにおいては、し張発振回路25
のパルス出力を停止してトライアック40を不導通にす
ることによって負荷41を不作動にすることがある。
By the way, in the case where the load 41 is energized by phase-controlled power as in this embodiment, the tension oscillation circuit 25
The load 41 may be rendered inactive by stopping the pulse output of the triac 40 and rendering the triac 40 non-conductive.

たとえば、複写機に用いられる光源の光出力制御用とし
て本実施例のものを適用する場合、平滑直流電源24を
開放して制御信号発生装置48の作動を停止させ、時定
数回路のトランジスタ28に制御信号を加えないように
することがある。
For example, when this embodiment is applied to control the light output of a light source used in a copying machine, the smoothing DC power supply 24 is opened to stop the operation of the control signal generator 48, and the transistor 28 of the time constant circuit is The control signal may not be applied.

この場合、本実施例のものは、平滑直流電源24を開放
することによって、PUT31のゲートには電圧が加え
られることがなく、ゲート電位は零電位になる。
In this case, in this embodiment, by opening the smoothed DC power supply 24, no voltage is applied to the gate of the PUT 31, and the gate potential becomes zero potential.

したがって、時定数回路のコンデンサ29が抵抗32を
介して整流装置21の出力により充電されようとしても
、PUT31はゲートが零電位であるため、常に導通状
態であるので、整流装置21からの電流はPUT31に
連続的に流れ、パルストランス31はパルスを出力する
ことがないのである。
Therefore, even if the capacitor 29 of the time constant circuit is to be charged by the output of the rectifier 21 via the resistor 32, the current from the rectifier 21 is The current flows continuously to the PUT 31, and the pulse transformer 31 does not output any pulses.

したがって、トライアック40は不所望に導通すること
がなく、負荷41に電流を流すことがないのである。
Therefore, the triac 40 does not conduct undesirably, and no current flows through the load 41.

これに対し、第1図示の従来装置にはつぎのような欠点
があった。
On the other hand, the conventional device shown in FIG. 1 has the following drawbacks.

すなわち、第1図示の装置において、時定数回路のトラ
ンジスタ8へ制御信号を供給しないようにしても、PU
T9のゲートには台形波状の電圧が加えられており、ま
た、時定数回路のコンデンサ9は抵抗12を介して充電
されるから、PUTIOは導通しパルスを出力してしま
うものである。
That is, in the device shown in FIG. 1, even if the control signal is not supplied to the transistor 8 of the time constant circuit, the PU
Since a trapezoidal voltage is applied to the gate of T9, and the capacitor 9 of the time constant circuit is charged via the resistor 12, PUTIO becomes conductive and outputs a pulse.

したがって、位相制御用のトライアックが導通し、負荷
に電流が流れてしまうものであった。
Therefore, the triac for phase control becomes conductive, causing current to flow through the load.

このため、時定数回路のコンデンサ9の充電回路にリレ
ーの接点を設けることが考えられているが、高価になる
欠点があった。
For this reason, it has been considered to provide a relay contact in the charging circuit of the capacitor 9 of the time constant circuit, but this has the drawback of being expensive.

第5図および第6図は他の実施例を示すものである。FIGS. 5 and 6 show other embodiments.

それぞれ第2図と同じ部分には同一符号を付しである。The same parts as in FIG. 2 are given the same reference numerals.

第5図は時定数回路を平滑直流電源24に接続するとと
もに、第1のトランジスタ33の導通を交流電源20の
全波整流出力によって制御するようにしたものである。
In FIG. 5, a time constant circuit is connected to a smoothed DC power supply 24, and the conduction of the first transistor 33 is controlled by the full-wave rectified output of the AC power supply 20.

第6図は、PUT30のゲート・カソード間に雑音バイ
パス用のコンデンサ90を接続したものである。
In FIG. 6, a noise bypass capacitor 90 is connected between the gate and cathode of the PUT 30.

なお、本発明は上記実施例に限られるものではない。Note that the present invention is not limited to the above embodiments.

たとえば、平滑直流電源は交流電源から得てもよく、ま
た別個の電源であってもよい。
For example, the smoothed DC power source may be derived from the AC power source or may be a separate power source.

また、し張発振回路はPUTを含むものの他、UJTを
含んで構成してもよいものである。
Further, the tension oscillation circuit may include not only the PUT but also the UJT.

以上詳述したように本発明は、し張発振回路を平滑直流
電源に接続するとともに、前記し張発振回路の発振位相
を決定する時定数回路のコンデンサの充放電を交流電源
に同期して導通を制御される第1および第2のトランジ
スタによって制御するようにしたから、交流電源に同期
した発振出力を得られるとともに、交流電源等に重畳さ
れる雑音によって発振位相が変化することのない発振装
置を提供できるものである。
As described in detail above, the present invention connects a constant oscillation circuit to a smoothed DC power source, and conducts charging and discharging of a capacitor of a time constant circuit that determines the oscillation phase of the constant oscillation circuit in synchronization with an AC power source. Since the oscillation device is controlled by the first and second transistors that are controlled, it is possible to obtain an oscillation output synchronized with the AC power supply, and the oscillation phase does not change due to noise superimposed on the AC power supply, etc. It is possible to provide

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来例を示す回路図、第2図は本発明の第1の
実施例を示す回路図、第3図は同じく動作を説明する電
圧波形図、第4図は同じく交流定電圧装置に適用した例
を示す回路図、第5図および第6図は本発明の他の実施
例を示す回路図である。 20・・・・・・交流電源、24・・・・・・平滑直流
電源、25・・・・・・し張発振回路、33・・・・・
・第1のトランジスタ、37・・・・・・第2のトラン
ジスタ。
Fig. 1 is a circuit diagram showing a conventional example, Fig. 2 is a circuit diagram showing a first embodiment of the present invention, Fig. 3 is a voltage waveform diagram explaining the operation, and Fig. 4 is also an AC constant voltage device. FIGS. 5 and 6 are circuit diagrams showing other embodiments of the present invention. 20... AC power supply, 24... Smoothing DC power supply, 25... Volcanic oscillation circuit, 33...
- First transistor, 37... Second transistor.

Claims (1)

【特許請求の範囲】 1 平滑直流電源と、コンデンサを含む時定数回路を有
し上記平滑直流電源に接続されたし張発振回路と、交流
電源と、この交流電源に同期して導通を制御される第1
のトランジスタと、上記し張発振回路の上記コンデンサ
に並列的に接続され上記第1のトランジスタの不導通時
に導通するとともに上記第1のトランジスタの導通時に
は不導通になって上記コンデンサの充放電を制御するこ
とによって上記し張発振回路を上記交流電源に同期して
発振させる第2のトランジスタとを具備したことを特徴
とする発振装置。 2 前記平滑直流電源は前記交流電源を整流、平滑化し
て得るものであることを特徴とする特許請求の範囲1記
載の発振装置。 3 前記し張発振回路はPUTを含んで構成されている
ことを特徴とする特許請求の範囲1または2記載の発振
装置。 4 前記し張発振回路の前記時定数回路はトランジスタ
およびコンデンサの直列回路を含むものであり、上記ト
ランジスタを制御信号により制御されて時定数を変化す
るものであることを特徴とする特許請求の範囲1〜3の
いずれか一記載の発振装置。 5 前記し張発振回路は前記交流電源による負荷への電
力供給を制御する半導体位相制御装置の導通を制御する
ものであることを特徴とする特許請求の範囲1〜4のい
ずれか一記載の発振装置。
[Scope of Claims] 1. A smoothed DC power supply, a time constant circuit including a capacitor, and an oscillation circuit connected to the smoothed DC power supply, an AC power supply, and a conduction controlled in synchronization with the AC power supply. First
and a transistor connected in parallel to the capacitor of the above-mentioned oscillation circuit, which conducts when the first transistor is non-conductive and becomes non-conductive when the first transistor conducts, thereby controlling charging and discharging of the capacitor. An oscillation device comprising: a second transistor that causes the above-mentioned oscillation circuit to oscillate in synchronization with the AC power supply. 2. The oscillation device according to claim 1, wherein the smoothed DC power source is obtained by rectifying and smoothing the AC power source. 3. The oscillation device according to claim 1 or 2, wherein the tension oscillation circuit includes a PUT. 4. Claims characterized in that the time constant circuit of the tension oscillation circuit includes a series circuit of a transistor and a capacitor, and the time constant is changed by controlling the transistor with a control signal. The oscillation device according to any one of 1 to 3. 5. The oscillation according to any one of claims 1 to 4, wherein the tension oscillation circuit controls conduction of a semiconductor phase control device that controls power supply to a load by the AC power supply. Device.
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59157676A (en) * 1983-02-28 1984-09-07 Canon Inc Fixing device
JPH0544834Y2 (en) * 1986-09-17 1993-11-15

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