JPS5849892B2 - keyboard device - Google Patents

keyboard device

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Publication number
JPS5849892B2
JPS5849892B2 JP51002585A JP258576A JPS5849892B2 JP S5849892 B2 JPS5849892 B2 JP S5849892B2 JP 51002585 A JP51002585 A JP 51002585A JP 258576 A JP258576 A JP 258576A JP S5849892 B2 JPS5849892 B2 JP S5849892B2
Authority
JP
Japan
Prior art keywords
circuit
memory circuits
preset
drive pulse
key
Prior art date
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Expired
Application number
JP51002585A
Other languages
Japanese (ja)
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JPS5286022A (en
Inventor
隆博 佐藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP51002585A priority Critical patent/JPS5849892B2/en
Publication of JPS5286022A publication Critical patent/JPS5286022A/en
Publication of JPS5849892B2 publication Critical patent/JPS5849892B2/en
Expired legal-status Critical Current

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  • Electrically Operated Instructional Devices (AREA)
  • Input From Keyboards Or The Like (AREA)
  • Management, Administration, Business Operations System, And Electronic Commerce (AREA)

Description

【発明の詳細な説明】 本発明はキーボード装置に関し、特に学校等において1
学級の生徒にテストを実施したとき、テストの各間また
は各項目についての各生徒の解答を得点11 1 PI
または“O nと採点して、電子計算機に入力したり、
紙テープさん孔装置または磁気テープ装置等の記録媒体
に入力するときに使用するキーボード装置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a keyboard device, particularly for use in schools, etc.
When a test is administered to students in a class, each student's answer for each period or item of the test is scored 11 1 PI
Or score “O n” and enter it into a computer,
The present invention relates to a keyboard device used when inputting data to a recording medium such as a paper tape punching device or a magnetic tape device.

教育・心理の分野で実施されるテストの各間または各項
目あるいは授業で実施される練習問題等に対して各生徒
の解答を正答であれば、得点77 1 91を与え、誤
答であれば、得点+1 0 11を与える場合が多い。
If each student's answer is correct, they will be given a score of 77, 1, or 91, and if the answer is incorrect, they will be given a score of 77, 1, or 91. , often gives a score of +1 0 11.

これらの“1′′または“O″データを電子計算機に入
力して分析処理するために、テレタイプのキーを介して
直接電子計算機に入力したり、あるいはテレタイプのキ
ーと同様な機能のキーボード装置を介して紙テープや磁
気テープに記録する方法がよく採用されている。
In order to input these "1'' or "O" data into a computer for analysis and processing, it can be input directly into the computer via the teletype keys, or by using a keyboard with the same function as the teletype keys. A method of recording on paper tape or magnetic tape via a device is often adopted.

この場合、一般に使用されているテレタイプのキーによ
って入力するときには操作者は“1″または゛′0″の
キーをデータ入力の形式に従ってひとつひとつ打込まね
ばならない。
In this case, when inputting data using the commonly used teletype keys, the operator must press the "1" or "0" keys one by one according to the data entry format.

ところで、多くの小間からなるテストまたは練習問題群
を1クラス数十人の生徒に与えたときのデータ量は問題
数と生徒数の積になるので非常に多量となり、これらの
データを従来の方法で入力するにはかなりの時間を要す
るという問題が生じる!また、操作の打鍵操作量も多量
であるので操作者の疲労などに加えて打鍵の誤りゃデー
タ入力の形式の誤りの発生が増加するなど種種の好まし
くない問題が起ってくる。
By the way, when a test or a set of practice questions consisting of many booths is given to dozens of students in a class, the amount of data is the product of the number of questions and the number of students, so the amount of data is extremely large. The problem arises that it takes a considerable amount of time to input data! Furthermore, since the amount of keystrokes required for operation is large, various undesirable problems occur, such as operator fatigue and increased occurrence of errors in keystrokes and data input formats.

これらの好ましからざる問題は特に初心者が操作ずるさ
いに多くあらわれる。
These undesirable problems often appear especially when beginners are sloppy with the operation.

しかも、学校などでの利用を考えると、操作者は教師な
ど一般に初心者である場合が多いので、操作が容易で打
鍵数ができるだけ少ない方法の入力装置が要求される。
Moreover, when considering use in schools and the like, the operator is often a beginner, such as a teacher, so an input device that is easy to operate and requires as few keystrokes as possible is required.

本発明の目的はこれらの要求を満足するキーボード装置
を提供することにある。
An object of the present invention is to provide a keyboard device that satisfies these requirements.

この発明のキーボード装置は、■学級のn人の生徒に対
応したn個の記憶回路と、これらの記憶回路のそれぞれ
に対応したn個のセット用キーと、前記n個の記憶回路
の状態を表示するn個の表示ランプと、前記n個の記憶
回路を一斉に“1″または“0″にプリセットするプリ
セット用キーと、前記n個の記憶回路を一斉に強制的に
初期状態に戻すリセット用キーと、前記n個の記憶回路
の状態を走査する走査回路と、前記走査回路を駆動する
駆動パルス発生回路と、前記駆動パルス発生回路から発
生される駆動パルスをn個計数したときに前記n個の記
憶回路を初期状態に戻すとともに前記駆動パルス発生回
路および前記走査回路の作動を止める計数回路と、前記
駆動パルス発生回路からの駆動パルスの発生を始動させ
る始動用キーとから構成される。
The keyboard device of the present invention includes (1) n memory circuits corresponding to n students in a class, n set keys corresponding to each of these memory circuits, and a state of the n memory circuits. n indicator lamps to display, a preset key to preset the n memory circuits to "1" or "0" all at once, and a reset that forcibly returns the n memory circuits to their initial state all at once. a scanning circuit that scans the states of the n storage circuits, a drive pulse generation circuit that drives the scanning circuit, and when n drive pulses generated from the drive pulse generation circuit are counted. It is composed of a counting circuit that returns n memory circuits to the initial state and stops the operation of the drive pulse generation circuit and the scanning circuit, and a start key that starts the generation of drive pulses from the drive pulse generation circuit. .

すなわち、本発明のキーボード装置は、■学級の生徒に
対応したn個の記憶回路をすべて“1″またはすべて“
0 91にブリセットするプリセット用キーを備えてい
るので、テストの小間または練習問題の1間毎について
、前記プリセット用キーと1からn人までの生徒の得点
のうち得点゛O′″または11 1 +1に対応するセ
ット用キーのみを打鍵して始動ボタンを押すと、一度に
n人のデータが発生し、電子計算機等に入力される。
In other words, the keyboard device of the present invention has the following advantages: ■ All n memory circuits corresponding to students in a class are "1" or all "1";
Since it is equipped with a preset key that presets to 0 to 91, the preset key and the score of students 1 to n will be set to ``O'' or 11 for each booth of a test or practice problem. When only the set key corresponding to 1 +1 is pressed and the start button is pressed, data for n people is generated at once and input into a computer or the like.

このように、本発明の利点は、ある小間のn個の得点を
打鍵するとき、得点“1″が大半を占める場合は、得点
“0″に対応するセット用キーのみを打鍵すれば、打鍵
数が少なくなり、逆に、得点゜“O IIが大半を占め
る場合には、得点“1′”に対応するセット用キーのみ
を打鍵すれば、打鍵数が少なくなるという点にある。
As described above, the advantage of the present invention is that when keying n scores for a certain booth, if the score "1" occupies the majority, only the set key corresponding to the score "0" can be pressed. Conversely, if the score ゜O II occupies the majority, the number of keystrokes will be reduced if only the set key corresponding to the score ``1'' is pressed.

本発明のキーボード装置を用いると、従来のキー操作に
比べてはるかに少ない打鍵数でn個からなる“′1″ま
たは“′O″あるいは両者の混合したデータを一度に発
生し、電子計算機に入力でき、しかも、従来の方法に比
べて短時間で入力が可能であるという優れた特長を持っ
ている。
By using the keyboard device of the present invention, it is possible to generate data consisting of n pieces of "'1" or "'O" or a mixture of both at once with a much smaller number of keystrokes than conventional key operations, and to input data into an electronic computer. It has the advantage of being able to input data in a shorter time than conventional methods.

次に図面を参照して本発明を詳細に説明する。Next, the present invention will be explained in detail with reference to the drawings.

第1図は本発明のキーボード装置の操作面を示し、参照
記号a1,a2,・・・,anはn個のセット用キーを
示し、参照記号bllb2j・・・,bnはn個のセッ
ト用キーに対応した表示用ランプを示している。
FIG. 1 shows the operation surface of the keyboard device of the present invention, where reference symbols a1, a2,..., an indicate keys for setting n pieces, and reference symbols bllb2j..., bn indicate keys for setting n pieces. Shows the indicator lamp corresponding to the key.

参照英文字Cとdはいずれもプリセット用キーを示し、
参照英文字eは始動用キーを示し、参照英文字fは誤っ
た打鍵を行なった場合などに記憶回路A(第2図)のn
個の回路を強制的に一斉に初期状態に戻すリセット用キ
ーを示している。
Reference letters C and d both indicate preset keys,
The reference letter e indicates the start key, and the reference letter f indicates the n key of the memory circuit A (Fig. 2) in case of an incorrect keystroke.
This shows a reset key that forcibly returns all circuits to their initial states.

第2図は本発明の一実施例を示すブロック図で、記憶回
路Aはそれぞれが゛1″または“O I+を記憶するn
個の記憶回路からなっている。
FIG. 2 is a block diagram showing one embodiment of the present invention, in which the memory circuits A each store "1" or "O I+".
It consists of several memory circuits.

参照記号PS1は第1図のブリセット用キーCに対応す
るプリセットスイッチを示し、このスイッチ操作によっ
てn個の記憶回路Aを一斉に77 1 11にプリセッ
トできる。
Reference symbol PS1 indicates a preset switch corresponding to the preset key C in FIG. 1, and by operating this switch, n memory circuits A can be preset to 77 1 11 all at once.

参照記号PS2は第1図のプリセット用キーdに対応す
るプリセットスイッチを示し、このスイッチ操作によっ
てn個の記憶回路Aを一斉に゜′0″にプリセットする
Reference symbol PS2 indicates a preset switch corresponding to the preset key d in FIG. 1, and by operating this switch, the n memory circuits A are preset to 0'0'' all at once.

参照記号KBS1〜KBSnはn個の記憶回路Aのそれ
ぞれに対応して接続されているセットスイッチを示し、
第1図のセット用キーa1〜anに対応していて、プリ
セットスイッチPS1またはPS2によってすべて“1
′”またはすべて77 0 11にプリセットされたn
個の記憶回路のうちの任意の記憶回路をこれらのセット
スイッチによって、“O′′または“1″にセットでき
る。
Reference symbols KBS1 to KBSn indicate set switches connected to each of the n memory circuits A,
They correspond to the set keys a1 to an in Fig. 1, and are all set to "1" by setting the preset switch PS1 or PS2.
’” or all n preset to 77 0 11
Any one of the memory circuits can be set to "O" or "1" by these set switches.

第2図の参照記号PL1〜PLnはn個の記憶回路Aの
記憶状態を表示するランプを示し、記憶回路が“1″の
状態であれば、点灯し、“0″の状態であれば、消滅す
る。
Reference symbols PL1 to PLn in FIG. 2 indicate lamps that display the storage status of the n storage circuits A. If the storage circuit is in the "1" state, it lights up, and if the storage circuit is in the "0" state, it lights up. Disappear.

また、参照記号PL1〜PLnは第1図の表示用ランプ
b1〜b,に対応する。
Further, reference symbols PL1 to PLn correspond to display lamps b1 to b in FIG. 1.

第2図の表示ランプ点灯回路Bは記憶回路Aのうち1か
らnのそれぞれの記憶状態の信号を得て“′1″の状態
にある記憶回路に対応した表示用ランプを点灯させるた
めに使用される。
The indicator lamp lighting circuit B in Fig. 2 is used to obtain the signals of the respective memory states of memory circuits 1 to n of the memory circuits A and light the indicator lamps corresponding to the memory circuits in the "'1" state. be done.

第2図の参照記号RSはn個のすべての記憶回路Aを初
期の状態に戻すためのりセッ1・スイッチを示し、第1
図のリセット用キーfに対応する。
Reference symbol RS in FIG. 2 indicates a reset switch 1 for returning all n memory circuits A to their initial states;
This corresponds to the reset key f in the figure.

第2図の走査回路Cは、n個の記憶回路Aが一斉に“′
1″にプリセットされた後、セットスイッチKBS1〜
KBSnによってそのうちのいくつかが“0 9+にセ
ットされた時点で、n個の記憶回路Aのそれぞれの状態
を駆動パルス発生回路Fからの駆動パルスに従って走査
して1からnの記憶回路の“1″または“0″の状態を
エンコーダ部に送る。
In the scanning circuit C of FIG. 2, n memory circuits A simultaneously
After being preset to 1″, set switch KBS1~
When some of them are set to "09+" by KBSn, the state of each of the n memory circuits A is scanned according to the drive pulse from the drive pulse generation circuit F to set "1" of the memory circuits 1 to n. ” or “0” status is sent to the encoder section.

エンコーダ部Dは走査回路Cから送られた信号を電子計
算機等に入力できる符号または紙テープさん孔装置や磁
気テープ装置などの記録装置に入力できる符号に変換す
る。
The encoder section D converts the signal sent from the scanning circuit C into a code that can be input into an electronic computer or the like or a code that can be input into a recording device such as a paper tape punching device or a magnetic tape device.

また、参照英文字Eは電子計算機へ入力するときのイン
ターフェイス部または記録媒体へ記録するときの制御回
路を示し、駆動パルス発生回路Fの発生する駆動パルス
によって動作する。
Reference letter E indicates an interface section for inputting data to a computer or a control circuit for recording data to a recording medium, and is operated by drive pulses generated by drive pulse generation circuit F.

この駆動パルス発生回路Fは走査回路Cおよびインター
フェイス部または制御回路Eを駆動するために用いられ
ており、始動スイッチDSは駆動パルス発生回路Fから
駆動パルスを発生させるときのその始動に用いられるも
のであり、かつ第1図の始動用キーeに対応する。
The drive pulse generation circuit F is used to drive the scanning circuit C and the interface section or the control circuit E, and the start switch DS is used to start the drive pulse generation circuit F when the drive pulse generation circuit F generates the drive pulse. and corresponds to the starting key e in FIG.

第2図の計数回路Gは駆動パルス所定の数まで計数する
ことによって走査回路Cが1からnまで走査した時点で
直ちに駆動パルスの発生を止めて走査を終らせ、その後
にn個の記憶回路Aを一斉に初期の状態に戻すための信
号を発生する回路である。
The counting circuit G in FIG. 2 counts the driving pulses up to a predetermined number, so that when the scanning circuit C scans from 1 to n, it immediately stops generating the driving pulses to complete the scanning, and then the n memory circuits This is a circuit that generates a signal to return A to its initial state all at once.

次に、本発明の動作を説明する。Next, the operation of the present invention will be explained.

操作者が先ず、第1図のプリセット用キーCまたはdを
打鍵すると、第2図のプリセットスイッチPS1または
PS2が作動して、n個の記憶回路Aがすべて゛1′′
または“0 11にブリセットされ、同時にランプ点灯
回路Bを通じて表示ランプPL1〜PLnすべでが点灯
または消滅の状態となる。
When the operator first presses the preset key C or d in FIG. 1, the preset switch PS1 or PS2 in FIG. 2 is activated and all n memory circuits A are set to ``1''.
Or, it is reset to "0 11" and at the same time, all of the display lamps PL1 to PLn are turned on or extinguished through the lamp lighting circuit B.

次に、操作者が第1図のセット用キーa1〜anのうち
の任意のキーを打鍵すると、第2図の記憶回路Aのうち
の打鍵されたキーに対応する記憶回路が“′O″または
“1″にセットされ、同時に“′O“′にセットされた
記憶回路に対応した表示用ランプが消滅するかまたは“
′1′”にセットされた記憶回路に対応した表示ランプ
が点灯する。
Next, when the operator presses any of the set keys a1 to an in FIG. 1, the memory circuit corresponding to the pressed key in the memory circuit A in FIG. Or, the display lamp corresponding to the memory circuit set to "1" and simultaneously set to "'O"' goes out, or "
The indicator lamp corresponding to the memory circuit set to '1' lights up.

すなわち、第2図の記憶回路Aにはn個の゛1″と“0
71からなるデータがセットされたことになる。
That is, the memory circuit A in FIG. 2 stores n "1" and "0".
This means that data consisting of 71 has been set.

操作者が第1図の表示用ランプb1〜bnを眺めてセッ
トされているデータを確認した後に、第1図の始動用キ
ーdを打鍵すると、第2図の始動スイッチDSが作動し
て駆動パルス発生回路Fから駆動パルスが発生され、走
査回路Cが作動し、記憶回路Aの各記憶回路のセット状
態が走査される。
When the operator presses the start key d in FIG. 1 after checking the set data by looking at the display lamps b1 to bn in FIG. 1, the start switch DS in FIG. A driving pulse is generated from the pulse generating circuit F, the scanning circuit C is activated, and the set state of each memory circuit of the memory circuit A is scanned.

その結果、走査回路Cから走査出力データはエンコーダ
部Dに送られる。
As a result, the scan output data from the scan circuit C is sent to the encoder section D.

このエンコーダ部Dでは、前記走査回路Cから送られて
きた゛1″,“0 11のデータを電子計算機または記
録装置への入力可能な符号に変換してインターフエイス
部Eまたは制御回路に送る。
This encoder section D converts the "1", "0 11" data sent from the scanning circuit C into a code that can be input to an electronic computer or recording device, and sends it to an interface section E or a control circuit.

一方、第2図の計数回路Gでは駆動パルスを計数して、
走査回路Cが記憶回路Aの1からnまで走査した時点を
とらえて直ちに,駆動パルス発生回路Fの作動を止めて
走査回路Cの働きを止め、同時に記憶回路Aの各記憶回
路を一斉に初期状態に戻す。
On the other hand, the counting circuit G in FIG. 2 counts the drive pulses,
As soon as the scanning circuit C scans the memory circuit A from 1 to n, the operation of the drive pulse generation circuit F is stopped to stop the operation of the scanning circuit C, and at the same time, each memory circuit of the memory circuit A is initialized all at once. Return to state.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明のキーボード装置の操作面を示す図およ
び第2図は本発明の一実施例を示すブロック図である。 第1図および第2図において、参照記号al+a2+・
・・,anはセット用キー、参照記号b1,b2,・・
・,bnは表示用ランプ、参照英文字Cおよびdはプリ
セット用キー、参照英文字eは走査開始用の始動用キー
、参照英文字fはリセット用キー、参照英文字Aはn個
の記憶回路、参照英文字Bは表示用ランプ点灯回路、参
照英文字Cは走査回路、参照英文字Dはエンコーダ部、
参照英文字Eはインターフエイス部または制御回路、参
照英文字Fは駆動パルス発生回路および参照英文字Gは
計数回路をそれぞれ表わす。
FIG. 1 is a diagram showing an operation surface of a keyboard device of the present invention, and FIG. 2 is a block diagram showing an embodiment of the present invention. In FIGS. 1 and 2, reference symbols al+a2+.
..., an is the set key, reference symbols b1, b2, ...
・, bn are display lamps, reference letters C and d are preset keys, reference letter e is a start key for starting scanning, reference letter f is a reset key, reference letter A is n memory Circuit, reference letter B is the display lamp lighting circuit, reference letter C is the scanning circuit, reference letter D is the encoder section,
Reference letter E represents an interface unit or control circuit, reference letter F represents a drive pulse generation circuit, and reference letter G represents a counting circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 “1″または゛0 11あるいは両者の混合したn
個のデータを一度に発生させるために“1″または゛0
″に記憶するn個の記憶回路と、これらすべての記憶回
路を“′1″または゛O nにプリセットすることので
きるプリセット用キーと、ブリセットされたn個の記憶
回路のそれぞれを゛o″または“1″にセットするn個
のセット用キーと、前記n個の記憶回路の状態を表示す
るn個の表示ランプと、前記n個の記憶回路の状態を走
査する走査回路と、前記走査回路を駆動する駆動パルス
発生回路と、前記駆動パルス発生回路から発生される駆
動パルスをn個計数したときに前記n個の記憶回路を初
期状態に戻すとともに前記駆動パルス発生回路および前
記走査回路の作動を止める計数回路と、前記駆動パルス
発生回路からの駆動パルスの発生を始動させる始動用キ
ーとから構成されたことを特徴とするキーボード装置。
1 "1" or "0 11" or a mixture of both n
“1” or “0” to generate data at once
n memory circuits to be stored in ``, a preset key that can preset all of these memory circuits to ``1'' or ``On'', and a preset key that can preset all of these memory circuits to ``1'' or n setting keys for setting the data to "" or "1"; n display lamps for displaying the states of the n memory circuits; a scanning circuit for scanning the states of the n memory circuits; a drive pulse generation circuit that drives a scanning circuit; and when n drive pulses generated from the drive pulse generation circuit are counted, the n storage circuits are returned to an initial state, and the drive pulse generation circuit and the scanning circuit are A keyboard device comprising: a counting circuit that stops the operation of the drive pulse generating circuit; and a starting key that starts the generation of drive pulses from the drive pulse generation circuit.
JP51002585A 1976-01-12 1976-01-12 keyboard device Expired JPS5849892B2 (en)

Priority Applications (1)

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JPS5286022A JPS5286022A (en) 1977-07-16
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