JPS5842437B2 - clock with keyboard - Google Patents

clock with keyboard

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Publication number
JPS5842437B2
JPS5842437B2 JP51081352A JP8135276A JPS5842437B2 JP S5842437 B2 JPS5842437 B2 JP S5842437B2 JP 51081352 A JP51081352 A JP 51081352A JP 8135276 A JP8135276 A JP 8135276A JP S5842437 B2 JPS5842437 B2 JP S5842437B2
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JP
Japan
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gate
clock
digit
time
signal
Prior art date
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Expired
Application number
JP51081352A
Other languages
Japanese (ja)
Other versions
JPS537273A (en
Inventor
栄作 清水
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Suwa Seikosha KK
Original Assignee
Suwa Seikosha KK
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Filing date
Publication date
Application filed by Suwa Seikosha KK filed Critical Suwa Seikosha KK
Priority to JP51081352A priority Critical patent/JPS5842437B2/en
Publication of JPS537273A publication Critical patent/JPS537273A/en
Publication of JPS5842437B2 publication Critical patent/JPS5842437B2/en
Expired legal-status Critical Current

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    • GPHYSICS
    • G04HOROLOGY
    • G04GELECTRONIC TIME-PIECES
    • G04G5/00Setting, i.e. correcting or changing, the time-indication
    • G04G5/04Setting, i.e. correcting or changing, the time-indication by setting each of the displayed values, e.g. date, hour, independently
    • G04G5/043Setting, i.e. correcting or changing, the time-indication by setting each of the displayed values, e.g. date, hour, independently using commutating devices for selecting the value, e.g. hours, minutes, seconds, to be corrected

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Electric Clocks (AREA)
  • Calculators And Similar Devices (AREA)
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Description

【発明の詳細な説明】 本発明はテンキーからの時刻修正に関するものである。[Detailed description of the invention] The present invention relates to time adjustment using a numeric keypad.

本発明はたとえば電子式卓上計算機に組み込まれる電子
時計を提供するものである。
The present invention provides an electronic timepiece that can be incorporated into, for example, an electronic desk calculator.

最近、機械式時計に比して精度が高く、かつデジタル的
に時間を知ることのできるデジタル時計が実用化されて
いる。
Recently, digital watches have been put into practical use that have higher accuracy than mechanical watches and can tell the time digitally.

このような電子時計の従来の時刻修正はパルス間隔が1
秒のパルスかあるいは1発ずつのパルスを各カウンタに
それぞれ別々に供給しなければならないので、そのパル
ス供給用のスイッチなどが各カウンタに対して1個ずつ
必要であり操作も非常に面倒である。
Conventional time adjustment for such electronic watches has a pulse interval of 1
Since pulses of seconds or single pulses must be supplied to each counter separately, a switch for supplying the pulses is required for each counter, and operation is very cumbersome. .

たとえば9に合わせたい場合は、9秒間スイッチを押し
たままにするか、あるいは9回スイッチを押さなければ
ならない。
For example, if you want to set the number 9, you must hold the switch for 9 seconds or press the switch 9 times.

このごろ、このようなデジタル時計を電子式卓上計算機
に組み込んだ計算機付時計が考えられるようになった。
Recently, calculator watches that incorporate such digital clocks into electronic desktop calculators have come to be considered.

本発明はキーボードを有する物に時計を組み込んだ時、
時計の時刻修正がキーボードのテン、キーの置数により
容易にしかも正確に行なわれる電子時計を提供するもの
である。
When the present invention incorporates a clock into an object having a keyboard,
To provide an electronic timepiece in which the time of the timepiece can be easily and accurately adjusted by adjusting the number of keys on a keyboard.

以下本発明の実施例に基づき説明する。The present invention will be explained below based on examples.

第1図は本発明になる時計を電子式卓上計算機に組み込
んだ計算機付時計の外観図。
FIG. 1 is an external view of a calculator watch in which the watch of the present invention is incorporated into an electronic desktop calculator.

第2図は第1図の計算機付時計の時計の制御回路、第3
図は第1図の計算機付時計の時計の修正回路、第4図は
第1図の時刻修正過程を示すものである。
Figure 2 shows the clock control circuit of the computer watch in Figure 1, and
The figure shows a clock adjustment circuit of the computer watch shown in FIG. 1, and FIG. 4 shows the time adjustment process of FIG. 1.

サイドスイッチSW2は計算機と時計の機能を切替える
スイッチである。
The side switch SW2 is a switch for switching between the functions of the calculator and the clock.

加算回路1,4ビットシフトレジスタ2.アンドゲート
3,5.オアゲート6.28ビツトシフトレジスタ7に
よる循環ループにより時刻情報を加算保持している。
Adder circuit 1, 4-bit shift register 2. And gate 3, 5. Time information is added and held in a circular loop using an OR gate 6.28-bit shift register 7.

アンドゲート9は10以上、アンドゲート10は6以上
、アンドゲート11は2以上、アンドゲート12は3以
上のコード検出を行ないFF14に信号を送る、アンド
ゲート13は13以上のコード検出を行ない、アンドゲ
ート15は13時になった時1時にリセット・セットす
るゲートである。
AND gate 9 detects codes of 10 or more, AND gate 10 detects codes of 6 or more, AND gate 11 detects codes of 2 or more, AND gate 12 detects codes of 3 or more and sends a signal to FF 14, AND gate 13 detects codes of 13 or more, AND gate 15 is a gate that is reset and set at 1 o'clock when 13 o'clock arrives.

時刻修正を説明する。Explain time adjustment.

第1図のサイドスイッチSW1を引っばるとアンロック
状態(修正可能)となり第3図布線Aが”Hnになり秒
の桁が2Hzで点滅を始める。
When the side switch SW1 in Figure 1 is pulled, the device becomes unlocked (correctable), the wiring line A in Figure 3 becomes "Hn", and the seconds digit starts blinking at 2Hz.

点滅している桁が修正桁であり基本的には2桁である。The blinking digit is the correction digit, which is basically 2 digits.

この状態に於て、キー目を押すと布線Bが°H″となり
分の桁が点滅を始める。
In this state, when the second key is pressed, the wiring B changes to °H'' and the minute digit starts blinking.

第4図はこれを示したものである。この状態に於て、キ
ー目を押すと布線りが11 HI+となり時の桁が点滅
を始める。
FIG. 4 shows this. In this state, when the second key is pressed, the wiring becomes 11 HI+ and the hour digit starts blinking.

アンロック状態に於てはキー目は修正桁を選択するセレ
クトキーとなり修正桁は秒−分一時一秒・・・・・・の
ようにセレクトされる。
In the unlocked state, the key number is a select key for selecting the corrected digit, and the corrected digit is selected as seconds, minutes, hours, one second, and so on.

時刻修正の例として分修正を説明する。Minute adjustment will be explained as an example of time adjustment.

第4図aは12時34分01秒が表示され分修正状態を
示したものである。
FIG. 4a shows the minute adjustment state where 12:34:01 is displayed.

更にこの状態はキー目により修正桁が分の桁にセレクト
された状態である。
Further, in this state, the correction digit is selected as the minute digit by the key.

キー目により第3図FF21.25はリセットされ出力
Qは6L”になっている。
The FF21.25 in FIG. 3 is reset by the key, and the output Q becomes 6L''.

この状態に於てキー(2)を置数するとキー■に対応し
たBCD信号信号0100)が発生しアンドゲート22
に送られる。
In this state, when key (2) is entered, a BCD signal signal 0100) corresponding to key ■ is generated and the AND gate 22
sent to.

更にキー(2)の置数によりD1〜D1までの時間幅の
1ワ一ド信号Hが発生してアンドゲート22より置数信
号Eが第2図オアゲート6に送られる。
Furthermore, a 1-word signal H having a time width of D1 to D1 is generated depending on the number set on the key (2), and a number signal E is sent from the AND gate 22 to the OR gate 6 in FIG.

また第3図アンドゲート23よりリセット信号Fが送ら
れアンドゲート3はシフトレジスタ2より送られてくる
分情報をリセットする。
Further, a reset signal F is sent from the AND gate 23 in FIG. 3, and the AND gate 3 resets the information sent from the shift register 2.

よって分の情報は2分となり第4図すの様になる。Therefore, the minute information becomes 2 minutes, as shown in Figure 4.

1ワ一ド信号が送られ終わるとFF21の出力Qが′H
”となる。
When the 1-word signal is sent, the output Q of FF21 becomes 'H.
” becomes.

−桁だけの修正ならばここで終了する。- If only the digit is corrected, end here.

この状態に於て、キー間を置数すると同様にして3の情
報がオアゲート6に送られる。
In this state, when a number is entered between the keys, information of 3 is sent to the OR gate 6 in the same way.

更にリセット信号Fによりアンドゲート3が働いてシフ
トレジスタ2からの分情報を禁止する。
Furthermore, the AND gate 3 is activated by the reset signal F to inhibit minute information from the shift register 2.

また更にFF21の出力Qがこんどは′H″になってい
るのでアンドゲート24が働きシフト信号Gをアンドゲ
ート4に送る。
Furthermore, since the output Q of the FF 21 is now ``H'', the AND gate 24 operates and sends the shift signal G to the AND gate 4.

アンドゲート4は4ビツトシフトレジスタ8からの情報
をアンドゲート5に送る。
AND gate 4 sends information from 4-bit shift register 8 to AND gate 5.

この状態に於ては前の1分の桁の情報2が送られる。In this state, information 2 of the previous one-minute digit is sent.

1分の桁に置数信号Eは常に入力され、2回目の置数の
時には1分の桁の情報がシフトレジスタ8により10分
の桁にシフトされる。
The number signal E is always input to the 1 minute digit, and when the number is set for the second time, the information of the 1 minute digit is shifted by the shift register 8 to the 10 minute digit.

更にまた1ワ一ド信号Hが終了するとFF25の出力Q
がH′”となり修正終了マークFが表示される。
Furthermore, when the 1-word signal H ends, the output Q of FF25
becomes H''' and a correction completion mark F is displayed.

よって分の情報は23分となり第4図Cのようになる。Therefore, the minute information becomes 23 minutes, as shown in FIG. 4C.

この状態に於て更にキーが置数されてもアンドゲート2
6により1ワ一ド信号を禁止するので修正されることは
ない。
In this state, even if another key is entered, the AND gate 2
6 prohibits one-word signals, so it cannot be modified.

この状態からサイドスイッチを押し込んでロック状態に
するとFF21,25にリセット信号が入り修正終了マ
ークFは消える。
When the side switch is pushed in from this state to the locked state, a reset signal is sent to the FFs 21 and 25 and the correction completion mark F disappears.

この状態を示したのが第4図C′である。This state is shown in FIG. 4C'.

第4図Cの状態に於て更に修正したい時にはクリアキー
間を押すとFF2125はリセットされる。
If you wish to make further corrections in the state shown in FIG. 4C, press between the clear keys to reset the FF 2125.

更にアンドゲート23よりクリアキー間の置数によりリ
セット信号Fが発生して分の桁がリセットされ時刻情報
は第4図dのようになる。
Furthermore, a reset signal F is generated from the AND gate 23 according to the number set between the clear keys, the minute digit is reset, and the time information becomes as shown in FIG. 4d.

この状態に於てキー■が置数されると第4図すと同様に
して第4図eのようになる。
In this state, when the key ◯ is pressed, the result is as shown in Fig. 4e in the same manner as shown in Fig. 4.

クリアキー間を置数すると更に2回置数することができ
る。
If you enter a number between the clear keys, you can enter the number two more times.

クリアキー間が置数されると00分。1時のようにセッ
トされる。
When the clear key interval is set, it is 00 minutes. It is set like 1 o'clock.

61分のように非存在の時刻が置数された時には上位の
桁がリセットされる。
When a non-existent time such as 61 minutes is entered, the upper digits are reset.

例えば61分の時にはアンドゲート10が働いて10分
の桁がリセットされ01分となる。
For example, at the 61st minute, the AND gate 10 is activated and the 10th minute digit is reset to become 01 minutes.

この時の桁上げ信号は1ワ一ド信号Hと同時に発生し2
倍の時間幅を持つ2ワ一ド信号りにより禁止される。
The carry signal at this time is generated at the same time as the 1 word signal H, and the 2
It is prohibited by a two-word signal with twice the time width.

時の修正に於て13時〜19時が置数された時には2ワ
一ド信号りによりアンドゲート15が働いてリセット信
号が禁止され、アンドゲート16が働いてFF17より
10時の桁にリセット信号が送られるので例えば13時
の時には3時となる。
When 13:00 to 19:00 is set during hour correction, AND gate 15 is activated by a 2-word signal and the reset signal is prohibited, and AND gate 16 is activated and reset to the 10:00 digit by FF 17. Since a signal is sent, for example, 13:00 becomes 3:00.

更にキー間が置数されて00時になった時にはFF18
,19が働いてアンドゲート20より1時の桁を1にセ
ットする信号を送る。
Furthermore, when the key interval is set and it reaches 00 o'clock, FF18
, 19 act and send a signal from the AND gate 20 to set the 1 o'clock digit to 1.

実施例では時、分、秒の機能を持つ時計で説明したがこ
れに限定されるものではなく、AI!vI/PM。
In the embodiment, a clock with hour, minute, and second functions was explained, but the invention is not limited to this. vI/PM.

出方、年、曜などの機能を持つ時計に於ても同様に用い
ることができる。
It can be used in the same way for clocks that have functions such as reading, year, and day of the year.

本発明は時計に限定されるものではなく時間を取り扱う
もの全てに用いることができる。
The present invention is not limited to watches, but can be used for anything that deals with time.

例えばアラームセット、タイマ一時間セット、ストップ
ウォッチ、時間計算である。
Examples are alarm set, timer set for one hour, stopwatch, and time calculation.

修正終了マークはあらたに設けるのではなく他の表示素
子と共用してもよい例えば計算機のエラーマークEであ
る。
The modification end mark may be used, for example, as a computer error mark E, which may be shared with other display elements instead of being newly provided.

以上実施例で示したように修正桁の修正は最高2回の置
数により修正することができるので2回の置数で区切る
と使用者は修正がわかりやすく、修正終了マークを表示
することにより修正できないことを知ることができる。
As shown in the above example, the correction digit can be corrected by setting the number twice at most, so if the correction is separated by two numbers, the user can easily understand the correction, and by displaying the correction completion mark. You can see that it cannot be fixed.

置数まちがいにより更に修正したい時にはクリアーキー
を置数することによりあらたに修正することができる。
If you want to make further corrections due to a mistake in the numbers entered, you can make new corrections by entering the clear key.

誤まって非存在の時刻が置数された時には表示されない
ようになっているので安心して修正することができる。
If a non-existent time is entered by mistake, it will not be displayed, so you can correct it with confidence.

このように簡単に修正することができ従来のような修正
のわずられしさから解放された時計を提供するものであ
る。
In this way, it is possible to provide a timepiece that can be easily corrected and is free from the troublesome corrections required in the past.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明になる時計を電子式卓上言上算機に組み
込んだ計算機付時計の外観図。 第2図は第1図の計算機付時計の時計の制御回路、第3
図は第1図の計算機付時計の時計の修正回路、第4図は
第1図の時刻修正過程を示す図。
FIG. 1 is an external view of a calculator clock in which the clock of the present invention is incorporated into an electronic desk calculator. Figure 2 shows the clock control circuit of the computer watch in Figure 1, and
The figure shows a clock correction circuit of the computer watch shown in FIG. 1, and FIG. 4 shows a time correction process shown in FIG. 1.

Claims (1)

【特許請求の範囲】[Claims] 1 少なくともテンキーを含むキーボードを有し、時刻
修正が前記テンキーの置数に対応した置数信号が修正桁
に入力されることにより行なわれるキーボード付時計に
おいて、時、分、秒の修正桁を2桁ずつ選択するセレク
トスイッチを設けると共に、前記テンキーによる置数が
2回行なわれたことを検出する検出回路21.25を設
け、前記検出回路の出力により、3回目以後の置数を禁
止するゲート回路26を設けたことを特徴とするキーボ
ード付時計。
1. In a watch with a keyboard, which has a keyboard including at least a numeric keypad, and in which the time is adjusted by inputting a number signal corresponding to the number entered on the numeric keypad into the correction digits, the correction digits for hours, minutes, and seconds are set to two. In addition to providing a select switch for selecting digits one by one, a detection circuit 21 and 25 is provided to detect that a number has been entered twice using the numeric keypad, and a gate that prohibits the third and subsequent number entry based on the output of the detection circuit. A clock with a keyboard characterized by being provided with a circuit 26.
JP51081352A 1976-07-08 1976-07-08 clock with keyboard Expired JPS5842437B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP51081352A JPS5842437B2 (en) 1976-07-08 1976-07-08 clock with keyboard

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP51081352A JPS5842437B2 (en) 1976-07-08 1976-07-08 clock with keyboard

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Publication Number Publication Date
JPS537273A JPS537273A (en) 1978-01-23
JPS5842437B2 true JPS5842437B2 (en) 1983-09-20

Family

ID=13743960

Family Applications (1)

Application Number Title Priority Date Filing Date
JP51081352A Expired JPS5842437B2 (en) 1976-07-08 1976-07-08 clock with keyboard

Country Status (1)

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JP (1) JPS5842437B2 (en)

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Publication number Publication date
JPS537273A (en) 1978-01-23

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