JPS5834965B2 - Transistor Zoufuku Cairo - Google Patents

Transistor Zoufuku Cairo

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JPS5834965B2
JPS5834965B2 JP48128273A JP12827373A JPS5834965B2 JP S5834965 B2 JPS5834965 B2 JP S5834965B2 JP 48128273 A JP48128273 A JP 48128273A JP 12827373 A JP12827373 A JP 12827373A JP S5834965 B2 JPS5834965 B2 JP S5834965B2
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Description

【発明の詳細な説明】 本発明はトランジスタ増幅回路に関し、特に出力回路が
プッシュプル回路によって構成されたトランジスタ増幅
回路を対象とする。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a transistor amplifier circuit, and is particularly directed to a transistor amplifier circuit whose output circuit is constituted by a push-pull circuit.

一般にトランジスタはコレクタ損失により接合部の温度
が上昇し、これが規定値以上になると破壊する。
Generally, a transistor's junction temperature increases due to collector loss, and if this temperature exceeds a specified value, it will be destroyed.

したがって、トランジスタを破壊するに至らしめない最
大コレクタ損失、すなわち最大許容コレクタ損失は接合
部の温度が一定の場合時一定であるのでコレクタ・エミ
ッタ間電圧が上昇した場合、コレクタ電流を減少させな
いとコレクタ損失が最大許容コレクタ損失を越えてトラ
ンジスタが破壊するおそれがある。
Therefore, the maximum collector loss that does not lead to destruction of the transistor, that is, the maximum allowable collector loss, is constant when the junction temperature is constant. Therefore, if the collector-emitter voltage increases, the collector current must be reduced. There is a risk that the loss will exceed the maximum allowable collector loss and the transistor will be destroyed.

ところで、従来より音響用電力増幅器として第3図に示
すようなプッシュプル回路が公知でアル。
By the way, a push-pull circuit as shown in FIG. 3 is conventionally known as an acoustic power amplifier.

この回路にあっては電源電圧が定格値以上に上昇した場
合、あるいは電源ON、OFF時における電源フィルタ
ーのLに発生するサージ電圧等によってB級プッシュプ
ル出力回路のパワー・トランジスタQ1□〜Q15が破
壊してしまうという問題があった。
In this circuit, when the power supply voltage rises above the rated value, or when a surge voltage occurs at the L of the power supply filter when the power is turned on or off, the power transistors Q1□ to Q15 of the class B push-pull output circuit are There was a problem with it being destroyed.

また、上記プッシュプル回路にあってはその負荷が短絡
すると出力コンデンサCのみが負荷となり、そのインピ
ーダンスがゼロに近く、かつキャパシティブな負荷とな
ってコレクタ電圧とコレクタ電流間の位相がずれ、この
ため、大レベル入力に対してコレクタ電圧が最大なとき
最大のコレクタ電流が流れる動作となり、コレクタ損失
が最大許容コレクタ損失を越えることがある。
In addition, in the above push-pull circuit, if the load is short-circuited, only the output capacitor C becomes a load, and its impedance is close to zero, and it becomes a capacitive load, causing a phase shift between the collector voltage and collector current. When the collector voltage is maximum for a large level input, the maximum collector current flows, and the collector loss may exceed the maximum allowable collector loss.

一方従来より、負荷短絡による出力トランジスタQ12
〜Q15の破壊を防止するための負荷短絡保護回路とし
て、第4図に示すように出力トランジスタのコレクタ・
エミッタ間電圧とコレクタ電流を同時に検出して出力ト
ランジスタを制御する保護回路が実公昭47−8162
公報「トランジスタ増幅回路」によって開示されている
が、上記保護回路は前記電源投入もしくは電源電圧の上
昇による出力トランジスタQ1□、Q14の破壊を保護
するには、電源電圧の変動に対する制御トランジスタQ
16 t Q1□の制限感度が低く、電源電圧変動に対
しての出力トランジスタを保護するための保護回路とし
ては適当ではなかった。
On the other hand, conventionally, output transistor Q12 due to load short circuit
~As a load short-circuit protection circuit to prevent damage to Q15, the output transistor collector and
A protection circuit that controls the output transistor by simultaneously detecting the emitter voltage and collector current was published in Japanese Utility Model Publication No. 47-8162.
Although disclosed in the publication ``Transistor Amplifier Circuit,'' the above protection circuit requires a control transistor Q against fluctuations in the power supply voltage in order to protect the output transistors Q1□, Q14 from being destroyed due to power-on or increase in power supply voltage.
The limiting sensitivity of 16 t Q1□ was low, and it was not suitable as a protection circuit for protecting the output transistor against fluctuations in the power supply voltage.

一方、特公昭45−33201号公報「回路保護装置」
においては同一の半導体集積回路の基板内に電力増幅回
路と半導体基板温度検出制御回路とが形成され、電力増
幅回路の出力トランジスタの接合部の温度が異常に上昇
した場合に半導体基板温度検出制御回路によって出力ト
ランジスタのベースに流入する交流信号を遮断せしめる
ことによって出力トランジスタの過熱破壊を防止するこ
とが開示されている。
On the other hand, Japanese Patent Publication No. 45-33201 "Circuit protection device"
In this case, a power amplifier circuit and a semiconductor substrate temperature detection control circuit are formed in the same semiconductor integrated circuit substrate, and when the temperature of the junction of the output transistor of the power amplifier circuit rises abnormally, the semiconductor substrate temperature detection control circuit It is disclosed that the output transistor is prevented from being destroyed by overheating by blocking an alternating current signal flowing into the base of the output transistor.

しかしながら、特公昭45−33201号公報に開示さ
れた半導体集積回路においては半導体基板温度検出制御
回路が電源分圧電圧と直列接続されたダイオードの順方
向電圧とを比較しているため、電源電圧が異常に上昇し
た場合はこの半導体基板温度検出制御回路が動作し、そ
の結果電力増幅回路のプッシュプル出力段を構成する出
力トランジスタのうち電源と出力端子との間にそのコレ
クタ・エミッタ経路が接続されたところの出力トランジ
スタのエミッタ・ベース接合が順方向バイアスされ比較
的大きな電流が流れるため、出力トランジスタの破壊の
危険性が高いことが明らかとなった。
However, in the semiconductor integrated circuit disclosed in Japanese Patent Publication No. 45-33201, the semiconductor substrate temperature detection control circuit compares the power supply voltage division voltage with the forward voltage of the diodes connected in series, so the power supply voltage is If the temperature rises abnormally, this semiconductor substrate temperature detection control circuit operates, and as a result, the collector-emitter path of the output transistor that constitutes the push-pull output stage of the power amplifier circuit is connected between the power supply and the output terminal. However, it has become clear that the emitter-base junction of the output transistor is forward biased and a relatively large current flows through it, which poses a high risk of destruction of the output transistor.

一方、本願発明の先願に係わる特願昭48−11661
5号(特公昭54−22272号公報)「出カドランス
レス形プッシュプルトランジスタ電力増幅回路」におい
ては電源電圧のサージ(異常に高い電源電圧)が印加さ
れた場合に電源端子と出力端子との間にそのコレクタ・
エミッタ経路が接続されたところの出力トランジスタの
ベース・エミッタ接合を保護用トランジスタによって実
質的に短絡せしめることが提案されている。
On the other hand, Japanese Patent Application No. 11661/1989 related to the earlier application of the present invention
No. 5 (Japanese Patent Publication No. 54-22272) ``Outputless push-pull transistor power amplifier circuit'', when a surge of power supply voltage (abnormally high power supply voltage) is applied, a voltage is generated between the power supply terminal and the output terminal. The collector
It has been proposed to substantially short-circuit the base-emitter junction of the output transistor to which the emitter path is connected by means of a protection transistor.

しかしながら、本願発明者等の検討によってトランジス
タのエミッタ・ベース接合が短絡された場合はベース電
流がほぼ零となるのでコレクタ・エミッタ間降伏電圧は
ベース開放コレクタ・エミッタ間降伏電圧BVOEOに
近い値となり満足できる破壊防止動作が達成できないこ
とが明らかとされた。
However, according to studies conducted by the inventors of the present application, when the emitter-base junction of a transistor is short-circuited, the base current becomes almost zero, so the collector-emitter breakdown voltage becomes a value close to the base-open collector-emitter breakdown voltage BVOEO, which is satisfactory. It has become clear that the possible anti-destruction action cannot be achieved.

本願発明はトランジスタのエミッタ・ベース接合が逆方
向バイアスされた場合はベース開放コレクタ・エミッタ
間降伏電圧BVC!Eoより高い値を有するところのエ
ミッタ開放コレクタ・ベース間降伏電圧BVOBOに近
い降伏電圧によってコレクタ・エミッタ間降伏電圧が定
まるという現象に着目してなされたものであり、その目
的とするところは高感度、高信頼性の過電圧保護回路を
具備したトランジスタ増幅回路を提供することにある。
In the present invention, when the emitter-base junction of a transistor is reverse biased, the base-open collector-emitter breakdown voltage BVC! This was done by focusing on the phenomenon that the collector-emitter breakdown voltage is determined by the breakdown voltage close to the emitter open collector-base breakdown voltage BVOBO, which has a value higher than Eo, and its purpose is to achieve high sensitivity. An object of the present invention is to provide a transistor amplifier circuit equipped with a highly reliable overvoltage protection circuit.

以下実施例にそって図面を参照し、本発明を具体的に説
明する。
The present invention will be specifically described below along with examples and with reference to the drawings.

第1図に本発明に係るトランジスタ増幅回路の一例を示
す。
FIG. 1 shows an example of a transistor amplifier circuit according to the present invention.

同図に示すように、初段増幅器1によって増幅された入
力信号■inを駆動トランジスタQ1、に印カロし、該
トランジスタQ1□によりプッシュプル出力トランジス
タQ12〜Q15を駆動する。
As shown in the figure, the input signal ■in amplified by the first stage amplifier 1 is applied to the driving transistor Q1, and the push-pull output transistors Q12 to Q15 are driven by the transistor Q1□.

このトランジスタ増幅回路においては、上記出力トラン
ジスタQ12〜Q15を破壊せしめるような電源電圧V
CCの上昇を検知するため基準直流定電圧を得るツェナ
ーダイオードDzと上記電源電圧VOOの変動を検出す
るための分圧抵抗R1,。
In this transistor amplifier circuit, the power supply voltage V that destroys the output transistors Q12 to Q15 is
A Zener diode Dz for obtaining a reference DC constant voltage for detecting a rise in CC, and a voltage dividing resistor R1 for detecting fluctuations in the power supply voltage VOO.

R2oとが配置されている。R2o is arranged.

さらに基準直流電圧と電源分圧電圧との電圧比較を行な
うトランジスタQ18が配置され、このトランジスタQ
18のコレクタ出力信号によって出力トランジスタQ1
□、Q13のベース電流を制御する制御トランジスタQ
1.のベースが駆動される。
Furthermore, a transistor Q18 is arranged to perform a voltage comparison between the reference DC voltage and the power supply divided voltage.
The collector output signal of output transistor Q1
□, control transistor Q that controls the base current of Q13
1. The base of is driven.

かくして出力トランジスタの電源電圧VOOの上昇によ
るコレクタ損失破壊が防止されることができる。
In this way, collector loss destruction due to an increase in the power supply voltage VOO of the output transistor can be prevented.

なお、上記回路例にあっては、トランジスタQ16゜Q
1□によって構成された前記負荷短絡による出力トラン
ジスタの破壊防止回路を有するトランジスタ増幅回路に
本発明を適用するものであるが、本発明に特に必要とす
るものでなく、負荷短絡等を考慮する必要のない増幅回
路であればトランジスタQ16.Q17は省略されるこ
とができる。
In addition, in the above circuit example, the transistor Q16゜Q
The present invention is applied to a transistor amplifier circuit having a circuit for preventing destruction of the output transistor due to a load short circuit configured by 1□, but it is not particularly necessary for the present invention, and it is necessary to take load short circuits etc. into consideration. If the amplifier circuit does not have transistor Q16. Q17 can be omitted.

以上実施例により説明した本発明によれば下記の理由で
その目的が達成できる。
According to the present invention explained in the examples above, the object can be achieved for the following reasons.

本発明によるトランジスタ増幅回路は電源電圧vccの
上昇に伴って抵抗R10,R2oの分圧電圧が上昇し、
したがって電圧比較トランジスタQ18のエミッタ電圧
が上昇する。
In the transistor amplifier circuit according to the present invention, the divided voltage of the resistors R10 and R2o increases as the power supply voltage vcc increases,
Therefore, the emitter voltage of voltage comparison transistor Q18 increases.

一方該トランジスタQ18のベースにはツェナーダイオ
ードD8によるコレクタ破壊電圧を検知するための基準
直流定電圧が印カ目されており、通常の電源電圧VOO
であれば該トランジスタQ18を非導通とし、したがっ
て制御トランジスタQl、を非導通として何ら正常動作
には支障をきたさない。
On the other hand, a reference DC constant voltage for detecting the collector breakdown voltage due to the Zener diode D8 is stamped on the base of the transistor Q18, and the normal power supply voltage VOO
If so, the transistor Q18 is made non-conductive, and therefore the control transistor Ql is made non-conductive, so that normal operation is not affected in any way.

電源電圧VOOが異常に上昇することによって分圧電圧
が基準直流定電圧以上に上昇すると電圧比較トランジス
タQ18が導通して制御トランジスタQ1.を導通せし
め、出力トランジスタQ12.Q13のベース入力をア
ースに短絡して遮断状態とし、該出力トランジスタQ1
□〜Q1.のコレクタ損失破壊を防止するものである。
When the divided voltage rises above the reference DC constant voltage due to an abnormal rise in the power supply voltage VOO, the voltage comparison transistor Q18 becomes conductive and the control transistors Q1. conducts, output transistor Q12. The base input of Q13 is shorted to ground to cut off the output transistor Q1.
□~Q1. This prevents collector loss and destruction.

したがって本発明による出力トランジスタの保護回路は
電圧比較トランジスタQ18による破壊電圧検出信号を
制御トランジスタQ19により増幅して行なうものであ
るため制御感度が高くでき、また電圧検出は安定したツ
ェナー電圧を基準電圧としているため確実な保護動作を
行なうことができる。
Therefore, since the output transistor protection circuit according to the present invention amplifies the breakdown voltage detection signal from the voltage comparison transistor Q18 using the control transistor Q19, the control sensitivity can be increased, and voltage detection is performed using the stable Zener voltage as the reference voltage. Therefore, reliable protection operation can be performed.

制御トランジスタQ1.の導通によって出力トランジス
タQ1□のベース電圧はアース電位に維持されるのに対
し、プッシュプル出力段の出力端子(いいかえれば出力
カップリングコンデンサCと負帰還抵抗R21との共通
接続点、抵抗R16と抵抗R1□との共通接続点)の電
位は直流動作点(電源電圧■ccの約半分の電位)に維
持されているので出力トランジスタQ42 p Q43
のエミッタ・ベース接合は逆方向バイアスされ遮断状態
となる。
Control transistor Q1. The base voltage of the output transistor Q1□ is maintained at ground potential due to the conduction of Since the potential of the common connection point with the resistor R1□ is maintained at the DC operating point (approximately half the potential of the power supply voltage ■cc), the output transistor Q42 p Q43
The emitter-base junction of is reverse biased and is in a cut-off state.

トランジスタのエミッタ・ベース接合が逆方向バイアス
された場合のコレクタ・エミッタ間電圧■cE−コレク
タ電流IC特性は第2図の曲線Rに示されている。
When the emitter-base junction of the transistor is biased in the reverse direction, the collector-emitter voltage cE-collector current IC characteristic is shown by curve R in FIG.

曲線Rのうち実線部分は非破壊の一次降伏領域を示し、
曲線Rのうち破線部分は永久破壊の二次破壊領域を示す
The solid line portion of the curve R indicates the non-destructive primary yield region,
The broken line portion of the curve R indicates the secondary destruction area of permanent destruction.

トランジスタのエミッタ・ベース接合が開放の場合のV
OE −I O特性が第2図の曲線Oに示されている。
V when the emitter-base junction of the transistor is open
The OE-IO characteristic is shown by curve O in FIG.

曲線Oのうち実線部分は非破壊の一次降伏領域を示し、
曲線Oのうち破線部分は永久破壊の二次破壊領域を示す
The solid line part of the curve O indicates the non-destructive primary yield region,
The broken line portion of the curve O indicates the secondary destruction area of permanent destruction.

トランジスタのエミッタ・ベース接合が順方向バイアス
された場合のVOE−IC特性が第2図の曲線Fに示さ
れている。
The VOE-IC characteristic when the emitter-base junction of the transistor is forward biased is shown by curve F in FIG.

曲線Fのうち実線部分は非破壊の一次降伏領域を示し、
曲線Fのうち破線部分は永久破壊の二次破壊領域を示す
The solid line part of the curve F indicates the non-destructive primary yield region,
The broken line portion of curve F indicates the secondary destruction area of permanent destruction.

トランジスタのエミッタ・ベース接合が短絡された場合
はベース電流はほぼ零となるのでコレクタ・エミッタ間
降伏電圧はベース開放コレクタ・エミッタ間降伏電圧B
YOEOに近い値となる。
When the emitter-base junction of a transistor is short-circuited, the base current becomes almost zero, so the collector-emitter breakdown voltage is the base open collector-emitter breakdown voltage B
The value is close to YOEO.

本願発明においては電源電圧VOOが異常に上昇した場
合は制御トランジスタQ1.の導通によって出力トラン
ジスタQ1□、Q13のエミッタ・ベース接合が逆方向
バイアスされ、出力トランジスタQ12 y Q13の
コレクタ・エミッタ間降伏電圧はBVOBOより高い値
を有するところのエミッタ開放コレクタ・ベース間降伏
電圧BYOBOに近い値となる。
In the present invention, when the power supply voltage VOO increases abnormally, the control transistor Q1. The emitter-base junctions of the output transistors Q1□ and Q13 are biased in the reverse direction due to the conduction of The value is close to .

かくして、本願発明によれば電源電圧VOOの異常な上
昇による出力トランジスタQ1□。
Thus, according to the present invention, the output transistor Q1□ due to an abnormal rise in the power supply voltage VOO.

Q13の二次破壊降伏に対する強度を向上することが可
能となり、初期の目的を達成することができる。
It becomes possible to improve the strength against secondary fracture yielding of Q13, and the initial objective can be achieved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明に係るトランジスタ増幅回路の一例を示
し、第2図はエミッタ・ベース接合が種種の条件に制御
された場合のVOE−IC特性を示し、第3図は従来の
トランジスタ増幅回路を示し、第4図は従来のプッシュ
プル回路の負荷短絡防止回路を示す。 1・・・・・・初段増幅回路、Q11〜Q28・・・・
・・トランジスタ、R1、〜R20,R3o−R4、・
・・・・・抵抗、DIl〜D、D−D ・・・・・・
ダイオード、D8・・・・・・ツェナ13 21
23 ナーダイオード、C・・・・・・コンデンサー、L・・
・・・・チョークコイル、SP・・・・・・スピーカ。
FIG. 1 shows an example of a transistor amplifier circuit according to the present invention, FIG. 2 shows VOE-IC characteristics when the emitter-base junction is controlled under various conditions, and FIG. 3 shows a conventional transistor amplifier circuit. FIG. 4 shows a conventional push-pull circuit for preventing load short circuits. 1...First stage amplifier circuit, Q11-Q28...
・Transistor, R1, ~R20, R3o-R4,・
...Resistance, DIl~D, D-D...
Diode, D8...Zena 13 21
23 Ner diode, C... Capacitor, L...
...Choke coil, SP...Speaker.

Claims (1)

【特許請求の範囲】 1 電源と出力端子との間にそのコレクタ・エミッタ経
路が接続された第1の出力トランジスタと、上記出力端
子と基底電位との間にそのコレクタ・エミッタ経路が接
続された第2の出力トランジスタと、上記出力端子と上
記基底電位との間に設けられ上記出力端子の出力が加え
られる直流カット用のコンデンサとを具備するとともに
上記第1の出力トランジスタと上記第2の出力トランジ
スタとがプッシュプル動作する如く構成されたトランジ
スタ増幅回路において、上記第1の出力トランジスタの
ベースと基底電位との間にそのコレクタ・エミッタ経路
が接続された制御トランジスタQ9と、電源の電源電圧
■。 Cもしくは電源分圧電圧と基準電圧とを比較し上記電源
電圧もしくは上記電源分圧電圧が上記基準電圧を越えた
ときに上記制御トランジスタを導通せしめる出力を形成
する比較手段DZ、R18,R19,R2o、Q18と
を備えてなり、上記制御□□トランジスタが導通せしめ
られたときに上記コンデンサから上記出力端子に与えら
れる電位によって上記第1の出力トランジスタのベース
・エミッタ間に逆バイアス電圧が与えられるようにされ
てなることを特徴とするトランジスタ増幅回路。
[Claims] 1. A first output transistor whose collector-emitter path is connected between a power source and an output terminal, and whose collector-emitter path is connected between the output terminal and a base potential. A second output transistor, a DC cutting capacitor provided between the output terminal and the base potential and to which the output of the output terminal is added, and the first output transistor and the second output In a transistor amplifier circuit configured such that a transistor operates in a push-pull manner, a control transistor Q9 whose collector-emitter path is connected between the base of the first output transistor and the ground potential, and a power supply voltage . C or a comparison means DZ, R18, R19, R2o that compares the power supply voltage and the reference voltage and forms an output that makes the control transistor conductive when the power supply voltage or the power supply voltage division exceeds the reference voltage. , Q18, such that a reverse bias voltage is applied between the base and emitter of the first output transistor by the potential applied from the capacitor to the output terminal when the control transistor is made conductive. A transistor amplifier circuit characterized by:
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