JPS5822758B2 - Eizohiyoujisouchi - Google Patents
EizohiyoujisouchiInfo
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- JPS5822758B2 JPS5822758B2 JP12706175A JP12706175A JPS5822758B2 JP S5822758 B2 JPS5822758 B2 JP S5822758B2 JP 12706175 A JP12706175 A JP 12706175A JP 12706175 A JP12706175 A JP 12706175A JP S5822758 B2 JPS5822758 B2 JP S5822758B2
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- emitting element
- sampling
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【発明の詳細な説明】
この発明は、ガス放電パネルまたはELパネル等のX−
Yマトリクス表示パネルを用いた映像表示装置に関する
ものである。DETAILED DESCRIPTION OF THE INVENTION The present invention provides an X-
The present invention relates to a video display device using a Y matrix display panel.
従来のX−Yマトリクス表示パネルの構成図を第1図に
示す。A block diagram of a conventional X-Y matrix display panel is shown in FIG.
第1図において、X電極X1.X2・・・・およびY電
極¥1.¥2・・・の交点P・ が発光素点を示す。In FIG. 1, X electrodes X1. X2... and Y electrode ¥1. The intersection point P of ¥2... indicates the light-emitting element point.
このような表示パネルを用いてテレビジョン画像を表示
する場合には、立上り速度および輝度を考慮してライン
・アット・ア・タイム表示にて可能にしている。When displaying television images using such a display panel, line-at-time display is possible in consideration of rising speed and brightness.
すなわち、X電極には1水平走査期間選択するパルスが
印加され、各X電極には、入力映像信号をサンプリング
してメモリし、並列信号に変換した後同時に印加される
。That is, a pulse for selecting one horizontal scanning period is applied to the X electrode, and an input video signal is sampled and stored in memory, converted into parallel signals, and then applied to each X electrode at the same time.
このようなマトリクス表示パネルにおいて、X電極の本
数を半分にすればコストダウンを計ることができるが、
表示しうる走査線を半減させてしまうことになり、画質
の劣化をきたすことになる。In such a matrix display panel, it is possible to reduce costs by halving the number of X electrodes, but
The number of scan lines that can be displayed is reduced by half, resulting in deterioration of image quality.
したがって、この発明の目的は、画質を劣化することな
くX電極を半減することができる映像表示装置を提供す
ることである。Therefore, an object of the present invention is to provide a video display device that can reduce the number of X electrodes by half without deteriorating the image quality.
第2図はこの発明に用いることができる表示パネルの構
成図である。FIG. 2 is a configuration diagram of a display panel that can be used in the present invention.
この表示パネルのY電極¥1゜¥2・・・は、行電極の
相互に隣接する一対の電極をそれぞれ共通的に接続した
共通電極となっている。The Y electrodes ¥1, ¥2, etc. of this display panel are common electrodes in which a pair of mutually adjacent row electrodes are respectively connected in common.
第2図において、Yl、¥2・・・は行選択電極すなわ
ちX電極を示し、Xl、X2・・・は列選択電極すなわ
ちX電極を示す。In FIG. 2, Yl, \2, . . . indicate row selection electrodes, ie, X electrodes, and Xl, X2, . . . indicate column selection electrodes, ie, X electrodes.
Pijは発光素点を示す。このような発光素点を構成す
る表示パネルは、例えばガス放電パネルでは中間シート
にセルを構成する孔をあけることによって作ることがで
きる。Pij indicates a luminescent element point. A display panel configuring such light-emitting element points, for example, in a gas discharge panel, can be made by punching holes configuring cells in an intermediate sheet.
従来と異なる点は、1つのX電極にて2走査線の信号を
表示することができる点である。The difference from the conventional method is that signals of two scanning lines can be displayed using one X electrode.
すなわち、Y電極Yjを選択した場合に、1番目の走査
線の信号をX電極X21−1に印加し、そして(j+1
)番目の走査線の信号をX電極X21に印加すればよい
。That is, when Y electrode Yj is selected, the signal of the first scanning line is applied to X electrode X21-1, and (j+1
)-th scanning line signal may be applied to the X electrode X21.
したがって、Y電極Yjを2水平走査線期間選択してい
る間に、最初の1水平走査期間にX電極X2i 、に信
号を与え、次の1水平走査期間にX電極X21に信号を
与えることによって水平解像度および垂直解像度を維持
することができる。Therefore, while selecting the Y electrode Yj for two horizontal scanning line periods, by giving a signal to the X electrode X2i in the first one horizontal scanning period and giving a signal to the X electrode X21 in the next one horizontal scanning period, Horizontal and vertical resolution can be maintained.
前述の動作を可能にする映像表示装置の構成図を第3図
に示す。FIG. 3 shows a configuration diagram of a video display device that enables the above-described operation.
すなわち、第3図はこの発明の映像表示装置の一実施例
の構成図である。That is, FIG. 3 is a block diagram of one embodiment of the video display device of the present invention.
第3図において、3−1は第2図に示した表示パネル、
3−2は映像信号増幅器、3.−3はサンプリングパル
ス発生回路、3−4はサンプリング・ホールド回路、3
−5はパルス幅変換器、3−6はパルス幅変換用の基準
鋸歯状波発生器、3−7は列電極選択用スイッチ回路、
3−8はタイミングパルス発生器、3−9はパネルドラ
イブ回路、3−10は水平同期信号に同期した信号を入
力とする行電極選択用パルス発生器を示す。In Fig. 3, 3-1 is the display panel shown in Fig. 2;
3-2 is a video signal amplifier; 3. -3 is a sampling pulse generation circuit, 3-4 is a sampling/hold circuit, 3
-5 is a pulse width converter, 3-6 is a reference sawtooth wave generator for pulse width conversion, 3-7 is a switch circuit for column electrode selection,
3-8 is a timing pulse generator, 3-9 is a panel drive circuit, and 3-10 is a row electrode selection pulse generator whose input is a signal synchronized with a horizontal synchronization signal.
第4図に第3図の波形図を示す。FIG. 4 shows a waveform diagram of FIG. 3.
第4図において、4−1は入力映像信号波形であり、斜
線部分はサンプリングされた部分である。In FIG. 4, 4-1 is the input video signal waveform, and the shaded portion is the sampled portion.
4−2および4−3はサンプリング波形を示し、’rH
+’rs 、 ’rH−’rsの周期で繰り返すもので
ある(ただし、TH:1水平走査期間、Ts:サンプリ
ングパルス幅)。4-2 and 4-3 show sampling waveforms, 'rH
+'rs, 'rH-'rs (where TH: 1 horizontal scanning period, Ts: sampling pulse width).
このようにすることによって、各X電極の位置に相当す
る位相のサンプリングパルスが得られる。By doing so, a sampling pulse having a phase corresponding to the position of each X electrode can be obtained.
4−4および4−5は第3図列電極選択用スイッチ3−
7を動作させるタイミングパルスであり、タイミングパ
ルス発生器3−8の出力波形である。4-4 and 4-5 are column electrode selection switches 3- in Figure 3.
This is the timing pulse for operating the timing pulse generator 3-8, and is the output waveform of the timing pulse generator 3-8.
4−6および4−7は第3図の行電極選択用パルス発生
器3−10の出力波形であり、X電極選択パルスを示す
。4-6 and 4-7 are output waveforms of the row electrode selection pulse generator 3-10 in FIG. 3, and represent the X electrode selection pulse.
つぎに、第3図および第4図を用いて動作説明を行う。Next, the operation will be explained using FIGS. 3 and 4.
入力映像信号はサンプリングパルス発生回路3−3の出
力端子より得られたパルスを用いてサンプリング・ホー
ルド回路3−4でサンプリングされ、パルス幅変換器3
−5でパルス幅変調される。The input video signal is sampled by the sampling/holding circuit 3-4 using the pulse obtained from the output terminal of the sampling pulse generation circuit 3-3, and then sent to the pulse width converter 3.
-5 pulse width modulation.
この出力信号は、スイッチ回路3−7により1水平走査
線毎に切り換えられてX電極の奇数番目または偶数番目
に与えられる。This output signal is switched by the switch circuit 3-7 every horizontal scanning line and is applied to the odd or even numbered X electrodes.
スイッチ回路3−7はANDゲート回路を組み合わせて
簡単に作ることができる。The switch circuit 3-7 can be easily made by combining AND gate circuits.
一方、X電極には、前述のように2水平走査期間のパル
ス幅をもつ信号が印加される。On the other hand, a signal having a pulse width of two horizontal scanning periods is applied to the X electrode as described above.
第5図はサンプリングパルス発生回路3−3の回路図で
ある。FIG. 5 is a circuit diagram of the sampling pulse generation circuit 3-3.
第5図において、5−1は水平同期信号に同期したゲー
ト信号入力端子、5−2は同期発振器で、発振周波数は
X電極の本数に依存して決定される。In FIG. 5, 5-1 is a gate signal input terminal synchronized with a horizontal synchronizing signal, 5-2 is a synchronous oscillator, and the oscillation frequency is determined depending on the number of X electrodes.
5−3は2進カウンタ、5−4は垂直同期信号入力端子
、5−5はフリップフロップ、5−6および5−7はN
AND回路、5−8はNOR回路、5−9はシフトレジ
スタ、5−10はサンプリングパルス出力端子を示し、
シフトレジスタ5−9の1段おきの出力端子からサンプ
リングパルスを取り出すことを示す。5-3 is a binary counter, 5-4 is a vertical synchronization signal input terminal, 5-5 is a flip-flop, 5-6 and 5-7 are N
An AND circuit, 5-8 a NOR circuit, 5-9 a shift register, 5-10 a sampling pulse output terminal,
This shows that sampling pulses are taken out from the output terminals of every other stage of the shift register 5-9.
この回路の動作は、まず発振器5−2の出力をカウンタ
5−3でカウントして1番目と2番目のパルスを取り出
し、これらのパルスを、垂直同期信号によってリセット
されかつ水平同期信号に同期した信号を入力とするフリ
ップフロップ5−5の出力QおよびQを用いてNAND
回路5−6.5−7でゲートし、このゲ゛−ト出力信号
によってシフトレジスタ5−9を始動させるものである
。The operation of this circuit is as follows: First, the output of the oscillator 5-2 is counted by the counter 5-3, the first and second pulses are taken out, and these pulses are reset by the vertical synchronizing signal and synchronized with the horizontal synchronizing signal. NAND using the outputs Q and Q of the flip-flop 5-5 which receives the signal as input.
It is gated by circuits 5-6 and 5-7, and the gate output signal starts the shift register 5-9.
したがって、出力端子5−10の1つには水平同期信号
のIH(水平走査期間)毎にパルス幅Tsのパルスが’
rH+’Il’、s 、’ TH−T3の繰り返し周期
で得られる。Therefore, one of the output terminals 5-10 receives a pulse with a pulse width Ts every IH (horizontal scanning period) of the horizontal synchronizing signal.
It is obtained with a repetition period of rH+'Il', s,'TH-T3.
また、フリップフロップ5−5のQ、Q信号は垂直同期
信号によって制御されるので、この信号を第3図のスイ
ッチ回路3−7の動作タイミングパルスとして使用する
ことができる。Furthermore, since the Q and Q signals of the flip-flop 5-5 are controlled by the vertical synchronizing signal, this signal can be used as an operation timing pulse for the switch circuit 3-7 in FIG.
第6図はこの発明に用いることができる表示パネルの他
の例の構成図である。FIG. 6 is a configuration diagram of another example of a display panel that can be used in the present invention.
第6図におけるX電極は、例えば蒸着にてジグザグにな
るよう構成することができる。The X electrode in FIG. 6 can be configured to have a zigzag pattern, for example, by vapor deposition.
また、X電極X1.X2・・・およびY電極Y1.¥2
・・・は、第2図のものと同じであり、その交点におい
て発光素点を形成する。Moreover, the X electrode X1. X2... and Y electrode Y1. ¥2
... are the same as those in FIG. 2, and a light emitting element point is formed at their intersection.
つぎに、カラー映像表示について述べる。Next, color image display will be described.
カラー表示パネルは、第7図に示すように発光素点P1
□、P2□、P3、に赤、緑、青の発光をする螢光体を
塗布することによって実現される。The color display panel has a light emitting element point P1 as shown in FIG.
This is achieved by coating □, P2□, and P3 with phosphors that emit red, green, and blue light.
すなわち、サンプリングする時の入力映像信号を1水平
走査期間毎に色信号を370−R2O・・・、B−R−
B−R・・・およびG−B−G−B・・・と切り換えれ
ばよむ)。That is, when sampling the input video signal, the color signal is 370-R2O..., B-R- for each horizontal scanning period.
You can read it by switching to B-R... and G-B-G-B...).
第8図および第9図に色信号切換回路およびその波形図
を示す。FIGS. 8 and 9 show a color signal switching circuit and its waveform diagram.
第8図において、スイッチ8−1は水平同期信号によっ
て制御され、その出力をEJRG 、 EGB 、 E
BRとすると、その波形図は第9図の9−1〜9−3に
示したものとなる。In FIG. 8, switch 8-1 is controlled by a horizontal synchronizing signal and outputs EJRG, EGB, E
If it is BR, its waveform diagram will be as shown in 9-1 to 9-3 in FIG.
ここでTHは1水平走査期間を示す。Here, TH indicates one horizontal scanning period.
これらの信号を入力映像信号としてサンプリング回路へ
導くことによって単色表示の場と同様にカラー表示をす
ることができる。By guiding these signals as input video signals to a sampling circuit, color display can be performed in the same way as monochromatic display.
第10図はこの発明を適用したカラー映像表示装置の構
成図である。FIG. 10 is a block diagram of a color video display device to which the present invention is applied.
第10図において、表示パネル10−1は第7図に示す
表示パネルであり、色信号切換回路1〇−八ま第8図に
示す色信号切換回路であり、そのほかは第3図のものと
同じであるから、相当部分に同一符号を付している。In FIG. 10, the display panel 10-1 is the display panel shown in FIG. 7, the color signal switching circuit 10-8 is the color signal switching circuit shown in FIG. 8, and the other parts are the same as those shown in FIG. Since they are the same, corresponding parts are given the same reference numerals.
なお、サンプリング回路およびメモリ回路を個個のX電
極の数だけ備えた場合もY電極走査回路は上述の方式で
可能である。Note that the Y electrode scanning circuit can be formed using the above-described method even when the number of sampling circuits and memory circuits is equal to the number of individual X electrodes.
この場合には、X電極駆動回路において、第3図に示し
た列電極選択用スイッチ回路3−7は不必要であるが、
サンプリングパルス発生回路3−3の出力端子のパルス
を全て使用してサンプリング・ホールドし、パルス幅変
調し、その出力をゲート回路にて第5図の端子5−11
の信号を用いて制御すればよい。In this case, the column electrode selection switch circuit 3-7 shown in FIG. 3 is unnecessary in the X electrode drive circuit;
All pulses at the output terminal of the sampling pulse generation circuit 3-3 are used for sampling and holding, pulse width modulation is performed, and the output is sent to the terminal 5-11 in Fig. 5 through a gate circuit.
Control can be performed using the signal.
また、第5図のサンプリングパルス発生回路は、発振回
路5−2とシフトレジスタ5−9(全ての出力端子を使
う)だけでよく、このシフトレジスタ5−9の始動は水
平同期信号に同期したゲート信号を用いればよい。Furthermore, the sampling pulse generation circuit shown in Fig. 5 only requires an oscillation circuit 5-2 and a shift register 5-9 (all output terminals are used), and the start of this shift register 5-9 is synchronized with the horizontal synchronizing signal. A gate signal may be used.
以上のように、この発明の映像表示装置によれば、画質
を劣化させることなくY電極本数を従来の半分にするこ
とができ、X電極駆動回路も従来の半分となる。As described above, according to the video display device of the present invention, the number of Y electrodes can be reduced to half of the conventional one without deteriorating the image quality, and the number of X electrode drive circuits can also be reduced to half of the conventional one.
また、X電極駆動回路においてもメモリおよびパルス幅
変換回路を半分に減少させることができる。Furthermore, the memory and pulse width conversion circuit in the X electrode drive circuit can also be reduced by half.
第1図は従来の表示パネルの電極配置図、第2図はこの
発明に用いることができる表示パネルの平面図、第3図
はこの発明の映像表示装置の一実施例の構成図、第4図
はその動作年明のための信号波形図、第5図は第3図の
装置の要部のブロック図、第6図はこの発明に用いるこ
とができる表示パネルの他の例の平面図、第7図はこの
発明に用いることができるカラー表示パネルの平面図、
第8図はそのカラー表示に必要な色信号切換回路の構成
図、第9図はその動作説明のための信号波形図、第10
図はこの発明を適用したカラー映像表示装置の構成図で
ある。
Xi・・・・・・X電極(列電極)、Yj・・・・・・
Y電極(行電極)、Pit $ P2□、P3.・・・
・・・螢光体、3−3・・・・・・サンプ1ノ、ングパ
ルス発生回路、3−4・・・・・・サンプリング・ホー
ルド回路、3−7・・・・・・列電極選択用スイッチ回
路、3−10・・・・・・行電極選択用パルス発生回路
、10−2・・・・・・色信号切換回路。FIG. 1 is an electrode layout diagram of a conventional display panel, FIG. 2 is a plan view of a display panel that can be used in the present invention, FIG. 3 is a configuration diagram of an embodiment of the video display device of the present invention, and FIG. FIG. 5 is a block diagram of the main parts of the device shown in FIG. 3, and FIG. 6 is a plan view of another example of the display panel that can be used in the present invention. FIG. 7 is a plan view of a color display panel that can be used in this invention;
Figure 8 is a configuration diagram of the color signal switching circuit necessary for color display, Figure 9 is a signal waveform diagram for explaining its operation, and Figure 10 is a diagram of the signal waveform for explaining its operation.
The figure is a configuration diagram of a color video display device to which the present invention is applied. Xi...X electrode (column electrode), Yj...
Y electrode (row electrode), Pit $ P2□, P3. ...
...Fluorescent material, 3-3...Sampling pulse generation circuit, 3-4...Sampling/hold circuit, 3-7...Column electrode selection 3-10... Pulse generation circuit for row electrode selection, 10-2... Color signal switching circuit.
Claims (1)
極と奇数番目の列電極との対応する位置に設けられた第
1の発光素点群と、前記−の行電極と偶数番目の列電極
との対応する位置に設けられかつ前記第1の発光素点群
に対し列電極方向に偏移した第2の発光素点群とを有す
るマトリクス表示パネルと、前記マトリクス表示パネル
の列電極の位置に対応する位相のサンプリングパルスを
用いて入力映像信号をサンプリングするサンプリング手
段と、前記サンプリング手段によりサンプリングされた
映像信号を前記列電極の相当する電極に印加する信号印
加手段と、前記マトリクス表示パネルの行電極を2水平
走査期間毎に順次選択する手段とを備えた映像表示装置
。 2 前記マトリクス表示パネルの任意の列電極の発光素
点が同色でかつ行電極方向に三原色が順次繰返されて配
列されるように前記マトリクス表示パネルの発光素点に
形成される螢光物質と、前記行電極の発光素点の発光色
に対応する一対の入力色信号を1水平走査期間毎に切換
えて前記サンプリング手段へ入力映像信号として供給す
る色信号切換手段とをさらに備えた特許請求の範囲1項
記載の映像表示装置。[Scope of Claims] 1. A first light emitting element point group including a plurality of row electrodes and a plurality of column electrodes and provided at a position corresponding to a - row electrode and an odd-numbered column electrode; a matrix display panel having a second light-emitting element point group provided at a position corresponding to a row electrode and an even-numbered column electrode and shifted in the column electrode direction with respect to the first light-emitting element point group; a sampling means for sampling an input video signal using a sampling pulse having a phase corresponding to the position of a column electrode of a matrix display panel; and a signal application for applying the video signal sampled by the sampling means to a corresponding electrode of the column electrode. and means for sequentially selecting row electrodes of the matrix display panel every two horizontal scanning periods. 2. A fluorescent substance formed at the light emitting element points of the matrix display panel such that the light emitting element points of any column electrode of the matrix display panel have the same color and the three primary colors are sequentially repeated in the direction of the row electrodes; Claims further comprising color signal switching means that switches a pair of input color signals corresponding to the luminescent color of the light-emitting element points of the row electrodes every horizontal scanning period and supplies them as input video signals to the sampling means. The video display device according to item 1.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12706175A JPS5822758B2 (en) | 1975-10-21 | 1975-10-21 | Eizohiyoujisouchi |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12706175A JPS5822758B2 (en) | 1975-10-21 | 1975-10-21 | Eizohiyoujisouchi |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5250623A JPS5250623A (en) | 1977-04-22 |
JPS5822758B2 true JPS5822758B2 (en) | 1983-05-11 |
Family
ID=14950611
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12706175A Expired JPS5822758B2 (en) | 1975-10-21 | 1975-10-21 | Eizohiyoujisouchi |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5822758B2 (en) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5431606Y2 (en) * | 1974-04-15 | 1979-10-03 | ||
JPS5946686A (en) * | 1982-09-09 | 1984-03-16 | セイコーエプソン株式会社 | Liquid crystal display |
JPH0321188A (en) * | 1990-06-01 | 1991-01-29 | Seiko Epson Corp | Liquid crystal display device |
JPH0644825B2 (en) * | 1990-06-01 | 1994-06-08 | セイコーエプソン株式会社 | Liquid crystal display |
JPH09171374A (en) * | 1996-09-02 | 1997-06-30 | Seiko Epson Corp | Active matrix substrate |
-
1975
- 1975-10-21 JP JP12706175A patent/JPS5822758B2/en not_active Expired
Also Published As
Publication number | Publication date |
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JPS5250623A (en) | 1977-04-22 |
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