JPS58190817U - カセツトデツキにおけるフエ−ドアウト回路 - Google Patents

カセツトデツキにおけるフエ−ドアウト回路

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JPS58190817U
JPS58190817U JP8736682U JP8736682U JPS58190817U JP S58190817 U JPS58190817 U JP S58190817U JP 8736682 U JP8736682 U JP 8736682U JP 8736682 U JP8736682 U JP 8736682U JP S58190817 U JPS58190817 U JP S58190817U
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JP
Japan
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fade
out circuit
cassette deck
converting
variable
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Pending
Application number
JP8736682U
Other languages
English (en)
Inventor
勝美 山口
Original Assignee
クラリオン株式会社
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Publication date
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Pending legal-status Critical Current

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Landscapes

  • Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
  • Management Or Editing Of Information On Record Carriers (AREA)
  • Control Of Amplification And Gain Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はこの考案に係るカセットデツキにおけるフェー
ドアウト回路の実施例を示すブロック回路図、第２図は
フェードアウト出力の一例を示す特性図である。 −１：録音信号入力端子、２：オペアンプ、ＡＭＰ。 録音アンプ、ＡＴＴ二可変減衰器、Ｃ：コンデンサ、Ｒ
：可変抵抗器、Ｓ：フェードアウトスイッチ、Ｕ：積分
回路、１：音声信号線路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 音声信号線路に介在させた可変減衰器と、定電圧源に接
    続されたフェードアウトスイッチと、該フェードアウト
    スイッチを介して導入された定電圧を所要の制御電圧信
    号に変換し該制御電圧信号を前記可変減衰器の制御端子
    に入力させぬ積分回路とを具備してなることを特徴とす
    るカセットデツキにおけるフェードアウト回路。
JP8736682U 1982-06-14 1982-06-14 カセツトデツキにおけるフエ−ドアウト回路 Pending JPS58190817U (ja)

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JPS58190817U true JPS58190817U (ja) 1983-12-19

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ID=30096084

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JP8736682U Pending JPS58190817U (ja) 1982-06-14 1982-06-14 カセツトデツキにおけるフエ−ドアウト回路

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