JPS58172233U - 発振回路 - Google Patents

発振回路

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Publication number
JPS58172233U
JPS58172233U JP6923182U JP6923182U JPS58172233U JP S58172233 U JPS58172233 U JP S58172233U JP 6923182 U JP6923182 U JP 6923182U JP 6923182 U JP6923182 U JP 6923182U JP S58172233 U JPS58172233 U JP S58172233U
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JP
Japan
Prior art keywords
circuit
input terminal
output terminal
oscillation circuit
control signal
Prior art date
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Pending
Application number
JP6923182U
Other languages
English (en)
Inventor
進 井口
憲次 小山
Original Assignee
株式会社リコー
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Filing date
Publication date
Application filed by 株式会社リコー filed Critical 株式会社リコー
Priority to JP6923182U priority Critical patent/JPS58172233U/ja
Publication of JPS58172233U publication Critical patent/JPS58172233U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の発振回路を示す回路図、第２図は同発振
回路のタイミングチャート、第３図は本考案の一実施例
を示す回路図、第４図は同実施例のタイミングチャート
、第５図及び第６図は本考案の他の各実施例を示す回路
図である。 Ｒ２，Ｒ３・・・・・・抵抗、ＶＲ・・・・・・可変抵
抗、ｂｌ・・・・・・ダイオード、Ｎ・・・・・・イン
バータ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第１の入力端子の電圧に対して第１のしきい値で出力端
    子が高レベルになって第２のしきい値で出力端子が低レ
    ベルになり第２の入力端子に入力される制御信号により
    動作が制御される回路と、□この回路の第１の入力端子
    に接続され前記出力端子のレベルに応じて充放電を行う
    コンデンサ及び抵抗と、前記第１の入力端子に所定のバ
    イアスを与えるバイアス回路と、このバイアス回路を前
    記制御信号により発振動作時に不動作にする手段とを備
    えた発振回路。
JP6923182U 1982-05-12 1982-05-12 発振回路 Pending JPS58172233U (ja)

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JP6923182U JPS58172233U (ja) 1982-05-12 1982-05-12 発振回路

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Application Number Priority Date Filing Date Title
JP6923182U JPS58172233U (ja) 1982-05-12 1982-05-12 発振回路

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JPS58172233U true JPS58172233U (ja) 1983-11-17

Family

ID=30078965

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Application Number Title Priority Date Filing Date
JP6923182U Pending JPS58172233U (ja) 1982-05-12 1982-05-12 発振回路

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