JPS58113551A - Car-speed controller - Google Patents

Car-speed controller

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Publication number
JPS58113551A
JPS58113551A JP21303681A JP21303681A JPS58113551A JP S58113551 A JPS58113551 A JP S58113551A JP 21303681 A JP21303681 A JP 21303681A JP 21303681 A JP21303681 A JP 21303681A JP S58113551 A JPS58113551 A JP S58113551A
Authority
JP
Japan
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vehicle speed
negative pressure
signal
valve
speed
Prior art date
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Pending
Application number
JP21303681A
Other languages
Japanese (ja)
Inventor
Hitoshi Hyodo
兵藤 仁志
Naoji Sakakibara
榊原 直次
Shoji Kawada
庄二 河田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Aisin Corp
Original Assignee
Aisin Seiki Co Ltd
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Filing date
Publication date
Application filed by Aisin Seiki Co Ltd filed Critical Aisin Seiki Co Ltd
Priority to JP21303681A priority Critical patent/JPS58113551A/en
Publication of JPS58113551A publication Critical patent/JPS58113551A/en
Pending legal-status Critical Current

Links

Classifications

    • BPERFORMING OPERATIONS; TRANSPORTING
    • B60VEHICLES IN GENERAL
    • B60KARRANGEMENT OR MOUNTING OF PROPULSION UNITS OR OF TRANSMISSIONS IN VEHICLES; ARRANGEMENT OR MOUNTING OF PLURAL DIVERSE PRIME-MOVERS IN VEHICLES; AUXILIARY DRIVES FOR VEHICLES; INSTRUMENTATION OR DASHBOARDS FOR VEHICLES; ARRANGEMENTS IN CONNECTION WITH COOLING, AIR INTAKE, GAS EXHAUST OR FUEL SUPPLY OF PROPULSION UNITS IN VEHICLES
    • B60K31/00Vehicle fittings, acting on a single sub-unit only, for automatically controlling vehicle speed, i.e. preventing speed from exceeding an arbitrarily established velocity or maintaining speed at a particular velocity, as selected by the vehicle operator
    • B60K31/06Vehicle fittings, acting on a single sub-unit only, for automatically controlling vehicle speed, i.e. preventing speed from exceeding an arbitrarily established velocity or maintaining speed at a particular velocity, as selected by the vehicle operator including fluid pressure actuated servomechanism in which the vehicle velocity affecting element is actuated by fluid pressure
    • B60K31/10Vehicle fittings, acting on a single sub-unit only, for automatically controlling vehicle speed, i.e. preventing speed from exceeding an arbitrarily established velocity or maintaining speed at a particular velocity, as selected by the vehicle operator including fluid pressure actuated servomechanism in which the vehicle velocity affecting element is actuated by fluid pressure and means for comparing one electrical quantity, e.g. voltage, pulse, waveform, flux, or the like, with another quantity of a like kind, which comparison means is involved in the development of a pressure which is fed into the controlling means
    • B60K31/102Vehicle fittings, acting on a single sub-unit only, for automatically controlling vehicle speed, i.e. preventing speed from exceeding an arbitrarily established velocity or maintaining speed at a particular velocity, as selected by the vehicle operator including fluid pressure actuated servomechanism in which the vehicle velocity affecting element is actuated by fluid pressure and means for comparing one electrical quantity, e.g. voltage, pulse, waveform, flux, or the like, with another quantity of a like kind, which comparison means is involved in the development of a pressure which is fed into the controlling means where at least one electrical quantity is set by the vehicle operator
    • B60K31/105Vehicle fittings, acting on a single sub-unit only, for automatically controlling vehicle speed, i.e. preventing speed from exceeding an arbitrarily established velocity or maintaining speed at a particular velocity, as selected by the vehicle operator including fluid pressure actuated servomechanism in which the vehicle velocity affecting element is actuated by fluid pressure and means for comparing one electrical quantity, e.g. voltage, pulse, waveform, flux, or the like, with another quantity of a like kind, which comparison means is involved in the development of a pressure which is fed into the controlling means where at least one electrical quantity is set by the vehicle operator in a memory, e.g. a capacitor

Abstract

PURPOSE:To maintain the stable traveling state of a car by installing a negative- pressure releasing valve which controls the opening degree of a throttle-valve and urging the negative-pressure releasing valve in the direction of closing the throttle valve, when the higher speed exceeding an objective car-speed is attained. CONSTITUTION:A F-V conversion circuit 20 converts a car-speed signal into a voltage. A memory circuit 50 stores the voltage corresponding to a car-speed voltage signal Vv through the operation of a set switch SW1. The output terminal of a comparator OM1 is connected to a transistor Qp for driving the solenoid SL1 of a negative-pressure control valve, and the output terminal of a comparator CM2 is connected to a transistor Q; for driving solenoid SL2 of the negative-pressure releasing valve through a diode Dg. When the autual car-speed exceeds the objective car-speed, the solenoid of the negative pressure releasing and controlling valve is electically excited or unexcited in the direction of closing the throttle vavle. Thus, the stable traveling state of the car can be maintained.

Description

【発明の詳細な説明】 本発明は、車輛速度を所望する目標の設定速度にて走行
ならしめる車輛用定速走行装置の、速度の設定、記憶、
解除に関する速度制御装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention provides speed setting, storage, and
This invention relates to a speed control device related to release.

通常この種の装置は、現行の車輛速度をパルス数として
検出して、そのパルス数に比例するアナ【ゴグ電圧を車
速信号として得る。ドライバは所望の車輌速度に到達し
た時、定速走行セットスイッチを操作してその時点の車
速信号を記憶回路にセット(記憶)する。速度制御装置
はセットされた車速信号を比較回路の一方の基準電圧と
して、それと現行の車輛速度との差に基づいて、その差
が零となる方向にスロットルバルブの開度を調節する。
Typically, this type of device detects the current vehicle speed as a number of pulses and obtains an analog voltage proportional to the number of pulses as a vehicle speed signal. When the driver reaches a desired vehicle speed, he operates a constant speed travel set switch to set (store) the vehicle speed signal at that time in the memory circuit. The speed control device uses the set vehicle speed signal as a reference voltage for one of the comparator circuits, and adjusts the opening degree of the throttle valve in a direction such that the difference becomes zero based on the difference between the set vehicle speed signal and the current vehicle speed.

この種の車輛用定速走行装置は、同−t+3願人の出願
にかかる特開昭53−127991号およびその他の公
報等で公知である。
This type of constant speed traveling device for a vehicle is known from Japanese Patent Laid-Open No. 53-127991 filed by the same applicant, T+3, and other publications.

この種の装置においてスロットルバルブは負圧アクチュ
エータで制御されている。たとえば負圧アクf:’−1
−−タのダイアフラムがスロットルバルブに連結され、
負圧室にインテークマニホールドエ′1圧が印加され、
負圧室がンレノイド弁(負圧制御弁)のオン又はオフで
大気と連通とされ、このオンオフのデユーティ比で負王
室の負圧つまりは負圧に対応したダイアフラムポジ7ヨ
ンが制御される。ところが、万一ルノイド弁又はそれを
制御する回路が故障すると、負圧室の圧力制御ができな
くなり、ダイアフラム位置が負王室の圧力に対応して前
進位置または後退位置のいずれかに移動する。その移動
する位置がスロットルバルブを閉じる(エンジンの回転
数を下げる)位置となる場合はよいが、故障の発生前よ
りもスロットルバルブを開ける(エンジンの回転数を上
げる)位置であると、アクセルペダルをいっばいに踏み
込んた場合と同様に車速か急加速されることになり、極
めて危険である。
In this type of device, the throttle valve is controlled by a negative pressure actuator. For example, negative pressure AC f:'-1
- the diaphragm of the throttle valve is connected to the throttle valve;
Intake manifold pressure is applied to the negative pressure chamber,
The negative pressure chamber is communicated with the atmosphere by turning on or off a negative pressure control valve, and the on/off duty ratio controls the negative pressure in the negative chamber, that is, the diaphragm position corresponding to the negative pressure. However, if the lunoid valve or the circuit that controls it fails, the pressure in the negative pressure chamber cannot be controlled, and the diaphragm position moves to either the forward position or the backward position in response to the pressure in the negative pressure chamber. It is fine if the position to which the throttle valve moves is the position that closes the throttle valve (reduces the engine speed), but if the throttle valve is opened (raises the engine speed) more than before the failure, the accelerator pedal This is extremely dangerous, as the vehicle speed will suddenly accelerate in the same way as if the pedal were pressed all at once.

本発明は、上記のような万一の故障発生時でも、車輛の
安全走行状態を維持しうるフェイルセーフ機能を有する
車輛速度制御装置を提供することを第1の目的とし、従
来の装置にわずかの構成要素を付加するだけで実施しう
る車輛速度制御装置を提供することを第2の目的とする
The first object of the present invention is to provide a vehicle speed control device having a fail-safe function that can maintain a safe running state of the vehicle even in the unlikely event of a failure as described above, and which has a slight improvement over conventional devices. A second object is to provide a vehicle speed control device that can be implemented by simply adding the following components.

1記目的を達成するため本発明においては、スロットル
バルブの開度を調整する第2の制御弁(負圧解放弁)を
備えて、目標車速よりも高いある車速に達した場合(第
2の制御弁を操作して、スロットルバルブが閉じるよう
に制御する。第2の制御弁はスロットルバルブを閉じる
方向のみに負圧室の圧力を調整しうるものであればよい
In order to achieve the above object, the present invention includes a second control valve (negative pressure release valve) that adjusts the opening degree of the throttle valve, and when a certain vehicle speed higher than the target vehicle speed is reached (second control valve). The control valve is operated to control the throttle valve to close.The second control valve may be of any type as long as it can adjust the pressure in the negative pressure chamber only in the direction of closing the throttle valve.

一般にこの種の速度制御装置の負圧アクチュエータは、
第1の制御弁(負圧制御弁)で大気の導入。
Generally, the negative pressure actuator of this type of speed control device is
Atmospheric air is introduced through the first control valve (negative pressure control valve).

エンジン負圧の遮断/大気の遮断、エンジン負圧の導入
の切換えを行なっているが、定速走行を解除するときに
ダイアフラムを速やかに特定の位置(スロットルバルブ
を閉じる位置)に戻すため、もう1つの制御弁(リリー
スバルブ)が設けられている。そこで本発明の好ましい
実施例においては、その制御弁を第2の制御弁として利
用する。
Switching is performed between shutting off the engine negative pressure, shutting off the atmosphere, and introducing engine negative pressure, but the diaphragm is quickly returned to a specific position (throttle valve closing position) when constant speed driving is canceled. One control valve (release valve) is provided. Therefore, in a preferred embodiment of the present invention, the control valve is utilized as a second control valve.

これによれば、本発明の実施のための付加要素を少なく
しうるだけでなく、定速走行の解除時のためにしか使用
されなかったもう1つの制御弁の機能を有効に利用しう
る。
According to this, it is possible not only to reduce the number of additional elements for carrying out the present invention, but also to effectively utilize the function of another control valve, which was used only when canceling constant speed running.

以下、図面を参照して本発明の実施例ff:説明する。Embodiment ff of the present invention will be described below with reference to the drawings.

第1a図は本発明の一実施例を示す回路図、第1b図は
速度制御装置の操作端である負圧アクチュエータ100
の縦断面図、第1C図は第1a図に示す回路の動作を示
すタイムチャートである。
FIG. 1a is a circuit diagram showing one embodiment of the present invention, and FIG. 1b is a negative pressure actuator 100 which is the operating end of the speed control device.
FIG. 1C is a time chart showing the operation of the circuit shown in FIG. 1A.

まず、第1a図を参照して実施例の回路構成を説明する
。10は電源のブロックであり、バッテリーからイグニ
ッションスイッチswo’l介して電圧VBを出力する
とともにツェナーダイオードZl)により安定化したV
ccを出力する。20は、車輌のスピードメータケーブ
ルと同一速度で回転する永久磁石2により開閉するリー
ドスイッチ3から得られる車速信号の周波数を電圧に変
換するF −■(周波数−電圧)変換回路である。50
はF −■変換回路20からの車速電圧信号(実車速信
号)Vv に対応する電圧をセットスイッチSWIの操
作により記憶し、その記憶を行なったときのある電圧を
中心として車速電圧信号Vvとともに変化する記憶電圧
信号VMを出力する記憶回路(目標車速記憶手段)であ
る。55は所定以下の車速(たとえば40ky′h以下
)が記憶されないようにし、車速が低いときに自動的に
所定の車速か記憶されるようにする下限速度検出回路で
ある。CMlおよびCMzはコンパレータであり、両者
の反転入力端Hには記憶電圧信号VMが印加され、 C
MtおよびCM2の非反転入力端汗)にはそれぞれ電圧
Vccを抵抗R1,R2,Raで分圧した比較電圧Vx
tおよびVX2が印加されている。CMlの出力端は第
1の制御弁(負圧制御弁)のソレノイドSL1を駆動す
るトランジスタQhに接続され、CM2の出力端は第2
の制御弁(負圧解放弁)のソレノイド5L21&:駆動
するトランジスタQiにダイオードDgを介して接続さ
れている。CM2の非反転入力端と出力端の間にはCM
2の動作にヒステリシスをもたせるだめの抵抗R4とダ
イオードDfの直列回路が接続されている。トランジス
タQiのベース端は抵抗R5によってプルアップされて
いる。FFは定速走行の設定や解除の状態を保持するフ
リップ70ツブであり、入力端はセットスイッチSWI
、IJジュームスイッチSW2.キャンセルスイッチS
W3およびブレーキスイッチSW4に接続され、オープ
ンコレクタ出力端がコンパレータCMIの非反転入力端
に接続され、もう1つの出力端がダイオードDhを介し
てトランジスタQiのベース端に接続されている。
First, the circuit configuration of the embodiment will be explained with reference to FIG. 1a. 10 is a power supply block, which outputs voltage VB from the battery via the ignition switch swo'l and stabilizes VB by a Zener diode Zl).
Output cc. Reference numeral 20 denotes an F-(frequency-voltage) conversion circuit that converts the frequency of a vehicle speed signal obtained from a reed switch 3, which is opened and closed by a permanent magnet 2 rotating at the same speed as the speedometer cable of the vehicle, into a voltage. 50
stores the voltage corresponding to the vehicle speed voltage signal (actual vehicle speed signal) Vv from the F-■ conversion circuit 20 by operating the set switch SWI, and changes with the vehicle speed voltage signal Vv around the voltage at the time when the storage was performed. This is a memory circuit (target vehicle speed memory means) that outputs a memory voltage signal VM. 55 is a lower limit speed detection circuit that prevents vehicle speeds below a predetermined value (for example, 40 ky'h or less) from being stored, and automatically stores a predetermined vehicle speed when the vehicle speed is low. CMl and CMz are comparators, and a storage voltage signal VM is applied to their inverting input terminals H, and C
A comparison voltage Vx, which is obtained by dividing the voltage Vcc by resistors R1, R2, and Ra, is applied to the non-inverting input terminals of Mt and CM2, respectively.
t and VX2 are applied. The output terminal of CMl is connected to the transistor Qh that drives the solenoid SL1 of the first control valve (negative pressure control valve), and the output terminal of CM2 is connected to the transistor Qh that drives the solenoid SL1 of the first control valve (negative pressure control valve).
The solenoid 5L21 & of the control valve (negative pressure release valve) is connected to the driving transistor Qi via the diode Dg. There is a CM between the non-inverting input terminal and the output terminal of CM2.
A series circuit of a resistor R4 and a diode Df is connected to provide hysteresis to the operation of the second circuit. The base end of the transistor Qi is pulled up by a resistor R5. FF is a flip 70 knob that maintains the setting and release state of constant speed running, and the input terminal is set switch SWI
, IJ zoom switch SW2. Cancel switch S
W3 and brake switch SW4, an open collector output terminal is connected to a non-inverting input terminal of comparator CMI, and another output terminal is connected to the base terminal of transistor Qi via diode Dh.

次に第1b図を参照して操作端の負圧アクチュエータ1
00を説明する。ハウジング101はIotaと101
bで構成され、101aと101b の7ランジでダイ
アフラム102が挾持されている。ダイアフラム102
とハウジング101aで囲まれた空間が負圧室であり、
ダイアフラム102とハウジング101bで囲まれた空
間は大気と連通している。
Next, referring to FIG. 1b, the negative pressure actuator 1 at the operating end is
00 will be explained. Housing 101 is Iota and 101
A diaphragm 102 is held between seven flanges 101a and 101b. Diaphragm 102
A space surrounded by the housing 101a is a negative pressure chamber,
A space surrounded by the diaphragm 102 and the housing 101b communicates with the atmosphere.

103はハウジング101aとダイアフラム102の間
に介挿された圧縮コイルスプリングであり、負圧室の圧
力が大気圧に近いときにはダイアフラム102を仮想線
の位置まで押し7戻す。ダイアフラム102の中央付近
に固着した突起104がスロットルバルブ105のリン
クと接続されている。
A compression coil spring 103 is inserted between the housing 101a and the diaphragm 102, and pushes the diaphragm 102 back to the position of the imaginary line 7 when the pressure in the negative pressure chamber is close to atmospheric pressure. A protrusion 104 fixed near the center of the diaphragm 102 is connected to a link of a throttle valve 105.

ハウジング101aにはインテークマニホールド106
と連通する負圧取入口107と大気取入口108.10
9が障けである。110が負圧制御弁である第1の制御
弁、111が負圧解放弁である第2の制御弁であり両者
ともハウジング101aに固着しである。第1の制御弁
110の可動片112はPを支点として傾動可能であり
一端に引張コイルスプリング113が接続され、もう一
端はソレノイドSL1に対向している。可動片1120
両端が弁体として機能し、それらがソレノイドSL1の
付勢・消勢に対応して負圧取入口107開放。
An intake manifold 106 is installed in the housing 101a.
Negative pressure intake 107 and atmospheric air intake 108.10 communicating with
9 is an obstacle. A first control valve 110 is a negative pressure control valve, and a second control valve 111 is a negative pressure release valve, both of which are fixed to the housing 101a. The movable piece 112 of the first control valve 110 is tiltable about P as a fulcrum, and has one end connected to a tension coil spring 113, and the other end facing the solenoid SL1. Movable piece 1120
Both ends function as valve bodies, and they open the negative pressure intake port 107 in response to energization and deenergization of the solenoid SL1.

大気取入口108閉塞(図示の状態)または負圧取入口
107閉塞、大気取入口108開放とする。
The air intake port 108 is closed (state shown) or the negative pressure intake port 107 is closed, and the air intake port 108 is opened.

第2の制御弁111も110と同様に可動片114゜引
張コイルスプリング115およびソレノイド8L2f有
するが、可動片114は大気取入口109の閉塞(図示
の状態)または開放を行なう。なお、116はアクセル
ペダル、117は引張コイルスプリングである。
The second control valve 111 also has a movable piece 114°, a tension coil spring 115, and a solenoid 8L2f, similar to 110, but the movable piece 114 closes (the state shown in the figure) or opens the air intake port 109. Note that 116 is an accelerator pedal, and 117 is a tension coil spring.

第1a図、第1b図および第1C図を参照して実施例の
速度制御動作を説明する。
The speed control operation of the embodiment will be described with reference to FIGS. 1a, 1b, and 1c.

F−V変換回路20は車速信号を電圧の高低が変化する
2値化号に変換し、抵抗RaとコンデンサーCaにより
リードスイッチ3のチャタリングに基づく不要信号を除
オしてトランジスタQaに印加する。トランジスタQa
は車速信号に対応してオン・オフし、抵抗1’tbとR
cの接続点の電位がそれに応じて変化し、その電位が高
くなると抵抗Rbを介してコンデンサに所定の電荷を充
電し、電位が低くなると抵抗Rcを介してその電荷を放
電する。トランジスタQbのペースおよびエミッタはそ
れぞれダイオードDaおよびDbにより共に同程度の電
位にバイアスされておりQbは通常はオフしている。抵
抗RbとR,cの接続点の電位が「低」から「高」に変
化するとき、トランジスタQbのエミッタは抵抗Rbと
コンデンサcbの時定数により定まる所定時間だけその
ベースよりも高電位にバイアスされてトランジスタQb
がオンする。トランジスタQbのコレクタは通常は低電
位であり、Qbがオンしたときにのみ高電位となるので
、Qbのコレクタ電位は車速信号の周期で各周期中にa
bcbの時定数により定まる所定時間だけ高電位となる
。これによシ生ずるパルス幅が一定のパルス信号は、抵
抗RdとコンデンサCcでなる積分回路に印加されて、
コンデンサCcの端子間に現われる電圧は、パルス周期
に応じた電圧すなわち車速信号に比例する電圧となり、
トランジスタQc を通って車速電圧信号Vvとなる。
The F-V conversion circuit 20 converts the vehicle speed signal into a binary signal whose voltage level changes, removes unnecessary signals due to chattering of the reed switch 3 using a resistor Ra and a capacitor Ca, and applies the signal to the transistor Qa. Transistor Qa
turns on and off in response to the vehicle speed signal, and resistors 1'tb and R
The potential at the connection point c changes accordingly, and when the potential becomes high, a predetermined charge is charged to the capacitor via the resistor Rb, and when the potential becomes low, the charge is discharged via the resistor Rc. The pace and emitter of transistor Qb are biased to the same potential by diodes Da and Db, respectively, and Qb is normally off. When the potential at the connection point between resistor Rb and R,c changes from "low" to "high," the emitter of transistor Qb is biased to a higher potential than its base for a predetermined time determined by the time constant of resistor Rb and capacitor cb. transistor Qb
turns on. Since the collector of transistor Qb is normally at a low potential and becomes a high potential only when Qb is turned on, the collector potential of Qb increases during each cycle of the vehicle speed signal.
The potential remains high for a predetermined time determined by the time constant of bcb. The resulting pulse signal with a constant pulse width is applied to an integrating circuit consisting of a resistor Rd and a capacitor Cc.
The voltage appearing between the terminals of the capacitor Cc is a voltage according to the pulse period, that is, a voltage proportional to the vehicle speed signal,
It passes through transistor Qc and becomes vehicle speed voltage signal Vv.

記憶回路50は記憶制御用のトランジスタQf。The memory circuit 50 includes a memory control transistor Qf.

記憶用のコンデンサCd、電界効果型トランジスタ(以
下FETと記載する) Qd、 Qe等を有する。
It includes a storage capacitor Cd, field effect transistors (hereinafter referred to as FETs) Qd, Qe, etc.

FETQdのドレイン(又はソース)には電源電圧Vc
c f抵抗Re、 Rf等で分圧した所定電圧が印加さ
れている。一方、記憶指示信号(アースレベル)が印加
されない状態においてはトランジスタQfがオンし、F
ETQdのゲートがアースレベルにバイアスサレ、ヒン
チオフ電圧以下となるので、 FETQdのドレイン−
ソース間の導通が遮断される。記憶指示信号が印加され
るとトランジスタQfがオフし、FETQdのゲート電
位が上がりQdのドレイン−ソース間が導通して、コン
デンサCdの一端に電源電圧Vccを抵抗Re、 Rf
 等で分圧した基準電圧Vrが印加され、コンデンサC
dのもう一端には車速電圧Vvが印加されるので、コン
デンサCdには端子間の電位差IVv−Vrlに対応す
る電荷が蓄積される。記憶指示信号を取り去るとFgT
Qdが再びオフし、F E T Q eの入力インピー
ダンスが高いので、そのゲートと接続されたコンデンサ
Cdの一端がフローティング状態となり、コンデンサC
dの電荷は記憶指示信号を取り去る直前の電荷に保持さ
れ、電位差VもそのときのIVv−Vrl に保持され
る(Q=CVより:Qは電荷。
The drain (or source) of FETQd is connected to the power supply voltage Vc.
A predetermined voltage divided by c f resistors Re, Rf, etc. is applied. On the other hand, when the storage instruction signal (earth level) is not applied, transistor Qf is turned on and F
Since the gate of ETQd is biased to ground level and the voltage is below the hinch-off voltage, the drain of FETQd -
Continuity between sources is broken. When the storage instruction signal is applied, the transistor Qf is turned off, the gate potential of the FET Qd rises, the drain-source of Qd becomes conductive, and the power supply voltage Vcc is applied to one end of the capacitor Cd through the resistors Re and Rf.
A reference voltage Vr divided by voltage is applied, and the capacitor C
Since the vehicle speed voltage Vv is applied to the other end of the capacitor Cd, a charge corresponding to the potential difference IVv-Vrl between the terminals is accumulated in the capacitor Cd. When the memory instruction signal is removed, FgT
Since Qd is turned off again and the input impedance of FETQe is high, one end of the capacitor Cd connected to its gate becomes floating, and the capacitor C
The charge of d is held at the charge immediately before the storage instruction signal is removed, and the potential difference V is also held at the current value of IVv-Vrl (from Q=CV: Q is the charge.

Cは静電容量)。FETQeのゲートにはVv+Vの電
圧が印加され、それに対応する電圧がFETQeのソー
ス端から記憶電圧信号VMとして出力される。記憶電圧
信号VMは、記憶直後のその電圧VMOを中心として、
車速か上昇すれば高くなり車速が低下すれば低くなるよ
うに変化する。また、この実施例では下限速度検出回路
55を設けであるため、車速かある程度まで低下して車
速電圧信号vvがある値以下になると、トランジスタQ
gがオフし、抵抗Jおよびダイオ−ドDeを介してFE
TQdのゲートが高電位(Vcc)にプルアップされる
。これによりトランジスタQfのオン・オフにかかわり
な(FETQdのドレインーソース間が導通し、コンデ
ンサCdの一端に電圧Vrが他端に電圧Vvが印加され
る。トランジスタQgは40b/hの車速に対応する電
圧にVvが達した(上昇した)ときにオンするようにな
っておりVvがその電圧に達したときにFETQdがオ
フして40いの車速か自動的にコンデンサCdに記憶さ
れる。
C is capacitance). A voltage of Vv+V is applied to the gate of FETQe, and a corresponding voltage is output from the source end of FETQe as a storage voltage signal VM. The storage voltage signal VM is centered around the voltage VMO immediately after storage,
The value increases as the vehicle speed increases, and decreases as the vehicle speed decreases. Furthermore, since this embodiment is provided with a lower limit speed detection circuit 55, when the vehicle speed decreases to a certain level and the vehicle speed voltage signal vv becomes less than a certain value, the transistor Q
g is turned off and FE is turned off via resistor J and diode De.
The gate of TQd is pulled up to a high potential (Vcc). As a result, conduction occurs between the drain and source of FET Qd, which is related to on/off of transistor Qf, and voltage Vr is applied to one end of capacitor Cd and voltage Vv is applied to the other end. Transistor Qg corresponds to a vehicle speed of 40 b/h. When Vv reaches (rises) a certain voltage, the FET Qd is turned on, and when Vv reaches that voltage, the FET Qd is turned off and the vehicle speed of 40 degrees is automatically stored in the capacitor Cd.

セットスイッチ5W1iだはりジュームスイッチ8W2
がオンすると、フリップフロップFF内のトランジスタ
Qjがオフし、またダイオードDhのカソード側が高電
位Hとなる。トランジスタQjがオフするとコンパレー
タCMlの非反転入力端の電位■xlが電圧Vcc f
抵抗R,1,R2,R3で分圧した所定の電圧となり、
コンパレータCM2の非反転入力端の電位VX2がVx
tよりも高いある電位となる。
Set switch 5W1i Dume switch 8W2
When turned on, the transistor Qj in the flip-flop FF is turned off, and the cathode side of the diode Dh becomes a high potential H. When the transistor Qj is turned off, the potential xl at the non-inverting input terminal of the comparator CMl becomes the voltage Vcc f
It becomes a predetermined voltage divided by resistors R, 1, R2, and R3,
The potential VX2 at the non-inverting input terminal of comparator CM2 is Vx
It becomes a certain potential higher than t.

VM (Vx lになるとコンパレータCMlの出力端
は畠電位Hになシ、トランジスタQh’tオンしてソレ
ノイドSLIを付勢し、 VM>VXIのときはコンパ
レータCM1の出力端が低電位りとなり、トランジスタ
QhをオフしてソレノイドSLtを消勢する。また後述
するように通常はVMキVxtとなるように車速か制御
されるので通常はVM (Vx 2の状態が維持サレテ
コンパレータCM2の出力がHとなりトランジスタQi
がオンしソレノイドSL2が付勢される(大気取入口1
09が閉)。車速か目標速度よりも低いとVM<Vxl
−Lなって前記のようにソレノイドSL1が付勢され、
第1の制御弁の可動片112が第1b図に示すように大
気取入口108全閉じて負圧取入口107全開ける。こ
れにより負圧室の圧力が徐々に低くなりそれにつれてダ
イアフラム102が負圧室の容積を小さくする方向に移
動し、ダイアフラム102に突起104等を介して接続
されたスロットルバルブ105の開度を大きくし車速を
上げる。また車速か目標速度よりも高いとVM ) V
x tとなって前記のようにソレノイドS L 1が消
勢され、可動片112が負圧取入口107を閉じて大気
取入口108を開く。これにより負圧室の圧力が徐々に
大気圧に近づき、それに伴なってダイアフラム102が
圧縮コイルスプリング103の力により押し戻され、ス
ロットルバルブ105の開度全小さくして車速を下げる
。実際の制御においては、目標車速とほぼ等しい速度で
車輛が走行することになりVM牛Vxtとなるが、第1
c図に示すように記憶電圧信号VMは車速信号のリップ
ルをわずかに含み、電圧VMは車速信号の周期で常に変
動している。そのためコンパレータCM1の出力信号は
車速信号と周期の等しいパルス信号になり、記憶電圧信
号VMの平均値の変化(車速の変化)があると、そのパ
ルス信号のパルス幅(デユーティ比)が変化し、それに
応じてトランジスタQhのオン・オフのデユーティ比が
変わる。トランジスタQhオンすなわちソレノイドSL
lが付勢されて大気遮断、負圧導入を行なう期間と、ト
ランジスタQhオフすなわちソレノイド8T、1が消勢
されて大気導入、負圧遮断を行なう期間の比率が変化す
れば、負圧室の圧力がそれに対応したものとなり、それ
に応じてダイアフラム102の位置が変わり、スロット
ルバルブ105の開度が変わる。
When VM (Vx l), the output terminal of the comparator CM1 becomes the Hatake potential H, turns on the transistor Qh't and energizes the solenoid SLI, and when VM>VXI, the output terminal of the comparator CM1 becomes a low potential. The transistor Qh is turned off and the solenoid SLt is deenergized.As will be described later, the vehicle speed is normally controlled so that the VM (Vx2) state is maintained and the output of the comparator CM2 is H. Next transistor Qi
turns on and solenoid SL2 is energized (air intake port 1
09 closed). If the vehicle speed is lower than the target speed, VM<Vxl
-L, solenoid SL1 is energized as described above,
The movable piece 112 of the first control valve fully closes the atmosphere intake port 108 and fully opens the negative pressure intake port 107, as shown in FIG. 1b. As a result, the pressure in the negative pressure chamber gradually decreases, and the diaphragm 102 moves in a direction to reduce the volume of the negative pressure chamber, increasing the opening degree of the throttle valve 105 connected to the diaphragm 102 via a protrusion 104 or the like. and increase the vehicle speed. Also, if the vehicle speed is higher than the target speed, VM) V
x t, the solenoid S L 1 is deenergized as described above, and the movable piece 112 closes the negative pressure intake 107 and opens the atmospheric intake 108 . As a result, the pressure in the negative pressure chamber gradually approaches atmospheric pressure, and accordingly, the diaphragm 102 is pushed back by the force of the compression coil spring 103, and the opening of the throttle valve 105 is completely reduced to reduce the vehicle speed. In actual control, the vehicle travels at a speed approximately equal to the target vehicle speed, resulting in the VM cow Vxt.
As shown in Figure c, the storage voltage signal VM slightly includes ripples of the vehicle speed signal, and the voltage VM always fluctuates with the cycle of the vehicle speed signal. Therefore, the output signal of the comparator CM1 becomes a pulse signal with the same period as the vehicle speed signal, and when there is a change in the average value of the memory voltage signal VM (change in vehicle speed), the pulse width (duty ratio) of the pulse signal changes. The on/off duty ratio of transistor Qh changes accordingly. Transistor Qh on, i.e. solenoid SL
If the ratio of the period in which transistor Qh is energized to shut off the atmosphere and introduce negative pressure to the period in which transistor Qh is turned off, that is, the period in which solenoids 8T and 1 are deenergized to introduce atmospheric air and shut off negative pressure, changes will occur in the negative pressure chamber. The pressure corresponds to this, the position of the diaphragm 102 changes accordingly, and the opening degree of the throttle valve 105 changes accordingly.

ところが、もしも可動片112がどこかに引っかかるな
どの状態が発生した場合、負王室に大気が導入されつづ
けるか、または負圧室に負圧が導入されつづけることに
なる。前者の場合には、負圧室が大気圧と同じ圧力にな
り、ダイアフラム102がスプリング103によって押
し戻されるのでスロットルバルブ105が閉じエンジン
の回転数が下がり車速が下がるので安全であるが、後者
の場合には負圧室の圧力が極端に下がりダイアフラム1
02がスロットルバルブ105を全開にするので急速に
車速か上昇する。しかし、車速かある値を越えるとVM
 )Vx 2となり、コンパレータCM2の出力端がH
からLに変わり、トランジスタQiのベース電位を下げ
てQiをオフにするのでソレノイドSL2が消勢され、
第2の制御弁111の可動片114がスプリング115
によって引張られ、大気取入口109を開放して大気を
導入するため、負圧室の圧力が上昇し、ダイアフラム1
02を戻してスロットルバルブ105開度を小さくシ、
自動的に車速を下げる。車速が異常に高くなりVM :
> Vx zとなる状態がわずかの期間でも生ずると、
コンパレータCM2の出力端がL(アースレベル)とな
ったときに抵抗R4、ダイオードDfi介して電流が出
力端側に流れ、抵抗R2とR3の直列回路に抵抗R4が
並列に接続されるのと等価になり、第1c図に示すよう
にVX2の電位を下げるので、記憶電圧信号VMに含ま
れるリップルによりVMの電圧がわずかに低下しても、
コンパレータCM2が再び反転することはない。
However, if a situation such as the movable piece 112 being caught somewhere occurs, the atmosphere will continue to be introduced into the negative chamber, or negative pressure will continue to be introduced into the negative pressure chamber. In the former case, the pressure in the negative pressure chamber becomes the same as atmospheric pressure, and the diaphragm 102 is pushed back by the spring 103, which closes the throttle valve 105 and reduces the engine speed and vehicle speed, which is safe; however, in the latter case, it is safe. When the pressure in the negative pressure chamber drops extremely, diaphragm 1
02 fully opens the throttle valve 105, so the vehicle speed rapidly increases. However, when the vehicle speed exceeds a certain value, VM
) Vx 2, and the output terminal of comparator CM2 becomes H.
changes from low to low, lowering the base potential of transistor Qi and turning off Qi, so solenoid SL2 is deenergized.
The movable piece 114 of the second control valve 111 is connected to the spring 115
, the air intake port 109 is opened and air is introduced, so the pressure in the negative pressure chamber increases and the diaphragm 1
02 and reduce the opening of the throttle valve 105.
Automatically reduce vehicle speed. Vehicle speed becomes abnormally high and VM:
> If a state where Vx z occurs even for a short period of time,
When the output terminal of comparator CM2 becomes L (earth level), current flows to the output terminal side via resistor R4 and diode Dfi, which is equivalent to connecting resistor R4 in parallel to a series circuit of resistors R2 and R3. As shown in FIG. 1c, the potential of VX2 is lowered, so even if the voltage of VM slightly decreases due to the ripple contained in the storage voltage signal VM,
Comparator CM2 is never inverted again.

キャンセルスイッチSW3またはブレーキスイッチ″−
8W4がオンすると、フリップフロップFF’が反転し
、内部のトランジスタQjがオンしVxiの電位を0〔
■〕にする。この状態ではVM>0[:V:lなのでコ
ンパレータCMIの出力端はLに保持され、トランジス
タQh ’Thオフし、ソレノイド5L1f常時消勢状
態にして負王室−を大気導入・負圧遮断のテ態にする。
Cancel switch SW3 or brake switch''-
When 8W4 is turned on, flip-flop FF' is inverted, internal transistor Qj is turned on, and the potential of Vxi is reduced to 0 [
■). In this state, since VM>0[:V:l, the output terminal of the comparator CMI is held at L, the transistor Qh'Th is turned off, and the solenoid 5L1f is constantly de-energized, so that the negative output terminal is set to the atmosphere introduction/negative pressure cutoff state. state.

またこのとき、フリップ70ツブI” Fによってダイ
オードDhのカンード側がLにされるので、トランジス
タQiのベース電位が下がり、Qi がオフしてソレノ
イド8L2を消勢し、大気取入口109を開放にするの
で、2つの大気取入口108.109が開くことになり
、負圧室の圧力は急速に大気圧に近づき、ダイアフラム
102が戻ってスロットルバルブ105が閉じ、車速制
御を解除する。なお上記実施例においては、記憶電圧信
号として実車速に対応する車速電圧信号と目標車速信号
を重畳したものを、定値信号である比較電圧■xlと比
較しているが、実車速信号と目標車速信号を比較してそ
の結果に応じて負圧制御弁110を制御するようにして
もよい。そのようにする場合、記憶回路50のコンデン
サCd1一端を接地し他端を車速電圧信号の出力端が一
ト手段を介して接続すれば記憶出力はある一定値となる
ので、これと車速電圧信号を比較すればよい。
At this time, the cand side of the diode Dh is set to L by the flip 70 knob I''F, so the base potential of the transistor Qi decreases, Qi is turned off, the solenoid 8L2 is deenergized, and the atmospheric air intake port 109 is opened. Therefore, the two atmospheric air intake ports 108 and 109 open, the pressure in the negative pressure chamber rapidly approaches atmospheric pressure, the diaphragm 102 returns, the throttle valve 105 closes, and the vehicle speed control is canceled. In the above, a superimposed vehicle speed voltage signal corresponding to the actual vehicle speed and a target vehicle speed signal as a memory voltage signal is compared with a comparison voltage xl which is a fixed value signal, but the actual vehicle speed signal and the target vehicle speed signal are compared. The negative pressure control valve 110 may be controlled according to the result.In such a case, one end of the capacitor Cd1 of the memory circuit 50 is grounded, and the other end is connected to the output end of the vehicle speed voltage signal. If the connection is made through the vehicle speed voltage signal, the stored output will be a certain constant value, and this can be compared with the vehicle speed voltage signal.

第2a図に本発明のもう1つの実施例の回路構成を示す
。この実施例においては速度制御の大部分ヲマイクロコ
ンピュータCPUで処理するように構成しである。リー
ドスイッチ3からの車速信号は抵抗Ra、コンデンサC
aでなるチャタリング除去回路を通ってトランジスタQ
aをスイッチングする。Qaの出力のパルス信号がCP
Uの入力ポートP3に印加される。セットスイッチSW
I。
FIG. 2a shows a circuit configuration of another embodiment of the present invention. In this embodiment, most of the speed control is performed by the microcomputer CPU. The vehicle speed signal from reed switch 3 is connected to resistor Ra and capacitor C.
The transistor Q passes through the chattering removal circuit consisting of a.
Switch a. The pulse signal of the output of Qa is CP
It is applied to input port P3 of U. Set switch SW
I.

リジュームスイッチ8W2.キャンセルスイッチ8W3
およびブレーキスイッチSW4はそれぞれCPUの入力
ポートP7. P6. PsおよびPAに接続されてい
る。前記実施例では車速信号によるF−■変換出力のリ
ップル成分を利用してソレノイド’8 L sのデユー
ティ制御を行なったが、この実施例ではF−V変換を行
なわないので鋸歯状波を発生する発振器08C1&:用
いてデユーティ制御を行なっている。CPUの8ビツト
分の出力ポートPAが8ビツトのD/AコンバータDA
Cに接続され、DACのアナログ信号出力端がコンパレ
ータCMIの非反転入力端に接続され、またコンパレー
タCMIの反転入力端には発振器O8Cの出力信号Vo
scが印加されている。トランジスタQjは、トランジ
スタQhがオンするのを禁止するだめのトランジスタで
あり、CPUの出力ポートPlに接続されている。ソレ
ノイドSL2を駆動するトランジスタQIは出力ポート
P2に接続されている。
Resume switch 8W2. Cancel switch 8W3
and brake switch SW4 are respectively input to the CPU input port P7. P6. Connected to Ps and PA. In the embodiment described above, the ripple component of the F-■ conversion output from the vehicle speed signal was used to control the duty of the solenoid '8Ls, but in this embodiment, F-V conversion is not performed, so a sawtooth wave is generated. Oscillator 08C1&: is used to perform duty control. Output port PA for 8 bits of CPU is 8 bit D/A converter DA
The analog signal output terminal of the DAC is connected to the non-inverting input terminal of the comparator CMI, and the output signal Vo of the oscillator O8C is connected to the inverting input terminal of the comparator CMI.
sc is applied. Transistor Qj is a transistor that prohibits transistor Qh from turning on, and is connected to output port Pl of the CPU. Transistor QI that drives solenoid SL2 is connected to output port P2.

なお負圧アクチュエータは、この実施例でも第1b図に
示す、ものを使用している。第2b図を参照して発振器
08C,D/AコンバータDAC,コンパレータCMI
、  )ランジスタQhおよびQjの動作を説明する。
Note that the negative pressure actuator shown in FIG. 1b is also used in this embodiment. Referring to Figure 2b, oscillator 08C, D/A converter DAC, comparator CMI
, ) The operation of transistors Qh and Qj will be explained.

発振器O8Cは常時鋸歯状波電圧Voscを出力してい
る。出カポ−)PAに所定のデータが出力されると、D
/AコンバータDACがそのデータに対応するアナログ
電圧Vxt(z出力する。Vxl、> Voscの期間
はコンパレータCMtの出力端力H1vXl<Vosc
)期nJ[CMl(D 出力iカLになり、出力ポート
PlがLでトランジスタQjがオフしていれば、0Ml
出力端の1(・Lに対応してトランジスタQhがオン・
オフt、、Qhがオンのときにソレノイド8L1が付勢
され、Qhがオフのときはソレノイド8L1・が消勢さ
れる。トランジスタQhのオン・オフのデユーティ比は
、出7]ポートPAに出力されるデジタルデータにより
定する。
The oscillator O8C always outputs a sawtooth wave voltage Vosc. When predetermined data is output to PA (output capo), D
/A converter DAC outputs an analog voltage Vxt (z) corresponding to the data. During the period of Vxl, > Vosc, the output terminal power of comparator CMt H1vXl<Vosc
) period nJ[CMl(D) If the output i becomes L and the output port Pl is L and the transistor Qj is off, then 0Ml
Transistor Qh turns on in response to 1(・L) at the output terminal.
When off t, , Qh is on, solenoid 8L1 is energized, and when Qh is off, solenoid 8L1 is deenergized. The on/off duty ratio of the transistor Qh is determined by the digital data output to the output port PA.

第2C図を参照してマイクロコンピュータCPUの処理
フローの一例を説明する。電源オン直後は、定速制御を
行なわないように初期状態をセットするため、ボー)P
IにHポートP2にLf:出力し、トランジスタQhを
オフ、Qi’eオフにして、2つの制御弁110.11
1が負圧室を大気と連通ずるように制御する。次に入カ
ポ−) Ps、 P7をチェックしてセットスイッチS
WIまたはリジュームスイッチSW2がオンになるのを
待つ。入力ボートP6がLになるとSW2がオンしたと
判断し、以前に車速か記憶されているかどうかをレジス
タR1fチェックして判断し、もしも記憶されてなけれ
ばROM(読出し専用メモリ)内にある初期データを読
出し2てそれをレジスタR1にストアする。入カポ−)
P7がLになるとSWlがオンしたと判断しボー) P
a 2チエツクして車速信号の周期を検出する。これは
ポートP3がHか′らL(又はLからH)に反転したと
きからカウントを開始して、次にボー)PsがHからL
(又は1.からH)に反転したときまでのカウント値を
1周期のデータとする。この周期データをレジスタR1
にストアする(車速記憶)。レジスタR1に格納された
周期データを、その周期に対応する車速を得るために必
要なソレノイドSLIの付勢・消勢のデユーティ比を定
める、電圧VXI設定用のデータに変換するために、予
めROM内に設けられたテーブルを参照して、レジスタ
R1の値に対応するデータを読出してそのデータをレジ
スタR2にストアする。レジスタR2のデータをボー、
トPAに出力し、D/AコンバータDACに所定の電圧
Vx+i発生させる。ボー)Ptにり、P2に11をそ
れぞれ出力する。これでトランジスタQ」がオフし、Q
iがオンするので、トランジスタQhが所定のデユーテ
ィでオン争オフを繰り返し、ンVノイド8Lxiデユー
ティ制御するとともにSL2が付勢され、負圧アクチュ
エータ100がそのデユーティ比に応じてスロットルバ
ルブ105の開度全設定する。次にキャンセルスイッチ
8W3.プレ−キスイツチSW4のチェックと車速を定
速に維持するための処理を行なうが、後者の処理には時
間がかかるので、ボートP4. P5の読取シのN回に
1回だけ車速処理を行なう。その回数NをレジスタR3
にストアしボートP4.P5およびレジスタR3の内容
をチェックし、レジスタR3の内容を1つデクリメント
(−1)する。キャンセルスイッチ5W3tたはブレー
キスイッチSW4がオンしボートP4またはP5がLに
力ると1スタービに戻る。レジスタR3の値が0になる
と、ボートPs fチェックし”て車速信号の周期をカ
ウントし、その結果得られる周期データをレジスタR4
にストアする。車速記憶時の周期データがレジスタR1
に格納されているので、その記憶車速に対応するレジス
タR1の内容と現車速に対応するレジスタR4の内容を
比較する。R1= R4であれば、現車速は記憶車速と
一致しているので■に戻シ、再びボー) P4.P5の
チェックとレジスタR3の比較およびデクリメントを行
なう。R1= R4でない場合、レジスタR,1とレジ
スタR4の内容の差、すなわち記憶車速と現車速の差を
レジスタR5にストアする。ここで、現車速が記憶車速
に対して異常に高すぎないかどうかをチェックする。M
がその上限を示すデータであり、たとえばMは現車速が
記憶車速を記憶車速の20%上まわるときのR1とR4
の差に対応する値とする。Rs〉Mであれば現車速が高
すぎるので、異常とみなしてボートP2にLを出力し、
トランジスタQiをオフし、ソレノイド8L21&:消
勢して大気取入口109を開く。異常が発生した場合ボ
ー)P4.P5のチェックは行なわす車速チェックを繰
シ返す。また異常が発生した場合、Mの値を0に更新し
、現車速か記憶車速よシも下がらない限りボートP2に
Lを出力しつづける。大気取入口109開放によって負
圧アクチュエータ100が消勢され、スロットルバルブ
105の開度が小さくなって車速が記憶車速まで低下す
る°と■に戻シボ−)P2にHを出力して大気取入口1
09を閉じる。現車速と記憶車速かわずかにずれている
場合(Rs≦M)、車速を補正するために設けられるテ
ーブルを参照して、そのテーブルからレジスタR5の内
容に対応するデータを読出して、そのデータをレジスタ
R2の値に加算して、その加算値をレジスタR2にスト
アする。レジスタR2の値をボー)PAに出力してD/
AコンバータDACの出力電圧VXlを更新し、車速が
記憶車速に近づくように調整し■に戻る。なお、上記実
施例においては車速が異常に高くなったときに、車速か
目標車速に下がるまで第2の制御弁111を開き、目標
車速と現車速が等しくなったら制御弁111を閉じて定
速制御を続行するようにしているが、短時間で第1の制
御弁110の故障がなおらない可能性もあり、そのよう
な場合には車輛が加速・減速を繰り返すことになるので
、異常発生時には定速制御を解除して、第2の制御弁を
再び閉じることがないように制御してもよい。
An example of the processing flow of the microcomputer CPU will be described with reference to FIG. 2C. Immediately after the power is turned on, the initial state is set so that constant speed control is not performed.
Output Lf to I to H port P2, turn off transistor Qh, turn off Qi'e, and turn off two control valves 110.11.
1 controls the negative pressure chamber to communicate with the atmosphere. Next, check Ps and P7 and press set switch S.
Wait until WI or resume switch SW2 is turned on. When the input port P6 becomes L, it is determined that SW2 is turned on, and the register R1f is checked to determine whether the vehicle speed has been previously stored. If it is not stored, the initial data in the ROM (read-only memory) is 2 and stores it in register R1. (in capo)
When P7 becomes L, it is judged that SWl is turned on, and BO) P
a Check 2 to detect the cycle of the vehicle speed signal. This starts counting when port P3 reverses from H to L (or from L to H), and then when port Ps changes from H to L.
(or from 1. to H) is taken as one cycle of data. This periodic data is stored in register R1.
(vehicle speed memory). In order to convert the cycle data stored in the register R1 into data for setting the voltage VXI, which determines the duty ratio of energization/deenergization of the solenoid SLI necessary to obtain the vehicle speed corresponding to the cycle, the data is stored in the ROM in advance. The data corresponding to the value of register R1 is read out by referring to a table provided therein, and the data is stored in register R2. Baud the data in register R2,
output to PA, and causes the D/A converter DAC to generate a predetermined voltage Vx+i. baud) Pt and outputs 11 to P2, respectively. This turns off transistor Q, and Q
Since i is turned on, the transistor Qh repeatedly turns on and off at a predetermined duty, and at the same time controls the duty of the N V node 8Lxi, SL2 is energized, and the negative pressure actuator 100 changes the opening degree of the throttle valve 105 according to the duty ratio. Set all settings. Next, cancel switch 8W3. Processing is performed to check the playback switch SW4 and maintain the vehicle speed at a constant speed, but since the latter process takes time, the boat P4. Vehicle speed processing is performed only once every N times P5 is read. The number of times N is registered in register R3.
Store boat P4. P5 and the contents of register R3 are checked, and the contents of register R3 are decremented by one (-1). When the cancel switch 5W3t or the brake switch SW4 is turned on and the boat P4 or P5 is pushed to L, it returns to 1 starbi. When the value of register R3 becomes 0, the boat Ps f is checked and the period of the vehicle speed signal is counted, and the period data obtained as a result is stored in register R4.
Store in. Periodic data when storing vehicle speed is in register R1
Since the stored vehicle speed is stored in the register R1, the contents of the register R1 corresponding to the stored vehicle speed are compared with the contents of the register R4 corresponding to the current vehicle speed. If R1=R4, the current vehicle speed matches the memory vehicle speed, so return to ■ and return to BO) P4. P5 is checked and register R3 is compared and decremented. If R1=R4, the difference between the contents of register R,1 and register R4, that is, the difference between the stored vehicle speed and the current vehicle speed, is stored in register R5. Here, it is checked whether the current vehicle speed is abnormally higher than the stored vehicle speed. M
is data indicating the upper limit, for example, M is R1 and R4 when the current vehicle speed exceeds the stored vehicle speed by 20%.
The value corresponding to the difference between If Rs>M, the current vehicle speed is too high, so it is considered abnormal and L is output to boat P2.
Transistor Qi is turned off, solenoid 8L21&: is deenergized, and air intake port 109 is opened. If an abnormality occurs, turn off) P4. Check P5 repeats the vehicle speed check. If an abnormality occurs, the value of M is updated to 0, and L continues to be output to the boat P2 unless the current vehicle speed or the stored vehicle speed decreases. By opening the atmosphere intake port 109, the negative pressure actuator 100 is deenergized, the opening degree of the throttle valve 105 is reduced, and the vehicle speed is reduced to the memorized vehicle speed. 1
Close 09. If there is a slight difference between the current vehicle speed and the stored vehicle speed (Rs≦M), refer to the table provided for correcting the vehicle speed, read the data corresponding to the contents of register R5 from the table, and use that data. It is added to the value of register R2 and the added value is stored in register R2. Outputs the value of register R2 to PA (baud) and outputs it to D/
Update the output voltage VXl of the A converter DAC, adjust the vehicle speed so that it approaches the stored vehicle speed, and return to step (3). In the above embodiment, when the vehicle speed becomes abnormally high, the second control valve 111 is opened until the vehicle speed decreases to the target vehicle speed, and when the target vehicle speed and the current vehicle speed become equal, the control valve 111 is closed to maintain a constant speed. Although we try to continue control, there is a possibility that the failure of the first control valve 110 will not be resolved in a short time, and in such a case, the vehicle will repeat acceleration and deceleration, so if an abnormality occurs, The constant speed control may be canceled and the second control valve may be controlled so as not to be closed again.

以上のとおり本発明によれば、車速を制御する弁の異常
が万−生じても車速かある値以上に上昇することはなく
安全である。
As described above, according to the present invention, even if an abnormality occurs in the valve that controls the vehicle speed, the vehicle speed will not rise above a certain value and it will be safe.

【図面の簡単な説明】[Brief explanation of the drawing]

第1a図、第1b図および第1C図は本発明の車輛速度
制御装置の一実施例を示し、第1a図は制御回路の構成
を示す電気回路図、第1b図は負圧アクチュエータ10
0およびその周辺の構成を示すブロック図、第1C図は
第1a図に示す回路のタイムチャートである。第2a図
、第2b図および第2C図は本発明のもう1つの実施例
を示し、第2a図は実施例の回路構成を示すブロック図
、第2b図はその回路の動作を示すタイムチャート、第
2C図はマイクロコンピュータCPUの処理フローの一
例を示すフローチャートである。 2:永久磁石    3:リードスイッチ10:電源 
     20:F’−V変換回路50:記憶回路  
  55:下限速度検出回路100:負圧アクチュエー
タ 101;ハウジング   102;ダイアフラム103
、113.115.117 ニスプリング105  :
スロットルバルブ 106:インテークマニホールド1
07:負圧取入口   108.109:大気取入口1
10:第1の制御弁(負圧制御弁) 111:第2の制御弁(負圧解放弁) 112.114: 可動片116 :アクセルペダルC
MI、 CM2 :コンパレータ 第2a図 第2b図
1a, 1b and 1c show an embodiment of the vehicle speed control device of the present invention, FIG. 1a is an electric circuit diagram showing the configuration of the control circuit, and FIG. 1b is a negative pressure actuator 10.
FIG. 1C is a block diagram showing the configuration of 0 and its surroundings, and is a time chart of the circuit shown in FIG. 1A. 2a, 2b and 2c show another embodiment of the present invention, FIG. 2a is a block diagram showing the circuit configuration of the embodiment, and FIG. 2b is a time chart showing the operation of the circuit. FIG. 2C is a flowchart showing an example of the processing flow of the microcomputer CPU. 2: Permanent magnet 3: Reed switch 10: Power supply
20: F'-V conversion circuit 50: Memory circuit
55: Lower limit speed detection circuit 100: Negative pressure actuator 101; Housing 102; Diaphragm 103
, 113.115.117 Nispring 105:
Throttle valve 106: Intake manifold 1
07: Negative pressure intake 108.109: Atmospheric intake 1
10: First control valve (negative pressure control valve) 111: Second control valve (negative pressure release valve) 112.114: Movable piece 116: Accelerator pedal C
MI, CM2: Comparator Figure 2a Figure 2b

Claims (5)

【特許請求の範囲】[Claims] (1)負圧制御弁、負圧解放弁、負圧制御弁を制御する
負圧制御ソレノイド、および負圧解放弁全制御する負圧
解放制御ソレノイドを備え、スロットルバルブに連結さ
れてその開度を制御する負圧アクチュエータ; 実車速信号を発生する実車速信号発生手段;スイッチ操
作に応答して目標車速を記憶する目標車速記憶手段; 実車速と目標車速に応じて負圧制御ソレノイドの付勢を
制御する定速制御手段;および実車速と目標車速に応じ
て、実車速か目標車速よりも設定量以上上廻わると負圧
解放制御ソレノイドをスロットルバルブ閉方向の電気的
付勢又は消勢状態とする高速抑制手段; 全備える車輛速度制御装置。
(1) Equipped with a negative pressure control valve, a negative pressure release valve, a negative pressure control solenoid that controls the negative pressure control valve, and a negative pressure release control solenoid that fully controls the negative pressure release valve, and is connected to the throttle valve to control its opening. Negative pressure actuator that controls; Actual vehicle speed signal generation means that generates an actual vehicle speed signal; Target vehicle speed storage means that stores the target vehicle speed in response to switch operation; Energizes the negative pressure control solenoid according to the actual vehicle speed and target vehicle speed. and, depending on the actual vehicle speed and target vehicle speed, electrically energizes or deenergizes the negative pressure release control solenoid in the direction of closing the throttle valve when the actual vehicle speed or target vehicle speed exceeds the set amount or more. High-speed restraint means; Complete vehicle speed control system.
(2)定速制御手段は、実車速信号と目標車速信号が重
畳した車速信号を定値信号と比較して両者の高低相関に
対応した2値化号を生ずる比較器と、負圧制御ソレノイ
ドに接続され前記2値化号でオン、オフ付勢されるスイ
ッチング素子である前記特許請求の範囲第(1)項記載
の車輛速度制御装置。
(2) The constant speed control means includes a comparator that compares the vehicle speed signal obtained by superimposing the actual vehicle speed signal and the target vehicle speed signal with a constant value signal and generates a binary signal corresponding to the high/low correlation between the two, and a negative pressure control solenoid. The vehicle speed control device according to claim 1, wherein the vehicle speed control device is a switching element that is connected and turned on and off by the binary signal.
(3)高速抑制手段は、実車速信号と目標車速信号が重
畳した車速信号を定値信号と比較して両者の高低相関に
対応した2値化号を生ずる比較器と、負圧解放制御ソレ
ノイドに接続され前記2値化号でオン、オフ付勢される
スイッチング素子である前記特許請求の範囲第(1)項
記載の車輌速度制御装置。
(3) The high speed suppression means includes a comparator that compares a vehicle speed signal in which the actual vehicle speed signal and target vehicle speed signal are superimposed with a fixed value signal and generates a binary signal corresponding to the high/low correlation between the two, and a negative pressure release control solenoid. The vehicle speed control device according to claim 1, which is a switching element that is connected and turned on and off by the binary signal.
(4)スイッチング素子は更にブレーキの踏み込みを示
す信号で、スロットルバルブを閉じる方向にオン又はオ
フ付勢される前記特許請求の範囲第(3)項記載の車輌
速度制御装置。
(4) The vehicle speed control device according to claim (3), wherein the switching element is further biased on or off in the direction of closing the throttle valve in response to a signal indicating depression of the brake.
(5)  目標車速記憶手段および高速抑制手段はマイ
クロプロセッサである前記特許請求の範囲第(1)項記
載の車輛速度制御装置。
(5) The vehicle speed control device according to claim (1), wherein the target vehicle speed storage means and the high speed suppression means are microprocessors.
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