JPS58111529A - Ａ／ｄ変換器 - Google Patents
Ａ／ｄ変換器Info
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- JPS58111529A JPS58111529A JP20920981A JP20920981A JPS58111529A JP S58111529 A JPS58111529 A JP S58111529A JP 20920981 A JP20920981 A JP 20920981A JP 20920981 A JP20920981 A JP 20920981A JP S58111529 A JPS58111529 A JP S58111529A
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/1205—Multiplexed conversion systems
- H03M1/123—Simultaneous, i.e. using one converter per channel but with common control or reference circuits for multiple converters
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/50—Analogue/digital converters with intermediate conversion to time interval
- H03M1/56—Input signal compared with linear ramp
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、アナログ値をディジタル値に変換するための
Ａ／Ｄ変換器に係シ、さらに詳しくはマイクロコンピュ
ータ制御装置のＡ／Ｄ変換器に好適な外部ノイズに強い
、ローコストな絶縁形アナログーパルス幅変換のＡ／Ｄ
変換器に関する。
Ａ／Ｄ変換器に係シ、さらに詳しくはマイクロコンピュ
ータ制御装置のＡ／Ｄ変換器に好適な外部ノイズに強い
、ローコストな絶縁形アナログーパルス幅変換のＡ／Ｄ
変換器に関する。
従来からアナログ−パルス幅変換を用いたル■変換の方
法および装置は種々提案されている。しかし、この種の
Ａ／Ｄ変換（至）をマイクロコンピュータ制御装置に応
用する場合、耐ノイズ性およびコストの点に問題がワシ
、その使用に際して十分なものではなかった。
法および装置は種々提案されている。しかし、この種の
Ａ／Ｄ変換（至）をマイクロコンピュータ制御装置に応
用する場合、耐ノイズ性およびコストの点に問題がワシ
、その使用に際して十分なものではなかった。
本発明は、上述の事柄にもとづいてなされたもので、マ
イクロコンピュータ制御装置のＡ／ Ｄｌｆ換器に好適
であシ、シかも多チヤンネル入力が可能なローコストな
絶縁形アナログーパルス幅変換のＡ／Ｄ変換器を提供す
ることを目的とするものである。
イクロコンピュータ制御装置のＡ／ Ｄｌｆ換器に好適
であシ、シかも多チヤンネル入力が可能なローコストな
絶縁形アナログーパルス幅変換のＡ／Ｄ変換器を提供す
ることを目的とするものである。
本発明は上記の目的を達成するために、アナログ回路と
マイクロコンピュータ部との絶縁を、電気的絶縁半導体
素子で構成し、その絶縁個所をディジタル信号個所、す
なわち、のこぎり波発生器の外部制御信号と比較器の出
力パルス信号とを絶縁し、ホトカプラなどの絶縁素子の
特性を考慮した安価なのこぎυ波発生回路を提供すると
共に、多種類のアナログ入力信号をＡ／Ｄｉ換するため
の安価な方策として、比較器を多数配置してその各々に
アナログ入力信号を接続しのこぎり波電圧と比較し、さ
らにその各々の出力パルスを電気的絶縁素子を介してマ
イクロコンピュータ制御装置に取込むようにしたもので
ある。これにより多種のアナログ信号をマイクロコンピ
ュータに取込むことが可能な耐ノイズに強く、安価なＡ
／ＤＫ換器を提供するものである。
マイクロコンピュータ部との絶縁を、電気的絶縁半導体
素子で構成し、その絶縁個所をディジタル信号個所、す
なわち、のこぎり波発生器の外部制御信号と比較器の出
力パルス信号とを絶縁し、ホトカプラなどの絶縁素子の
特性を考慮した安価なのこぎυ波発生回路を提供すると
共に、多種類のアナログ入力信号をＡ／Ｄｉ換するため
の安価な方策として、比較器を多数配置してその各々に
アナログ入力信号を接続しのこぎり波電圧と比較し、さ
らにその各々の出力パルスを電気的絶縁素子を介してマ
イクロコンピュータ制御装置に取込むようにしたもので
ある。これにより多種のアナログ信号をマイクロコンピ
ュータに取込むことが可能な耐ノイズに強く、安価なＡ
／ＤＫ換器を提供するものである。
以下、本発明の実施例を図面によシ説明する。
第１図は、本発明の変換器の一例をマイクロコンピュー
タに適用した場合の構成を示す。図において、定電圧回
路１は抵抗３およびツェナーダイオード５からなる基準
電圧発生回路と、演算増幅器４および抵抗８．７よシな
る非反転増ｌ１ｌＩ器とで構成している。この定電圧回
路１は電源電圧２および周囲温度の変動に対して変動し
ない一定電圧９を発生する。なお、図中６は電源グラン
ドを示す。また、演算増幅器４の＋は非反転入力を、−
は反転入力を示す。電源電圧２および電源グランド６は
、演算増幅器４の動作電源を示す。
タに適用した場合の構成を示す。図において、定電圧回
路１は抵抗３およびツェナーダイオード５からなる基準
電圧発生回路と、演算増幅器４および抵抗８．７よシな
る非反転増ｌ１ｌＩ器とで構成している。この定電圧回
路１は電源電圧２および周囲温度の変動に対して変動し
ない一定電圧９を発生する。なお、図中６は電源グラン
ドを示す。また、演算増幅器４の＋は非反転入力を、−
は反転入力を示す。電源電圧２および電源グランド６は
、演算増幅器４の動作電源を示す。
のこぎυ波発生器１０は、演算増幅器２１、コンデンサ
１１、抵抗１２．１３，１４．１５およびホトカブＩ）
１７からなっている。こののこぎシ波発生器１０はホト
カプラ１７のホトトランジスタ１８のＯＮ（コレクタ・
エミッタ関導通）、ＯＦＦ （コレクタ・エミッタ間開
放）動作でツレぞれ積分および放電が行なわれる。この
積分速度は一定電圧９を積分するため一定である。した
がって、演算増幅器２１の出力はのこぎシ波電圧１６と
なる。ホトトランジスタ１８はマイクロコンピュータ４
４の外部制御、信号２０によシ制御される。外部制御信
号２Ｇ！、ホトカプラ１７のホトダイオード１９に加え
られ、光信号となってホトトランジスタ１８を作動する
。
１１、抵抗１２．１３，１４．１５およびホトカブＩ）
１７からなっている。こののこぎシ波発生器１０はホト
カプラ１７のホトトランジスタ１８のＯＮ（コレクタ・
エミッタ関導通）、ＯＦＦ （コレクタ・エミッタ間開
放）動作でツレぞれ積分および放電が行なわれる。この
積分速度は一定電圧９を積分するため一定である。した
がって、演算増幅器２１の出力はのこぎシ波電圧１６と
なる。ホトトランジスタ１８はマイクロコンピュータ４
４の外部制御、信号２０によシ制御される。外部制御信
号２Ｇ！、ホトカプラ１７のホトダイオード１９に加え
られ、光信号となってホトトランジスタ１８を作動する
。
このように、ホトカブ５１７はアナログ−パルス幅変換
回路とマイクロコンピュータ４４とを電気的に絶縁して
いる。
回路とマイクロコンピュータ４４とを電気的に絶縁して
いる。
また、抵抗１５を可変抵抗にすれば、コンデンサ、抵抗
による積分速度の変動を、３１１ｍ整することができる
。
による積分速度の変動を、３１１ｍ整することができる
。
電圧比較回路はアナログ入力信号の数だけ接続されてい
る。この電圧比較回路はそれぞれ比較器２３．２７．３
１と、抵抗２２．２４．３０とからなっている。抵抗２
２，２４．３０をそれぞれ比較器２３．２７．３１に接
続することによシ第２図に示すヒステリシス特性を得る
ことができる。
る。この電圧比較回路はそれぞれ比較器２３．２７．３
１と、抵抗２２．２４．３０とからなっている。抵抗２
２，２４．３０をそれぞれ比較器２３．２７．３１に接
続することによシ第２図に示すヒステリシス特性を得る
ことができる。
このヒステリシス特性の幅はアナログ人力信号４１（Ｃ
ＨＩ）では抵抗２２とローパスフィルタ４８の抵抗３９
とによって決定される。他の入力信号４２ （ＣＨ２）
、４３ （ＣＨｎ）に対しても同様に抵抗２４．３’？
）とローパスフィルタ４９゜５．０の抵抗３９とによっ
て決定される。この電圧比較回路はア“ナログ入力信号
゛４１１．４２．４３とのこぎシ波電圧１６とを比較し
、アナログ入力信号がのこぎシ波電圧よシ大きｈならば
、比較器２３．２７，３１０出カトランジスタをＯＦＦ
し、逆の場合にはＯＮするように動作する。そして、こ
れら出力信号２６．２９．３３はそれぞれホトーｈプ５
４５．４６．４７によって、電気的に絶縁されたのち、
マイクロコンピュータ４４に入力される。
ＨＩ）では抵抗２２とローパスフィルタ４８の抵抗３９
とによって決定される。他の入力信号４２ （ＣＨ２）
、４３ （ＣＨｎ）に対しても同様に抵抗２４．３’？
）とローパスフィルタ４９゜５．０の抵抗３９とによっ
て決定される。この電圧比較回路はア“ナログ入力信号
゛４１１．４２．４３とのこぎシ波電圧１６とを比較し
、アナログ入力信号がのこぎシ波電圧よシ大きｈならば
、比較器２３．２７，３１０出カトランジスタをＯＦＦ
し、逆の場合にはＯＮするように動作する。そして、こ
れら出力信号２６．２９．３３はそれぞれホトーｈプ５
４５．４６．４７によって、電気的に絶縁されたのち、
マイクロコンピュータ４４に入力される。
なお、ホトカブ？４５，４６．４７のホトトランジスタ
１８は、比較器２３，２７．３１の出方トランジスタが
ＯＮの場合に、ＯＮ（導通し、またＯＦＦの場合にＯＦ
Ｆ （開放）となる。なお抵抗２５，２８．３２はそれ
ぞれホトダイオード１９に規定の電流を流すために設け
られている。
１８は、比較器２３，２７．３１の出方トランジスタが
ＯＮの場合に、ＯＮ（導通し、またＯＦＦの場合にＯＦ
Ｆ （開放）となる。なお抵抗２５，２８．３２はそれ
ぞれホトダイオード１９に規定の電流を流すために設け
られている。
前述したローパスフィルタ４８，４９．５０は抵抗３９
およびコンデンサ４ｏからなっている。
およびコンデンサ４ｏからなっている。
このローパスフィルタ４８．４９．５０は、アナログ人
力信号４１．４２．４３中に含まれるノイズ等による高
周波成分を除去する働きをする。また、ダイオード５１
，５２．５３はアナログ人力信号と電源電圧２との間に
接続されている。これは比較器２３，２７．３１に対す
るオーバ電圧を保護するためのものである。この場合の
アナログ入力域圧は、電源電圧２で制限される。
力信号４１．４２．４３中に含まれるノイズ等による高
周波成分を除去する働きをする。また、ダイオード５１
，５２．５３はアナログ人力信号と電源電圧２との間に
接続されている。これは比較器２３，２７．３１に対す
るオーバ電圧を保護するためのものである。この場合の
アナログ入力域圧は、電源電圧２で制限される。
次に上述した本発明の変換器を備えたマイクロコンピュ
ータの全体の動作について説明する。
ータの全体の動作について説明する。
第３図はマイクロコンピュータによる操作手順の一例を
示す。また、その時の各部動作波形を第４図に示す。
示す。また、その時の各部動作波形を第４図に示す。
まず、Ａ／ＤＫ換の指令および変換したいチャンネル番
号ｎが指定されると、第３図に示すプロゲラＡが実行さ
れる。すなわち、この第・３図に示すプラグラムにおけ
るステップ１では外部制御信号２０パルス幅を計測する
カウンタをクリアする。
号ｎが指定されると、第３図に示すプロゲラＡが実行さ
れる。すなわち、この第・３図に示すプラグラムにおけ
るステップ１では外部制御信号２０パルス幅を計測する
カウンタをクリアする。
ステップ２ではＡ／Ｄ変換開始のための外部制御信号を
ＯＮに出力する。ステップ３では第４図に示す変換開始
から終了までの外部制御信号のパルス幅を計測するため
のカウンタを＋１加算する。
ＯＮに出力する。ステップ３では第４図に示す変換開始
から終了までの外部制御信号のパルス幅を計測するため
のカウンタを＋１加算する。
ステップ４では指定のチャンネルｎ１すなわち、比較器
ｎの出力パルスの変化を測定し、出力パルスがＯＮから
ＯＦＦ’、すなわちＡ／Ｄ変換が終了した場合にはステ
ップ５へ、また、変化がない場合にはススツブ３へ戻る
。ステップ５では外部制御信号−ＯをＯＦＦに出力する
。ステップ６ではカウンタのカウント値をチャンネルｎ
のディジタル値としてメモリに格納、する。ステップ７
は本操作手順を終了し他の操作手順へ移行するためのリ
ターン命令を実行する。
ｎの出力パルスの変化を測定し、出力パルスがＯＮから
ＯＦＦ’、すなわちＡ／Ｄ変換が終了した場合にはステ
ップ５へ、また、変化がない場合にはススツブ３へ戻る
。ステップ５では外部制御信号−ＯをＯＦＦに出力する
。ステップ６ではカウンタのカウント値をチャンネルｎ
のディジタル値としてメモリに格納、する。ステップ７
は本操作手順を終了し他の操作手順へ移行するためのリ
ターン命令を実行する。
以上述べたように、ホトカプラ１７をめこぎシ波発生器
１０に組み込み、さらに、比較器２３゜２７．３１の出
力とマイクロコンピュータ４４の回路とをホトカプラ３
４，３５．３６で接続した簡単な回路構成で安価な高精
度の多チヤンネルＡ／Ｄ変換器を提供することができる
。さらに、比較器２３，２７．３１にヒステリシスを持
たせてチャタリングを防止し、また、オーバ電圧保護の
ためのダイオード５１，５２，５３、ノイズ除去のため
のローパスフィを夕４ｇ、４９．５０を符加して、より
信頼性の高いＡ／Ｄ変換器を提供することができる。
１０に組み込み、さらに、比較器２３゜２７．３１の出
力とマイクロコンピュータ４４の回路とをホトカプラ３
４，３５．３６で接続した簡単な回路構成で安価な高精
度の多チヤンネルＡ／Ｄ変換器を提供することができる
。さらに、比較器２３，２７．３１にヒステリシスを持
たせてチャタリングを防止し、また、オーバ電圧保護の
ためのダイオード５１，５２，５３、ノイズ除去のため
のローパスフィを夕４ｇ、４９．５０を符加して、より
信頼性の高いＡ／Ｄ変換器を提供することができる。
以上述べた実施例ではディジタル変換部の対象として、
マイクロコンピュータとしたが、通常のディジタルＩＣ
の組み合わせでも可能である。
マイクロコンピュータとしたが、通常のディジタルＩＣ
の組み合わせでも可能である。
前述したのこぎり波発生器１０の他の実施例を第５図に
示す。この図において、第１図と同符号のものは同一部
分である。こののこぎり波発生器１０は演算増幅６６５
、抵抗６０，６１，６４、コンデンサ６３、ダイオード
６２を備えて構成されている。ホトカプラ１７はのこぎ
９波発生器１０の積分及び放電動作を制御する。すなわ
ち、ホトカプラ１７のホトトランジスタ１８のＣ−１間
が導通の場合に積分動作を、またＣ−１間が開放の場合
に放電動作となる。
示す。この図において、第１図と同符号のものは同一部
分である。こののこぎり波発生器１０は演算増幅６６５
、抵抗６０，６１，６４、コンデンサ６３、ダイオード
６２を備えて構成されている。ホトカプラ１７はのこぎ
９波発生器１０の積分及び放電動作を制御する。すなわ
ち、ホトカプラ１７のホトトランジスタ１８のＣ−１間
が導通の場合に積分動作を、またＣ−１間が開放の場合
に放電動作となる。
また、のこぎり波発生器１０の他の一例を第６図に示す
。のこぎり波発生器ｌＯは演算増幅器７７．８０、抵抗
７０，７１，７２，７３，７４゜７５．７８．７９およ
びコンデンサ７６を備えて構成されている。ホトカブ２
１７はのこぎり波発生器ｌＯの積分及び放電動作を制御
する。すなわち、ホトカプラ１７のホトトランジスタ１
８のＣ−１間が導通の場合に放電動作を、またＣ−Ｅ関
が開放の場合に積分動作となる。
。のこぎり波発生器ｌＯは演算増幅器７７．８０、抵抗
７０，７１，７２，７３，７４゜７５．７８．７９およ
びコンデンサ７６を備えて構成されている。ホトカブ２
１７はのこぎり波発生器ｌＯの積分及び放電動作を制御
する。すなわち、ホトカプラ１７のホトトランジスタ１
８のＣ−１間が導通の場合に放電動作を、またＣ−Ｅ関
が開放の場合に積分動作となる。
次に、マイクロコンピュータによる操作手順の他の実施
例を第７図によ）説明する。
例を第７図によ）説明する。
第７図に示す操作手順は第３図に示す操作手順のステッ
プ３とステップ４との間に、ステップ３゜５を加えたも
のであシ、このステップ３．５はＡ／Ｄ変換持関をチェ
ックするためのものである。
プ３とステップ４との間に、ステップ３゜５を加えたも
のであシ、このステップ３．５はＡ／Ｄ変換持関をチェ
ックするためのものである。
これは、カウンタの値ＣとＣＭ（アナログ入力信号の最
高値のカウント値）とを比較することで可能となる。そ
の結果、Ｃ＝Ｃ舅であるならば、ステップ５へ、そうで
ないならばステップ４を実行する。
高値のカウント値）とを比較することで可能となる。そ
の結果、Ｃ＝Ｃ舅であるならば、ステップ５へ、そうで
ないならばステップ４を実行する。
次に、マイクロコンピュータによる操作手順のさらに他
の実施例を第８図によシ説明する。
の実施例を第８図によシ説明する。
第８図は、タイマ割込み処理にてＡ／Ｄ変換を実行する
手順を示す。まず、ステップ１では、Ａ／Ｄ変換中かど
うかを変換実行中ＦＬＡＧで判定する。変換実行中であ
れば、ステップ１０へ、また、変換終了であれば、ステ
ップ２を実行する。ステップ２ではＡ／Ｄ変換実行中の
ＦＬＡＧをセットする。ステップ３ではカウンタをクリ
アする。ステップ４ではＡ／Ｄ変換開始のための外部制
御信号２０をＯＮに出力する。ステップ５では第４図に
示す変換開始から終了までの外部制御信号２０のパルス
幅を計測するためのカウンタを＋１加算する。ステップ
６では指定のチャンネルｎ１すなわち、比較器ｎの出力
パルスの変化を測定し、出力パルスがＯＮからＯＦＦ、
すなわち、Ａ／Ｄ変換が終了した場合にはステップ７へ
、また、変化がない場合にはステップ５へ戻る。ステッ
プ７では外部制御信号２０をＯＦＦに出力する。ステッ
プ８ではカウンタのカウント値をチャンネルｎのディジ
タル値としてメモリに格納する。ステップ９ではＡ／Ｄ
変換が終了したので、変換実行中ＦＬＡＧをリセットす
る。ステップ１０ではＡ／Ｄ変換時間をオーバしている
ので、カウンタの値をＣＭ（アナログ入力信号の最高値
のカウント値）にセットする。ステップ１１は本操作手
順を終了し他の操作手順へ移行するためのリターン命令
を実行する。
手順を示す。まず、ステップ１では、Ａ／Ｄ変換中かど
うかを変換実行中ＦＬＡＧで判定する。変換実行中であ
れば、ステップ１０へ、また、変換終了であれば、ステ
ップ２を実行する。ステップ２ではＡ／Ｄ変換実行中の
ＦＬＡＧをセットする。ステップ３ではカウンタをクリ
アする。ステップ４ではＡ／Ｄ変換開始のための外部制
御信号２０をＯＮに出力する。ステップ５では第４図に
示す変換開始から終了までの外部制御信号２０のパルス
幅を計測するためのカウンタを＋１加算する。ステップ
６では指定のチャンネルｎ１すなわち、比較器ｎの出力
パルスの変化を測定し、出力パルスがＯＮからＯＦＦ、
すなわち、Ａ／Ｄ変換が終了した場合にはステップ７へ
、また、変化がない場合にはステップ５へ戻る。ステッ
プ７では外部制御信号２０をＯＦＦに出力する。ステッ
プ８ではカウンタのカウント値をチャンネルｎのディジ
タル値としてメモリに格納する。ステップ９ではＡ／Ｄ
変換が終了したので、変換実行中ＦＬＡＧをリセットす
る。ステップ１０ではＡ／Ｄ変換時間をオーバしている
ので、カウンタの値をＣＭ（アナログ入力信号の最高値
のカウント値）にセットする。ステップ１１は本操作手
順を終了し他の操作手順へ移行するためのリターン命令
を実行する。
以上説明した本発明の実施例によれば、第１にアナログ
−パルス幅変換のＡ／Ｄ変換器におけるのこぎり波発生
器ｌＯの積分および放電を制御する外部制御信号２０と
、比較器２１の出力パルス信号１６のディジタル変換部
との信号伝達にホトカプラ１７等の一次側と２次側が電
気的に絶縁した半導体素子で行なうことによシアナログ
部とディジタル変換部とが電気的に絶縁できるので外部
から進入するノイズによるｖ４ＩＩＩｈ作をなくす効果
がある。
−パルス幅変換のＡ／Ｄ変換器におけるのこぎり波発生
器ｌＯの積分および放電を制御する外部制御信号２０と
、比較器２１の出力パルス信号１６のディジタル変換部
との信号伝達にホトカプラ１７等の一次側と２次側が電
気的に絶縁した半導体素子で行なうことによシアナログ
部とディジタル変換部とが電気的に絶縁できるので外部
から進入するノイズによるｖ４ＩＩＩｈ作をなくす効果
がある。
第２に、のこぎ多波発生器１０の回路へホトカプラ１７
を組み込むことによ多回路構成を簡単にすることができ
るので、安価なＡ／Ｄ変換器を提供できる。
を組み込むことによ多回路構成を簡単にすることができ
るので、安価なＡ／Ｄ変換器を提供できる。
第３に、比較器２３，２７．３０を多数配置して、その
各々にアナログ信号を、接続しのこぎシ波電圧１６と比
較する。セしてζその各々の出力パルス２６，２９．３
３をホトカブ゛う４５，４６゜４７等倉介してディジタ
ル弯換部に取シ込む簡単な回路構成で安価な多信号人力
Ａ／Ｄ変換器が可能となる。
各々にアナログ信号を、接続しのこぎシ波電圧１６と比
較する。セしてζその各々の出力パルス２６，２９．３
３をホトカブ゛う４５，４６゜４７等倉介してディジタ
ル弯換部に取シ込む簡単な回路構成で安価な多信号人力
Ａ／Ｄ変換器が可能となる。
第４に、比較器２３．２７．３０にヒステリシスを持た
せてチャタリングの防止、また、ダイオード５１＊ ５
２，３３をアナログ入力２インに挿 。
せてチャタリングの防止、また、ダイオード５１＊ ５
２，３３をアナログ入力２インに挿 。
入してオーバ電圧（で対する回路保護、さらに、アナロ
グ入力ラインにローパスフィルタ４８．４９゜５０を符
加して外部ノイズ除去等を行なうことができる。
グ入力ラインにローパスフィルタ４８．４９゜５０を符
加して外部ノイズ除去等を行なうことができる。
以上詳述したように、本発明によれば、マイクロコンピ
ュータ制御装置のＡ／Ｄ変換器に好適でアシ、シかも多
チヤンネル入力が可能なローコストな絶縁形アナログー
パルス幅変換のＡ／Ｄ変換器を提供することができるも
のである。
ュータ制御装置のＡ／Ｄ変換器に好適でアシ、シかも多
チヤンネル入力が可能なローコストな絶縁形アナログー
パルス幅変換のＡ／Ｄ変換器を提供することができるも
のである。
第１図は本発明の変換器の一実施例をマイクロコンピュ
ータに適用した場合の回路構成図、第２図は本発明を構
成する比較器のヒステリシス特性図、第３図はマイクロ
コンピュータによるＡ／Ｄ変換の操作手順の一例を示す
７０−チャート、第４図はその動作時の各部波形を示す
図、第５図は本発明を構成するホトカプラを組み込んだ
のこぎり波発生器の一実施例を示す回路構成図、第６図
は本発明を構成するホトカプラを組み込んだのこぎり波
発生器の他の実施例を示す回路構成図、第７図はマイク
ロコンピュータによるＡ／Ｄ変換の操作手順の他の例を
示すフローチャート、第８図はマイクロコンピュータに
よるＡ／Ｄ変換の操作手順のさらに他の例を示すフロー
チャートである。 ｌ・・・定電圧回路、１０・・・のこぎシ波発生器、１
７・・・ホトカプラ、２１−・・演算増幅器、２３，２
７゜３１・・・比較器、４１．４２．４３・・・アナロ
グ入力４号、４４・・・マイクロコンビエータ、４５．
４６゜４７・・・ホトカプラ、４８，４９．５０・・・
ローノ（スフイルタ。 −１（ ′ｆＪ １ 口 ！ ’９ｆ）２ 日 ＹＪ Ｊ 目 ′ＶＪ ４ 口 ￥Ｊ Ｚ 口
ータに適用した場合の回路構成図、第２図は本発明を構
成する比較器のヒステリシス特性図、第３図はマイクロ
コンピュータによるＡ／Ｄ変換の操作手順の一例を示す
７０−チャート、第４図はその動作時の各部波形を示す
図、第５図は本発明を構成するホトカプラを組み込んだ
のこぎり波発生器の一実施例を示す回路構成図、第６図
は本発明を構成するホトカプラを組み込んだのこぎり波
発生器の他の実施例を示す回路構成図、第７図はマイク
ロコンピュータによるＡ／Ｄ変換の操作手順の他の例を
示すフローチャート、第８図はマイクロコンピュータに
よるＡ／Ｄ変換の操作手順のさらに他の例を示すフロー
チャートである。 ｌ・・・定電圧回路、１０・・・のこぎシ波発生器、１
７・・・ホトカプラ、２１−・・演算増幅器、２３，２
７゜３１・・・比較器、４１．４２．４３・・・アナロ
グ入力４号、４４・・・マイクロコンビエータ、４５．
４６゜４７・・・ホトカプラ、４８，４９．５０・・・
ローノ（スフイルタ。 −１（ ′ｆＪ １ 口 ！ ’９ｆ）２ 日 ＹＪ Ｊ 目 ′ＶＪ ４ 口 ￥Ｊ Ｚ 口
Claims (1)
- 【特許請求の範囲】 １、定電圧回路と、外部制御信号で同定電圧を入力とす
る積分および放電動作を行なうのこぎり波発生器と、こ
の発生器からののこぎり波電圧とアナログ入力信号とを
比較するだめの比較器と、この比較器の出力パルスの測
定、外部制御信号の発生、さらに変換後のパルス幅を計
測しディジタル値に変換するためのディジタル変換部と
で構成するアナログ−パルス幅変換のＡ／Ｄ変換器にお
いて、前記のこぎシ波発生器の積分および放電動作部に
、−次側と２次側とを電気的に絶縁する半導体素子を組
み入れ、この素子の一次側を外部制御信号で駆動して、
のこぎシ波発生器の積分および放電を制御するとともに
、前記比較器の出力側も同様の素子を介してディジタル
変換部と接続したことを特徴とす゛ るＡ／Ｄ変換器・ ２、のこぎ〉波発生器は、演算増幅器を備え、この演算
増幅器の正入力端子には定電圧回路の定′亀圧を抵抗分
割した電圧を印加し、負入力端子には、同定電圧を第１
の抵抗を介して接続すると共に、第２の抵抗を接続し、
演算増幅器の出力側をホトダイオードおよびホトトラン
ジスタからなる電気的絶縁半導体素子におけるホトトラ
ンジスタに接続し、前記演算増幅器の負入力と出力との
間にコンデンサを接続し、ディジタル変換部の外部制御
信号を電気的絶縁半導体素子のホトダイオードに接続し
たことを特徴とする特許請求の範囲＠１項記載のＡ／Ｄ
変換器。 ３、のこぎり波発生器からののこぎり波電圧とアナログ
入力信号とを比較する比較器およびその出力パルスをデ
ィジタル変換部へ接続するための電気的絶縁素子を多数
配列し、多種類のアナログ信号をＡ／Ｄ変換することを
特徴とする特許請求の範囲５ｇ１項または第２項記載の
ル■変換器。 ４、比較器はヒステリシス特性を有していることを特徴
とする特許請求の範囲第１項〜第３項のいずれかに記載
ＯＡ／Ｄ変換器。 ５．比較器のアナログ信号入力端子と演算増幅器の電源
又は、定電圧回路の定電圧間にダイオードを挿入し、オ
ーバ入力電圧補償をしたことを特徴とする特許請求の範
囲第１項〜第４項のいずれかに記載のＡ／Ｄ変換器。 ６、ディジタル変換部において、外部制御信号を出力後
、のこぎり波発生器の出力電圧の立上シまでの遅嬌時間
に相当するディジタル童をアナログ信号変換後のディジ
タル値から減算することを特徴とする特許請求の範囲第
１項〜第５項のいずれかに記載のＡ／Ｄ変換器。 ７、のこぎシ波発生器の第２の抵抗を可変抵抗にして積
分時間を調節したことを特徴とする特許請求の範囲第２
項記載のＡ／Ｄ変換器。 ８、比較器の出力パルスの変化から、Ａ／Ｄ変換終了を
検出し、のこぎシ波発生器を放電するように、外部制御
信号を出力する゛ことを特徴とする特許請求の範囲第１
項または第２項記載のＡ／Ｄ変換器。 ９、Ａ／Ｄ変換開始から終了までの変換時間を検出する
変換時間検出部を設けて、制限時間を越えた場合には変
換後のディジタル値をアナログ入力信号の最高値の値に
設定するとともに、のこぎ９波発生器を放電する外部制
御信号を出力することを特徴とする特許請求の範囲第１
項または第２項記載ＯＡ／Ｄ変換器。 １０、アナログ入力信号をローパスフィルタを通したの
ち、比較器に入力したことを特徴とする特許請求の範囲
第１項または第２項記載のルΦ変換器。 １１、ディジタル変換部にマイクロコンピュータを用い
、タイマ割込み処理にてＡ／Ｄ変換を開始し、次の割込
みに入った時に、Ａ／Ｄ変換が終了したかどへかを判定
し、Ａ／Ｄ変換が終了していない場合には、変換後のデ
ィジタル壱値をアナログ入力信号の最高値に設定すると
ともに、のこぎυ波発生器を放電する外部制御信号を出
力することを特徴とする特許請求の範囲第１項または第
２項記載のＡ／Ｄ変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20920981A JPS58111529A (ja) | 1981-12-25 | 1981-12-25 | Ａ／ｄ変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20920981A JPS58111529A (ja) | 1981-12-25 | 1981-12-25 | Ａ／ｄ変換器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58111529A true JPS58111529A (ja) | 1983-07-02 |
Family
ID=16569157
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20920981A Pending JPS58111529A (ja) | 1981-12-25 | 1981-12-25 | Ａ／ｄ変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58111529A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02216915A (ja) * | 1989-02-16 | 1990-08-29 | Yokogawa Electric Corp | 多点測定装置 |
| KR20190022864A (ko) * | 2016-11-18 | 2019-03-06 | 그리 일렉트릭 어플라이언시즈, 인코포레이티드 오브 주하이 | 클록 보상 회로, 클록 회로 및 마이크로컨트롤러 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5332651A (en) * | 1976-09-07 | 1978-03-28 | Yokogawa Hokushin Electric Corp | Analog operation unit |
| JPS53126239A (en) * | 1977-04-11 | 1978-11-04 | Yokogawa Hokushin Electric Corp | Arithmetic unit for analog signal |
| JPS55110428A (en) * | 1979-02-16 | 1980-08-25 | Mitsubishi Electric Corp | Analog signal input unit |
-
1981
- 1981-12-25 JP JP20920981A patent/JPS58111529A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5332651A (en) * | 1976-09-07 | 1978-03-28 | Yokogawa Hokushin Electric Corp | Analog operation unit |
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|---|---|---|---|---|
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| KR20190022864A (ko) * | 2016-11-18 | 2019-03-06 | 그리 일렉트릭 어플라이언시즈, 인코포레이티드 오브 주하이 | 클록 보상 회로, 클록 회로 및 마이크로컨트롤러 |
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