JPS58101536U - スイツチ入力回路 - Google Patents
スイツチ入力回路Info
- Publication number
- JPS58101536U JPS58101536U JP19501581U JP19501581U JPS58101536U JP S58101536 U JPS58101536 U JP S58101536U JP 19501581 U JP19501581 U JP 19501581U JP 19501581 U JP19501581 U JP 19501581U JP S58101536 U JPS58101536 U JP S58101536U
- Authority
- JP
- Japan
- Prior art keywords
- row
- column
- lines
- switch
- input circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は従来のスイッチ入力回路の例を示す構成図、第
2図は本考案スイッチ入力回路の一実施例を示す構成図
、第3図は本考案の他の実施例を示す結線図、第4図は
第3図の要部例を示す結線 図である。 4、 5. 6. 8. 9. 10. 11. 12
は選択端子、7は電源端子、5jj(1りi<5. 1
<:j<:3)はスイッチ、Q□、Q2・・・・・・、
Q6はトランジスタ、 □R□、R2,・・・・・
・、R15は抵抗器である。 第1図 第4図
2図は本考案スイッチ入力回路の一実施例を示す構成図
、第3図は本考案の他の実施例を示す結線図、第4図は
第3図の要部例を示す結線 図である。 4、 5. 6. 8. 9. 10. 11. 12
は選択端子、7は電源端子、5jj(1りi<5. 1
<:j<:3)はスイッチ、Q□、Q2・・・・・・、
Q6はトランジスタ、 □R□、R2,・・・・・
・、R15は抵抗器である。 第1図 第4図
Claims (1)
- マトリックス状に配さ杆た所定数の行線及び列線を有し
、該行線及び列線の所定の交点を結線し得るように配さ
れた所定数のスイッチと、上記行線または列線の夫々一
端にベースを接続すると共にエミッタを共通に接続した
上記行または列の数に等しい数のトランジスタとを有し
、上記スイッチが操作されたときに上記列線または行線
が上記トランジスタのエミッタと略同電位になることと
関連して上記列または行の出力を発生させると共に、上
記スイッチを通して流れる電流によって上記トランジス
タが導通することと関連させて上記行または列の出力を
発生させることを特徴とするスイッチ入力回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19501581U JPS58101536U (ja) | 1981-12-29 | 1981-12-29 | スイツチ入力回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19501581U JPS58101536U (ja) | 1981-12-29 | 1981-12-29 | スイツチ入力回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58101536U true JPS58101536U (ja) | 1983-07-11 |
JPH0224276Y2 JPH0224276Y2 (ja) | 1990-07-03 |
Family
ID=30108306
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19501581U Granted JPS58101536U (ja) | 1981-12-29 | 1981-12-29 | スイツチ入力回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58101536U (ja) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4976519U (ja) * | 1972-07-10 | 1974-07-03 |
-
1981
- 1981-12-29 JP JP19501581U patent/JPS58101536U/ja active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4976519U (ja) * | 1972-07-10 | 1974-07-03 |
Also Published As
Publication number | Publication date |
---|---|
JPH0224276Y2 (ja) | 1990-07-03 |
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