JPH09121440A - Protective relay - Google Patents

Protective relay

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JPH09121440A
JPH09121440A JP7277674A JP27767495A JPH09121440A JP H09121440 A JPH09121440 A JP H09121440A JP 7277674 A JP7277674 A JP 7277674A JP 27767495 A JP27767495 A JP 27767495A JP H09121440 A JPH09121440 A JP H09121440A
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circuit
analog circuit
output
analog
relay
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JP7277674A
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Inventor
Masaaki Taira
正明 平
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Nissin Electric Co Ltd
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Nissin Electric Co Ltd
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Abstract

PROBLEM TO BE SOLVED: To realize the fail safe function of an analog circuit against abnormality without increasing the burden on a processing circuit. SOLUTION: The analog circuit of a protective relay is doubled by providing an analog circuit 21 in parallel with another analog circuit 15 and whether the difference between the outputs of the circuits 15 and 21 is equal to or smaller than a prescribed value is discriminated by means of an amplifier circuit 22 and a window comparator 23. When the difference is larger than the prescribed value, the output of a processing circuit 17 is inhibited by means of a NAND gate 24 interposed between the processing circuit 17 and an auxiliary relay 18.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は、短絡や過電圧に対
する過電流継電器として好適に用いられる保護継電器に
関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a protective relay preferably used as an overcurrent relay against a short circuit or overvoltage.

【0002】[0002]

【従来の技術】図4は、典型的な従来技術の過電流継電
器1の電気的構成を示すブロック図である。この過電流
継電器1には、母線2に介在される変流器3の2次電流
が入力される。前記2次電流は、変換抵抗4において電
圧波形に変換された後、アナログ回路5に入力される。
2. Description of the Related Art FIG. 4 is a block diagram showing an electrical configuration of a typical prior art overcurrent relay 1. The secondary current of the current transformer 3 interposed in the bus bar 2 is input to the overcurrent relay 1. The secondary current is converted into a voltage waveform by the conversion resistor 4 and then input to the analog circuit 5.

【0003】アナログ回路5は、ダイオードブリッジお
よびRC積分回路などで実現され、入力電圧波形を全波
整流・平滑化して出力する。アナログ回路5の出力は、
アナログ/デジタル変換器6においてデジタル値に変換
された後、マイクロコンピュータなどで実現される処理
回路7に入力される。処理回路7は、入力された前記デ
ジタル値と予め定める閾値とを比較し、閾値以上となる
と補助リレー8のリレーコイル9を励磁し、リレースイ
ッチ10を導通する。これによって、前記母線2に介在
されている図示しない遮断器が遮断する。
The analog circuit 5 is realized by a diode bridge, an RC integrating circuit, etc., and full-wave rectifies and smoothes the input voltage waveform and outputs it. The output of the analog circuit 5 is
After being converted into a digital value in the analog / digital converter 6, it is input to the processing circuit 7 realized by a microcomputer or the like. The processing circuit 7 compares the input digital value with a predetermined threshold value, and when the threshold value or more is exceeded, the relay coil 9 of the auxiliary relay 8 is excited and the relay switch 10 is turned on. As a result, the circuit breaker (not shown) interposed in the bus bar 2 shuts off.

【0004】[0004]

【発明が解決しようとする課題】上述の従来技術では、
アナログ回路5に異常が発生し、その出力が前記閾値以
上となると、処理回路7は誤出力を導出し、前記遮断器
が作動して停電となってしまうことになる。
In the above-mentioned prior art,
When an abnormality occurs in the analog circuit 5 and the output thereof exceeds the threshold value, the processing circuit 7 derives an erroneous output, and the circuit breaker operates to cause a power failure.

【0005】このような不具合に対する対策として、ア
ナログ回路5を二重化し、その出力をデジタル変換した
後、処理回路7で比較することが考えられる。しかしな
がらこのような構成では、処理回路7の本来の閾値判定
動作とともに、アナログ回路5の出力の比較動作が加わ
ることになり、判定に時間がかかり過ぎるとともに、ソ
フトウエアが複雑になるという問題がある。一方、過電
流発生時には、速やかに、たとえば50msec以内に
遮断器を作動させたいという要望がある。
As a countermeasure against such a problem, it may be considered that the analog circuit 5 is duplicated, its output is digitally converted, and then compared by the processing circuit 7. However, in such a configuration, the original threshold value determination operation of the processing circuit 7 and the comparison operation of the output of the analog circuit 5 are added, and there is a problem that the determination takes too long and the software becomes complicated. . On the other hand, there is a demand for activating the circuit breaker promptly when an overcurrent occurs, for example, within 50 msec.

【0006】本発明の目的は、アナログ回路の異常を速
やかに検知することができるとともに、誤出力を防止す
ることができる保護継電器を提供することである。
An object of the present invention is to provide a protective relay capable of promptly detecting an abnormality in an analog circuit and preventing an erroneous output.

【0007】[0007]

【課題を解決するための手段】本発明に係る保護継電器
は、入力波形を第1のアナログ回路で整流・平滑化し、
前記第1のアナログ回路の出力電圧をデジタル回路にお
いて、デジタル値に変換した後、予め定める第1の閾値
と比較し、該第1の閾値以上となると遮断器を遮断駆動
するようにした保護継電器において、前記第1のアナロ
グ回路と同様に構成され、かつ並列に設けられる第2の
アナログ回路と、第1のアナログ回路の出力電圧と第2
のアナログ回路の出力電圧とを比較し、両者の差が予め
定める第2の閾値以内であるか否かを判定する判定回路
と、前記判定回路の判定結果に応答し、前記差が前記第
2の閾値外であるときには、前記デジタル回路から遮断
器への遮断出力を阻止する阻止手段とを含むことを特徴
とする。
A protective relay according to the present invention rectifies and smoothes an input waveform by a first analog circuit,
A protective relay that converts the output voltage of the first analog circuit into a digital value in a digital circuit, compares it with a predetermined first threshold value, and drives the breaker to be cut off when the output voltage exceeds the first threshold value. A second analog circuit configured in the same manner as the first analog circuit and provided in parallel, an output voltage of the first analog circuit and a second analog circuit.
Of the analog circuit, and a determination circuit that determines whether or not the difference between the two is within a predetermined second threshold, and the determination circuit that responds to the determination result of the determination circuit. When it is outside the threshold value of, a blocking means for blocking the cutoff output from the digital circuit to the breaker is included.

【0008】上記の構成によれば、アナログ回路を二重
化するとともに、それらの出力の差からいずれか一方に
異常が発生しているか否かを判定する判定回路を、遮断
器を遮断駆動する既存のデジタル回路とは個別に設け、
前記デジタル回路と遮断器との間に介在した阻止手段を
その判定結果に対応して作動させる。
According to the above structure, the existing analog circuit is duplicated, and the judgment circuit for judging whether or not any one of the outputs is abnormal is driven by the circuit breaker. Provided separately from the digital circuit,
The blocking means interposed between the digital circuit and the circuit breaker is operated according to the result of the determination.

【0009】したがって、デジタル回路のソフトウエア
の負担が増加することなく、速やかにアナログ回路の異
常を検知することができるとともに、デジタル回路から
の誤出力も確実に阻止することができる。
Therefore, an abnormality in the analog circuit can be detected promptly without increasing the load on the software of the digital circuit, and erroneous output from the digital circuit can be surely prevented.

【0010】[0010]

【発明の実施の形態】本発明の実施の一形態について、
図1〜図3に基づいて説明すれば以下のとおりである。
BEST MODE FOR CARRYING OUT THE INVENTION Regarding one embodiment of the present invention,
The following is a description based on FIGS. 1 to 3.

【0011】図1は、本発明の実施の一形態の保護継電
器である過電流継電器11の電気的構成を示すブロック
図である。この過電流継電器11には、母線12に介在
される変流器13の2次電流が入力される。前記2次電
流は、変換抵抗14において電圧波形に変換された後、
第1のアナログ回路であるアナログ回路15に入力され
る。
FIG. 1 is a block diagram showing an electrical configuration of an overcurrent relay 11 which is a protective relay according to an embodiment of the present invention. The secondary current of the current transformer 13 interposed in the bus bar 12 is input to the overcurrent relay 11. After the secondary current is converted into a voltage waveform in the conversion resistor 14,
It is input to the analog circuit 15 which is the first analog circuit.

【0012】アナログ回路15は、ダイオードブリッジ
およびRC積分回路などから成り、図2(a)で示され
る入力電圧波形を、図2(b)において参照符α1で示
されるように、全波整流・平滑化して出力する。前記ア
ナログ回路15の出力電圧V1は、アナログ/デジタル
変換器16において、たとえば240Hzのサンプリン
グ周波数で、8ビットのデジタル値に変換された後、マ
イクロコンピュータなどで実現される処理回路17に入
力される。
The analog circuit 15 is composed of a diode bridge, an RC integrator circuit, etc., and converts the input voltage waveform shown in FIG. 2 (a) into a full-wave rectified signal as indicated by reference numeral α1 in FIG. 2 (b). Smooth and output. The output voltage V1 of the analog circuit 15 is converted into an 8-bit digital value at a sampling frequency of, for example, 240 Hz in an analog / digital converter 16, and then input to a processing circuit 17 realized by a microcomputer or the like. .

【0013】したがって、たとえば母線12を流れる交
流が60Hzであるときには、前記図2(b)におい
て、参照符α1で示す波形に対して、△印で示すよう
に、図2(a)で示す電圧波形の一周期T当り、4つの
データがサンプリングされる。処理回路17は、サンプ
リングされたデジタル値を予め定める期間、たとえば1
秒間に亘って、その平均値を求め、該平均値が予め定め
る第1の閾値である整定電流、たとえば2Aに対応した
値以上となると、過電流状態であると判定する。
Therefore, for example, when the alternating current flowing through the bus bar 12 is 60 Hz, the voltage shown in FIG. 2 (a), as indicated by a triangle, is added to the waveform shown by reference numeral α1 in FIG. 2 (b). Four data items are sampled per one cycle T of the waveform. The processing circuit 17 sets the sampled digital value in a predetermined period, for example, 1
The average value is obtained over a period of 2 seconds, and when the average value becomes equal to or larger than a value corresponding to a preset first preset threshold current, for example, 2 A, it is determined that an overcurrent state exists.

【0014】処理回路17は、前記出力電圧V1のデジ
タル値が前記整定電流に対応した値未満であるとき、す
なわち過電流状態でないときには、補助リレー18のリ
レーコイル19を消磁しており、これによってリレース
イッチ20が遮断し、前記母線12に介在される図示し
ない遮断器は導通状態となっている。これに対して、前
記出力電圧V1のデジタル値が前記整定電流に対応した
値以上、すなわち過電流状態となると、処理回路17は
リレーコイル19を励磁し、これによってリレースイッ
チ20が導通して、母線12に介在される遮断器が遮断
する。
The processing circuit 17 degausses the relay coil 19 of the auxiliary relay 18 when the digital value of the output voltage V1 is less than the value corresponding to the settling current, that is, when it is not in the overcurrent state. The relay switch 20 is cut off, and the circuit breaker (not shown) interposed in the bus bar 12 is in a conductive state. On the other hand, when the digital value of the output voltage V1 is equal to or more than the value corresponding to the settling current, that is, when the processing circuit 17 is in the overcurrent state, the processing circuit 17 excites the relay coil 19, whereby the relay switch 20 becomes conductive, The circuit breaker interposed in the bus bar 12 shuts off.

【0015】このように構成される既存の継電系統に対
して、本発明では、第2のアナログ回路であるアナログ
回路21を設けて、アナログ回路が二重化されるととも
に、判定回路を構成する増幅回路22およびウインドコ
ンパレータ23ならびに阻止手段であるNANDゲート
24が設けられる。
In the present invention, an analog circuit 21 which is a second analog circuit is provided to the existing relay system configured as described above, and the analog circuit is duplicated and the amplification which constitutes the determination circuit is performed. A circuit 22, a window comparator 23, and a NAND gate 24 as a blocking means are provided.

【0016】アナログ回路21は、前記アナログ回路1
5と同様に構成され、たとえば前記図2(b)において
参照符α2で示すような出力電圧V2を出力する。
The analog circuit 21 is the analog circuit 1
5 and outputs an output voltage V2 as indicated by reference numeral α2 in FIG. 2B, for example.

【0017】増幅回路22は、差動増幅器25と、入力
抵抗26,27と、帰還抵抗28とを備えて構成されて
いる。前記各アナログ回路15,21からの出力電圧V
1,V2は、それぞれ入力抵抗26,27を介して、差
動増幅器25の反転入力端子および非反転入力端子に入
力される。この差動増幅器25の出力端子と、反転入力
端子との間には、帰還抵抗28が介在されている。した
がって、差動増幅器25は、抵抗26〜28で設定され
たゲインで前記出力電圧V1とV2との差に対応した出
力電圧VSを出力する。
The amplifier circuit 22 comprises a differential amplifier 25, input resistors 26 and 27, and a feedback resistor 28. Output voltage V from each of the analog circuits 15 and 21
1, V2 are input to the inverting input terminal and the non-inverting input terminal of the differential amplifier 25 via the input resistors 26 and 27, respectively. A feedback resistor 28 is interposed between the output terminal of the differential amplifier 25 and the inverting input terminal. Therefore, the differential amplifier 25 outputs the output voltage VS corresponding to the difference between the output voltages V1 and V2 with the gain set by the resistors 26 to 28.

【0018】前記出力電圧VSは、ウインドコンパレー
タ23を構成する一対の比較器31,32の反転入力端
子および非反転入力端子にそれぞれ入力される。比較器
31の非反転入力端子には、予め定めるハイレベルの電
圧VHが入力され、これに対して比較器32の反転入力
端子には、予め定めるローレベルの電圧VLが入力され
ている。比較器31,32からの出力は、出力抵抗3
3,34を介して、前記NANDゲート24の一方の入
力に与えられる。NANDゲート24の他方の入力に
は、ライン29を介して前記処理回路17の出力が入力
され、またこのNANDゲート24の出力は、前記リレ
ーコイル19の一方の入力に接続される。リレーコイル
19の他方の入力は、ハイレベルの電源ライン30に接
続されている。
The output voltage VS is input to the inverting input terminal and the non-inverting input terminal of the pair of comparators 31 and 32 constituting the window comparator 23, respectively. A predetermined high level voltage VH is input to the non-inverting input terminal of the comparator 31, whereas a predetermined low level voltage VL is input to the inverting input terminal of the comparator 32. The output from the comparators 31 and 32 is the output resistance 3
It is supplied to one input of the NAND gate 24 via 3, 34. The output of the processing circuit 17 is input to the other input of the NAND gate 24 via the line 29, and the output of the NAND gate 24 is connected to one input of the relay coil 19. The other input of the relay coil 19 is connected to the high level power supply line 30.

【0019】また、前記出力抵抗33,34と、NAN
Dゲート24の一方の入力との接続点35は、プルアッ
プ抵抗36を介してハイレベルVHの電源ライン37に
接続されるとともに、発光ダイオード38および抵抗3
9を介してハイレベルの電源ライン40に接続されてい
る。
Further, the output resistors 33 and 34 and the NAN
A connection point 35 with one input of the D gate 24 is connected to a power supply line 37 of high level VH via a pull-up resistor 36, and a light emitting diode 38 and a resistor 3 are connected.
It is connected to the high level power supply line 40 via 9.

【0020】したがって、図3(a)で示す増幅回路2
2の出力電圧VSが、時刻t1以前で示すように、前記
電圧VL以上VH以下であるとき、すなわち前記出力電
圧V1とV2との差が比較的小さいときには、比較器3
1,32は、それぞれハイレベルの出力を導出する。こ
れによって、前記接続点35は図3(b)で示すように
ハイレベルとなって、処理回路17からの出力がNAN
Dゲート24を介して、そのまま反転されて出力される
ことになり、前記出力電圧V1が前記整定電流に対応し
た値以上であるときには、処理回路17の出力はハイレ
ベルとなってリレーコイル19は励磁され、母線12の
遮断器は遮断する。
Therefore, the amplifier circuit 2 shown in FIG.
When the output voltage VS of 2 is above the voltage VL and below VH, that is, before the time t1, that is, when the difference between the output voltages V1 and V2 is relatively small, the comparator 3
1 and 32 respectively derive high level outputs. As a result, the connection point 35 becomes high level as shown in FIG. 3B, and the output from the processing circuit 17 becomes NAN.
The output is inverted as it is through the D gate 24 and is output. When the output voltage V1 is equal to or higher than the value corresponding to the settling current, the output of the processing circuit 17 becomes high level and the relay coil 19 becomes When excited, the breaker of the bus bar 12 is cut off.

【0021】これに対して、前記時刻t1以降で示すよ
うに、出力電圧V1が出力電圧V2よりも高くなって、
出力電圧VSが高くなり、前記電圧VHより高くなる
と、比較器31はローレベルの出力を導出する。これに
よって、接続点35がローレベルとなり、処理回路17
からの出力がNANDゲート24で阻止されるととも
に、発光ダイオード38が点灯する。また同様に、前記
出力電圧V2が出力電圧V1より高くなると、前記出力
電圧VSが低くなってゆき、前記電圧VL未満となる
と、比較器32がローレベルの出力を導出し、NAND
ゲート24が処理回路17の出力を遮断するとともに、
発光ダイオード38が点灯する。
On the other hand, as shown after the time t1, the output voltage V1 becomes higher than the output voltage V2,
When the output voltage VS becomes higher and becomes higher than the voltage VH, the comparator 31 derives a low level output. As a result, the connection point 35 becomes low level, and the processing circuit 17
The output from is blocked by the NAND gate 24 and the light emitting diode 38 is turned on. Similarly, when the output voltage V2 becomes higher than the output voltage V1, the output voltage VS becomes lower, and when the output voltage V2 becomes lower than the voltage VL, the comparator 32 derives a low level output, and the NAND
The gate 24 cuts off the output of the processing circuit 17, and
The light emitting diode 38 lights up.

【0022】このようにして、出力電圧V1とV2との
差が大きくなると、アナログ回路15,21のいずれか
に異常が発生しているものと判定されて、NANDゲー
ト24を介する処理回路17の出力が遮断されて誤出力
が防止されるとともに、発光ダイオード38が点灯して
異常発生が報知される。
In this way, when the difference between the output voltages V1 and V2 becomes large, it is determined that an abnormality has occurred in one of the analog circuits 15 and 21, and the processing circuit 17 of the processing circuit 17 via the NAND gate 24 determines. The output is cut off to prevent erroneous output, and the light emitting diode 38 is turned on to notify the occurrence of abnormality.

【0023】なお、前記出力電圧VSに対する比較器3
1,32および接続点35からの出力を表すと、表1の
ようになる。
The comparator 3 for the output voltage VS
Table 1 shows the outputs from 1, 32 and the connection point 35.

【0024】[0024]

【表1】 [Table 1]

【0025】このように、本発明に従う過電流継電器1
1では、アナログ回路15,21を用いてアナログ回路
を二重化し、処理回路17から補助リレー18への誤出
力を防止して信頼性を向上するとともに、その信頼性の
向上をアナログ/デジタル変換器16および処理回路1
7から成るデジタル回路とは個別に設けた増幅回路22
およびウインドコンパレータ23によって実現するの
で、処理回路17のソフトウエアの負担が増加すること
はなく、また速やかに異常発生を検知することができ
る。
Thus, the overcurrent relay 1 according to the present invention
1, the analog circuit is duplicated by using the analog circuits 15 and 21 to prevent erroneous output from the processing circuit 17 to the auxiliary relay 18 to improve reliability, and the reliability is improved by an analog / digital converter. 16 and processing circuit 1
An amplifier circuit 22 provided separately from the digital circuit composed of 7
Since it is realized by the window comparator 23, the load on the software of the processing circuit 17 does not increase, and the occurrence of abnormality can be detected promptly.

【0026】なお、本発明は、変流器13の2次電流が
入力される過電流継電器に限らず、変成器から電圧波形
が入力される過電圧継電器に関しても実施することがで
きる。
The present invention is not limited to the overcurrent relay in which the secondary current of the current transformer 13 is input, but can be implemented in an overvoltage relay in which a voltage waveform is input from the transformer.

【0027】[0027]

【発明の効果】本発明に係る保護継電器は、以上のよう
に、入力波形を第1のアナログ回路で整流・平滑化し、
前記第1のアナログ回路の出力電圧をデジタル回路にお
いて、デジタル値に変換した後、予め定める第1の閾値
と比較し、該第1の閾値以上となると遮断器を遮断駆動
するようにした保護継電器において、第2のアナログ回
路を設けてアナログ回路を二重化し、かつデジタル回路
とは個別に設けた判定回路で2つのアナログ回路の異常
の有無を判定する。
As described above, the protective relay according to the present invention rectifies and smoothes the input waveform by the first analog circuit,
A protective relay that converts the output voltage of the first analog circuit into a digital value in a digital circuit, compares it with a predetermined first threshold value, and drives the breaker to be cut off when the output voltage exceeds the first threshold value. In (2), a second analog circuit is provided to duplicate the analog circuit, and a determination circuit provided separately from the digital circuit determines whether or not there is an abnormality in the two analog circuits.

【0028】それゆえ、アナログ回路を二重化してフェ
イルセーフを実現し、信頼性を向上するにあたって、デ
ジタル回路での負担を増加することなく、速やかにアナ
ログ回路の異常を検知して、フェイルセーフ動作を行う
ことができる。
Therefore, in order to realize the fail safe by duplicating the analog circuit and improve the reliability, the abnormality of the analog circuit is promptly detected without increasing the load on the digital circuit, and the fail safe operation is performed. It can be performed.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の実施の一形態の過電流継電器の電気的
構成を示すブロック図である。
FIG. 1 is a block diagram showing an electrical configuration of an overcurrent relay according to an embodiment of the present invention.

【図2】前記過電流継電器におけるアナログ回路の動作
を説明するための波形図である。
FIG. 2 is a waveform diagram for explaining an operation of an analog circuit in the overcurrent relay.

【図3】前記過電流継電器におけるウインドコンパレー
タの動作を説明するための波形図である。
FIG. 3 is a waveform diagram for explaining the operation of a window comparator in the overcurrent relay.

【図4】典型的な従来技術の過電流継電器の電気的構成
を示すブロック図である。
FIG. 4 is a block diagram showing an electrical configuration of a typical prior art overcurrent relay.

【符号の説明】[Explanation of symbols]

11 過電流継電器(保護継電器) 12 母線 13 変流器 14 変換抵抗 15 アナログ回路(第1のアナログ回路) 16 アナログ/デジタル変換器(デジタル回路) 17 処理回路(デジタル回路) 18 補助リレー 21 アナログ回路(第2のアナログ回路) 22 増幅回路(判定回路) 23 ウインドコンパレータ(判定回路) 24 NANDゲート(阻止手段) 25 差動増幅器 31 比較器 32 比較器 38 発光ダイオード 11 Overcurrent Relay (Protective Relay) 12 Busbar 13 Current Transformer 14 Conversion Resistor 15 Analog Circuit (First Analog Circuit) 16 Analog / Digital Converter (Digital Circuit) 17 Processing Circuit (Digital Circuit) 18 Auxiliary Relay 21 Analog Circuit (Second analog circuit) 22 Amplifier circuit (judgment circuit) 23 Window comparator (judgment circuit) 24 NAND gate (blocking means) 25 Differential amplifier 31 Comparator 32 Comparator 38 Light emitting diode

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】入力波形を第1のアナログ回路で整流・平
滑化し、前記第1のアナログ回路の出力電圧をデジタル
回路において、デジタル値に変換した後、予め定める第
1の閾値と比較し、該第1の閾値以上となると遮断器を
遮断駆動するようにした保護継電器において、 前記第1のアナログ回路と同様に構成され、かつ並列に
設けられる第2のアナログ回路と、 第1のアナログ回路の出力電圧と第2のアナログ回路の
出力電圧とを比較し、両者の差が予め定める第2の閾値
以内であるか否かを判定する判定回路と、 前記判定回路の判定結果に応答し、前記差が前記第2の
閾値外であるときには、前記デジタル回路から遮断器へ
の遮断出力を阻止する阻止手段とを含むことを特徴とす
る保護継電器。
1. An input waveform is rectified and smoothed by a first analog circuit, and an output voltage of the first analog circuit is converted into a digital value by a digital circuit, and then compared with a predetermined first threshold value. A protective relay configured to drive a circuit breaker to shut off when the voltage exceeds a first threshold value. A second analog circuit configured in the same manner as the first analog circuit and provided in parallel, and a first analog circuit. Comparing the output voltage of the second analog circuit with the output voltage of the second analog circuit, in response to the determination result of the determination circuit for determining whether the difference between the two is within a predetermined second threshold, And a blocking means for blocking a breaking output from the digital circuit to the breaker when the difference is outside the second threshold.
JP7277674A 1995-10-25 1995-10-25 Protective relay Pending JPH09121440A (en)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012222964A (en) * 2011-04-08 2012-11-12 Takaoka Electric Mfg Co Ltd Fault detection method for protection relay device, and protection relay device
KR101327575B1 (en) * 2012-07-13 2013-11-12 엘에스산전 주식회사 Digital protection relay and method for preventing mal-operation thereof

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