JPH08167909A - 出力バッファ型atmスイッチ - Google Patents
出力バッファ型atmスイッチInfo
- Publication number
- JPH08167909A JPH08167909A JP24347295A JP24347295A JPH08167909A JP H08167909 A JPH08167909 A JP H08167909A JP 24347295 A JP24347295 A JP 24347295A JP 24347295 A JP24347295 A JP 24347295A JP H08167909 A JPH08167909 A JP H08167909A
- Authority
- JP
- Japan
- Prior art keywords
- output
- cells
- switch
- input
- output line
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 240000003537 Ficus benghalensis Species 0.000 claims abstract description 18
- 238000000034 method Methods 0.000 claims abstract description 3
- 238000012545 processing Methods 0.000 abstract description 5
- 210000004027 cell Anatomy 0.000 abstract 4
- 210000004460 N cell Anatomy 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 10
- 230000006727 cell loss Effects 0.000 description 7
- 238000011017 operating method Methods 0.000 description 3
- 230000005540 biological transmission Effects 0.000 description 2
- 238000004891 communication Methods 0.000 description 2
- 230000008707 rearrangement Effects 0.000 description 2
- 238000011160 research Methods 0.000 description 2
- 238000012827 research and development Methods 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/15—Interconnection of switching modules
- H04L49/1507—Distribute and route fabrics, e.g. sorting-routing or Batcher-Banyan
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
- H04L12/5601—Transfer mode dependent, e.g. ATM
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/10—Packet switching elements characterised by the switching fabric construction
- H04L49/104—Asynchronous transfer mode [ATM] switching fabrics
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/10—Packet switching elements characterised by the switching fabric construction
- H04L49/104—Asynchronous transfer mode [ATM] switching fabrics
- H04L49/105—ATM switching elements
- H04L49/106—ATM switching elements using space switching, e.g. crossbar or matrix
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/15—Interconnection of switching modules
- H04L49/1553—Interconnection of ATM switching modules, e.g. ATM switching fabrics
- H04L49/1561—Distribute and route fabrics, e.g. Batcher-Banyan
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/15—Interconnection of switching modules
- H04L49/1553—Interconnection of ATM switching modules, e.g. ATM switching fabrics
- H04L49/1584—Full Mesh, e.g. knockout
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/20—Support for services
- H04L49/201—Multicast operation; Broadcast operation
- H04L49/203—ATM switching fabrics with multicast or broadcast capabilities
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/30—Peripheral units, e.g. input or output ports
- H04L49/3027—Output queuing
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/30—Peripheral units, e.g. input or output ports
- H04L49/3081—ATM peripheral units, e.g. policing, insertion or extraction
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
- H04L12/5601—Transfer mode dependent, e.g. ATM
- H04L2012/5678—Traffic aspects, e.g. arbitration, load balancing, smoothing, buffer management
- H04L2012/5681—Buffer or queue management
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Physics & Mathematics (AREA)
- Mathematical Physics (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】
【課題】 多数の入力セルを各出力ラインに同時に送り
出すことができる分散処理が可能であり、モジュール化
に因り具現が容易であり、各入出力ラインに入出力され
る高速のデータをスイッチのスピードアップ無しでも処
理すること。 【解決手段】 スイッチの入力ラインを通じて同時に入
って来るN個のセルを出力ライングループに従って小さ
いものから大きいものの順に配列するバッチャ−ソーテ
ィングネットワーク(BSN)401と、BSN401
から配列されたセルをそれぞれの出力ラインが属する出
力ライングループに出力する拡張型バンヤンネットワー
ク(EBRN)40と、EBRN402から出力される
セルを共同メモリのバッファに一時貯蔵した後、出力端
に送り出す出力キューイング・モジュール403を具備
する。
出すことができる分散処理が可能であり、モジュール化
に因り具現が容易であり、各入出力ラインに入出力され
る高速のデータをスイッチのスピードアップ無しでも処
理すること。 【解決手段】 スイッチの入力ラインを通じて同時に入
って来るN個のセルを出力ライングループに従って小さ
いものから大きいものの順に配列するバッチャ−ソーテ
ィングネットワーク(BSN)401と、BSN401
から配列されたセルをそれぞれの出力ラインが属する出
力ライングループに出力する拡張型バンヤンネットワー
ク(EBRN)40と、EBRN402から出力される
セルを共同メモリのバッファに一時貯蔵した後、出力端
に送り出す出力キューイング・モジュール403を具備
する。
Description
【0001】
【発明の属する技術分野】本発明は、非同期伝送方式
(Asynchronous TransferMod
e:ATM)に適用される広帯域統合サービス・デジタ
ル網(BISDN)に使用されるスイッチに関し、特
に、複数の出力グループに出力ラインを分割する出力バ
ッファ型ATMスイッチであって、同じグループ内の出
力ラインが共同バッファを使用することにより入出力ラ
イン間に複数の経路(paths)を有する出力バッフ
ァ型ATMスイッチに関する。
(Asynchronous TransferMod
e:ATM)に適用される広帯域統合サービス・デジタ
ル網(BISDN)に使用されるスイッチに関し、特
に、複数の出力グループに出力ラインを分割する出力バ
ッファ型ATMスイッチであって、同じグループ内の出
力ラインが共同バッファを使用することにより入出力ラ
イン間に複数の経路(paths)を有する出力バッフ
ァ型ATMスイッチに関する。
【0002】なお、本明細書の記述は本件出願の優先権
の基礎たる韓国特許出願第1994−34021号(1
994年12月13日出願)の明細書の記載に基づくも
のであって、当該韓国特許出願の番号を参照することに
よって当該韓国特許出願の明細書の記載内容が本明細書
の一部分を構成するものとする。
の基礎たる韓国特許出願第1994−34021号(1
994年12月13日出願)の明細書の記載に基づくも
のであって、当該韓国特許出願の番号を参照することに
よって当該韓国特許出願の明細書の記載内容が本明細書
の一部分を構成するものとする。
【0003】
【従来の技術】去る数年間ATMスイッチが活発に研究
開発され、現在試製品の生産段階にある。今まで提案さ
れたスイッチには共同(common)バッファ型、共
同媒体型、空間分割型、そして完全連結型等がある。
開発され、現在試製品の生産段階にある。今まで提案さ
れたスイッチには共同(common)バッファ型、共
同媒体型、空間分割型、そして完全連結型等がある。
【0004】しかし、共同バッファ型は、一つのバッフ
ァが全ての入出力端により共同使用されるため、これを
制御してやるプロセッサの速度がスイッチの入出力端の
数に比例するよう増加されなければならない。従って、
スイッチの入出力端の数はプロセッサの速度により制限
を受けるようになる。
ァが全ての入出力端により共同使用されるため、これを
制御してやるプロセッサの速度がスイッチの入出力端の
数に比例するよう増加されなければならない。従って、
スイッチの入出力端の数はプロセッサの速度により制限
を受けるようになる。
【0005】さらに、共同媒体型も一つの媒体を互いに
共有することにより、上記の如き制限を受けるようにな
る。故に、上記共同バッファ型および共同媒体型スイッ
チは大容量化に係る速度倍率(speed−up)の問
題点に因り大容量よりは却って小容量のスイッチとして
用いられる。
共有することにより、上記の如き制限を受けるようにな
る。故に、上記共同バッファ型および共同媒体型スイッ
チは大容量化に係る速度倍率(speed−up)の問
題点に因り大容量よりは却って小容量のスイッチとして
用いられる。
【0006】一方、空間分割型と完全連結型スイッチは
大容量化による速度倍率の問題点がないという長所を有
している。
大容量化による速度倍率の問題点がないという長所を有
している。
【0007】図1は従来の空間分割型スイッチである8
×8バンヤン(Banyan)ネットワークを示す。
×8バンヤン(Banyan)ネットワークを示す。
【0008】8×8Banyanネットワークは12個
の基本スイッチングエレメント(SE)が3ステージ
(stage)に配列される。従って、入力ラインの数
がNである場合にN×N Banyanネットワークは
log2 N×(N/2)スイッチングエレメントがlo
g2 Nステージに配列される。
の基本スイッチングエレメント(SE)が3ステージ
(stage)に配列される。従って、入力ラインの数
がNである場合にN×N Banyanネットワークは
log2 N×(N/2)スイッチングエレメントがlo
g2 Nステージに配列される。
【0009】それぞれ二つの入/出力ポートを有するス
イッチングエレメントはそれぞれの入力ポートを通じて
入力されるセルに含まれた出力ポートアドレスのうち1
ビット(bit)だけを検査し、検査したビットが1で
あると、下端の出力ポートに、そして0であると上端の
出力ポートに前記セルを出力する。
イッチングエレメントはそれぞれの入力ポートを通じて
入力されるセルに含まれた出力ポートアドレスのうち1
ビット(bit)だけを検査し、検査したビットが1で
あると、下端の出力ポートに、そして0であると上端の
出力ポートに前記セルを出力する。
【0010】上記の如き空間分割型スイッチは動作方法
が簡単で、分散処理されるに従って高速化によるスイッ
チ内部処理速度の問題点を無くし、スイッチングエレメ
ントのステージとステージ間の相互連結構造の図式化が
容易である。従って、スイッチのブロック化で大容量ス
イッチ具現による入出力ラインの数に制限を受けないた
め、広帯域総合通信網でスイッチの構造的な基本モデル
として研究と開発が活発に進められた。
が簡単で、分散処理されるに従って高速化によるスイッ
チ内部処理速度の問題点を無くし、スイッチングエレメ
ントのステージとステージ間の相互連結構造の図式化が
容易である。従って、スイッチのブロック化で大容量ス
イッチ具現による入出力ラインの数に制限を受けないた
め、広帯域総合通信網でスイッチの構造的な基本モデル
として研究と開発が活発に進められた。
【0011】
【発明が解決しようとする課題】しかし、上記の如きス
イッチはスイッチ内部や出力ラインから発生するセル衝
突現象に因り効率が極めて低いという問題点を有してい
る。すなわち、二つの入力ライン1,4を通じて入力さ
れるセルの出力ラインアドレスがそれぞれ101,10
0であるとすれば、スイッチングエレメント116の二
つの入力ポートに印加される二つのセルの出力ラインア
ドレスの最上位ビットが同一であるため、同一の出力ポ
ート0に送られて、内部セル衝突が発生するようにな
る。従って、一つのセルだけが成功的に出力ラインに送
られ、残りのセルは流失されたり、出力ポート1を通じ
て他の出力ラインに送られてセル損失が発生するように
なる。
イッチはスイッチ内部や出力ラインから発生するセル衝
突現象に因り効率が極めて低いという問題点を有してい
る。すなわち、二つの入力ライン1,4を通じて入力さ
れるセルの出力ラインアドレスがそれぞれ101,10
0であるとすれば、スイッチングエレメント116の二
つの入力ポートに印加される二つのセルの出力ラインア
ドレスの最上位ビットが同一であるため、同一の出力ポ
ート0に送られて、内部セル衝突が発生するようにな
る。従って、一つのセルだけが成功的に出力ラインに送
られ、残りのセルは流失されたり、出力ポート1を通じ
て他の出力ラインに送られてセル損失が発生するように
なる。
【0012】一方、二つの入力ライン0,7に入力され
るセルの出力ラインアドレスが全て011である場合、
二つのセルはステージ2内のスイッチングエレメント1
20の二つの入力ポート0,1を通じてそれぞれ入力さ
れて出力ラインセル衝突が発生するようになる。この
際、最下位ビットが1で同一であるため、一つのセルの
みが所望の出力ポート1を通じて出力ライン3に出力
し、残りのセルは流失されてセル損失が発生するように
なる。従って、サービス品質(Quality of
Service:QOS)の1要素である10-6のセル
損失率を考慮するとき、このようなスイッチ構造が広帯
域総合情報通信網に適用されるためには、セル衝突現象
を優先的に解決しなければならない。
るセルの出力ラインアドレスが全て011である場合、
二つのセルはステージ2内のスイッチングエレメント1
20の二つの入力ポート0,1を通じてそれぞれ入力さ
れて出力ラインセル衝突が発生するようになる。この
際、最下位ビットが1で同一であるため、一つのセルの
みが所望の出力ポート1を通じて出力ライン3に出力
し、残りのセルは流失されてセル損失が発生するように
なる。従って、サービス品質(Quality of
Service:QOS)の1要素である10-6のセル
損失率を考慮するとき、このようなスイッチ構造が広帯
域総合情報通信網に適用されるためには、セル衝突現象
を優先的に解決しなければならない。
【0013】図2は内部セル衝突を解決した従来のバッ
チャ−バンヤン(Batcher−Banyan)スイ
ッチ構造を示し、バッチャ−ソーティング(Batch
er−sorting)ネットワーク201とバンヤン
(Banyan)ネットワーク202が直列に配列され
ている。
チャ−バンヤン(Batcher−Banyan)スイ
ッチ構造を示し、バッチャ−ソーティング(Batch
er−sorting)ネットワーク201とバンヤン
(Banyan)ネットワーク202が直列に配列され
ている。
【0014】このスイッチ構造は、入力ラインのセルを
先ずバッチャ−ソーティングネットワーク201を通じ
て出力ラインアドレスが低い順から高い順へ(上から下
へ)配列する。この際、同一の出力ラインアドレスを有
するセルは互いに隣接して出力され、遊休(idle)
セルがある場合にこれらはバッチャ−ソーティングネッ
トワーク201の下部出力ラインを通じて出力される。
バッチャ−ソーティングネットワークを通じて出力され
たセルはバンヤンネットワーク202を通じてそれぞれ
所望のスイッチの出力ラインに送り出される。
先ずバッチャ−ソーティングネットワーク201を通じ
て出力ラインアドレスが低い順から高い順へ(上から下
へ)配列する。この際、同一の出力ラインアドレスを有
するセルは互いに隣接して出力され、遊休(idle)
セルがある場合にこれらはバッチャ−ソーティングネッ
トワーク201の下部出力ラインを通じて出力される。
バッチャ−ソーティングネットワークを通じて出力され
たセルはバンヤンネットワーク202を通じてそれぞれ
所望のスイッチの出力ラインに送り出される。
【0015】上記の如きバッチャ−バンヤンスイッチ
は、先ずバッチャ−ソーティングネットワークを通じて
ソーティング(sorting)を遂行した後、バンヤ
ンネットワークを通じてルーティング(routin
g)を遂行することにより、内部セル衝突を除去する。
は、先ずバッチャ−ソーティングネットワークを通じて
ソーティング(sorting)を遂行した後、バンヤ
ンネットワークを通じてルーティング(routin
g)を遂行することにより、内部セル衝突を除去する。
【0016】しかし、同一の出力端アドレスを有するセ
ル間には出力端セル衝突が依然として発生する。B−I
SDN(Broadband Integrated
Services Digital Network)
環境下ではセルの出力ラインアドレスが多様である程内
部セル衝突よりはむしろ出力ラインセル衝突によるセル
損失率がより高くなる点を考慮すると、スイッチのセル
損失率が依然として大きいという欠点を有する。
ル間には出力端セル衝突が依然として発生する。B−I
SDN(Broadband Integrated
Services Digital Network)
環境下ではセルの出力ラインアドレスが多様である程内
部セル衝突よりはむしろ出力ラインセル衝突によるセル
損失率がより高くなる点を考慮すると、スイッチのセル
損失率が依然として大きいという欠点を有する。
【0017】図3ないし図4は、別の従来技術の構成を
示し、完全連結型スイッチであるノックアウト(kno
ckout)スイッチの構成図である。
示し、完全連結型スイッチであるノックアウト(kno
ckout)スイッチの構成図である。
【0018】ノックアウトスイッチは図3の通り、全体
的にバス型の構造を有し、各バスには、図4の通り、パ
ケットフィルタ(packet filter)301
が連結されている。セルは上記パケットフィルタ301
および集信機(concentrator)302を通
じて出力バッファ303に入力される。この際、N個の
入力セルは集信機302で、図5の通り、ノックアウト
トーナメント(knockout tournamen
t)を通じてL個の出力セルに集束されて出力バッファ
303に送られる。
的にバス型の構造を有し、各バスには、図4の通り、パ
ケットフィルタ(packet filter)301
が連結されている。セルは上記パケットフィルタ301
および集信機(concentrator)302を通
じて出力バッファ303に入力される。この際、N個の
入力セルは集信機302で、図5の通り、ノックアウト
トーナメント(knockout tournamen
t)を通じてL個の出力セルに集束されて出力バッファ
303に送られる。
【0019】上記の如き完全連結型スイッチは各入力ラ
インと各出力ライン間に唯一の経路(path)を有す
るため、全ての入力セルが同時に、それらの所望の出力
ラインに送り出されるので、セル損失が発生しない理想
的な構造を有する。
インと各出力ライン間に唯一の経路(path)を有す
るため、全ての入力セルが同時に、それらの所望の出力
ラインに送り出されるので、セル損失が発生しない理想
的な構造を有する。
【0020】しかし、入力ラインの数がNであると、全
体スイッチの交叉点(cross−point)の数が
N2 と大きくなるため、大容量化によりハードウェアが
複雑となり、実現に困難があるので、その使用にあって
は大容量よりは小容量のスイッチに制限される。
体スイッチの交叉点(cross−point)の数が
N2 と大きくなるため、大容量化によりハードウェアが
複雑となり、実現に困難があるので、その使用にあって
は大容量よりは小容量のスイッチに制限される。
【0021】そこで、本発明は上記の如き問題点を解決
するために案出したもので、各入・出力ラインに入・出
力される高速データ(例えば、150Mbits/se
c)の処理が可能な出力バッファ型ATMスイッチを提
供することをその目的とする。
するために案出したもので、各入・出力ラインに入・出
力される高速データ(例えば、150Mbits/se
c)の処理が可能な出力バッファ型ATMスイッチを提
供することをその目的とする。
【0022】本発明の別の目的は、既存のスイッチより
出力を向上させることができ、スイッチの入出力ライン
間に複数経路を有するのみならず、分散処理能力とモジ
ュール化された構造を有する出力バッファ型ATMスイ
ッチを提供することである。
出力を向上させることができ、スイッチの入出力ライン
間に複数経路を有するのみならず、分散処理能力とモジ
ュール化された構造を有する出力バッファ型ATMスイ
ッチを提供することである。
【0023】
【課題を解決するための手段】上記の如き目的を達成す
るために本発明は、スイッチの入力ラインを通じて同時
に入って来るN(N=21 ,22 ,…,2n 、nは自然
数)個のセルを出力ライングループに従って小さいもの
から大きいものの順に配列するバッチャ−ソーティング
ネットワークと、上記バッチャ−ソーティングネットワ
ークから配列されたセルをそれぞれの出力ラインが属す
る出力ライングループに出力する拡張型バンヤンルーテ
ィングネットワークと、上記拡張型バンヤンルーティン
グネットワークから出力されるセルを共同メモリのバッ
ファに一時貯蔵した後、出力ラインに送り出す出力キュ
ーイング・モジュールとを具備することを特徴とする。
るために本発明は、スイッチの入力ラインを通じて同時
に入って来るN(N=21 ,22 ,…,2n 、nは自然
数)個のセルを出力ライングループに従って小さいもの
から大きいものの順に配列するバッチャ−ソーティング
ネットワークと、上記バッチャ−ソーティングネットワ
ークから配列されたセルをそれぞれの出力ラインが属す
る出力ライングループに出力する拡張型バンヤンルーテ
ィングネットワークと、上記拡張型バンヤンルーティン
グネットワークから出力されるセルを共同メモリのバッ
ファに一時貯蔵した後、出力ラインに送り出す出力キュ
ーイング・モジュールとを具備することを特徴とする。
【0024】
【発明の実施の形態】以下、本発明の一実施形態を添付
した図面を参照して詳細に説明する。
した図面を参照して詳細に説明する。
【0025】図6は本発明に係るスイッチの構成を示
し、スイッチの入力ラインを通じて同時に入って来るN
(N=21 ,22 ,…,2n 、nは自然数)個(0ない
しN−1)のセルはN×Nバッチャ−ソーティングネッ
トワーク(BSN)401により出力ライングループに
従って小さいものから大きいものの順に配列され、同一
の出力端グループに送り出されるセルは互いに隣接して
配列される。この際に、遊休(idle)セルは下端部
に出力される。
し、スイッチの入力ラインを通じて同時に入って来るN
(N=21 ,22 ,…,2n 、nは自然数)個(0ない
しN−1)のセルはN×Nバッチャ−ソーティングネッ
トワーク(BSN)401により出力ライングループに
従って小さいものから大きいものの順に配列され、同一
の出力端グループに送り出されるセルは互いに隣接して
配列される。この際に、遊休(idle)セルは下端部
に出力される。
【0026】BSN401を通じて配列されたセルは、
拡張率K(K=21 ,22 ,…,2k 、kは自然数)を
有し、log2 N−log2 C(C=21 ,22 ,…,
2c、cは自然数)のステージで構成されるN×NK拡
張型バンヤンルーティングネットワーク(EBRN)4
02によりそれぞれの出力ラインが属する出力ライング
ループに送られ、これらのセルはN/C個(Cは出力端
の数)のKC×C出力キューイング・モジュール(OQ
M:Output Queueing Module
s)403を通じてそれぞれの出力ラインに送り出され
る。
拡張率K(K=21 ,22 ,…,2k 、kは自然数)を
有し、log2 N−log2 C(C=21 ,22 ,…,
2c、cは自然数)のステージで構成されるN×NK拡
張型バンヤンルーティングネットワーク(EBRN)4
02によりそれぞれの出力ラインが属する出力ライング
ループに送られ、これらのセルはN/C個(Cは出力端
の数)のKC×C出力キューイング・モジュール(OQ
M:Output Queueing Module
s)403を通じてそれぞれの出力ラインに送り出され
る。
【0027】以下、N=8、K=2、そしてC=2であ
る場合の各構成要素の詳細構成および動作を説明する。
る場合の各構成要素の詳細構成および動作を説明する。
【0028】図7はBSNの内部構造を示し、BSNは
二つの入力ポートおよび出力ポートを有する多数のソー
ティング・エレメント(sorting elemen
t)で構成され、出力ライングループアドレスが大きい
セルはソーティング・エレメント内に表示した矢印方向
へ連結され、アドレスが小さいセルは、その反対方向へ
連結される。従って、BSNを通じて送り出されたセル
は出力ライングループアドレスが小さいものから大きい
ものの順に配列され、遊休セルは下端部に出力される。
さらに、BSN内部にはバッファを置かないため、内部
セル衝突は生じない。
二つの入力ポートおよび出力ポートを有する多数のソー
ティング・エレメント(sorting elemen
t)で構成され、出力ライングループアドレスが大きい
セルはソーティング・エレメント内に表示した矢印方向
へ連結され、アドレスが小さいセルは、その反対方向へ
連結される。従って、BSNを通じて送り出されたセル
は出力ライングループアドレスが小さいものから大きい
ものの順に配列され、遊休セルは下端部に出力される。
さらに、BSN内部にはバッファを置かないため、内部
セル衝突は生じない。
【0029】出力ライングループの大きさが2であるB
SN入力ポート(1,2,3,6)に四つのセルが入力
され、それぞれの出力ラインアドレスが1,3,1,0
である場合のBSNのルーティング(routing)
動作を考察してみれば、次の通りである。
SN入力ポート(1,2,3,6)に四つのセルが入力
され、それぞれの出力ラインアドレスが1,3,1,0
である場合のBSNのルーティング(routing)
動作を考察してみれば、次の通りである。
【0030】BSNの出力ライン(0,1,2,3)に
出力される四つのセルの出力ラインアドレスはそれぞれ
0,1,1,3であり、そのうち出力ラインアドレス
0,1,1は出力グループ0に、出力ラインアドレス3
は出力グループ1に再配列されている。
出力される四つのセルの出力ラインアドレスはそれぞれ
0,1,1,3であり、そのうち出力ラインアドレス
0,1,1は出力グループ0に、出力ラインアドレス3
は出力グループ1に再配列されている。
【0031】上記の如き再配列は、出力ラインアドレス
に従うのでなく、出力ライングループによっているた
め、同一のグループ内の他の出力ラインアドレスを有す
るセル相互間には再配列が起こらない。従って、同一の
グループ内の他の出力ラインアドレスは常に同等に配列
される。
に従うのでなく、出力ライングループによっているた
め、同一のグループ内の他の出力ラインアドレスを有す
るセル相互間には再配列が起こらない。従って、同一の
グループ内の他の出力ラインアドレスは常に同等に配列
される。
【0032】図8はEBRNの内部構造を示し、バンヤ
ンネットワークの構造を有している。
ンネットワークの構造を有している。
【0033】EBRNを構成する多数のスイッチングエ
レメント(SE)404はそれぞれ二つの入/出力ポー
トを有しており、入力ポートからのセルを出力ラインア
ドレスに従ってスイッチングエレメントの出力ポートに
伝達する。
レメント(SE)404はそれぞれ二つの入/出力ポー
トを有しており、入力ポートからのセルを出力ラインア
ドレスに従ってスイッチングエレメントの出力ポートに
伝達する。
【0034】出力ラインのアドレスはnビットの2進数
であるb0 b1 …bn-1 で示し、最上位ビットはb0 で
ある。例えば、1が最上位ビットである出力ラインのア
ドレス4は100として表すことができる。各スイッチ
ングエレメントは自身が属しているステージに従って各
入力ラインに入って来るセルの出力ラインアドレスのう
ち一つのビットだけを検査して、1であると下部出力ラ
インに、そして0であると上部出力ラインにセルを出力
する。もし、二つの入力セルの出力ラインアドレスのビ
ットが同一であると同一の出力ラインに連結されるた
め、セル衝突が発生して、結局一つのセルだけが成功的
に送り出される。
であるb0 b1 …bn-1 で示し、最上位ビットはb0 で
ある。例えば、1が最上位ビットである出力ラインのア
ドレス4は100として表すことができる。各スイッチ
ングエレメントは自身が属しているステージに従って各
入力ラインに入って来るセルの出力ラインアドレスのう
ち一つのビットだけを検査して、1であると下部出力ラ
インに、そして0であると上部出力ラインにセルを出力
する。もし、二つの入力セルの出力ラインアドレスのビ
ットが同一であると同一の出力ラインに連結されるた
め、セル衝突が発生して、結局一つのセルだけが成功的
に送り出される。
【0035】一方、図7のBSNにより再配列された出
力ラインアドレスが0,1,1,3である四つのセルは
EBRNの四つの入力ライン(0,1,2,3)を通じ
て入力されてEBRNの四つの出力ライン(0,1,
2,7)に出力される。
力ラインアドレスが0,1,1,3である四つのセルは
EBRNの四つの入力ライン(0,1,2,3)を通じ
て入力されてEBRNの四つの出力ライン(0,1,
2,7)に出力される。
【0036】OQM43はK×C=4の入力ラインとC
=2の出力ラインを有し、内部的には共同バッファ型で
それぞれの入力ラインに入って来るセルを共同メモリで
あるバッファに貯蔵して送り出す機能を遂行する。
=2の出力ラインを有し、内部的には共同バッファ型で
それぞれの入力ラインに入って来るセルを共同メモリで
あるバッファに貯蔵して送り出す機能を遂行する。
【0037】
【発明の効果】上記の通り、本発明は非同期伝送方式を
採択しているB−ISDNに用いられるATMスイッチ
で、多数の入力セルを各出力ラインに同時に送り出すこ
とができる分散処理が可能であり、モジュール化に因り
具現が容易であり、各入出力ラインに入出力される高速
のデータをスイッチのスピードアップ(speed−u
p)なしで処理できる。
採択しているB−ISDNに用いられるATMスイッチ
で、多数の入力セルを各出力ラインに同時に送り出すこ
とができる分散処理が可能であり、モジュール化に因り
具現が容易であり、各入出力ラインに入出力される高速
のデータをスイッチのスピードアップ(speed−u
p)なしで処理できる。
【0038】さらに、出力ラインバッファ型を適用する
ことによって既存のスイッチより向上された出力(en
hanced output)を得ることができるのみ
ならず、出力ライングループ内におけるマルチキャステ
ィング(multicasting)およびブロードキ
ャスティング(broadcasting)も容易であ
る。
ことによって既存のスイッチより向上された出力(en
hanced output)を得ることができるのみ
ならず、出力ライングループ内におけるマルチキャステ
ィング(multicasting)およびブロードキ
ャスティング(broadcasting)も容易であ
る。
【0039】併せて、スイッチの入出力ライン間に複数
経路が可能であるため、セル衝突を予防できるので、セ
ル損失率を低めることができる。
経路が可能であるため、セル衝突を予防できるので、セ
ル損失率を低めることができる。
【図1】バンヤンスイッチの構造図である。
【図2】バッチャ−バンヤンスイッチの構造図である。
【図3】ノックアウトスイッチの動作方法を説明するた
めの説明図である。
めの説明図である。
【図4】ノックアウトスイッチの動作方法を説明するた
めの説明図である。
めの説明図である。
【図5】ノックアウトスイッチの動作方法を説明するた
めの説明図である。
めの説明図である。
【図6】本発明に係る出力バッファ型ATMスイッチの
構成図である。
構成図である。
【図7】図6のBSNの内部構造図である。
【図8】図6のEBRNの内部構造図である。
401 バッチャ−ソーティング(Batcher−s
orting)ネットワーク(Network)(BS
N) 402 拡張型バンヤンルーティングネットワーク(E
BRN) 403 出力ラインバッファ部(OQM) 404 スイッチングエレメント(SE)
orting)ネットワーク(Network)(BS
N) 402 拡張型バンヤンルーティングネットワーク(E
BRN) 403 出力ラインバッファ部(OQM) 404 スイッチングエレメント(SE)
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ユ ゴル ウ 大韓民国 デージョン スウォク ガジョ ンドン 161 エレクトロニクス アンド テレコミュニケーションズ リサーチ インスティテュート内 (72)発明者 ジョン テ スュ 大韓民国 デージョン スウォク ガジョ ンドン 161 エレクトロニクス アンド テレコミュニケーションズ リサーチ インスティテュート内
Claims (7)
- 【請求項1】 スイッチの入力ラインを通じて同時に入
って来るN(N=21 ,22 ,…,2n 、nは自然数)
個のセルを出力ライングループに従って小さいものから
大きいものの順に配列するバッチャ−ソーティングネッ
トワークと、 上記バッチャ−ソーティングネットワークから配列され
たセルをそれぞれの出力ラインが属する出力ライングル
ープに出力する拡張型バンヤンルーティングネットワー
クと、 上記拡張型バンヤンルーティングネットワークから出力
されるセルを共同メモリのバッファに一時貯蔵した後、
出力ラインに送り出す出力キューイング・モジュールと
を具備することを特徴とする出力バッファ型ATMスイ
ッチ。 - 【請求項2】 請求項1において、上記バッチャ−ソー
ティングネットワークは、N個の入力ラインとN個の出
力ラインを有することを特徴とする出力バッファ型AT
Mスイッチ。 - 【請求項3】 請求項1において、上記拡張型バンヤン
ルーティングネットワークは、拡張率K(K=21 ,2
2 ,…,2k 、kは自然数)を有し、N個の入力ライン
とNKの出力ラインを有することを特徴とする出力バッ
ファ型ATMスイッチ。 - 【請求項4】 請求項1において、上記出力キューイン
グ・モジュールは、KC(C=21 ,22 ,…,2c 、
cは自然数)個の入力ラインとC個の出力ラインを有す
ることを特徴とする出力バッファ型ATMスイッチ。 - 【請求項5】 請求項1において、N/C(N=21 ,
22 ,…,2n 、C=21 ,22 ,…,2c ;n,cは
自然数)個の上記出力キューイング・モジュールが上記
拡張型バンヤンルーティングネットワークに並列接続さ
れていることを特徴とする出力バッファ型ATMスイッ
チ。 - 【請求項6】 請求項1において、上記バッチャ−ソー
ティングネットワークは、入力されるセルを出力ライン
グループに再配列して出力することを特徴とする出力バ
ッファ型ATMスイッチ。 - 【請求項7】 請求項1において、上記拡張型バンヤン
ルーティングネットワークは、スイッチング素子をlo
g2 N−log2 C(N=21 ,22 ,…,2n 、C=
21 ,22 ,…,2c ;n,cは自然数)のステージに
配置することを特徴とする出力バッファ型ATMスイッ
チ。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940034021A KR960027803A (ko) | 1994-12-13 | 1994-12-13 | 출력버퍼형 비동기 전송방식(atm) 스위치 |
KR1994-34021 | 1994-12-13 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH08167909A true JPH08167909A (ja) | 1996-06-25 |
Family
ID=19401336
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24347295A Pending JPH08167909A (ja) | 1994-12-13 | 1995-09-21 | 出力バッファ型atmスイッチ |
Country Status (3)
Country | Link |
---|---|
US (1) | US5612951A (ja) |
JP (1) | JPH08167909A (ja) |
KR (1) | KR960027803A (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5862128A (en) * | 1995-12-29 | 1999-01-19 | Gte Laboratories Inc | Merged buffer signal switch |
US5774463A (en) * | 1995-12-29 | 1998-06-30 | Gte Laboratories Incorporated | Switching matrix with contention arbitration |
US5813040A (en) * | 1995-12-29 | 1998-09-22 | Gte Laboratories Inc | Write controller for a CAM-based switch with lineraly searchable memory utilizing hardware-encoded status tags to indicate avaliablity of each memory location for writing |
JP3077647B2 (ja) * | 1997-11-04 | 2000-08-14 | 日本電気株式会社 | コンセントレータ型atmスイッチシステム |
JP3387868B2 (ja) * | 1999-10-20 | 2003-03-17 | 日本電気株式会社 | 出力バッファ型atmスイッチ |
Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63221740A (ja) * | 1987-03-11 | 1988-09-14 | Fujitsu Ltd | 自己ル−テイングスイツチ網制御方式 |
JPS63287140A (ja) * | 1987-05-20 | 1988-11-24 | Fujitsu Ltd | 自己ル−ティング制御装置 |
JPH01272344A (ja) * | 1988-04-25 | 1989-10-31 | Mitsubishi Electric Corp | データ伝送におけるスイッチング回路網 |
JPH0392048A (ja) * | 1989-08-29 | 1991-04-17 | American Teleph & Telegr Co <Att> | パケット伝送用交換器 |
JPH03198552A (ja) * | 1989-12-27 | 1991-08-29 | Fujitsu Ltd | Atm交換通話路システム |
JPH03236651A (ja) * | 1989-08-29 | 1991-10-22 | American Teleph & Telegr Co <Att> | パケット伝送用相互接続構造とパケットの伝送方法 |
JPH04271544A (ja) * | 1991-02-27 | 1992-09-28 | Nec Corp | Atmスイッチの多段リンク拡大方式 |
JPH04276943A (ja) * | 1991-03-05 | 1992-10-02 | Hitachi Ltd | スイッチングシステム |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0744544B2 (ja) * | 1992-01-17 | 1995-05-15 | 富士通株式会社 | 自己ルーチング機能付き相互接続網 |
US5341369A (en) * | 1992-02-11 | 1994-08-23 | Vitesse Semiconductor Corp. | Multichannel self-routing packet switching network architecture |
US5274642A (en) * | 1992-06-05 | 1993-12-28 | Indra Widjaja | Output buffered packet switch with a flexible buffer management scheme |
-
1994
- 1994-12-13 KR KR1019940034021A patent/KR960027803A/ko not_active Application Discontinuation
-
1995
- 1995-08-09 US US08/513,119 patent/US5612951A/en not_active Expired - Lifetime
- 1995-09-21 JP JP24347295A patent/JPH08167909A/ja active Pending
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63221740A (ja) * | 1987-03-11 | 1988-09-14 | Fujitsu Ltd | 自己ル−テイングスイツチ網制御方式 |
JPS63287140A (ja) * | 1987-05-20 | 1988-11-24 | Fujitsu Ltd | 自己ル−ティング制御装置 |
JPH01272344A (ja) * | 1988-04-25 | 1989-10-31 | Mitsubishi Electric Corp | データ伝送におけるスイッチング回路網 |
JPH0392048A (ja) * | 1989-08-29 | 1991-04-17 | American Teleph & Telegr Co <Att> | パケット伝送用交換器 |
JPH03236651A (ja) * | 1989-08-29 | 1991-10-22 | American Teleph & Telegr Co <Att> | パケット伝送用相互接続構造とパケットの伝送方法 |
JPH03198552A (ja) * | 1989-12-27 | 1991-08-29 | Fujitsu Ltd | Atm交換通話路システム |
JPH04271544A (ja) * | 1991-02-27 | 1992-09-28 | Nec Corp | Atmスイッチの多段リンク拡大方式 |
JPH04276943A (ja) * | 1991-03-05 | 1992-10-02 | Hitachi Ltd | スイッチングシステム |
Also Published As
Publication number | Publication date |
---|---|
US5612951A (en) | 1997-03-18 |
KR960027803A (ko) | 1996-07-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5892932A (en) | Reprogrammable switching apparatus and method | |
US5875190A (en) | Asynchronous transfer mode switching system | |
US5687172A (en) | Terabit per second distribution network | |
KR100211123B1 (ko) | 고속 패킷 스위칭을 위한 다단 상호 연결 망 | |
US6147999A (en) | ATM switch capable of routing IP packet | |
WO1997019407A9 (en) | A method and apparatus for switching | |
EP0593609A1 (en) | High speed switching architecture | |
Guo et al. | Multicast ATM switches: Survey and performance evaluation | |
Widjaja et al. | The helical switch: A multipath ATM switch which preserves cell sequence | |
Hui | Switching integrated broadband services by sort-banyan networks | |
JPH08167909A (ja) | 出力バッファ型atmスイッチ | |
JP2764017B2 (ja) | 制御交換素子を用いる分配装置 | |
Rathgeb et al. | ATM switches—basic architectures and their performance | |
JP3077647B2 (ja) | コンセントレータ型atmスイッチシステム | |
Kannan et al. | MSXmin: a modular multicast ATM packet switch with low delay and hardware complexity | |
JP2724174B2 (ja) | 分配接続可能なatm交換装置 | |
Yang et al. | BATMAN: A new architectural design of a very large next generation gigabit switch | |
WO1990005419A1 (en) | Distributed router of connectionless packets over connection oriented networks | |
KR100383604B1 (ko) | 비동기 전송모드 교환망 구조 및 자기 경로 설정 방법 | |
Guo et al. | A simple multicast ATM switches based on broadcast buses | |
Pibulyarojana et al. | A study on a hybrid dilated banyan network | |
KR0150622B1 (ko) | 대용량화에 적합한 비동기 전송모드 스위칭 시스템 | |
US5475708A (en) | Circuit arrangement with at least one input and at least one output for forwarding an input signal that can be filtered, parallelized and digitized | |
JP3012313B2 (ja) | コピースイッチ網 | |
Chen et al. | PPCN: a high-performance copy network for large scale ATM switching systems |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19971121 |