JPH0755702Y2 - Shift track circuit - Google Patents
Shift track circuitInfo
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- JPH0755702Y2 JPH0755702Y2 JP10735889U JP10735889U JPH0755702Y2 JP H0755702 Y2 JPH0755702 Y2 JP H0755702Y2 JP 10735889 U JP10735889 U JP 10735889U JP 10735889 U JP10735889 U JP 10735889U JP H0755702 Y2 JPH0755702 Y2 JP H0755702Y2
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- counter
- switching signal
- pulse
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Description
【考案の詳細な説明】 （イ）産業上の利用分野 本考案は、８ミリビデオのシフトトラック回路に関す
る。DETAILED DESCRIPTION OF THE INVENTION (a) Field of Industrial Application The present invention relates to an 8 mm video shift track circuit.
（ロ）従来の技術 ビデオテープレコーダは、そのメカニズム製造工程に於
てシリンダに対するテープの巻付状態を調整するため、
テープの巻付状態を規定するガイドの位置や方向を変更
している。(B) Conventional technology The video tape recorder adjusts the winding state of the tape around the cylinder in the mechanism manufacturing process.
The position and direction of the guide that regulates the tape winding state have been changed.
この調整は、スタンダードテープを再生した状態で再生
エンベロープが一定となる様に為される。This adjustment is made so that the reproduction envelope becomes constant when the standard tape is reproduced.
しかし、多くのビデオテープレコーダは、再生ヘッドの
走査の幅が記録トラック幅より広く、記録トラックを10
0％走査することは容易であるものの記録トラックの中
心と再生走査跡が完全に一致しているか否かを判別する
ことは出来ない。However, in many video tape recorders, the scanning width of the reproducing head is wider than the recording track width, and the recording track width is 10
Although it is easy to perform 0% scanning, it is impossible to determine whether or not the center of the recording track and the reproduction scanning trace are completely coincident with each other.
そこで、調整は、再生出力レベルが不安定で変動し易い
臨界再生状態で為され、この臨界再生状態は再生ヘッド
の走査タイミングを一定期間シフトすることにより実現
される。Therefore, the adjustment is performed in a critical reproduction state in which the reproduction output level is unstable and easily fluctuates, and this critical reproduction state is realized by shifting the scanning timing of the reproduction head for a certain period.
このタイミングシフトは、８ミリビデオの場合リファレ
ンス信号の切換タイミングをヘッド出力切換タイミング
に対して一定量シフトすることによって実現される。そ
の結果、再生ヘッドは、目標とする記録トラックを部分
的に走査する。この走査状態をシフトトラックと称す
る。This timing shift is realized by shifting the reference signal switching timing by a fixed amount with respect to the head output switching timing in the case of 8 mm video. As a result, the reproducing head partially scans the target recording track. This scanning state is called a shift track.
このシフトトラックのため従来は、ヘッド出力切換パル
スを入力してタイムシフトしたリファレンス信号切換信
号を発生する特別の調整回路を治具として調整時に接続
していた。For this shift track, conventionally, a special adjustment circuit for inputting a head output switching pulse and generating a time-shifted reference signal switching signal is connected as a jig during adjustment.
尚、第３図は、本来の再生走査位置Ａと臨界再生状態の
再生走査位置Ｂの関係を示す図である。Incidentally, FIG. 3 is a diagram showing the relationship between the original reproduction scanning position A and the reproduction scanning position B in the critical reproduction state.
（ハ）考案が解決しようとする問題点 しかし、上述する従来例の場合、治具としての調整回路
を調整の度に接続し面倒な操作をしなければならなかっ
た。(C) Problems to be solved by the invention However, in the case of the above-mentioned conventional example, it was necessary to connect an adjusting circuit as a jig for every adjustment and perform a troublesome operation.
そこで、調整治具を用いることなく製品側にシフトトラ
ック機能を付加する必要性が生ずる。Therefore, it becomes necessary to add a shift track function to the product side without using an adjusting jig.
（ニ）課題を解決するための手段 本考案は、シリンダモータの回転位相検出出力をリセッ
ト入力とし回転速度検出出力を計数入力とするカウンタ
と、プリセットとアップ・ダウン計数が可能なプリセッ
トカウンタと、前記両カウンタ出力が一致したとき一致
出力を発する比較手段と、前記一致出力に同期してリフ
ァレンス信号切換信号を形成導出する切換信号発生手段
と、操作スイッチの操作に応答して前記プリセットカウ
ンタを制御するシステムコントローラとを設けることを
特徴とする。(D) Means for Solving the Problems The present invention is a counter that uses a rotation phase detection output of a cylinder motor as a reset input and a rotation speed detection output as a count input, and a preset counter capable of presetting and up / down counting, Comparing means for issuing a coincidence output when the outputs of both counters coincide, switching signal generating means for forming and deriving a reference signal switching signal in synchronization with the coincidence output, and controlling the preset counter in response to operation of an operation switch. And a system controller that operates.
（ホ）作用 よって、本考案によれば、操作スイッチによりシフトト
ラックモードの設定及びシフト量の変更が実現される。(E) Operation Therefore, according to the present invention, the setting of the shift track mode and the change of the shift amount are realized by the operation switch.
（ヘ）実施例 以下、本考案を図示せる一実施例に従い説明する。(F) Embodiment Hereinafter, the present invention will be described with reference to an embodiment.
本実施例は第１図に図示する様に、シリンダＳに対して
テープＪを270°強巻付ける８ミリビデオに本考案を採
用するものである。In this embodiment, as shown in FIG. 1, the present invention is applied to an 8 mm video in which a tape J is strongly wound around a cylinder S by 270 °.
まず本実施例では、マイクロコンピュータで構成され通
常モードで対応する操作スイッチに応答してビデオテー
プレコーダのモードを設定するシステムコントローラー
１の２本のテストピンTPTをショートすることによりタ
イミングシフトモードを設定する。このタイミングシフ
トモードで記録スイッチS2を操作すると、ビデオテープ
レコーダは再生モードに設定されると共に、サーボ用マ
イクロコンピュータのプリセットカウンタ２にプリセッ
トパルスを供給する。このプリセットカウンタ２は、プ
リセットパルスを受けてその値を“9"に設定する。First, in this embodiment, the timing shift mode is set by short-circuiting the two test pins TPT of the system controller 1 which is configured by a microcomputer and sets the mode of the video tape recorder in response to the corresponding operation switch in the normal mode. To do. When the recording switch S2 is operated in this timing shift mode, the video tape recorder is set to the reproduction mode and the preset pulse is supplied to the preset counter 2 of the servo microcomputer. The preset counter 2 receives the preset pulse and sets its value to "9".
また、シリンダＳを45回転/secで駆動するシリンダモー
タ８からは45HzのPGパルスPGと、720HzのFGパルスFGが
導出されている。前記PGパルスPGは、1/3分周回路７に
入力され、その結果得られる分周パルスDPは、12進カウ
ンタ４と48進カウンタ５をリセットしている。これらの
カウンタ４、５は、前記FGパルスFGを計数入力としてい
る。A 45 Hz PG pulse PG and a 720 Hz FG pulse FG are derived from the cylinder motor 8 that drives the cylinder S at 45 revolutions / sec. The PG pulse PG is input to the 1/3 frequency dividing circuit 7, and the frequency dividing pulse DP obtained as a result resets the 12-ary counter 4 and the 48-ary counter 5. These counters 4 and 5 use the FG pulse FG as a count input.
尚前記48進カウンタ５は4bitの12進カウンタとその上位
の2bitの４進カウンタにて構成されており、この４進カ
ウンタの出力B5、B6が切換信号発生手段６のデータ入力
とされる。The 48-ary counter 5 is composed of a 4-bit 12-bit counter and an upper 2-bit quaternary counter. The outputs B5 and B6 of the 4-ary counter are used as the data input of the switching signal generating means 6.
前記12進カウンタ４のカウント出力と、前記プリセット
カウンタ２のプリセット出力は比較手段３に入力され、
両出力が一致したときに一致パルスIPを前記切換信号発
生手段６のラッチパルスとして入力している。The count output of the 12-decimal counter 4 and the preset output of the preset counter 2 are input to the comparison means 3,
When both outputs match, the matching pulse IP is input as the latch pulse of the switching signal generating means 6.
前記切換信号発生手段６は、モード制御信号により機能
を変更しており、タイミングシフトモードに於て２個の
Ｄタイプフリップフロップより成るラッチ回路として機
能しており、2bitのラッチ出力R1・R2をリファレンス信
号切換信号として導出している。The switching signal generating means 6 has its function changed by a mode control signal, and functions as a latch circuit composed of two D-type flip-flops in the timing shift mode, and outputs 2-bit latch outputs R1 and R2. It is derived as a reference signal switching signal.
その結果、リファレンス信号切換信号は、FGパルスFG9
個分遅れて導出されることになる。尚、前記切換信号発
生手段６は、通常モードでヘット出力切換パルスRFを計
数入力とする2bitのカウンタとして機能しており、ヘッ
ド出力切換パルスRFは前記PGパルスPGに対してFGパルス
FG約4.5周期分の位相遅れを持っているものとする。As a result, the reference signal switching signal is FG pulse FG9.
It will be derived with a delay. The switching signal generating means 6 functions as a 2-bit counter that counts the head output switching pulse RF in the normal mode, and the head output switching pulse RF is an FG pulse with respect to the PG pulse PG.
It is assumed that the FG has a phase delay of about 4.5 cycles.
従って、リファレンス信号切換信号は、タイミングシフ
トモードに於て通常モードに比しFGパルスFG約4.5周期
分遅れることになる。Therefore, the reference signal switching signal is delayed by about 4.5 cycles of the FG pulse FG in the timing shift mode as compared with the normal mode.
この遅れたリファレンス信号切換信号を入力するリファ
レンス信号発生回路９は切換タイミングの遅れたリファ
レンス信号を発生する。キャプスタンサーボ回路10は、
再生パイロット信号とリファレンス信号を入力してキャ
プスタンモータ11の回転を遅らせて臨界再生状態を実現
している。The reference signal generation circuit 9 which inputs the delayed reference signal switching signal generates a reference signal with a delayed switching timing. The capstan servo circuit 10
By inputting the reproduction pilot signal and the reference signal, the rotation of the capstan motor 11 is delayed to realize the critical reproduction state.
しかし、前記キャプスタンサーボ回路10は、その特性に
バラ付きがあり、再生出力レベルが臨界出力レベルとな
らないことがある。そこで、本実施例では早送スイッチ
S1を操作したときカウントアップパルスを、また、巻戻
しスイッチS3を操作したときカウントダウンパルスを前
記プリセットカウンタ２に入力する様に前記シフトコン
トローラ１を構成している。従って、プリセットによっ
て臨界再生状態とならない場合は、再生出力レベルをモ
ニタし乍ら早送りスイッチS1や巻戻しスイッチS3を操作
し、再生出力レベルが臨界レベルとなる様に、プリセッ
ト値を変更することが可能となる。However, the capstan servo circuit 10 may have variations in its characteristics, and the reproduction output level may not reach the critical output level. Therefore, in this embodiment, the fast-forward switch
The shift controller 1 is configured so that a count-up pulse is input to the preset counter 2 when S 1 is operated and a count-down pulse is input when the rewind switch S 3 is operated. Therefore, if the critical playback state is not reached by presetting, the playback output level is monitored and the fast-forward switch S 1 or rewind switch S 3 is operated to change the preset value so that the playback output level becomes the critical level. It becomes possible.
この様にして形成された臨界再生状態で、再生出力レベ
ルが一定となる様に、シリンダＳに対するテープ巻付状
態を規定するガイドＧ・Ｇ・Ｇ・Ｇの位置及び角度を調
整つる。調整後、テストポイントの単絡を解除すればシ
フトトラックモードは解除される。In the critical reproduction state thus formed, the positions and angles of the guides G, G, G, G defining the tape winding state with respect to the cylinder S are adjusted so that the reproduction output level becomes constant. After the adjustment, the shift track mode is released if the single point of the test point is released.
（ト）考案の効果 上述する様に本考案によれば、シフトトラック回路を、
サーボ用のマイクロコンピュータとシステムコントロー
ラのマイクロコンピュータのソフトウェアによって構成
しており、簡単なプログラムの変更により、ビデオテー
プレコーダ本体内にシフトトラック機能を追加すること
が出来、その効果は大である。(G) Effect of the Invention As described above, according to the present invention, the shift track circuit is
It is composed of the software of the microcomputer for the servo and the microcomputer of the system controller, and the shift track function can be added in the main body of the video tape recorder by a simple program change, and the effect is great.
第１図は本考案の一実施例を示す回路ブロック図、第２
図は同要部信号波形説明図、第３図はトラッキング状態
説明図を、それぞれ示す。 （１）…システムコントローラ、（２）…プリセットカ
ウンタ、（４）…（12進）カウンタ、（３）…比較手
段、（６）…切換信号発生手段FIG. 1 is a circuit block diagram showing an embodiment of the present invention, and FIG.
FIG. 3 is an explanatory diagram of signal waveforms of the main part, and FIG. 3 is an explanatory diagram of a tracking state. (1) ... System controller, (2) ... Preset counter, (4) ... (Decimal) counter, (3) ... Comparison means, (6) ... Switching signal generation means
フロントページの続き (56)参考文献 特開 昭63−268155（ＪＰ，Ａ) 特開 昭62−1162（ＪＰ，Ａ) 特開 昭60−111363（ＪＰ，Ａ) 特開 平２−76154（ＪＰ，Ａ) 特開 昭63−316351（ＪＰ，Ａ) 特開 昭61−94577（ＪＰ，Ａ) 特開 昭61−84175（ＪＰ，Ａ) 特開 昭61−187148（ＪＰ，Ａ) 特開 昭54−48210（ＪＰ，Ａ) 実開 昭60−16343（ＪＰ，Ｕ)Continuation of the front page (56) Reference JP-A 63-268155 (JP, A) JP-A 62-1162 (JP, A) JP-A 60-111363 (JP, A) JP-A 2-76154 (JP , A) JP 63-316351 (JP, A) JP 61-94577 (JP, A) JP 61-84175 (JP, A) JP 61-187148 (JP, A) JP 54-48210 (JP, A) Actually opened Sho-60-16343 (JP, U)
Claims (1)
て臨界再生状態を設定するビデオテープレコーダに於
て、 シリンダモータの回転位相検出出力をリセット入力とし
回転速度検出出力を計数入力するカウンタと、 所定値がプリセットされると共にアップ・ダウン計数を
可能とするプリセットカウンタと、 前記カウンタ及び前記プリセットカウンタの出力を比較
し一致出力を発する比較手段と、 前記一致出力に同期してリファレンス信号切換信号を形
成導出する切換信号発生手段と、 操作スイッチの操作に応答して前記プリセットカウンタ
に所定値をプリセットすると共にアップ・ダウン計数を
実行せしめるシステムコントロール回路とを、 それぞれ配して成るシフトトラック回路。1. A video tape recorder for phase-shifting a reference signal switching signal to set a critical reproduction state, a counter for inputting a rotational phase detection output of a cylinder motor as a reset input, and a rotational speed detection output for counting input, and a predetermined counter. A preset counter for presetting a value and enabling up / down counting, a comparing means for comparing outputs of the counter and the preset counter to generate a coincidence output, and forming a reference signal switching signal in synchronization with the coincidence output. A shift track circuit comprising a switching signal generating means for deriving and a system control circuit for presetting a predetermined value in the preset counter and executing up / down counting in response to an operation of an operation switch.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10735889U JPH0755702Y2 (en) | 1989-09-13 | 1989-09-13 | Shift track circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10735889U JPH0755702Y2 (en) | 1989-09-13 | 1989-09-13 | Shift track circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0349644U JPH0349644U (en) | 1991-05-15 |
| JPH0755702Y2 true JPH0755702Y2 (en) | 1995-12-20 |
Family
ID=31656050
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10735889U Expired - Fee Related JPH0755702Y2 (en) | 1989-09-13 | 1989-09-13 | Shift track circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0755702Y2 (en) |
-
1989
- 1989-09-13 JP JP10735889U patent/JPH0755702Y2/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0349644U (en) | 1991-05-15 |
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