JPH0749664A - 放電パネル駆動装置 - Google Patents
放電パネル駆動装置Info
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- JPH0749664A JPH0749664A JP5196003A JP19600393A JPH0749664A JP H0749664 A JPH0749664 A JP H0749664A JP 5196003 A JP5196003 A JP 5196003A JP 19600393 A JP19600393 A JP 19600393A JP H0749664 A JPH0749664 A JP H0749664A
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Abstract
し、表示階調数と発光輝度との関係を調整可能にする。 【構成】 放電時間に応じたパルスの波形制御信号を出
力する波形リードオンリメモリタイミング制御回路25
と、上記放電パルスの個数をR,G,Bの色信号につい
てモード別に選択する波形リードオンリメモリモード選
択回路26との各出力にもとづき、上記パルスのプログ
ラム制御データを出力する波形リードオンリメモリ24
とを設け、該波形リードオンリメモリからのプログラム
制御データにもとづき行の電極および列の電極を行側お
よび列側の各ドライバにより駆動させる。
Description
ス調整を実施する放電パネル駆動装置に関するものであ
る。
ID89−73(1990年1月18日発行)の「20
型カラー放電ディスプレイにおけるテレビ画質の改
善」,関昌彦他に示された従来の放電パネル表示装置を
示す構成図であり、図において、1は前面板、2は背面
板、3は土手、4はプライミング用空間、5は表示セ
ル、6は補助セル、7は陰極、8は陽極、9は補助陽極
である。
るマトリックス型表示装置の制御回路を示すブロック図
であり、図において、11は表示パネル、12は表示制
御信号発生器、13はフレームメモリ、14は陰極駆動
回路、15は表示陽極駆動回路、16は補助陽極駆動回
路である。
置の各電極7,8と表示セル5の動作を示すタイミング
図であり、図11はこのマトリックス型表示装置におけ
る1フィード間の発光時間と階調制御の関係を示す説明
図である。
ない定電流源より正電圧が印加されている上記補助陽極
9と、図10に示す走査パルスが印加される陰極7との
間には、補助放電が発生する。この放電で生じた準安定
粒子は、補助セル6から表示セル5へプライミング用空
間4を通じて拡散する。
は、陽極8に正電圧の書込パルスが印加され、負電圧の
走査パルスが印加されている陰極7との間で放電を発生
させる。
すように一定期間維持レベルを保つので、放電が生じた
表示セル5では、表示陽極8に連続して印加される維持
パルスによって、連続的な維持放電が発生する。維持放
電は陰極7への消去パルスの印加によって停止する。
フレームメモリ13の1つのアドレスと表示パネル11
の各ドットが1対1に対応し、フレームメモリ13の1
つのアドレスの深さが8ビットとして説明する。
陰極駆動回路14による陰極の走査が上から下へ順次行
なわれ、データ表示の有無に関係なく補助陽極駆動回路
16によって補助陽極9に正電圧が印加されると、補助
放電が発生し、陰極走査に従って、この補助放電も上か
ら下へ順次移行する。
出され、表示陽極駆動回路15を経由して走査タイミン
グに合せて陽極8に出力され、表示データが有効な時、
陽極8に正の書込パルスが印加されて、補助放電直後の
プライミング効果によって、表示放電が行なわれる。
の走査用負電圧パルスだけ印加されるので、表示放電は
行なわない。
時に、1つのサブフィールドが終了する。この1つのサ
ブフィールドでは、フレームメモリ13の深さ8ビット
のうちの1つのビットについて表示を行う。従って、こ
の場合サブフィールドの数は8個となるサブフィールド
の構成内容を図11に示す。
トすなわち最上位ビット(MSB)の第7ビットの表示
走査を行い、それから順に重みの小さいビットの表示走
査を行って、最後に一番重みの小さいビットすなわち最
下位ビット(LSB)の第0ビットの表示走査を行う様
子が示されている。
さに反映させる為に、書込み後の発光維持期間をビット
の重みに応じて変化させている。発光維持期間の制御は
先に述べた消去パルスの印加タイミングによって行う。
発光維持期間の長さを維持パルスによる維持放電回数に
よって表わすと第7ビットで384回、第6ビットはそ
の半分で192回となり、最後の第0ビットは第7ビッ
トの128分の1で3回となる。
6階調の表示が可能となる。表示デューティはサブフィ
ールド「7」を100%とみなすと、サブフィールド
「6」が50%と、順に半減して、1フィールド全体で
は25%となる。
装置は以上のように構成されているので、表示時のカラ
ーバランスについて対策されておらず、カラー化におい
ては何らかのカラーバランスが必要で、また、256階
調制御においては、輝度が犠牲になるなどの問題点があ
った。
消するためになされたもので、カラーバランスの調整が
できるとともに、多階調制御の階調数と輝度の関係を調
整できる放電パネル駆動装置を得ることを目的とする。
ンタ回路の動作周波数を単位としたパルス幅調整を高精
度に実施できる放電パネル駆動装置を得ることを目的と
する。
設定により鮮明画像を得ることができる放電パネル駆動
装置を得ることを目的とする。
維持パルスR,G,Bの関係を変化させることで、良好
なカラーバランスを設定できる放電パネル駆動装置を得
ることを目的とする。
ランスを設定できる放電パネル駆動装置を得ることを目
的とする。
電パネル駆動装置は、放電時間に応じたパルスの波形制
御信号を出力する波形リードオンリメモリタイミング制
御回路と、上記パルスの幅をR,G,Bの色信号につい
てモード別に選択する波形リードオンリメモリモード選
択回路と、該波形リードオンリメモリモード選択回路お
よび上記波形リードオンリメモリタイミング制御回路の
各出力にもとづき、上記パルスのプログラム制御データ
を出力する波形リードオンリメモリとを設け、該波形リ
ードオンリメモリからのプログラム制御データにもとづ
き、行の電極および列の電極を行側および列側の各ドラ
イバにより駆動させるようにしたものである。
は、立ち上がりタイミングおよび立ち下がりタイミング
を示すパルスデータを出力する波形データ生成回路と、
上記パルスデータの立ち上がりタイミングのパルスデー
タおよび立ち下がりタイミングのパルスデータをラッチ
する第1のラッチバッファおよび第2のラッチバッファ
と、該第1のラッチバッファおよび第2のラッチバッフ
ァの出力値とカウンタ回路からの刻々変化する出力値と
を比較する第1のコンパレータおよび第2のコンパレー
タとを設け、セットリセットフリップフロップを、上記
第1のコンパレータにおいて比較される各値が一致した
ときを維持パルスの立ち上がりタイミングとしてセット
させ、上記第2のコンパレータにおいて比較される各値
が一致したときを維持パルスの立ち下がりタイミングと
してリセットさせるようにしたものである。
は、所定の発光輝度を得るための階調数を選択する階調
数選択回路と、該階調数選択回路の出力にもとづいて、
表示の1フィールドにおけるサブフィールドの個数を制
御するフィールド制御回路と、放電に必要な放電パルス
のプログラム制御データを出力する波形リードオンリメ
モリとを設け、該リードオンリメモリおよび上記フィー
ルド制御回路の各出力にもとづき、行側および列側の各
ドライバに、発光輝度および階調数が調整されるよう
に、放電パネルの行の電極および列の電極を駆動させる
ようにしたものである。
は、サブフィールドごとにR,G,Bの各維持パルスの
パルス幅を調整するように、上記波形リードオンリメモ
リのモード選択回路を制御するフィールド制御回路を設
けたものである。
は、サブフィールドごとにR,G,Bの各維持パルスの
パルス幅を調整するように、波形データ生成回路を制御
するフィールド制御回路を設けたものである。
は、維持パルスのパルス幅をR,G,Bの各色ごとに変
化させることで、各色ごとの放電強度を変化させ、発光
色のカラーバランスをとる。
置は、波形データ生成回路を構成する論理回路により、
カウンタ回路の動作周波数を単位としたパルス幅の精度
の高い微調整を可能にする。
置は、階調数選択回路によって表示階調数を選択するこ
とで、表示デューティを上げ、全体の輝度を向上させ
る。
置は、サブフィールドごとに各維持パルスR,G,Bの
関係を変化させ、発光色のカラーバランスをとらせるよ
うにする。
置は、論理回路で構成されたパルス発生器より出力され
る各維持パルスR,G,Bの関係を変化させ、より精度
の高いカラーバランスが得られるようにする。
て説明する。図1において、21は放電パネル、22は
行側ドライバ、23は列側ドライバ、24は波形メモリ
としての波形リードオンリメモリ(以下、波形ROMと
いう)、25は波形ROMタイミング制御回路(波形リ
ードオンメモリタイミング制御回路)、26は波形RO
Mモード選択回路(波形リードオンメモリモード選択回
路)である。
分離された列側ドライバ23に印加されるそれぞれの維
持パルスと、波形ROMモード選択回路26のモード選
択状態とを示すタイムチャートである。
ネル21に映像を表示する場合には、行側ドライバ22
と列側ドライバ23を、波形ROMタイミング制御回路
25によって制御される波形ROM24の出力である制
御パルスで駆動し、目的とする放電セルに放電を生じさ
せ、さらに表示データの重みに応じた回数分だけ維持放
電を行う。
素がR,G,B用の三つの放電セルで構成されることに
なるが、通常R,G,Bの発光色は紫外線で蛍光体を励
起して得る為、同一条件で放電させれば、バランスのと
れた発光色が得られるというものではない。従って維持
パルスのパルス幅をR,G,Bごとにそれぞれ調整し
て、発光色のカラーバランスを調整する。
択回路26で選択されたモードAの状態では、各維持パ
ルスR,G,Bのパルス幅が同一であり、モードBの状
態になると、維持パルスRの幅が大きくなり、維持パル
スGはそのまま、維持パルスBの幅は小さくなる。
まり、B色の発光強度は弱まる。そして、モード数を増
やしてあらゆる維持パルスの組み合せを備えれば、カラ
ーバランスの調整が容易に行えることとなる。
生器として波形ROM24を用いたものを示したが、論
理回路によって精度の高いパルス発生器を構成すること
もできる。図3はこの実施例を示す。
イプのフリップフロップ、28および29は各フリップ
フロップ27のセット入力端子およびリセット入力端子
に接続された複数組の第1のコンパレータおよび第2の
コンパレータとしてのコンパレータ、30および31は
各コンパレータ28,29に接続された第1のラッチバ
ッファおよび第2のラッチバッファとしてのラッチバッ
ファ、32はカウンタ回路、33は波形データ生成回路
であり、操作入力部、プロセッサ部、ラッチバッファや
シフトレジスタなどから構成される。
から各維持パルスR,G,Bの立ち上りタイミングと立
ち下りタイミングを示すデータが出力される。このう
ち、維持パルスRの立ち上りタイミングデータはラッチ
バッファ30にラッチされ、維持パルスRの立ち下りタ
イミングを示すデータはラッチバッファ31にラッチさ
れる。
出力値と刻々と変化するカウンタ回路32の出力値を比
較し、両者が一致した時を維持パルスRの立ち上りタイ
ミングとして、セットリセットフリップフロップ27を
セットし、一方、コンパレータ29はラッチバッファ3
1の出力値とカウンタ回路32の出力値を比較し、両者
が一致した時を維持パルスRの立ち下りタイミングとし
て、セットリセットフリップフロップ27をリセットす
る。
成される。なお、維持パルスGおよび維持パルスBも独
立した同様の回路動作によって生成される。
使った場合、パルス幅のパターン数がROMの持つアド
レス入力数によって制限されるが、この実施例の波形デ
ータ生成回路33を構成する論理回路では、カウンタ回
路32の動作周波数を単位とした微調整が可能となる。
ル・ゲートアレー(FPGA)等のカスタムICの普及
により、簡単なハードウエアで実現できる。
の為に、1フィールドを8個のサブフィールドに分割し
て走査しているので、表示デューティが25%であった
が、発光輝度と階調数を選択して、表示デューティを向
上させることができる。
34は階調表示に必要なサブスキャンを制御するフィー
ルド制御回路であり、8ビット256階調の場合、1フ
ィールドを8個のサブフィールドに分割して表示制御を
行う。
方、全体の輝度を向上させたい時には、階調数選択回路
35が動作して、所望の階調数の制御波形がフィールド
制御回路34より出力されるようにして、表示デューテ
ィを上げる。
ィールド構成を示し、この場合の表示デューティは50
%である。階調数をさらに減らして1ビット2値表示と
すれば表示デューティは100%となる。
が高ければ輝度が不足しても画質は鮮明であるので、階
調数が多い時には輝度が落ちて階調数が少ない時には輝
度が上がるという本実施例は、有意義な機能である。
よって発生する紫外線の量や、紫外線によって励起され
る蛍光体の特性などさまざまな条件が影響する為に、放
電回数との関係が非線形となる場合があり、例えば8ビ
ット256階調で表示する時、MSBすなわち最上位ビ
ットを表示するサブフィールドでバランスされた各維持
パルスR,G,Bの関係を、そのままLSBすなわち最
下位ビットを表示するサブフィールドまで、8個全ての
サブフィールドに適用できない場合が生じる。
ルスR,G,Bの関係を変化させれば良い。図6にその
実施例を示す。この実施例では、フィールド制御回路3
4がサブフィールドを制御する時、その制御信号の一部
が波形ROMモード選択回路26に伝えられ、維持パル
スR,G,Bの関係が、図2にある様に、サブフィール
ドの切り替わりに同期して、例えばモードAからモード
Bに切り替わって、サブフィールド毎に変化する。
ールド制御回路34で波形ROMモード選択回路26を
制御して、波形ROM24から出力される各維持パルス
R,G,Bのパルス幅を変化させたものを示したが、上
記実施例2に示す波形データ生成回路33を制御して、
論理回路で構成されたパルス発生器より出力される各維
持パルスR,G,Bの関係を変化させても良い。図7に
その実施例を示す。
サブフィールドを制御する時、その制御信号の一部が波
形データ生成回路33に伝えられ、各組のラッチバッフ
ァ30,31、コンパレータ28,29、セットリセッ
トフリップフロップ27の動作が変化することで、例え
ば維持パルスRのパルス幅が変化し、同様に維持パルス
G,Bも変化し、各維持パルスR,G,Bの関係が変化
する。
に比較した場合、より精度の高いカラーバランスを得る
ことができる。
放電時間に応じたパルスの波形制御信号を出力する波形
リードオンリメモリタイミング制御回路と、上記放電パ
ルスの幅をR,G,Bの色信号についてモード別に選択
する波形リードオンリメモリモード選択回路と、該波形
リードオンリメモリモード選択回路および上記波形リー
ドオンリメモリタイミング制御回路の各出力にもとづ
き、上記パルスのプログラム制御データを出力する波形
リードオンリメモリとを設け、該波形リードオンリメモ
リからのプログラム制御データにもとづき行の電極およ
び列の電極を行側および列側の各ドライバにより駆動さ
せるように構成したので、カラー表示におけるカラーバ
ランスの調整ができるものが得られる効果がある。
ングおよび立ち下がりタイミングを示すパルスデータの
立ち上がりタイミングのパルスデータおよび立ち下がり
タイミングのパルスデータをラッチする第1のラッチバ
ッファおよび第2のラッチバッファと、該第1のラッチ
バッファおよび第2のラッチバッファの出力値とカウン
タ回路からの刻々変化する出力値とを比較する第1のコ
ンパレータおよび第2のコンパレータとを設け、セット
リセットフリップフロップを、上記第1のコンパレータ
において比較される各値が一致したときを維持パルスの
立ち上がりタイミングとしてセットさせ、上記第2のコ
ンパレータにおいて比較される各値が一致したときを維
持パルスの立ち下がりタイミングとしてリセットさせる
ように構成したので、論理回路を使用して、カウンタ回
路の動作周波数を単位とするパルス幅調整を高い精度に
て実現できるものが得られる効果がある。
出力にもとづいて、表示の1フィールドにおけるサブフ
ィールドの個数を制御するフィールド制御回路と、放電
に必要な放電パルスのプログラム制御データを出力する
波形リードオンリメモリとを設け、該リードオンリメモ
リおよび上記フィールド制御回路の各出力にもとづき、
行側および列側の各ドライバに、発光輝度および階調数
が調整されるように、放電パネルの行の電極および列の
電極を駆動させるように構成したので、発光輝度と階調
数の選択設定により鮮明画像表示を行えるものが得られ
る効果がある。
路によって、サブフィールドごとにR,G,Bの各維持
パルスのパルス幅を調整するように、上記波形リードオ
ンリメモリのモード選択回路を制御するように構成した
ので、各維持パルスの関係をサブフィールドごとに変化
させることで、必要とする発光輝度を得ながら良好なカ
ラーバランスを多階調制御の各階調で設定できるものが
得られる効果がある。
路に、サブパルスごとに各維持パルスR,G,Bのパル
ス幅を調整させるように構成したので、更に精度の高い
カラーバランスを設定できるものが得られる効果があ
る。
動装置を示すブロック図である。
ング図である。
動装置を示すブロック図である。
動装置を示すブロック図である。
す説明図である。
動装置を示すブロック図である。
動装置を示すブロック図である。
である。
ロック図である。
ミング図である。
の発光時間と階調制御の関係を示す説明図である。
リメモリタイミング制御回路) 26 波形ROMモード選択回路(波形リードオンリメ
モリモード選択回路) 27 セットリセットフリップフロップ 28 コンパレータ(第1のコンパレータ) 29 コンパレータ(第2のコンパレータ) 30 ラッチバッファ(第1のラッチバッファ) 31 ラッチバッファ(第2のラッチバッファ) 32 カウンタ回路 33 波形データ生成回路 34 フィールド制御回路 35 階調数選択回路
Claims (5)
- 【請求項1】 放電パネルを構成する行の電極および列
の電極間で発生する放電の放電時間に応じたパルスの波
形制御信号を出力する波形リードオンリメモリタイミン
グ制御回路と、上記パルスの幅をR,G,Bの色信号に
ついてモード別に選択する波形リードオンリメモリモー
ド選択回路と、該波形リードオンリメモリモード選択回
路および上記波形リードオンリメモリタイミング制御回
路の各出力にもとづき、上記パルスのプログラム制御デ
ータを出力する波形リードオンリメモリと、該波形リー
ドオンリメモリからのプログラム制御データにもとづ
き、上記行の電極および列の電極を駆動する行側ドライ
バおよび列側ドライバとを備えた放電パネル駆動装置。 - 【請求項2】 立ち上がりタイミングおよび立ち下がり
タイミングを示すパルスデータを出力する波形データ生
成回路と、R,G,Bの色信号対応で設けられ、上記パ
ルスデータの立ち上がりタイミングのパルスデータおよ
び立ち下がりタイミングのパルスデータをラッチする第
1のラッチバッファおよび第2のラッチバッファと、該
第1のラッチバッファおよび第2のラッチバッファの出
力値とカウンタ回路からの刻々変化する出力値とを比較
する第1のコンパレータおよび第2のコンパレータと、
上記第1のコンパレータにおいて比較される各値が一致
したときを維持パルスの立ち上がりタイミングとしてセ
ットされ、一方、上記第2のコンパレータにおいて比較
される各値が一致したときを維持パルスの立ち下がりタ
イミングとしてリセットされるセットリセットフリップ
フロップとを備えた放電パネル駆動装置。 - 【請求項3】 所定の発光輝度を得るための階調数を選
択する階調数選択回路と、該階調数選択回路の出力にも
とづいて、表示の1フィールドにおけるサブフィールド
の個数を制御するフィールド制御回路と、上記発光輝度
を得るために放電に必要な放電パルスのプログラム制御
データを出力する波形リードオンリメモリと、該リード
オンリメモリおよび上記フィールド制御回路の各出力に
もとづき、発光輝度および階調数が調整されるように、
上記放電パネルの行の電極および列の電極を駆動する行
側ドライバおよび列側ドライバとを備えた放電パネル駆
動装置。 - 【請求項4】 放電パネルを構成する行の電極および列
の電極間で発生する放電の放電時間に応じたパルスの波
形制御信号を出力する波形リードオンリメモリタイミン
グ制御回路と、上記パルスの幅をR,G,Bの色信号に
ついてモード別に選択する波形リードオンリメモリモー
ド選択回路と、サブフィールドごとにR,G,Bの各維
持パルスのパルス幅を調整するように、上記波形リード
オンリメモリのモード選択回路を制御するフィールド制
御回路と、上記波形リードオンリメモリモード選択回路
および上記波形リードオンリメモリタイミング制御回路
の各出力を受けて、上記放電パルスのプログラム制御デ
ータを出力する波形リードオンリメモリと、該波形リー
ドオンリメモリからのプログラム制御データにもとづ
き、上記行の電極および列の電極を駆動する行側ドライ
バおよび列側ドライバとを備えた放電パネル駆動装置。 - 【請求項5】 立ち上がりタイミングおよび立ち下がり
タイミングを示すパルスデータを出力する波形データ生
成回路と、サブフィールドごとにR,G,Bの各維持パ
ルスのパルス幅を調整するように、上記波形データ生成
回路を制御するフィールド制御回路と、R,G,Bの色
信号対応で設けられ、上記パルスデータの立ち上がりタ
イミングのパルスデータおよび立ち下がりタイミングの
パルスデータをラッチする第1のラッチバッファおよび
第2のラッチバッファと、該第1のラッチバッファおよ
び第2のラッチバッファの出力値とカウンタ回路からの
刻々変化する出力値とを比較する第1のコンパレータお
よび第2のコンパレータと、上記第1のコンパレータに
おいて比較される各値が一致したときを維持パルスの立
ち上がりタイミングとしてセットされ、一方、上記第2
のコンパレータにおいて比較される各値が一致したとき
を維持パルスの立ち下がりタイミングとしてリセットさ
れるセットリセットフリップフロップとを備えた放電パ
ネル駆動装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP05196003A JP3121965B2 (ja) | 1993-08-06 | 1993-08-06 | 放電パネル駆動装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP05196003A JP3121965B2 (ja) | 1993-08-06 | 1993-08-06 | 放電パネル駆動装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0749664A true JPH0749664A (ja) | 1995-02-21 |
JP3121965B2 JP3121965B2 (ja) | 2001-01-09 |
Family
ID=16350612
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP05196003A Expired - Lifetime JP3121965B2 (ja) | 1993-08-06 | 1993-08-06 | 放電パネル駆動装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3121965B2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100585631B1 (ko) * | 1999-04-10 | 2006-06-02 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 계조표현 방법 |
US7236153B1 (en) | 1999-10-28 | 2007-06-26 | Sharp Kabushiki Kaisha | Signal production circuit and display device using the same |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101927329B1 (ko) | 2017-03-28 | 2019-03-12 | 울산대학교 산학협력단 | 복와위 심폐소생 보조기 |
-
1993
- 1993-08-06 JP JP05196003A patent/JP3121965B2/ja not_active Expired - Lifetime
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100585631B1 (ko) * | 1999-04-10 | 2006-06-02 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 계조표현 방법 |
US7236153B1 (en) | 1999-10-28 | 2007-06-26 | Sharp Kabushiki Kaisha | Signal production circuit and display device using the same |
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---|---|
JP3121965B2 (ja) | 2001-01-09 |
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