JPH07175477A - 信号処理装置 - Google Patents
信号処理装置Info
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- JPH07175477A JPH07175477A JP5317203A JP31720393A JPH07175477A JP H07175477 A JPH07175477 A JP H07175477A JP 5317203 A JP5317203 A JP 5317203A JP 31720393 A JP31720393 A JP 31720393A JP H07175477 A JPH07175477 A JP H07175477A
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- Japan
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- channels
- channel
- steps
- processing
- signal processing
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Abstract
(57)【要約】
【目的】 チャンネル数をアプリケーション毎に設定可
能にし、効率的な信号処理を行う。 【構成】 ＣＰＵ２２により、パッケージメディア２１
から読み出されたチャンネル数は、信号処理部２５を介
してＮレジスタに設定され、各種楽器または音声の波形
データは、外部ＲＡＭ２８に供給される。信号処理部２
５により、外部ＲＡＭ２８から読み出された波形データ
は、ＣＰＵ２２より信号処理部２５にリアルタイムで供
給される楽譜データに基づいて、ＲＯＭ２６に予め記憶
されたチャンネル処理用のプログラムにより、Ｎレジス
タに設定されたチャンネル数分、チャンネル処理が施さ
れ、ＲＡＭ２７に記憶されたエフェクト処理用のプログ
ラムにより、エフェクト処理が施された後、Ｄ／Ａ変換
器２９を介してスピーカ３０に供給される。
能にし、効率的な信号処理を行う。 【構成】 ＣＰＵ２２により、パッケージメディア２１
から読み出されたチャンネル数は、信号処理部２５を介
してＮレジスタに設定され、各種楽器または音声の波形
データは、外部ＲＡＭ２８に供給される。信号処理部２
５により、外部ＲＡＭ２８から読み出された波形データ
は、ＣＰＵ２２より信号処理部２５にリアルタイムで供
給される楽譜データに基づいて、ＲＯＭ２６に予め記憶
されたチャンネル処理用のプログラムにより、Ｎレジス
タに設定されたチャンネル数分、チャンネル処理が施さ
れ、ＲＡＭ２７に記憶されたエフェクト処理用のプログ
ラムにより、エフェクト処理が施された後、Ｄ／Ａ変換
器２９を介してスピーカ３０に供給される。
Description
【０００１】
【産業上の利用分野】本発明は、例えばサンプラ音源シ
ステムに用いて好適な信号処理装置に関する。
ステムに用いて好適な信号処理装置に関する。
【０００２】
【従来の技術】図５は、従来のサンプラ音源システムの
一例の構成を示すブロック図である。このサンプラ音源
システムは、例えば、圧縮データの伸張、音程変換、エ
ンベロープ演算、またはボリューム演算などのチャンネ
ル処理を行うＤＳＰ（ディジタル信号処理装置）１を備
え、さらに、例えば、リバーブ、エコー、イコライザな
どのエフェクト処理を行うＤＳＰ２を備えている。ＤＳ
Ｐ２から出力された信号は、Ｄ／Ａコンバータによりア
ナログの信号に変換され、図示せぬスピーカに供給され
るようになされている。
一例の構成を示すブロック図である。このサンプラ音源
システムは、例えば、圧縮データの伸張、音程変換、エ
ンベロープ演算、またはボリューム演算などのチャンネ
ル処理を行うＤＳＰ（ディジタル信号処理装置）１を備
え、さらに、例えば、リバーブ、エコー、イコライザな
どのエフェクト処理を行うＤＳＰ２を備えている。ＤＳ
Ｐ２から出力された信号は、Ｄ／Ａコンバータによりア
ナログの信号に変換され、図示せぬスピーカに供給され
るようになされている。
【０００３】例えば、図示せぬホストコンピュータのＣ
ＰＵの制御により出力された楽譜データ、若しくは波形
データを表すディジタルの信号は、ＤＳＰ１に入力さ
れ、ＤＳＰ１においてチャンネル処理が施された後、Ｄ
ＳＰ２へ出力される。ＤＳＰ２に入力された信号は、そ
こでエフェクト処理が施された後、出力される。ＤＳＰ
２より出力された信号は、Ｄ／Ａコンバータ３に入力さ
れ、アナログの信号に変換された後、図示せぬスピーカ
に出力される。
ＰＵの制御により出力された楽譜データ、若しくは波形
データを表すディジタルの信号は、ＤＳＰ１に入力さ
れ、ＤＳＰ１においてチャンネル処理が施された後、Ｄ
ＳＰ２へ出力される。ＤＳＰ２に入力された信号は、そ
こでエフェクト処理が施された後、出力される。ＤＳＰ
２より出力された信号は、Ｄ／Ａコンバータ３に入力さ
れ、アナログの信号に変換された後、図示せぬスピーカ
に出力される。
【０００４】ここで、ＤＳＰ１およびＤＳＰ２は、例え
ば、音声の１サンプリング周期（１サンプル期間）内に
７６８ステップの演算が可能であるとする。ＤＳＰ１
は、１サンプル期間内に可能な７６８ステップの全ステ
ップにおいて、チャンネル処理に関する演算を行い、Ｄ
ＳＰ２は、１サンプル期間内に可能な７６８ステップの
全ステップにおいて、エフェクト処理を行うようになさ
れている。
ば、音声の１サンプリング周期（１サンプル期間）内に
７６８ステップの演算が可能であるとする。ＤＳＰ１
は、１サンプル期間内に可能な７６８ステップの全ステ
ップにおいて、チャンネル処理に関する演算を行い、Ｄ
ＳＰ２は、１サンプル期間内に可能な７６８ステップの
全ステップにおいて、エフェクト処理を行うようになさ
れている。
【０００５】即ち、ＤＳＰ１においては、チャンネル処
理１回当たり２４ステップの演算が行われるとした場
合、チャンネル数が３２に固定され、チャンネル処理を
行うステップ数は７６８ステップとされる。また、ＤＳ
Ｐ２においては、エフェクト処理を行うステップ数が７
６８ステップに固定されている。
理１回当たり２４ステップの演算が行われるとした場
合、チャンネル数が３２に固定され、チャンネル処理を
行うステップ数は７６８ステップとされる。また、ＤＳ
Ｐ２においては、エフェクト処理を行うステップ数が７
６８ステップに固定されている。
【０００６】図６は、従来のサンプラ音源システムの他
の一例の構成を示すブロック図である。図５に示したサ
ンプラ音源システムの場合とは異なり、１個のＤＳＰ１
１により、チャンネル処理とエフェクト処理を行うよう
になされている。
の一例の構成を示すブロック図である。図５に示したサ
ンプラ音源システムの場合とは異なり、１個のＤＳＰ１
１により、チャンネル処理とエフェクト処理を行うよう
になされている。
【０００７】ＤＳＰ１１は、ＤＳＰ１またはＤＳＰ２と
同様に、１サンプル期間内に７６８ステップの演算が可
能であり、その各ステップを、図７に示すように、チャ
ンネル処理期間とエフェクト処理期間とに所定の比率で
割り当てている。この例では、チャンネル数は２４とさ
れ、チャンネル処理１回当たり２４ステップの演算が行
われる。
同様に、１サンプル期間内に７６８ステップの演算が可
能であり、その各ステップを、図７に示すように、チャ
ンネル処理期間とエフェクト処理期間とに所定の比率で
割り当てている。この例では、チャンネル数は２４とさ
れ、チャンネル処理１回当たり２４ステップの演算が行
われる。
【０００８】従って、チャンネル処理を行うチャンネル
処理期間には５７６ステップが割り当てられ、エフェク
ト処理を行うエフェクト処理期間には全ステップ数（７
６８ステップ）から、チャンネル処理期間に割り当てら
れたステップ数（５７６ステップ）を差し引いた残りの
１９２ステップが割り当てられている。
処理期間には５７６ステップが割り当てられ、エフェク
ト処理を行うエフェクト処理期間には全ステップ数（７
６８ステップ）から、チャンネル処理期間に割り当てら
れたステップ数（５７６ステップ）を差し引いた残りの
１９２ステップが割り当てられている。
【０００９】即ち、ＤＳＰ１１においても、チャンネル
数が固定され、エフェクト処理期間に割り当てられるス
テップ数は１９２ステップに固定されている。
数が固定され、エフェクト処理期間に割り当てられるス
テップ数は１９２ステップに固定されている。
【００１０】
【発明が解決しようとする課題】このように、従来のサ
ンプラ音源システムにおいては、チャンネル数が所定の
数に固定され、ＤＳＰが１サンプル期間内に演算可能な
ステップ数のうち、チャンネル数分のチャンネル処理を
行うのに必要とされるステップ数をチャンネル処理期間
に割り当て、残りのステップ数をエフェクト処理を行う
エフェクト処理期間に割り当てるようになされている。
即ち、チャンネル数と、エフェクト処理期間に割り当て
られるステップ数とは固定されている。
ンプラ音源システムにおいては、チャンネル数が所定の
数に固定され、ＤＳＰが１サンプル期間内に演算可能な
ステップ数のうち、チャンネル数分のチャンネル処理を
行うのに必要とされるステップ数をチャンネル処理期間
に割り当て、残りのステップ数をエフェクト処理を行う
エフェクト処理期間に割り当てるようになされている。
即ち、チャンネル数と、エフェクト処理期間に割り当て
られるステップ数とは固定されている。
【００１１】従って、チャンネル数と、エフェクト処理
期間に割り当てるステップ数とをアプリケーション毎に
変更することができないという課題があった。
期間に割り当てるステップ数とをアプリケーション毎に
変更することができないという課題があった。
【００１２】本発明はこのような状況に鑑みてなされた
ものであり、アプリケーション毎に、チャンネル数と、
エフェクト処理期間に割り当てるステップ数とを変更す
ることができるようにするものである。
ものであり、アプリケーション毎に、チャンネル数と、
エフェクト処理期間に割り当てるステップ数とを変更す
ることができるようにするものである。
【００１３】
【課題を解決するための手段】本発明の信号処理装置
は、チャンネル数を記憶するチャンネル数記憶手段（例
えば、図１のＮレジスタ２４）と、Ｎレジスタ２４によ
り記憶されたチャンネル数に基づいて、チャンネル処理
とエフェクト処理をそれぞれ所定のステップ数ずつ行う
処理手段（例えば、図１の信号処理部２５）とを備える
ことを特徴とする。
は、チャンネル数を記憶するチャンネル数記憶手段（例
えば、図１のＮレジスタ２４）と、Ｎレジスタ２４によ
り記憶されたチャンネル数に基づいて、チャンネル処理
とエフェクト処理をそれぞれ所定のステップ数ずつ行う
処理手段（例えば、図１の信号処理部２５）とを備える
ことを特徴とする。
【００１４】Ｎレジスタ２４は、チャンネル数をアプリ
ケーション毎に記憶することができる。
ケーション毎に記憶することができる。
【００１５】また、チャンネル処理のプログラム、また
はエフェクト処理のプログラムを記憶する記憶手段（例
えば、図１のＲＯＭ２６またはＲＡＭ２７）をさらに設
けることができる。
はエフェクト処理のプログラムを記憶する記憶手段（例
えば、図１のＲＯＭ２６またはＲＡＭ２７）をさらに設
けることができる。
【００１６】また、信号処理部２５は、ＲＯＭ２６およ
びＲＡＭ２７に記憶されたプログラムに基づいて処理を
行うことができる。
びＲＡＭ２７に記憶されたプログラムに基づいて処理を
行うことができる。
【００１７】
【作用】本発明の信号処理装置においては、Ｎレジスタ
２４により、チャンネル数が記憶され、信号処理部２５
により、Ｎレジスタ２４に記憶されたチャンネル数に基
づいて、チャンネル処理とエフェクト処理がそれぞれ所
定のステップ数ずつ行われる。従って、アプリケーショ
ン毎に所定の回数だけチャンネル処理を行うとともに、
アプリケーション毎に所定のステップ数分のエフェクト
処理を行うことができる。
２４により、チャンネル数が記憶され、信号処理部２５
により、Ｎレジスタ２４に記憶されたチャンネル数に基
づいて、チャンネル処理とエフェクト処理がそれぞれ所
定のステップ数ずつ行われる。従って、アプリケーショ
ン毎に所定の回数だけチャンネル処理を行うとともに、
アプリケーション毎に所定のステップ数分のエフェクト
処理を行うことができる。
【００１８】
【実施例】図１は、本発明の信号処理装置の一実施例の
構成を示すブロック図である。信号処理装置は、各種楽
器または音声の波形データ、楽譜データ、チャンネル
数、およびエフェクト処理のプログラムなどを記憶す
る、例えば、ＲＯＭ−カートリッジ、ＣＤ−ＲＯＭ、ま
たはフロッピーディスクなどのパッケージメディア２１
と、ディジタルの信号を処理するＤＳＰ２３と、それら
を制御するＣＰＵ２２を備え、ＤＳＰ２３は、チャンネ
ル数を記憶するＮレジスタ２４と、ディジタル信号を処
理する信号処理部２５から構成されている。
構成を示すブロック図である。信号処理装置は、各種楽
器または音声の波形データ、楽譜データ、チャンネル
数、およびエフェクト処理のプログラムなどを記憶す
る、例えば、ＲＯＭ−カートリッジ、ＣＤ−ＲＯＭ、ま
たはフロッピーディスクなどのパッケージメディア２１
と、ディジタルの信号を処理するＤＳＰ２３と、それら
を制御するＣＰＵ２２を備え、ＤＳＰ２３は、チャンネ
ル数を記憶するＮレジスタ２４と、ディジタル信号を処
理する信号処理部２５から構成されている。
【００１９】また、信号処理部２５は、チャンネル処理
のプログラムを記憶するＲＯＭ２６と、エフェクト処理
のプログラムを記憶するＲＡＭ２７とで構成されてい
る。
のプログラムを記憶するＲＯＭ２６と、エフェクト処理
のプログラムを記憶するＲＡＭ２７とで構成されてい
る。
【００２０】信号処理装置は、さらに、波形データなど
を記憶する外部ＲＡＭ２８と、ＤＳＰ２３から出力され
るディジタルの信号をアナログの信号に変換するＤ／Ａ
変換器２９を備え、Ｄ／Ａ変換器２９から出力された信
号は、スピーカ３０に供給されるようになされている。
を記憶する外部ＲＡＭ２８と、ＤＳＰ２３から出力され
るディジタルの信号をアナログの信号に変換するＤ／Ａ
変換器２９を備え、Ｄ／Ａ変換器２９から出力された信
号は、スピーカ３０に供給されるようになされている。
【００２１】また、外部ＲＡＭ２８に対し、ＣＰＵ２２
または信号処理部２５により、時分割でデータが読み出
しまたは書き込まれるようになされている。
または信号処理部２５により、時分割でデータが読み出
しまたは書き込まれるようになされている。
【００２２】次に、その動作を説明する。まず、ＣＰＵ
２２により、パッケージメディア２１に記録されている
各種楽器または音声の波形データが読み出され、信号処
理部２５を介して、外部ＲＡＭ２８に転送される。次
に、ＣＰＵ２２により、パッケージメディア２１に記録
されているチャンネル数が読み出される。読み出された
チャンネル数は、ＣＰＵ２２により、信号処理部２５を
介してＮレジスタ２４に設定される。
２２により、パッケージメディア２１に記録されている
各種楽器または音声の波形データが読み出され、信号処
理部２５を介して、外部ＲＡＭ２８に転送される。次
に、ＣＰＵ２２により、パッケージメディア２１に記録
されているチャンネル数が読み出される。読み出された
チャンネル数は、ＣＰＵ２２により、信号処理部２５を
介してＮレジスタ２４に設定される。
【００２３】次に、ＣＰＵ２２により、１つまたは複数
の種類のエフェクト処理のプログラムが、パッケージメ
ディア２１から読み出され、信号処理部２５の内部に設
けられたＲＡＭ２７に書き込まれる。ＲＡＭ２７は、１
つまたは複数の種類のエフェクト処理のプログラムを記
憶することができる。さらに、ＣＰＵ２２により、パッ
ケージメディア２１から楽譜データが読み出され、信号
処理部２５にリアルタイムで供給される。
の種類のエフェクト処理のプログラムが、パッケージメ
ディア２１から読み出され、信号処理部２５の内部に設
けられたＲＡＭ２７に書き込まれる。ＲＡＭ２７は、１
つまたは複数の種類のエフェクト処理のプログラムを記
憶することができる。さらに、ＣＰＵ２２により、パッ
ケージメディア２１から楽譜データが読み出され、信号
処理部２５にリアルタイムで供給される。
【００２４】楽譜データは、例えば、信号処理部２５
が、外部ＲＡＭ２８より所定の波形データを読み出すタ
イミングデータ、読み出した波形データに対してチャン
ネル処理を行う際のパラメータ、およびチャンネル処理
が施されたデータに対して、エフェクト処理を行う際の
パラメータ、さらに、数種類のエフェクト処理を組み合
わせて行う場合には、その組み合わせの情報などにより
構成される。
が、外部ＲＡＭ２８より所定の波形データを読み出すタ
イミングデータ、読み出した波形データに対してチャン
ネル処理を行う際のパラメータ、およびチャンネル処理
が施されたデータに対して、エフェクト処理を行う際の
パラメータ、さらに、数種類のエフェクト処理を組み合
わせて行う場合には、その組み合わせの情報などにより
構成される。
【００２５】信号処理部２５により、ＣＰＵ２２より供
給される楽譜データに基づいて、所定のタイミングで外
部ＲＡＭ２８から所定の波形データが読み出され、それ
に対して、所定のパラメータに基づいたチャンネル処理
が行われる。さらに１つまたは複数の種類の所定のエフ
ェクト処理が、所定のパラメータに基づいて行われた
後、Ｄ／Ａ変換器２９に出力される。Ｄ／Ａ変換器２９
に入力されたディジタルの信号は、そこでアナログの信
号に変換され、スピーカ３０に供給される。
給される楽譜データに基づいて、所定のタイミングで外
部ＲＡＭ２８から所定の波形データが読み出され、それ
に対して、所定のパラメータに基づいたチャンネル処理
が行われる。さらに１つまたは複数の種類の所定のエフ
ェクト処理が、所定のパラメータに基づいて行われた
後、Ｄ／Ａ変換器２９に出力される。Ｄ／Ａ変換器２９
に入力されたディジタルの信号は、そこでアナログの信
号に変換され、スピーカ３０に供給される。
【００２６】次に、図４に示したフローチャートを参照
して、ＤＳＰ２３の動作について説明する。まず、ステ
ップＳ１において、信号処理部２５は、ＣＰＵ２２によ
り、パッケージメディア２１より読み出され、信号処理
部２５に供給されるチャンネル数Ｎ（Ｎは０乃至３２の
整数）を、Ｎレジスタ２４に設定し、ステップＳ２に進
む。
して、ＤＳＰ２３の動作について説明する。まず、ステ
ップＳ１において、信号処理部２５は、ＣＰＵ２２によ
り、パッケージメディア２１より読み出され、信号処理
部２５に供給されるチャンネル数Ｎ（Ｎは０乃至３２の
整数）を、Ｎレジスタ２４に設定し、ステップＳ２に進
む。
【００２７】ステップＳ２において、信号処理部２５
は、ＣＰＵ２２により、パッケージメディア２１より読
み出され、信号処理部２５に供給される１つまたは複数
の種類のエフェクト処理のプログラムを、信号処理部２
５の内部に設けられたＲＡＭ２７に書き込む。次に、ス
テップＳ３に進み、チャンネル処理実行回数Ａに初期値
０をセットし、ステップＳ４に進む。
は、ＣＰＵ２２により、パッケージメディア２１より読
み出され、信号処理部２５に供給される１つまたは複数
の種類のエフェクト処理のプログラムを、信号処理部２
５の内部に設けられたＲＡＭ２７に書き込む。次に、ス
テップＳ３に進み、チャンネル処理実行回数Ａに初期値
０をセットし、ステップＳ４に進む。
【００２８】ステップＳ４において、チャンネル処理実
行回数Ａ（いまの場合、Ａ＝０）が、ステップＳ１にお
いてＮレジスタ２４に設定されたチャンネル数Ｎより小
さいか否かが判定される。チャンネル処理実行回数Ａ
が、チャンネル数Ｎより小さいと判定された場合は、ス
テップＳ５に進み、信号処理部２５は、ＣＰＵ２２より
供給される楽譜データに基づいて、外部ＲＡＭ２８に記
憶された各種楽器または音声の所定の波形データを所定
のタイミングで読み出し、その波形データに対して、所
定のパラメータによるチャンネル処理を実行する。
行回数Ａ（いまの場合、Ａ＝０）が、ステップＳ１にお
いてＮレジスタ２４に設定されたチャンネル数Ｎより小
さいか否かが判定される。チャンネル処理実行回数Ａ
が、チャンネル数Ｎより小さいと判定された場合は、ス
テップＳ５に進み、信号処理部２５は、ＣＰＵ２２より
供給される楽譜データに基づいて、外部ＲＡＭ２８に記
憶された各種楽器または音声の所定の波形データを所定
のタイミングで読み出し、その波形データに対して、所
定のパラメータによるチャンネル処理を実行する。
【００２９】次に、ステップＳ６に進み、チャンネル処
理実行回数Ａに１を加算し、ステップＳ４に戻る。そし
て、ステップＳ４乃至Ｓ６の処理を繰り返す。
理実行回数Ａに１を加算し、ステップＳ４に戻る。そし
て、ステップＳ４乃至Ｓ６の処理を繰り返す。
【００３０】ステップＳ４において、チャンネル処理実
行回数Ａが、ステップＳ１においてＮレジスタ２４に設
定されたチャンネル数Ｎに等しいと判定された場合は、
ステップＳ７に進み、まず、ステップＳ５においてチャ
ンネル処理が施されたＮチャンネル分のデータが加算さ
れ、モノラルの場合には最終的に１チャンネルのデータ
とされ、ステレオの場合には最終的に２チャンネルのデ
ータとされる。
行回数Ａが、ステップＳ１においてＮレジスタ２４に設
定されたチャンネル数Ｎに等しいと判定された場合は、
ステップＳ７に進み、まず、ステップＳ５においてチャ
ンネル処理が施されたＮチャンネル分のデータが加算さ
れ、モノラルの場合には最終的に１チャンネルのデータ
とされ、ステレオの場合には最終的に２チャンネルのデ
ータとされる。
【００３１】そして、その１チャンネルまたは２チャン
ネルのデータに対して、信号処理部２５は、ＣＰＵ２２
より供給される楽譜データに基づいて、内部のＲＡＭ２
７に記憶された１つまたは複数の種類のエフェクト処理
のプログラムのうち、１つまたは複数の種類の所定のエ
フェクト処理のプログラムに従って、所定のパラメータ
に基づいたエフェクト処理を実行する。
ネルのデータに対して、信号処理部２５は、ＣＰＵ２２
より供給される楽譜データに基づいて、内部のＲＡＭ２
７に記憶された１つまたは複数の種類のエフェクト処理
のプログラムのうち、１つまたは複数の種類の所定のエ
フェクト処理のプログラムに従って、所定のパラメータ
に基づいたエフェクト処理を実行する。
【００３２】次に、ステップＳ３に戻り、ステップＳ３
乃至ステップＳ７の処理を繰り返す。ステップＳ３乃至
Ｓ７の処理は、１サンプル期間で行われる。また、ＣＰ
Ｕ２２より、処理を終了する指令が信号処理部２５に送
られた場合は、処理を終了する。
乃至ステップＳ７の処理を繰り返す。ステップＳ３乃至
Ｓ７の処理は、１サンプル期間で行われる。また、ＣＰ
Ｕ２２より、処理を終了する指令が信号処理部２５に送
られた場合は、処理を終了する。
【００３３】前述したように、チャンネル数は、アプリ
ケーション毎に設定することができる。図３は、チャン
ネル数を３２とした場合の１サンプル期間内のステップ
の割り当てを示す図である。１サンプル期間内の総ステ
ップ数は７６８ステップであり、１チャンネル当たり２
４ステップである。
ケーション毎に設定することができる。図３は、チャン
ネル数を３２とした場合の１サンプル期間内のステップ
の割り当てを示す図である。１サンプル期間内の総ステ
ップ数は７６８ステップであり、１チャンネル当たり２
４ステップである。
【００３４】図４は、チャンネル数を８とした場合の１
サンプル期間内のステップの割り当てを示す図である。
１チャンネル当たりのステップ数は２４ステップである
から、８チャンネルで合計１９２ステップがチャンネル
処理に割り当てられることになる。また、１サンプル期
間内の総ステップ数は７６８ステップであるから、７６
８ステップからチャンネル処理に割り当てられた１９２
ステップを差し引いた残りの５７６ステップがエフェク
ト処理に割り当てられることになる。
サンプル期間内のステップの割り当てを示す図である。
１チャンネル当たりのステップ数は２４ステップである
から、８チャンネルで合計１９２ステップがチャンネル
処理に割り当てられることになる。また、１サンプル期
間内の総ステップ数は７６８ステップであるから、７６
８ステップからチャンネル処理に割り当てられた１９２
ステップを差し引いた残りの５７６ステップがエフェク
ト処理に割り当てられることになる。
【００３５】このように、チャンネル数をアプリケーシ
ョン毎に、設定することができるため、例えば、チャン
ネル数は少なくてもよいが、大量のエフェクト処理を行
う必要があるアプリケーションや、エフェクト処理はそ
れほど行う必要はないが、チャンネル数は多いほどよい
というアプリケーションに対応することができる。
ョン毎に、設定することができるため、例えば、チャン
ネル数は少なくてもよいが、大量のエフェクト処理を行
う必要があるアプリケーションや、エフェクト処理はそ
れほど行う必要はないが、チャンネル数は多いほどよい
というアプリケーションに対応することができる。
【００３６】なお、図２に示したフローチャートのステ
ップＳ１とステップＳ２に示した処理は、どちらの処理
を先に行ってもよい。
ップＳ１とステップＳ２に示した処理は、どちらの処理
を先に行ってもよい。
【００３７】また、本実施例では、チャンネル処理のプ
ログラムをＲＯＭ２６に予め記憶させるようにしたが、
パッケージメディア２１にチャンネル処理のプログラム
を記録させておき、それをＣＰＵ２２が読み出し、信号
処理部２５を介してＲＡＭ２７に記憶させるようにして
もよい。その場合、信号処理部２５は、ＣＰＵ２２より
供給される楽譜データに基づいて、ＲＡＭ２７に記憶さ
れたチャンネル処理のプログラムを、所定のパラメータ
で実行することができる。
ログラムをＲＯＭ２６に予め記憶させるようにしたが、
パッケージメディア２１にチャンネル処理のプログラム
を記録させておき、それをＣＰＵ２２が読み出し、信号
処理部２５を介してＲＡＭ２７に記憶させるようにして
もよい。その場合、信号処理部２５は、ＣＰＵ２２より
供給される楽譜データに基づいて、ＲＡＭ２７に記憶さ
れたチャンネル処理のプログラムを、所定のパラメータ
で実行することができる。
【００３８】また、本実施例では、ＣＰＵ２２により、
パッケージメディア２１より読み出された１つまたは複
数の種類のエフェクト処理のプログラムが、信号処理部
２５の内部のＲＡＭ２７に記憶されるようにしたが、１
つまたは複数の種類のエフェクト処理のプログラムを、
信号処理部２５の内部のＲＯＭ２６に予め記憶させてお
くようにしてもよい。この場合、信号処理部２５は、Ｃ
ＰＵ２２より供給される楽譜データに基づいて、ＲＯＭ
２６に予め記憶された１つまたは複数の種類のエフェク
ト処理のプログラムのうち、１つまたは複数の種類の所
定のエフェクト処理のプログラムを、所定のパラメータ
で実行することができる。
パッケージメディア２１より読み出された１つまたは複
数の種類のエフェクト処理のプログラムが、信号処理部
２５の内部のＲＡＭ２７に記憶されるようにしたが、１
つまたは複数の種類のエフェクト処理のプログラムを、
信号処理部２５の内部のＲＯＭ２６に予め記憶させてお
くようにしてもよい。この場合、信号処理部２５は、Ｃ
ＰＵ２２より供給される楽譜データに基づいて、ＲＯＭ
２６に予め記憶された１つまたは複数の種類のエフェク
ト処理のプログラムのうち、１つまたは複数の種類の所
定のエフェクト処理のプログラムを、所定のパラメータ
で実行することができる。
【００３９】さらに、本実施例では、信号処理部２５
は、ＣＰＵ２２により、パッケージメディア２１から読
み出され、信号処理部２５に供給される楽譜データに基
づいて、チャンネル処理、またはエフェクト処理を行う
ようにしたが、パッケージメディア２１から読み出され
た楽譜データが、信号処理部２５を介して、一旦外部Ｒ
ＡＭ２８に転送されるようにしてもよい。この場合、楽
譜データは、信号処理部２５により、外部ＲＡＭ２８か
ら読み出され、それに基づいて、チャンネル処理、また
はエフェクト処理が行われる。
は、ＣＰＵ２２により、パッケージメディア２１から読
み出され、信号処理部２５に供給される楽譜データに基
づいて、チャンネル処理、またはエフェクト処理を行う
ようにしたが、パッケージメディア２１から読み出され
た楽譜データが、信号処理部２５を介して、一旦外部Ｒ
ＡＭ２８に転送されるようにしてもよい。この場合、楽
譜データは、信号処理部２５により、外部ＲＡＭ２８か
ら読み出され、それに基づいて、チャンネル処理、また
はエフェクト処理が行われる。
【００４０】
【発明の効果】本発明の信号処理装置によれば、チャン
ネル数記憶手段により、チャンネル数を記憶し、処理手
段により、チャンネル数記憶手段により記憶されたチャ
ンネル数に基づいて、チャンネル処理とエフェクト処理
をそれぞれ所定のステップ数ずつ行うようにしたので、
アプリケーション毎に所定のチャンネル数分のチャンネ
ル処理を行うとともに、アプリケーション毎に所定のス
テップ数分のエフェクト処理を行うことができる。
ネル数記憶手段により、チャンネル数を記憶し、処理手
段により、チャンネル数記憶手段により記憶されたチャ
ンネル数に基づいて、チャンネル処理とエフェクト処理
をそれぞれ所定のステップ数ずつ行うようにしたので、
アプリケーション毎に所定のチャンネル数分のチャンネ
ル処理を行うとともに、アプリケーション毎に所定のス
テップ数分のエフェクト処理を行うことができる。
【図１】本発明の信号処理装置の一実施例の構成を示す
ブロック図である。
ブロック図である。
【図２】図１に示したＤＳＰ２３の動作を説明するため
のフローチャートである。
のフローチャートである。
【図３】図１に示したＤＳＰ２３が処理するチャンネル
数を３２に設定した場合のステップの割り当てを示す図
である。
数を３２に設定した場合のステップの割り当てを示す図
である。
【図４】図１に示したＤＳＰ２３が処理するチャンネル
数を８に設定した場合のステップの割り当てを示す図で
ある。
数を８に設定した場合のステップの割り当てを示す図で
ある。
【図５】従来のサンプラ音源システムの一例の構成を示
すブロック図である。
すブロック図である。
【図６】従来のサンプラ音源システムの他の一例の構成
を示すブロック図である。
を示すブロック図である。
【図７】図６に示したＤＳＰ１１のステップの割り当て
の一例を示す図である。
の一例を示す図である。
１，２ ＤＳＰ ３ Ｄ／Ａコンバータ １１，２３ ＤＳＰ ２１ パッケージメディア ２２ ＣＰＵ ２４ Ｎレジスタ ２５ 信号処理部 ２６ ＲＯＭ ２７ ＲＡＭ ２８ 外部ＲＡＭ ２９ Ｄ／Ａ変換器 ３０ スピーカ
Claims (4)
- 【請求項１】 チャンネル数を記憶するチャンネル数記
憶手段と、 前記チャンネル数記憶手段により記憶されたチャンネル
数に基づいて、チャンネル処理とエフェクト処理をそれ
ぞれ所定のステップ数ずつ行う処理手段とを備えること
を特徴とする信号処理装置。 - 【請求項２】 前記チャンネル数記憶手段は、前記チャ
ンネル数を、アプリケーション毎に記憶することを特徴
とする請求項１に記載の信号処理装置。 - 【請求項３】 前記チャンネル処理のプログラム、また
は前記エフェクト処理のプログラムを記憶する記憶手段
をさらに備えることを特徴とする請求項１または２に記
載の信号処理装置。 - 【請求項４】 前記処理手段は、前記記憶手段に記憶さ
れたプログラムに基づいて処理を行うことを特徴とする
請求項１乃至３のいずれかに記載の信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31720393A JP3516470B2 (ja) | 1993-12-17 | 1993-12-17 | 信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31720393A JP3516470B2 (ja) | 1993-12-17 | 1993-12-17 | 信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07175477A true JPH07175477A (ja) | 1995-07-14 |
| JP3516470B2 JP3516470B2 (ja) | 2004-04-05 |
Family
ID=18085617
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31720393A Expired - Fee Related JP3516470B2 (ja) | 1993-12-17 | 1993-12-17 | 信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3516470B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6025552A (en) * | 1995-09-20 | 2000-02-15 | Yamaha Corporation | Computerized music apparatus processing waveform to create sound effect, a method of operating such an apparatus, and a machine-readable media |
-
1993
- 1993-12-17 JP JP31720393A patent/JP3516470B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6025552A (en) * | 1995-09-20 | 2000-02-15 | Yamaha Corporation | Computerized music apparatus processing waveform to create sound effect, a method of operating such an apparatus, and a machine-readable media |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3516470B2 (ja) | 2004-04-05 |
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