JPH0682574U - Waveform observation device - Google Patents

Waveform observation device

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JPH0682574U
JPH0682574U JP2327493U JP2327493U JPH0682574U JP H0682574 U JPH0682574 U JP H0682574U JP 2327493 U JP2327493 U JP 2327493U JP 2327493 U JP2327493 U JP 2327493U JP H0682574 U JPH0682574 U JP H0682574U
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comparator
voltage value
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output
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JP2327493U
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宏則 沖田
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Yokogawa Electric Corp
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Yokogawa Electric Corp
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Abstract

(57)【要約】 【目的】入力信号を入力部で切り換えることにより、入
力信号の測定の効率が向上した波形観測装置を実現す
る。 【構成】入力したアナログ信号を減衰するバッファと、
前記バッファからの出力と設定された電圧値とを比較
し、設定された電圧値と入力信号の電圧値の大小関係に
基づいて検出信号を出力する第1のコンパレータと、前
記バッファからの出力と設定された電圧値とを比較し、
設定された電圧値と入力信号の電圧値の大小関係に基づ
いて検出信号を出力し、前記第1のコンパレータと異な
る周波数特性を有する第2のコンパレータと、前記第1
のコンパレータおよび第2のコンパレータの出力を選択
して出力する選択手段と、前記第1のコンパレータ及び
第2のコンパレータの比較すべき電圧値を設定し、前記
選択手段での信号の選択を設定する制御回路と、を設け
たことを特徴とする波形観測装置である。
(57) [Abstract] [Purpose] To realize a waveform observing device with improved input signal measurement efficiency by switching input signals at the input section. [Structure] A buffer that attenuates the input analog signal,
A first comparator that compares the output from the buffer with a set voltage value, and outputs a detection signal based on the magnitude relationship between the set voltage value and the voltage value of the input signal; and the output from the buffer Compare with the set voltage value,
A second comparator that outputs a detection signal based on the magnitude relationship between the set voltage value and the voltage value of the input signal, and has a frequency characteristic different from that of the first comparator;
Setting means for selecting and outputting the outputs of the comparator and the second comparator, and the voltage value to be compared between the first comparator and the second comparator, and setting the selection of the signal by the selecting means. A control circuit and a waveform observing device.

Description

【考案の詳細な説明】[Detailed description of the device]

【0001】[0001]

【産業上の利用分野】[Industrial applications]

本考案は、波形観測装置に関し、詳しくは波形観測装置の信号入力部分の回路 の改善に関するものである。 The present invention relates to a waveform observing device, and more particularly to improvement of a circuit of a signal input portion of the waveform observing device.

【0002】[0002]

【従来の技術】[Prior art]

従来より、電気信号を観測するための装置にあたり、その測定対象たる入力信 号が高速になると、信号を入力するにあたり、入力インピーダンスあるいは反射 の問題を考慮にいれる必要がある。 この様な事情に基づき、その入力信号の振幅が制限されたり、トリガ入力のコ ンポーネントとしては、トリガ信号として特別に外部から信号を入力したりする 必要がある。 また、トリガ信号もその周波数にかかわらず一律に高速に動作する材料にて設 計された回路を使用するが、高速に動作するものは、一般に熱雑音等の影響が多 いのが常である。 Conventionally, when an input signal to be measured has a high speed in a device for observing an electric signal, it is necessary to take the problem of input impedance or reflection into consideration when inputting the signal. Under such circumstances, it is necessary to limit the amplitude of the input signal, or to input a signal from the outside as a trigger signal as a component of the trigger input. Also, the trigger signal uses a circuit designed with a material that operates uniformly at high speed regardless of the frequency, but a high-speed operation is generally affected by thermal noise and the like. .

【0003】[0003]

【考案が解決しようとする課題】[Problems to be solved by the device]

このため、高周波を測定する際に、ジッタが発生しやすいという問題がある。 本考案はこの課題を解決し、電気信号の波形観測において、信号の入力を正確 に捕らえ、かつ、操作性の向上を図ることを可能とした波形観測装置を実現する ことを目的とする。 Therefore, there is a problem that jitter is likely to occur when measuring a high frequency. An object of the present invention is to solve this problem and to realize a waveform observing device capable of accurately capturing a signal input and improving operability in observing the waveform of an electric signal.

【0004】[0004]

【課題を解決するための手段】[Means for Solving the Problems]

本考案は、外部より波形観測の対象としてアナログ信号を入力する入力端子と 、 前記入力端子に接続し、入力したアナログ信号を減衰するバッファと、 前記バッファからの出力と設定された電圧値とを比較し、設定された電圧値と 入力信号の電圧値の大小関係に基づいて検出信号を出力する第1のコンパレータ と、 前記バッファからの出力と設定された電圧値とを比較し、設定された電圧値と 入力信号の電圧値の大小関係に基づいて検出信号を出力し、前記第1のコンパレ ータと異なる周波数特性を有する第2のコンパレータと 前記第1のコンパレータおよび第2のコンパレータの出力を選択して出力する 選択手段と、 前記第1のコンパレータ及び第2のコンパレータの比較すべき電圧値を設定し 、前記選択手段での信号の選択を設定する制御回路と、 を設けたことを特徴とする波形観測装置である。 The present invention provides an input terminal for inputting an analog signal as a target of waveform observation from the outside, a buffer connected to the input terminal for attenuating the input analog signal, and an output from the buffer and a set voltage value. The first comparator that outputs a detection signal based on the magnitude relation between the set voltage value and the input signal voltage value is compared with the set voltage value by comparing the output from the buffer with the set voltage value. A second comparator that outputs a detection signal based on the magnitude relationship between the voltage value and the voltage value of the input signal and has a frequency characteristic different from that of the first comparator, and outputs of the first comparator and the second comparator And a voltage value to be compared by the first comparator and the second comparator are set, and a signal is selected by the selection means. A control circuit for a waveform observing apparatus, characterized in that a.

【0005】[0005]

【作用】[Action]

信号の特性に応じて、入力特性を切り換えることで、観測波形の品質の向上を 図ることができる。 The quality of the observed waveform can be improved by switching the input characteristics according to the characteristics of the signal.

【0006】[0006]

【実施例】【Example】

図1は本考案の一実施例の構成図である。図において、11および12は異な る周波数特性を有するコンパレータで、入力信号と設定された電圧値とを比較し 、設定された電圧値と入力信号の電圧値の大小関係に基づいて検出信号を出力す る。このとき、コンパレータ11とコンパレータ12とでは。 13,14はDフリップフロップで、コンパレータ11の出力はDフリップフ ロップ13のクロック端子CKに入力され、コンパレータ12の出力はDフリッ プフロップ14のクロック端子CKに入力される。Dフリップフロップ13およ びDフリップフロップ14のQ出力端子の出力をセレクタ15にて出力する。 また、制御手段6にて、セレクタ15における動作の制御のための信号が出力 される。従って、Dフリップフロップ13およびDフリップフロップ14におけ るデータ端子Dに信号が入力されることで、Dフリップフロップ13およびDフ リップフロップ14の動作が制御され、セレクタ15にセレクト信号を出力する ことで、セレクタ15における信号出力の選択がなされる。 FIG. 1 is a block diagram of an embodiment of the present invention. In the figure, 11 and 12 are comparators having different frequency characteristics, which compare an input signal with a set voltage value and output a detection signal based on the magnitude relationship between the set voltage value and the voltage value of the input signal. Suru At this time, in the comparator 11 and the comparator 12. Reference numerals 13 and 14 denote D flip-flops, the output of the comparator 11 is input to the clock terminal CK of the D flip-flop 13, and the output of the comparator 12 is input to the clock terminal CK of the D flip-flop 14. The outputs of the Q output terminals of the D flip-flops 13 and 14 are output by the selector 15. Further, the control means 6 outputs a signal for controlling the operation of the selector 15. Therefore, the operation of the D flip-flop 13 and the D flip-flop 14 is controlled by inputting a signal to the data terminal D of the D flip-flop 13 and the D flip-flop 14, and the select signal is output to the selector 15. As a result, the signal output in the selector 15 is selected.

【0007】 この様な構成における動作を説明する。 入力された信号は、コンパレータ11に入力されるものと、コンパレータ12 に入力されるものとがある。このときコンパレータ11はコンパレータ12に比 較し、低い周波数帯域を有する。 このとき、コンパレータにおける熱雑音は、√(4kTfR)で表される。従って、 周波数の帯域が広いものほど熱雑音が、大きいことになる。例えば、fがコンパ レータ11の2倍の帯域をコンパレータ12で有するとすると、コンパレータ1 2の熱雑音はコンパレータ11の1.41倍あることになる。The operation in such a configuration will be described. The input signals include those input to the comparator 11 and those input to the comparator 12. At this time, the comparator 11 has a lower frequency band than the comparator 12. At this time, the thermal noise in the comparator is represented by √ (4kTfR). Therefore, the wider the frequency band, the larger the thermal noise. For example, if f has a band twice that of the comparator 11 in the comparator 12, the thermal noise of the comparator 12 is 1.41 times that of the comparator 11.

【0008】 このため、2種類の周波数特性を有するコンパレータを設けることで、入力信 号の周波数およびそのサンプリング方法に適したコンパレータによるトリガ信号 を用いることで、ジッタの発生を防ぐことができる。 なお、入力信号の周波数が不明な場合は、コンパレータ11およびコンパレー タ12を切り換えて入力信号を入力し、その各々の観測結果からどちらを用いる か判断する方法も考えられる。Therefore, by providing a comparator having two types of frequency characteristics, it is possible to prevent the occurrence of jitter by using the trigger signal from the comparator suitable for the frequency of the input signal and its sampling method. If the frequency of the input signal is unknown, a method may be considered in which the comparator 11 and the comparator 12 are switched to input the input signal, and which of the observation results is used to determine which to use.

【0009】 図2は本考案の他の実施例の構成図である。図において21はデバイダで、入 力端子1に接続し、入力したアナログ信号を分割するものである。このデバイダ は伝送線路R1〜R3から構成される。このとき伝送線路R1は入力端子1に接 続され、伝送線路R2、R3は各々コンパレータ22およびコンパレータ23に 接続される。接地抵抗であるR4,R5は100Ωである。 コンパレータ22は、デバイダ21の一の出力が設定された電圧値に対し、立 ち上がりが生じたことを検出する。 コンパレータ23は、デバイダ21の他の出力が設定された電圧値に対し、立 ち下がりが生じたことを検出する。 デジタル処理回路24は、コンパレータ22およびコンパレータ23の出力を デジタル処理等をすることにより、いわゆるトリガ信号の生成あるいは波形観測 における時間軸の制御等といったデジタル処理を行う。FIG. 2 is a block diagram of another embodiment of the present invention. In the figure, reference numeral 21 denotes a divider which is connected to the input terminal 1 and divides the input analog signal. This divider is composed of transmission lines R1 to R3. At this time, the transmission line R1 is connected to the input terminal 1, and the transmission lines R2 and R3 are connected to the comparator 22 and the comparator 23, respectively. Ground resistances R4 and R5 are 100Ω. The comparator 22 detects that one output of the divider 21 has risen with respect to the set voltage value. The comparator 23 detects that the other output of the divider 21 has fallen with respect to the set voltage value. The digital processing circuit 24 performs digital processing such as so-called trigger signal generation or time axis control in waveform observation by digitally processing the outputs of the comparators 22 and 23.

【0010】 このような構成における動作の説明をする。 入力信号は、デバイタ21によって分圧されコンパレータ22およびコンパレ ータ23に入力される。デバイタ21はその構成における抵抗値の割合故、入力 信号の振幅が減衰することなくコンパレータ22およびコンパレータ23に入力 される。さらに同一の信号の立ち上がりをコンパレータ22で、その立ち下がり をコンパレータ23で検出する。 このため、整合を保ちつつ、振幅が減少することなく処理ができる。The operation of such a configuration will be described. The input signal is divided by the divider 21 and input to the comparator 22 and the comparator 23. The divider 21 is input to the comparator 22 and the comparator 23 without the amplitude of the input signal being attenuated because of the ratio of the resistance value in the configuration. Further, the rising edge of the same signal is detected by the comparator 22 and the falling edge thereof is detected by the comparator 23. Therefore, the processing can be performed while maintaining the matching and without reducing the amplitude.

【0011】 図3は本考案のその他の実施例の構成図である。 31は複数の入力端子を有する入力部で、32はアッテネータ部で各々の入力 端子からの入力の減衰を行い、かつそのコモン電圧は制御手段6により切り換わ る構成となっている。FIG. 3 is a block diagram of another embodiment of the present invention. Reference numeral 31 is an input section having a plurality of input terminals, 32 is an attenuator section for attenuating the input from each input terminal, and its common voltage is switched by the control means 6.

【0012】 このような構成を具体的に説明する。 アッテネータ部32において、各々の減衰器にはスイッチが設られ、終端抵抗 を選択できる。 また選択回路33の入力端子には各々デバイダが接続され、信号が2つに分割 される。 このデバイダの出力はスイッチSW1〜SW8に接続される。 SW1〜SW8は1の入力に対し、2の出力を選択することができる構成にな っているものである。 スイッチSW1,SW3,SW5,SW7の各々の出力はそのまま出力がされ るもの(いわゆるスルーな状態)又は遅延素子d1〜d4を介した出力のいずれ かに接続することを選択できる構成となっている。 スイッチSW2,SW4,SW6,SW8の各々の片側の出力が結合したもの はトリガ端子とする。 スイッチSW2,SW4,SW6,SW8の各々の出力はトリガ端子又は終端 抵抗を介し接地されたもののいずれかに接続することを選択できる構成となって いる。Such a configuration will be specifically described. In the attenuator section 32, a switch is provided in each attenuator, and a terminating resistor can be selected. Further, a divider is connected to each input terminal of the selection circuit 33, and the signal is divided into two. The output of this divider is connected to the switches SW1 to SW8. SW1 to SW8 have a configuration in which 2 outputs can be selected with respect to 1 input. The output of each of the switches SW1, SW3, SW5, and SW7 is directly output (so-called through state) or the output via the delay elements d1 to d4 can be connected. . One of the outputs of the switches SW2, SW4, SW6 and SW8, which is connected, is used as a trigger terminal. The output of each of the switches SW2, SW4, SW6, and SW8 can be selected to be connected to either the trigger terminal or the one grounded via the terminating resistor.

【0013】 SW9〜SW12は1の出力に対し、2の入力を選択することができる構成に なっているものである。 従って、各々は遅延素子d1〜d4又はスルーな状態を各々選択し、出力する こととなる。SW9 to SW12 are configured so that two inputs can be selected with respect to one output. Therefore, each of the delay elements d1 to d4 or the through state is selected and output.

【0014】 このため、制御手段6にて、各々のスイッチのオン・オフを制御することで、 ディレイライン(遅延素子)を介したり、スルーでデジタル処理回路24に入力 したりする。また、測定に用いない信号は終端抵抗に接続されることで、測定対 象としない入力端子に高周波の信号が入力されていても、反射が生じることがな い。 トリガ端子も配置できるので、通常サンプリングオシロで必要とされる外部ト リガをわざわさ用いる必要がなくなる。 また、入力信号はディレイラインを介してデジタル処理回路34に入力し、一 方、トリガ信号(trg)を遅延させることなく、デジタル処理回路34に入力さ せることで従来のサンプリングオシロスコープでは実現ができなかったプリトリ ガの機能を実現することが可能となる。For this reason, the control means 6 controls ON / OFF of each switch to input to the digital processing circuit 24 via a delay line (delay element) or through. In addition, signals that are not used for measurement are connected to terminating resistors, so that reflection does not occur even if a high-frequency signal is input to an input terminal that is not intended for measurement. Since the trigger terminal can also be placed, it is not necessary to use the external trigger that is usually required in the sampling oscilloscope. In addition, the input signal is input to the digital processing circuit 34 via the delay line, and on the other hand, the trigger signal (trg) can be input to the digital processing circuit 34 without delay, which can be realized with the conventional sampling oscilloscope. It is possible to realize the functions of the pre-trigger that were not there.

【0015】[0015]

【考案の効果】[Effect of device]

なお、本考案により、波形観測装置において、入力信号の測定の効率が向上す る。 The present invention improves the efficiency of measuring the input signal in the waveform observation device.

【図面の簡単な説明】[Brief description of drawings]

【図1】本考案の一実施例の回路図である。FIG. 1 is a circuit diagram of an embodiment of the present invention.

【図2】本考案の他の実施例の構成図である。FIG. 2 is a configuration diagram of another embodiment of the present invention.

【図3】本考案の他の実施例の回路図である。FIG. 3 is a circuit diagram of another embodiment of the present invention.

【符号の説明】[Explanation of symbols]

11 高周波用コンパレータ 12 低周波用コンパレータ 13,14 Dフリップフロップ 15 セレクタ 6 制御回路 11 High Frequency Comparator 12 Low Frequency Comparator 13, 14 D Flip Flop 15 Selector 6 Control Circuit

Claims (3)

【実用新案登録請求の範囲】[Scope of utility model registration request] 【請求項1】外部より波形観測の対象としてアナログ信
号を入力し、設定された電圧値と入力信号の電圧値の大
小関係に基づいて検出信号を出力する第1のコンパレー
タと、 外部より波形観測の対象としてアナログ信号を入力し、
設定された電圧値と入力信号の電圧値の大小関係に基づ
いて検出信号を出力し、前記第1のコンパレータと異な
る周波数特性を有する第2のコンパレータと前記第1の
コンパレータおよび第2のコンパレータの出力を選択し
て出力する選択手段と、 前記第1のコンパレータ及び第2のコンパレータの比較
すべき電圧値を設定し、前記選択手段での信号の選択を
設定する制御回路と、 を設けたことを特徴とする波形観測装置。
1. A first comparator which inputs an analog signal as an object of waveform observation from the outside and outputs a detection signal based on a magnitude relation between a set voltage value and a voltage value of the input signal, and an external waveform observation. Input the analog signal as the target of
The second comparator, which outputs a detection signal based on the magnitude relationship between the set voltage value and the voltage value of the input signal, has a frequency characteristic different from that of the first comparator, and the first comparator and the second comparator. Selection means for selecting and outputting an output; and a control circuit for setting voltage values to be compared by the first comparator and the second comparator and setting signal selection by the selection means. Waveform observation device characterized by.
【請求項2】外部より波形観測の対象としてアナログ信
号を入力する入力端子と、 前記入力端子に接続する、特性インピーダンス50Ωの
ケーブル(R1)と、前記ケーブルに一端を接続し、他端
に第1のコンパレータと第1の100Ωの抵抗を接続し
た特性インピーダンス100Ωを有する第1の伝送線路
(R2)と、前記ケーブルに片端を接続し、他端に第2の
コンパレータと第2の100Ωの抵抗を接続した特性イ
ンピーダンス100Ωを有する第2の伝送線路(R3)と
からなるデバイダと、 前記デバイダの第1の出力を、設定された電圧値と比較
し、入力信号が設定された電圧値に対し、立ち上がりを
生じたことを検出し検出信号を出力する第1のコンパレ
ータと、 前記デバイダの第2の出力を、設定された電圧値と比較
し、入力信号が設定された電圧値に対し、立ち下がりが
生じたことを検出し検出信号を出力する第2のコンパレ
ータと、 前記第1のコンパレータおよび第2のコンパレータの出
力を選択するためのデジタル処理回路と、 を設けたことを特徴とする波形観測装置。
2. An input terminal for inputting an analog signal as an object of waveform observation from the outside, a cable (R1) having a characteristic impedance of 50Ω connected to the input terminal, one end of which is connected to the cable, and the other end of which is A first transmission line having a characteristic impedance of 100Ω in which a first comparator and a first 100Ω resistor are connected.
A divider comprising (R2) and a second transmission line (R3) having a characteristic impedance of 100Ω, one end of which is connected to the cable and the other end of which is connected a second comparator and a second 100Ω resistor; A first comparator that compares a first output of the divider with a set voltage value, detects that a rising edge has occurred with respect to the set voltage value of the input signal, and outputs a detection signal; and a first comparator of the divider. A second comparator that compares the second output with a set voltage value, detects a fall of the input signal with respect to the set voltage value, and outputs a detection signal; and the first comparator. A waveform observing device, comprising: a digital processing circuit for selecting the output of the comparator and the second comparator.
【請求項3】外部より波形観測の対象としてアナログ信
号を入力する入力端子と、 前記入力端子に接続し、入力したアナログ信号を減衰
し、接地電位のレベルを切り換える手段を有するアッテ
ネータ部と、 前記アッテネータ部からの出力にたいし、その終端抵抗
および信号の遅延時間を選択することが可能な選択手段
と、 前記アッテネータ部での切り換えおよび、前記選択手段
での信号の選択を設定する制御回路と、 を設けたことを特徴とする波形観測装置。
3. An input terminal for inputting an analog signal as an object of waveform observation from the outside, an attenuator section having means for connecting to the input terminal, attenuating the input analog signal, and switching the level of the ground potential. A selection unit capable of selecting a termination resistance and a signal delay time for the output from the attenuator unit; and a control circuit for setting switching in the attenuator unit and selection of the signal in the selection unit. A waveform observing device, which is provided with.
JP2327493U 1993-05-06 1993-05-06 Waveform observation device Withdrawn JPH0682574U (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014147035A (en) * 2013-01-30 2014-08-14 Toppan Printing Co Ltd CMOS comparator

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