JPH0656691B2 - Disk device by multi-channel parallel transfer method - Google Patents

Disk device by multi-channel parallel transfer method

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JPH0656691B2
JPH0656691B2 JP14673789A JP14673789A JPH0656691B2 JP H0656691 B2 JPH0656691 B2 JP H0656691B2 JP 14673789 A JP14673789 A JP 14673789A JP 14673789 A JP14673789 A JP 14673789A JP H0656691 B2 JPH0656691 B2 JP H0656691B2
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data
read
timing
parallel transfer
channel
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芳夫 藤岡
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Toshiba Corp
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Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) 本発明は、複数チャネル並列転送方式によるディスク装
置に関し、特に複数枚のディスクのチャネル間に生じる
回転ずれの影響を抑える技術の改良に関する。
DETAILED DESCRIPTION OF THE INVENTION Object of the Invention (Industrial field of use) The present invention relates to a disk device using a multi-channel parallel transfer system, and more particularly to a technique for suppressing the influence of rotational deviation occurring between channels of a plurality of disks. Regarding the improvement of.

(従来の技術) 従来、この種の複数チャネル並列転送方式によるディス
ク装置は、複数枚のディスクにそれぞれ書き込まれた情
報を対応する各ヘッドで読み出し、この各読み出し信号
をそれぞれヘッドICで増幅後、例えば第4図に示す如
く各再生回路1(11〜1N)へ送出し、各再生回路1に
おいて、仁値化データ(PRDT1Nとクロック(PR
CK1N)に変換した後、各駆動回路2(21〜2N)を
介して図示しないホストシステムのコントローラへ送出
するようになされている。
(Prior Art) Conventionally, in a disk device using a multi-channel parallel transfer system of this type, information written in a plurality of disks is read by each corresponding head, and each read signal is amplified by a head IC, For example, as shown in FIG. 4, it is sent to each reproducing circuit 1 (1 1 to 1 N ), and in each reproducing circuit 1, the binarized data (PRDT 1 to N and clock (PR
After being converted into CK 1 to N ), it is sent to the controller of the host system (not shown) via each drive circuit 2 (2 1 to 2 N ).

そして、複数枚のディスクのチャネル間に生じる回転ず
れの影響を抑え対策を、ホストシステムのコントローラ
に施していた。
Then, the controller of the host system is provided with a measure to suppress the influence of the rotational deviation generated between the channels of the plurality of disks.

(発明が解決しようとする課題) しかしながら、上記した従来の如く複数チャネル並列転
送方式で各駆動回路2をドライブする場合、上記チャネ
ル間の回転ずれのため、ドライブクロックを共通化する
ことができない。
(Problems to be Solved by the Invention) However, when driving each drive circuit 2 by the multi-channel parallel transfer method as in the above-described conventional case, the drive clock cannot be made common due to the rotation deviation between the channels.

この場合、チャネル数が増加すればする程、ホストシス
テム側において信号線の数が増え、またインターフェイ
ス仕様が複雑化するためコントローラは複数のクロック
に対応できる機能を持つことが要求される。
In this case, as the number of channels increases, the number of signal lines on the host system side also increases, and the interface specifications become complicated. Therefore, the controller is required to have a function capable of handling a plurality of clocks.

従って、従来のこの種の複数チャネル並列転送方式によ
るディスク装置は、システム全体が大がかりとなるだけ
でなく、更にチャネル数を増大させることがシステムの
信頼性等の観点で困難であるという不具合があった。
Therefore, the conventional disk device using the multi-channel parallel transfer system of this type has a problem that not only the entire system becomes large-scale, but also it is difficult to further increase the number of channels from the viewpoint of system reliability and the like. It was

本発明は、係る事情に着目してなされたものであり、そ
の目的は、各ヘッドよりの読み出し信号に対応する各二
値化データを共通のドライブクロックに従ってホストシ
ステムへ転送することができる複数チャネル並列転送方
式によるディスク装置を提供することにある。
The present invention has been made in view of such circumstances, and an object thereof is to provide a plurality of channels capable of transferring each binarized data corresponding to a read signal from each head to a host system according to a common drive clock. It is to provide a disk device by a parallel transfer method.

[発明の構成] (課題を解決するための手段) 本発明は、上記の目的を達成するため、複数枚のディス
クにそれぞれ書き込まれた情報を対応する各ヘッドより
読み出し、この各読み出し信号を二値化データに変換し
てホストシステムへ複数チャネル並列転送方式で転送す
るディスク装置において、 前記各二値化データを対象として書き込み及び読み出し
がなされるメモリ手段と、 このメモリ手段に対し、チャネル毎に再生したクロック
タイミングで書き込み制御するとともに、各チャネル共
通のクロックタイミングで読み出し制御するタイミング
制御手段と、 このタイミング制御手段により書き込み及び読み出し制
御されている前記メモリ手段よりの読み出しデータを、
前記ホストシステムへ複数チャネル並列転送方式で転送
するデータとして用いるデータ転送駆動手段とを、具備
することを特徴とするものである。
[Structure of the Invention] (Means for Solving the Problems) In order to achieve the above-mentioned object, the present invention reads the information respectively written on a plurality of disks from each corresponding head, and outputs each read signal to each disk. In a disk device for converting into binarized data and transferring to a host system by a multi-channel parallel transfer method, memory means for writing and reading each binarized data as a target, and for this memory means, for each channel Timing control means for controlling writing at the reproduced clock timing and reading control at the clock timing common to each channel, and read data from the memory means subjected to writing and reading control by the timing control means,
Data transfer driving means used as data to be transferred to the host system by a multi-channel parallel transfer method.

(作用) 本発明による構成であれば、各ヘッドよりの読み出し信
号にそれぞれ対応する各二値化データがメモリ手段にお
いてタイミング制御手段のタイミング制御により同期し
て読み出されるため、上記各二値化データは、データ転
送駆動手段からホストシステムへ共通クロックに従って
転送されることになる。
(Operation) With the configuration according to the present invention, since each binarized data corresponding to the read signal from each head is read in synchronization with the timing control of the timing control means in the memory means, each binarized data described above. Will be transferred from the data transfer driving means to the host system according to a common clock.

そのため、ホストシステム側において、コントローラは
単一クロックに従って上記二値化データを受け取れ、し
かもその単一クロックをリード時の基本クロックとして
使用することが可能となる。
Therefore, on the host system side, the controller can receive the binarized data in accordance with a single clock and can use the single clock as a basic clock at the time of reading.

(実施例) 第1図は、本発明が適用された一実施例の複数チャネル
並列転送方式によるディスク装置の要部回路構成を示す
ブロック図である。
(Embodiment) FIG. 1 is a block diagram showing a circuit configuration of essential parts of a disk device by a multi-channel parallel transfer system of an embodiment to which the present invention is applied.

この一実施例のディスク装置は、各ヘッドよりの読み出
し信号を二値化データに変換してホストシステムへ複数
チャネル並列転送方式で転送するため、再生回路1(1
1〜1N)と駆動回路2との間に各再生回路1に対応させ
てチャネル毎に先入先出(FIFO)バッファメモリ3
(31〜3N)とセレクタ4(41〜4N)を設け、またこ
れらをタイミング制御するため、タイミング制御部5を
設けている。
In the disk device of this embodiment, since the read signal from each head is converted into binary data and transferred to the host system by the multiple channel parallel transfer method, the reproducing circuit 1 (1
1 to 1 N ) and the drive circuit 2 in correspondence with each reproduction circuit 1 for each channel, first-in first-out (FIFO) buffer memory 3
(3 1 to 3 N ) and the selector 4 (4 1 to 4 N ) are provided, and the timing control unit 5 is provided to control the timing of these.

タイミング制御部5は、回転制御部6から発生される回
1を示すインデックス/セクタ信号と、各再生回路1
のうち特定の再生回路1Nの再生クロック(PRCK
N)とを基に、各バッファメモリ3への書き込み/読み
出し期間を決定する。これにより各バッファメモリ3に
対し、チャネル毎に再生したクロックタイミングで書き
込み制御するとともに、各チャネル共通のクロックタイ
ミングで読み出し制御するタイミング制御手段としての
機能と、各バッファメモリ3におけるデータ読み出し開
始をその書き込み開始より予め設定した時間だけ遅延さ
せる処理を実行する遅延手段としての機能をもつもので
ある。
The timing control unit 5 includes an index / sector signal indicating the rotation 1 generated from the rotation control unit 6 and each reproduction circuit 1
Reproduction clock (PRCK specific reproduction circuit 1 N of
N), the write / read period for each buffer memory 3 is determined. As a result, a function as a timing control unit that controls writing to each buffer memory 3 at a clock timing reproduced for each channel and controls reading at a clock timing common to each channel, and a start of data reading in each buffer memory 3 are performed. It has a function as a delay unit that executes a process of delaying a preset time from the start of writing.

更に、このタイミング制御部5は、上記インデックス/
セクタ信号と、上記特定の再生回路1Nの再生クロック
(PRCKN)とを基に、各再生回路1の安定化に要す
る時間及びチャネル間の回転ずれ時間のそれぞれを加算
した時間だけ予め定めたデータを出力すべき旨の指示を
各1レクタ4へ加える指示手段としての機能を併せ持つ
ものである。
Further, the timing control unit 5 uses the index /
Based on the sector signal and the reproduction clock (PRCKN) of the specific reproduction circuit 1 N , predetermined data for the time required for stabilizing each reproduction circuit 1 and the rotation deviation time between channels are added. It also has a function as an instruction means for adding an instruction to output 1 to each 1-lector 4.

このようなタイミング制御部5から出力される各信号の
タイミングチャートを図示すると第2図に示す通りとな
る。
A timing chart of each signal output from the timing controller 5 is shown in FIG.

第2図において、S0はセクタの開始を示す信号であ
り、このセクタ開始信号S0が回転制御部6からタイミ
ングマ制御部5へ加わると、タイミング制御部5は、各
バッファメモリ3のカウンタクリア(S1)を行った
後、書き込み(S2)と読み出し(S3)とを指示す
る。
In FIG. 2, S 0 is a signal indicating the start of a sector. When the sector start signal S 0 is applied from the rotation control unit 6 to the timing control unit 5, the timing control unit 5 causes the counter of each buffer memory 3 to count. After clearing (S1), writing (S2) and reading (S3) are instructed.

従って、各再生回路1で再生された二値化データ(PR
DT1N)が同時に再生されたクロック(PRCK
1N)のタイミングで各バッファメモリ3に書き込ま
れ、上記特定の再生回路1Nの再生クロック(PRCK
N)を共通クロックとして各バッファメモリ3から読み
出される。
Therefore, the binarized data (PR) reproduced by each reproduction circuit 1
A clock (PRCK) in which DT 1 to N are reproduced at the same time.
1 to N ) is written in each buffer memory 3 and the reproduction clock (PRCK) of the specific reproduction circuit 1 N is written.
N) is used as a common clock and is read from each buffer memory 3.

そして、各バッファメモリ3における読み出しのタイミ
ングは、チャネル間に回転ずれが生じてもデータがとぎ
れないように、第2図中、期間Aだけ読み出しを遅らせ
ている。
The read timing of each buffer memory 3 is delayed by the period A in FIG. 2 so that the data is not interrupted even if the rotation shift occurs between the channels.

一方、各バッファメモリ3から読み出された二値化デー
タを受けることになる各セレクタ4は、タイミング制御
部5の上記指示手段より指示(S4)に応答して、第2
図中の期間B即ち各再生回路1の安定化に要する時間に
チャネル間の回転ずれ時間を加えた時間だけ、予め定め
たデータを駆動回路2へ出力した後、各バッファメモリ
3よりの二値化データを駆動回路2へ送出する切り替え
を行う切り替え手段として機能する。
On the other hand, each selector 4, which receives the binarized data read from each buffer memory 3, responds to the instruction (S 4 ) from the above-mentioned instructing means of the timing control section 5, and outputs the second
In the period B in the figure, that is, the time required for stabilizing each reproducing circuit 1 plus the rotational deviation time between channels, after outputting predetermined data to the drive circuit 2, the binary value from each buffer memory 3 is output. It functions as a switching unit that performs switching to send the converted data to the drive circuit 2.

従って、タイミング制御部5の指示手段と各セレクタ4
との組み合せによって各バッファメモリ3から駆動回路
2へ送出される二値化データの頭出しが保証されること
になる。
Therefore, the instruction means of the timing control unit 5 and each selector 4
In combination with the above, the cueing of the binarized data sent from each buffer memory 3 to the drive circuit 2 is guaranteed.

前述の如く、タイミング制御部5によって各バッファメ
モリ3及び各セレクタ4がコントロールされることによ
り、各再生回路1で得られた二値化データが駆動回路2
から図示しないホストシステムのコントローラへ共通ク
ロックに従って転送される。
As described above, the timing control unit 5 controls the respective buffer memories 3 and the respective selectors 4, so that the binarized data obtained by the respective reproducing circuits 1 is converted into the driving circuit 2.
From a host system controller (not shown) according to a common clock.

このようなことから、本発明の一実施例のディスク装置
であれば、ホストシステム側において、コントローラは
単一クロックに従って、各再生回路1の二値化データを
受け取れ、しかもその単一クロックをリード時の基本ク
ロックとして使用することが可能となる。
From the above, in the disk device according to the embodiment of the present invention, the controller on the host system side can receive the binary data of each reproducing circuit 1 according to the single clock and read the single clock. It becomes possible to use it as a basic clock of time.

これにともないインターフェイス使用の単純化を図るこ
とが容易となり、また、ホストシステム側の信号線数を
減らせるので、システム内の各部間を結線するケーブル
の配分も容易となる。従って、チャネル数を従来に比し
て大幅に増大しても、システム全体が大がかりとなるの
を制御することができるだけでなく、データ転送上の信
頼性が劣化するのを回避し得る。
Along with this, it becomes easy to simplify the use of the interface, and since the number of signal lines on the host system side can be reduced, it becomes easy to distribute the cables connecting the respective parts in the system. Therefore, even if the number of channels is significantly increased as compared with the conventional one, not only can the entire system be controlled in a large scale, but also the reliability in data transfer can be prevented from deteriorating.

なお、上述した本発明の一実施例では、第3図(A)の
上面図及び同図(B)の一部切欠き側面図に示す如く、
スピンドルモータ(不図示)に結合されたディスク回転
軸7に、ディスク8を一定間隔毎に複数枚装着する一
方、各ディスク8に対して情報の読み書きを行う各ヘッ
ド9を各ヘッドアーム10に装着してディスク部を構成
している。そして、このディスク部における各ヘッド9
よりの読み出し信号をヘッドIC(不図示)で増幅後、
第1図の各再生回路1へ出力するようになされている。
In the embodiment of the present invention described above, as shown in the top view of FIG. 3 (A) and the partially cutaway side view of FIG. 3 (B),
A plurality of disks 8 are mounted at regular intervals on a disk rotating shaft 7 coupled to a spindle motor (not shown), while heads 9 for reading / writing information from / to the disks 8 are mounted on head arms 10. And constitutes the disc portion. Then, each head 9 in this disk portion
Read signal from the head IC (not shown),
It outputs to each reproduction circuit 1 in FIG.

[発明の効果] 以上説明したように、本発明の複数チャネル並列転送方
式によるディスク装置は、チャネル毎に再生したクロッ
クタイミングに従って二値化データをメモリ手段に一旦
格納する一方で、メモリ手段より共通クロックでデータ
を読み出し、ホストシステムへ出力するから、ホストシ
ステム側では共通化したクロックに従って上記二値化デ
ータを受け取るだけでそのデータの読み出しができる。
[Effects of the Invention] As described above, the disk device according to the multiple channel parallel transfer system of the present invention temporarily stores the binarized data in the memory means in accordance with the clock timing reproduced for each channel, while it is shared by the memory means. Since the data is read at the clock and output to the host system, the host system can read the data only by receiving the binarized data according to the common clock.

従って、本発明によれば、ホストシステム側のシステム
構成を簡単にし得るとともに、データ転送上の信頼性の
向上に寄与することができる。
Therefore, according to the present invention, the system configuration on the host system side can be simplified, and the reliability of data transfer can be improved.

【図面の簡単な説明】[Brief description of drawings]

第1図は本発明が適用された一実施例のディスク装置の
要部回路構成を示すブロック図、第2図はタイミング制
御部から出力される各信号のタイミングチャート、第3
図はディスク装置におけるディスク部の概略を示す構成
図、第4図は従来の複数チャネル並列転送方式の機能構
成を示すブロック図である。 1…再生回路、2…駆動回路 3…先入先出バッファメモリ、4…セレクタ 5…タイミング制御部、6…回転制御部
FIG. 1 is a block diagram showing a circuit configuration of essential parts of a disk device of an embodiment to which the present invention is applied, FIG. 2 is a timing chart of each signal output from a timing control unit, and FIG.
FIG. 4 is a block diagram showing an outline of a disk unit in a disk device, and FIG. 4 is a block diagram showing a functional structure of a conventional multiple channel parallel transfer system. DESCRIPTION OF SYMBOLS 1 ... Reproducing circuit, 2 ... Driving circuit 3 ... First-in first-out buffer memory, 4 ... Selector 5 ... Timing control part, 6 ... Rotation control part

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】複数枚のディスクにそれぞれ書き込まれた
情報を対応する各ヘッドより読み出し、この各読み出し
信号を二値化データに変換してホストシステムへ複数チ
ャネル並列転送方式で転送するディスク装置において、 前記各二値化データを対象として書き込み及び読み出し
がなされるメモリ手段と、 このメモリ手段に対し、チャネル毎に再生したクロック
タイミングで書き込み制御するとともに、各チャネル共
通のクロックタイミングで読み出し制御するタイミング
制御手段と、 このタイミング制御手段により書き込み及び読み出し制
御されている前記メモリ手段よりの読み出しデータを、
前記ホストシステムへ複数チャネル並列転送方式で転送
するデータとして用いるデータ転送駆動手段とを、具備
することを特徴とする複数チャネル並列転送方式による
ディスク装置。
1. A disk apparatus for reading information written on a plurality of disks from corresponding heads, converting each read signal into binary data, and transferring the binary data to a host system by a multi-channel parallel transfer method. A memory means for writing and reading each of the binarized data, and a timing for performing write control on the memory means at a clock timing reproduced for each channel and a read control at a clock timing common to each channel. Control means, and read data from the memory means which is controlled to write and read by the timing control means,
And a data transfer driving means used as data to be transferred to the host system by a multi-channel parallel transfer system.
【請求項2】前記タイミング制御手段は、前記メモリ手
段におけるデータ読み出し開始をその書き込み開始より
予め設定した時間だけ遅延させる処理を実行する遅延手
段を含むことを特徴とする請求項1記載の複数チャネル
並列転送方式によるディスク装置。
2. The plurality of channels according to claim 1, wherein the timing control means includes a delay means for executing a process of delaying a data read start in the memory means from a write start by a preset time. Disk device by parallel transfer method.
【請求項3】前記タイミング制御手段は、データ読み出
し要求を受ける毎に、前記各再生回路の安定化に要する
時間及びチャネル間の回転ずれ時間のそれぞれを加算し
た時間だけ予め定めたデータを出力すべき旨の指示を前
記データ転送駆動手段に加える指示手段を含み、前記デ
ータ転送駆動手段は、前記指示手段よりの指示に応答し
て予め定めたデータを出力した後、前記メモリ手段から
読み出しデータを受ける切り替え手段を含むことを特徴
とする請求項1記載の複数チャネル並列転送方式による
ディスク装置。
3. The timing control means outputs, every time a data read request is received, predetermined data for a time obtained by adding a time required for stabilizing each of the reproducing circuits and a rotation deviation time between channels. An instruction means for adding an instruction to the effect to the data transfer driving means, wherein the data transfer driving means outputs predetermined data in response to the instruction from the instructing means and then reads the read data from the memory means. 2. The disk device according to the multi-channel parallel transfer system according to claim 1, further comprising switching means for receiving the data.
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KR101513710B1 (en) * 2007-09-25 2015-04-20 가부시키가이샤 다이헨 Pwm signal generator, and inverter equipped with this pwm signal generator
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