JPH0568110U - Variable frequency oscillator - Google Patents
Variable frequency oscillatorInfo
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- JPH0568110U JPH0568110U JP620792U JP620792U JPH0568110U JP H0568110 U JPH0568110 U JP H0568110U JP 620792 U JP620792 U JP 620792U JP 620792 U JP620792 U JP 620792U JP H0568110 U JPH0568110 U JP H0568110U
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Abstract
(57)【要約】
【目的】 周波数可変範囲を広げつつ発振余裕度が大き
い周波数可変発振回路を実現する。
【構成】 インバータ1及び水晶振動子2を備えた周波
数可変発振回路において、水晶振動子2と直列に接続さ
れたインダクタLと、インダクタLと並列に接続された
抵抗Rd2と、並列接続されたインダクタL及び抵抗Rd2
を短絡させるスイッチ4とを備えたことを特徴とするも
のである。
(57) [Summary] [Purpose] To realize a variable frequency oscillator circuit with a wide oscillation margin while widening the variable frequency range. In a variable frequency oscillation circuit including an inverter 1 and a crystal oscillator 2, an inductor L connected in series with the crystal oscillator 2, a resistor Rd2 connected in parallel with the inductor L, and an inductor connected in parallel. L and resistance Rd2
And a switch 4 for short-circuiting.
Description
【0001】[0001]
本考案は周波数可変発振回路に関し、更に詳しくは発振周波数の変更が可能な 周波数可変発振回路に関する。 The present invention relates to a variable frequency oscillator circuit, and more particularly to a variable frequency oscillator circuit capable of changing an oscillation frequency.
【0002】[0002]
従来から一般に使用されているインバータを使用した周波数可変発振回路を図 3に示す。この図において、1はCMOS等のインバータ、2は水晶振動子、3 はバッファ、Rは帰還抵抗、Rd はダンピング抵抗、CL1及びCL2は負荷容量で ある。 Fig. 3 shows a variable frequency oscillator circuit that uses an inverter that has been commonly used. In this figure, 1 is an inverter such as CMOS, 2 is a crystal oscillator, 3 is a buffer, R is a feedback resistor, Rd is a damping resistor, and CL1 and CL2 are load capacitors.
【0003】 ここで、ダンピング抵抗Rd は、回路の低消費電力化,移相量の確保,ループ 利得を低下させる目的で挿入されている。 この周波数可変発振回路では、インバータを増幅回路として使用し、発振回路 を構成している。Here, the damping resistor Rd is inserted for the purpose of reducing the power consumption of the circuit, ensuring the amount of phase shift, and lowering the loop gain. In this variable frequency oscillator circuit, an inverter is used as an amplifier circuit to form an oscillator circuit.
【0004】[0004]
上記の構成のダンピング抵抗Rd は異常発振を抑えるためにループ利得を低下 させるものであるが、この抵抗値を大きくすると発振余裕度が小さくなる問題が ある。 The damping resistor Rd having the above-mentioned configuration lowers the loop gain in order to suppress abnormal oscillation, but there is a problem in that the oscillation margin becomes small when the resistance value is increased.
【0005】 また、水晶振動子を使用した発振回路では発振周波数を可変にすると、可変範 囲を広げることが困難であるという問題も存在していた。 本考案は上記従来技術の問題点に鑑みてなされたものであり、その目的は、周 波数可変範囲を広げつつ発振余裕度が大きい周波数可変発振回路を実現すること にある。In addition, in the oscillation circuit using the crystal oscillator, if the oscillation frequency is variable, it is difficult to expand the variable range. The present invention has been made in view of the above problems of the prior art, and an object thereof is to realize a frequency variable oscillation circuit having a large oscillation margin while widening the frequency variable range.
【0006】[0006]
【課題を解決するための手段】 上記した課題を解決する手段は、 インバータ及び水晶振動子を備えた周波数可変発振回路において、 水晶振動子と直列に接続されたインダクタと、 インダクタと並列に接続された抵抗と、 並列接続されたインダクタ及び抵抗を短絡させるスイッチとを備えたことを特 徴とするものである。[Means for Solving the Problems] Means for solving the above-mentioned problems are as follows: In a frequency variable oscillation circuit including an inverter and a crystal unit, an inductor connected in series with the crystal unit and connected in parallel with the inductor. And a switch that short-circuits the inductor and the resistor connected in parallel.
【0007】[0007]
インバータを用いた周波数可変発振回路において、水晶振動子にインダクタが 直列接続されているため、周波数可変範囲が広がり、かつ発振余裕度が増加する 。 In a variable frequency oscillator that uses an inverter, the inductor is connected in series to the crystal unit, which widens the variable frequency range and increases the oscillation margin.
【0008】[0008]
以下図面を参照して、本考案の実施例を詳細に説明する。 図1は本考案の一実施例をPLL構成として示す構成図、図2は各部の信号波 形を示す波形図、図3は波形の詳細を示す波形図である。これらの図において、 1はインバータ、2は水晶振動子、3はバッファ、4は外部からの指示によりオ ンオフするようにインダクタLと並列に配置されたスイッチ、Rd は異常発振を 抑制するためのダンピング抵抗、Lは水晶振動子2と直列に接続されたインダク タ、Rd2はインダクタLと並列に接続された第二ダンピング抵抗、Rは帰還抵抗 、CL1, CL2は負荷容量、5は周波数CLK2で発振する発振器、6は発振器5 の発振出力とインバータ3の出力とを位相比較する位相比較器である。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. 1 is a block diagram showing an embodiment of the present invention as a PLL configuration, FIG. 2 is a waveform diagram showing signal waveforms of respective parts, and FIG. 3 is a waveform diagram showing details of waveforms. In these figures, 1 is an inverter, 2 is a crystal oscillator, 3 is a buffer, 4 is a switch arranged in parallel with the inductor L so as to be turned off by an instruction from the outside, and Rd is for suppressing abnormal oscillation. Damping resistor, L is an inductor connected in series with the crystal unit 2, Rd2 is a second damping resistor connected in parallel with the inductor L, R is a feedback resistor, CL1 and CL2 are load capacitors, and 5 is a frequency CLK2. An oscillator that oscillates, 6 is a phase comparator that compares the oscillation output of the oscillator 5 with the output of the inverter 3.
【0009】 このように構成した本実施例装置の動作は以下のとおりである。 バッファ3の出力CLK2が発振器5の出力CLK1より周波数が高いとき、 位相比較器6の出力によりスイッチ4がオフ側に切換えられる。この結果、イン ダクタLが水晶振動子2と直列に接続され、L成分が大きくなるため、発振周波 数CLK2が下がる。The operation of the apparatus of this embodiment having the above-described configuration is as follows. When the output CLK2 of the buffer 3 has a higher frequency than the output CLK1 of the oscillator 5, the output of the phase comparator 6 switches the switch 4 to the off side. As a result, the inductor L is connected in series with the crystal unit 2 and the L component increases, so that the oscillation frequency CLK2 decreases.
【0010】 ここで、発振周波数CLK2がCLK1よりも下がると、位相比較器の位相比 較結果によりスイッチ4がオン側に切換えられ、インダクタLは作用しなくなる 。この結果、発振周波数CLK2が高くなる。Here, when the oscillation frequency CLK2 becomes lower than CLK1, the switch 4 is switched to the ON side according to the phase comparison result of the phase comparator, and the inductor L stops operating. As a result, the oscillation frequency CLK2 becomes high.
【0011】 以上の動作を繰り返すことにより、CLK2はCLK1と同期が取れるように なる。 また、本実施例では周波数切換え手段として、水晶振動しにインダクタLを直 列接続する構成にしているために、周波数を下げると同時に発振余裕度を上げる ことが可能になっている。By repeating the above operation, CLK2 can be synchronized with CLK1. Further, in this embodiment, the frequency switching means has a structure in which the inductors L are connected in series with each other by vibrating the crystal so that it is possible to increase the oscillation allowance at the same time as decreasing the frequency.
【0012】 本願考案の発明者は図2に示すような回路を試作して実験を行ったところ良好 な結果を得ている。ここでは、帰還抵抗Rを1MΩ,ダンピング抵抗Rd を47 0Ω,水晶振動子2に20MHz,負荷容量CL1及びCL2を7pF,インダクタL を4.7μH,第二ダンピング抵抗を7.5kΩとしている。この場合、周波数 変位幅は320ppm であり、発振余裕度は1kΩ以上であった。The inventor of the present invention has produced good results when the circuit shown in FIG. 2 is prototyped and tested. Here, the feedback resistance R is 1 MΩ, the damping resistance Rd is 470 Ω, the crystal oscillator 2 is 20 MHz, the load capacitances CL1 and CL2 are 7 pF, the inductor L is 4.7 μH, and the second damping resistance is 7.5 kΩ. In this case, the frequency displacement width was 320 ppm and the oscillation allowance was 1 kΩ or more.
【0013】 一方、また、スイッチ7を開閉して負荷容量CL3(22pF)を付加すること で、従来と同じ様に周波数を変更するようにした場合は、周波数変位幅は285 ppm であり、発振余裕度は617Ωであった。On the other hand, when the frequency is changed in the same manner as in the conventional case by opening / closing the switch 7 and adding the load capacitance CL3 (22 pF), the frequency displacement width is 285 ppm and the oscillation is generated. The allowance was 617Ω.
【0014】 このように、本実施例の構成によると、従来の構成より大きな周波数変位幅を 持ち、なおかつ大きな発振余裕度を持つようになる。As described above, according to the configuration of this embodiment, the frequency displacement width is larger than that of the conventional configuration, and the oscillation margin is large.
【0015】[0015]
以上実施例とともに詳細に説明したように、水晶振動子と直列にインダクタを 挿入し、このインダクタと並列に接続されたスイッチでインダクタの状態を切換 えるようにすることで、従来の構成より大きな周波数変位幅を持ち、なおかつ大 きな発振余裕度を持つ周波数可変発振回路を実現できる。 As described in detail with the examples above, an inductor is inserted in series with the crystal unit, and the state of the inductor can be switched by the switch connected in parallel with this inductor. It is possible to realize a variable frequency oscillator circuit that has a large displacement range and a large oscillation margin.
【図1】本考案の一実施例の全体の構成を示す構成図で
ある。FIG. 1 is a configuration diagram showing an overall configuration of an embodiment of the present invention.
【図2】本考案の一実施例に試験状態を示す説明図であ
る。FIG. 2 is an explanatory view showing a test state in one embodiment of the present invention.
【図3】従来における装置の構成を示す説明図である。FIG. 3 is an explanatory diagram showing a configuration of a conventional device.
1 インバータ 2 水晶振動子 3 インバータ(バッファ) 4 スイッチ 5 発振器 6 位相比較器 R 帰還抵抗 Rd ダンピング抵抗 CL1,CL2 負荷容量 L インダクタ Rd2 第二ダンピング抵抗 1 Inverter 2 Crystal oscillator 3 Inverter (buffer) 4 Switch 5 Oscillator 6 Phase comparator R Feedback resistor Rd Damping resistor CL1, CL2 Load capacitance L Inductor Rd2 Second damping resistor
Claims (1)
を備えた周波数可変発振回路において、 水晶振動子(2)と直列に接続されたインダクタ(L)
と、 インダクタ(L)と並列に接続された抵抗(Rd2)と、 並列接続されたインダクタ(L)及び抵抗(Rd2)を短
絡させるスイッチ(4)とを備えたことを特徴とする周
波数可変発振回路。1. An inverter (1) and a crystal unit (2)
In a variable frequency oscillator circuit including: an inductor (L) connected in series with a crystal unit (2)
And a resistor (Rd2) connected in parallel with the inductor (L), and a switch (4) for short-circuiting the inductor (L) and the resistor (Rd2) connected in parallel. circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP620792U JPH0568110U (en) | 1992-02-17 | 1992-02-17 | Variable frequency oscillator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP620792U JPH0568110U (en) | 1992-02-17 | 1992-02-17 | Variable frequency oscillator |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0568110U true JPH0568110U (en) | 1993-09-10 |
Family
ID=11632092
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP620792U Withdrawn JPH0568110U (en) | 1992-02-17 | 1992-02-17 | Variable frequency oscillator |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0568110U (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012177667A (en) * | 2011-02-25 | 2012-09-13 | Conti Temic Microelectronic Gmbh | Circuit device to obtain frequency |
JP2012527826A (en) * | 2009-05-18 | 2012-11-08 | クゥアルコム・インコーポレイテッド | System and method for reducing power consumption of an oscillator |
-
1992
- 1992-02-17 JP JP620792U patent/JPH0568110U/en not_active Withdrawn
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012527826A (en) * | 2009-05-18 | 2012-11-08 | クゥアルコム・インコーポレイテッド | System and method for reducing power consumption of an oscillator |
JP2012177667A (en) * | 2011-02-25 | 2012-09-13 | Conti Temic Microelectronic Gmbh | Circuit device to obtain frequency |
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Legal Events
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A300 | Withdrawal of application because of no request for examination |
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