JPH0563858B2 - - Google Patents

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JPH0563858B2
JPH0563858B2 JP30106687A JP30106687A JPH0563858B2 JP H0563858 B2 JPH0563858 B2 JP H0563858B2 JP 30106687 A JP30106687 A JP 30106687A JP 30106687 A JP30106687 A JP 30106687A JP H0563858 B2 JPH0563858 B2 JP H0563858B2
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JP
Japan
Prior art keywords
subcode data
address
signal
subcode
microcomputer
Prior art date
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Application number
JP30106687A
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Japanese (ja)
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JPH01143077A (en
Inventor
Hiroyuki Matsuoka
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Sharp Corp
Original Assignee
Sharp Corp
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Publication date
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Description

【発明の詳細な説明】 [産業上の利用分野] この発明は、磁気記録再生装置に関し、特にデ
イジタル・オーデイオ・テープレコーダ(以下、
単にDATと称す)等におけるサブコードデータ
の重ね書き制御に関する。
[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to a magnetic recording and reproducing device, and particularly to a digital audio tape recorder (hereinafter referred to as
This invention relates to overwriting control of subcode data in devices such as DAT (simply referred to as DAT).

[従来の技術] 従来、磁気テープ上にPCM信号を記録する磁
気記録再生装置として、たとえばDATのように
回転ヘツドを用いて行なうものがある。この方式
において磁気テープ上の記録トラツクは、第4図
に示すように、ヘツドの走行方向に沿つてサブコ
ード領域、ATF領域、PCM領域、ATF領域およ
びサブコード領域の順に信号領域が配置される。
トラツクは196ブロツクに分割でき、それぞれの
領域は図に示すブロツク数で構成されている。1
ブロツクは32シンボルで構成され、1シンボルは
8ビツトで構成される。PCM領域にはPCM音声
データ等が記録され、ATF領域には自動トラツ
キング検出(Automatic Track Finding)のた
めのATF信号が記録される。また、本発明にと
つて興味あるサブコード領域には、種々の制御、
表示等に利用されるサブコードデータ(たとえば
時間情報や曲番情報)が記録される。
[Prior Art] Conventionally, as a magnetic recording/reproducing apparatus for recording PCM signals on a magnetic tape, there is one that uses a rotating head, such as a DAT. In this method, the recording track on the magnetic tape has signal areas arranged in the order of subcode area, ATF area, PCM area, ATF area, and subcode area along the running direction of the head, as shown in Figure 4. .
The track can be divided into 196 blocks, and each area consists of the number of blocks shown in the figure. 1
A block consists of 32 symbols, and one symbol consists of 8 bits. PCM audio data and the like are recorded in the PCM area, and ATF signals for automatic tracking detection are recorded in the ATF area. Furthermore, subcode regions of interest to the present invention include various controls,
Subcode data (for example, time information and track number information) used for display etc. is recorded.

第4図に示すごとく、サブコード領域には上下
8ブロツクずつ合計で16ブロツクが割当てられて
いるが、サブコードデータのデータ長は必要に応
じて長くなつたり短くなつりたするので、その記
録には必ずしも16ブロツクが必要とは限らない。
たとえば、2ブロツクだけでも済む場合もある。
このような場合、残り14ブロツクは空きエリアと
なつてしまうが、それでは残り14ブロツクのサブ
コード領域が無駄になつてしまう。そこで、従来
は、同じサブコードデータを空きエリアにも繰返
し連続して記録し、それによつて読み違えが起こ
らないようにしている。これをN重書き(N=
8、4、2、1)という。
As shown in Figure 4, a total of 16 blocks (8 blocks above and below) are allocated to the subcode area, but since the data length of the subcode data can be lengthened or shortened as necessary, the data length of the subcode data can be lengthened or shortened as necessary. does not necessarily require 16 blocks.
For example, in some cases, only two blocks are required.
In such a case, the remaining 14 blocks will become empty areas, but in this case, the remaining 14 blocks of subcode area will be wasted. Therefore, conventionally, the same subcode data is repeatedly and continuously recorded in empty areas to prevent misreading. Write this N times (N=
8, 4, 2, 1).

第5図は、サブコードデータのN重書きが行な
える従来のDATの記録系を示すブロツクである。
また、第6図は、第5図に示すメモリ4における
サブコードデータ記憶領域を示す図である。第5
図において、外部からローパスフイルタ1に入つ
てきたアナログ信号(たとえば音声信号)は、そ
の高域成分が除去された後、サンプルホールド回
路2で標本化され、A/D変換器3でデイジタル
信号に変換される。一方、マイクロコンピユータ
5から送られてサブコードデータは、一旦バツフ
アの機能を有するメモリ4に第6図のメモリマツ
プ記録方向l沿つて、ブロツクアドレス0から順
に書込まれる。ここで、第6図中のPは、C1パ
リテイすなわち誤り訂正符号(8シンボルで構成
される)を示している。なお、パリテイが作られ
る段階で、2つのブロツクが1つのまとまりとな
つており、結局そのパリテイが奇数番目のブロツ
クにまとめて記憶されている。
FIG. 5 is a block diagram showing a conventional DAT recording system capable of N-multiple writing of subcode data.
Further, FIG. 6 is a diagram showing a subcode data storage area in the memory 4 shown in FIG. 5. Fifth
In the figure, an analog signal (for example, an audio signal) that enters a low-pass filter 1 from the outside is sampled by a sample-hold circuit 2 after its high-frequency components are removed, and converted into a digital signal by an A/D converter 3. converted. On the other hand, the subcode data sent from the microcomputer 5 is once written into the memory 4 having a buffer function in order from block address 0 along the memory map recording direction l in FIG. Here, P in FIG. 6 indicates C1 parity, that is, an error correction code (consisting of 8 symbols). Note that at the stage when parity is created, two blocks are combined into one block, and the parity is ultimately stored together in odd-numbered blocks.

ところで、前述したように、サブコードデータ
は、ブロツクアドレス0〜Fのすべてのブロツク
に記憶されるとは限らない。たとえば、ブロツク
アドレス0および1だけに記憶される場合もあ
り、この場合は、磁気テープ上に同じサブコード
データを8重書きできることになる。同様の考え
方で、ブロツクアドレス0〜3のブロツクにサブ
コードデータが記憶されている場合は、4重書き
が可能であり、ブロツクアドレス0〜8のブロツ
クにサブコードデータが記憶される場合は、2重
書きが可能である。また、ブロツクアドレス0〜
Fのすべてのブロツクにサブコードデータが記憶
される場合は、1重書きしかできない。マイクロ
コンピユータ5は、サブコードデータのデータ長
(すなわちサブコードデータが何ブロツク分ある
か)に応じて、メモリ4を複数回アクセスし、信
号処理回路6にサブコードデータを読出す。信号
処理回路6は前述したA/D変換器3からのデイ
ジタル信号に、上記複数回(1回の場合もある)
読出されたサブコードデータを加え、出力する。
信号処理回路6の出力はヘツドアンプ7で増幅さ
れた後、回転ドラム8に装着された磁気ヘツドで
磁気テープ9上に記録される。
By the way, as mentioned above, subcode data is not necessarily stored in all blocks of block addresses 0 to F. For example, the subcode data may be stored only in block addresses 0 and 1, and in this case, the same subcode data can be written 8 times on the magnetic tape. In the same way, if subcode data is stored in blocks with block addresses 0 to 3, quadruple writing is possible, and if subcode data is stored in blocks with block addresses 0 to 8, Double writing is possible. Also, block address 0~
If subcode data is stored in all blocks of F, only single writing is possible. Microcomputer 5 accesses memory 4 multiple times depending on the data length of the subcode data (ie, how many blocks of subcode data there are), and reads the subcode data to signal processing circuit 6. The signal processing circuit 6 processes the digital signal from the A/D converter 3 a plurality of times (sometimes once).
Add the read subcode data and output.
The output of the signal processing circuit 6 is amplified by a head amplifier 7 and then recorded on a magnetic tape 9 by a magnetic head mounted on a rotating drum 8.

[発明が解決しようとする問題点] 上記のごとく、従来の磁気記録再生装置では、
サブコードデータを重ね書きする場合、マイクロ
コンピユータ5がメモリ4を複数回アクセスしな
ければならず、そのためマイクロコンピユータの
負担が重くなるという問題点があつた。しかも、
複数回のアクセスを高速で行なわなければならな
いので、マイクロコンピユータに高速のものを必
要とし、そのコストが高くなるという問題点もあ
つた。
[Problems to be solved by the invention] As mentioned above, in the conventional magnetic recording and reproducing device,
When overwriting subcode data, the microcomputer 5 has to access the memory 4 multiple times, which poses a problem in that the burden on the microcomputer becomes heavy. Moreover,
Since multiple accesses had to be made at high speed, a high-speed microcomputer was required, which also raised the cost.

この発明は、上記のような従来の問題点を解消
するためになされたもので、マイクロコンピユー
タの負担が軽くて済み、しかもコストの上昇を招
くことなくサブコードデータ読出のためのアクセ
スを高速に行なえるような磁気記録再生装置を提
供することを目的とする。
This invention was made in order to solve the above-mentioned conventional problems, and it is possible to lighten the burden on the microcomputer and speed up access for reading subcode data without increasing costs. The object of the present invention is to provide a magnetic recording/reproducing device that can perform the following operations.

[問題点を解決するための手段] この発明に係る磁気記録再生装置は、磁気記録
媒体上にPCM信号を記録するとともに、そこに
記録されたPCM信号を再生するためのものであ
つて、磁気記録媒体のサブコード領域に記録すべ
きサブコードデータを予め記憶する記憶手段と、
与えられるクロツク信号を計数して、複数ビツト
のアドレス信号を順次歩進しながら発生するアド
レスカウンタと、アドレス信号の各ビツトごとに
設けられる複数のゲート手段と、各ゲート手段の
開閉を制御するマイクロコンピユータよりなるゲ
ート制御手段とを備え、複数のゲート手段の出力
がサブコードデータ読出のためのアドレス信号と
して記憶手段に与えられることを特徴としてい
る。
[Means for Solving the Problems] A magnetic recording and reproducing device according to the present invention is for recording a PCM signal on a magnetic recording medium and reproducing the PCM signal recorded thereon. storage means for pre-storing subcode data to be recorded in a subcode area of the recording medium;
An address counter that counts the applied clock signal and generates a multi-bit address signal while sequentially incrementing it, a plurality of gate means provided for each bit of the address signal, and a microcontroller that controls opening and closing of each gate means. It is characterized in that it comprises gate control means consisting of a computer, and the outputs of the plurality of gate means are applied to the storage means as address signals for reading subcode data.

[作用] この発明においては、マイクロコンピユータが
各ゲート手段の開閉を制御するだけで同じアドレ
スを複数回連続して記憶手段に与えることがで
き、その結果マイクロコンピユータの負担が軽く
なる。
[Operation] In the present invention, the same address can be given to the storage means several times in succession simply by the microcomputer controlling the opening and closing of each gate means, and as a result, the burden on the microcomputer is lightened.

[実施例] 第1図はこの発明の一実施例の磁気記録再生装
置の記録系を示すブロツク図である。図におい
て、この実施例は、以下の点を除いて第5図に示
す従来装置と同様の構成であり、相当する部分に
は同一の参照番号を付し、適宜その説明を省略す
る。図において、マイクロコンピユータ50はゲ
ート制御手段を構成するもので、クロツク信号と
ゲート制御信号A〜Dを出力する。クロツク信号
は、16個のクロツクパルスを含んで構成され、信
号処理回路60内に設けられたアドレスカウンタ
61に与えられる。アドレスカウンタ61は、ク
ロツク信号に含まれるクロツクパルスをカウント
して4ビツトのアドレス信号を出力する。これら
4ビツトのアドレス信号は、それぞれ、ANDゲ
ート11〜14の各一方入力に与えられる。
ANDゲート11〜14の各地方入力には、それ
ぞれ、前記ゲート制御信号A〜Dが与えられる。
ANDゲート11〜14の出力は、サブコードデ
ータ記憶領域(第6図参照)のブロツクアドレス
を指定するためのアドレス信号として、メモリ4
に与えられる。
[Embodiment] FIG. 1 is a block diagram showing a recording system of a magnetic recording/reproducing apparatus according to an embodiment of the present invention. In the figure, this embodiment has the same configuration as the conventional device shown in FIG. 5 except for the following points, and corresponding parts are given the same reference numerals and the explanation thereof will be omitted as appropriate. In the figure, a microcomputer 50 constitutes gate control means and outputs a clock signal and gate control signals A to D. The clock signal includes 16 clock pulses and is applied to an address counter 61 provided within the signal processing circuit 60. Address counter 61 counts clock pulses included in the clock signal and outputs a 4-bit address signal. These 4-bit address signals are applied to one input of each of AND gates 11-14, respectively.
The gate control signals A to D are applied to respective local inputs of the AND gates 11 to 14, respectively.
The outputs of the AND gates 11 to 14 are used as address signals for specifying the block address of the subcode data storage area (see FIG. 6).
given to.

次に、第1図に示す実施例の動作を説明する。
まず、サブコードデータの8重書きを行なう場合
の動作を説明する。この場合、マイクロコンピユ
ータ50から出力される前記ゲート制御信号A,
B,C,Dは、(1、0、0、0)に設定される。
したがつて、ANDゲート11のみがアドレスカ
ウンタ61のアドレス61のアドレス出力を通過
させることになる。第2図は、16個のクロツクパ
ルスに対するアドレスカウンタ61の4ビツトア
ドレス信号の変化状態を示した図である。上述の
ごとく、8重書きの場合は、ANDゲート11の
みがアドレスカウンタ61の出力(最下位ビツ
ト)を通過させるので、メモリ4に与えられるブ
ロツクアカドレスは(0、0、0、0)と(0、
0、0、1)が交互に8回ずつ与えられることに
なる。したがつて、磁気テープ9上には、第3図
aに示すように、メモリ4のブロツクアドレス
0,1のサブコードデータがそれぞれ8回すなわ
ち8重書きされる。
Next, the operation of the embodiment shown in FIG. 1 will be explained.
First, the operation when performing octet writing of subcode data will be explained. In this case, the gate control signals A, which are output from the microcomputer 50,
B, C, and D are set to (1, 0, 0, 0).
Therefore, only AND gate 11 allows the address output of address 61 of address counter 61 to pass through. FIG. 2 is a diagram showing changes in the 4-bit address signal of the address counter 61 with respect to 16 clock pulses. As mentioned above, in the case of 8-overwriting, only the AND gate 11 passes the output (lowest bit) of the address counter 61, so the block address given to the memory 4 is (0, 0, 0, 0). (0,
0, 0, 1) are given 8 times alternately. Therefore, on the magnetic tape 9, as shown in FIG. 3a, the subcode data of block addresses 0 and 1 of the memory 4 are written eight times each, that is, eight times.

次に、サブコードデータを4重書きする場合
は、前記ゲート制御信号A,B,C,Dが(1、
1、0、0)に設定される。この場合、ANDゲ
ート11および12のみがアドレスカウンタ61
の出力を通過させるので、メモリ4に与えられる
ブロツクアドレスとしては、(0、0、0、0)
と(0、0、0、1)(0、0、1、0、)(0、
0、1、1)をそれぞれ4回繰返すことになる。
したがつて、磁気テープ9上には、第3図b示す
ように、メモリ4のブロツクアドレス0,1,
2,3のサブコードデータがそれぞれ4回すなわ
ち4重書きされることになる。
Next, when subcode data is written in four layers, the gate control signals A, B, C, D are (1,
1, 0, 0). In this case, only AND gates 11 and 12 are connected to address counter 61.
The block address given to memory 4 is (0, 0, 0, 0).
and (0, 0, 0, 1) (0, 0, 1, 0,) (0,
0, 1, 1) will be repeated four times each.
Therefore, on the magnetic tape 9, as shown in FIG. 3b, the block addresses 0, 1,
The second and third subcode data are each written four times, that is, four times.

同様に、2重書き、1重書きの場合は、前記ゲ
ート制御信号A,B,C,Dがそれぞれ、(0、
1、1、1)、(1、1、1、1)に設定され、第
3図c,dに示すようにサブコーデータが2重書
き、1重書きされる。
Similarly, in the case of double writing and single writing, the gate control signals A, B, C, and D are (0,
1, 1, 1), (1, 1, 1, 1), and the subcode data is written in double or single writing as shown in FIG. 3c and d.

[発明の効果] 以上説明したようにこの発明によれば、マイク
ロコンピユータははサブコードデータを重ね書き
する場合に記憶手段を複数回アクセスする必要が
なく、単にゲート手段の開閉を制御するだけでよ
いので、マイクロコンピユータの負担が軽くな
る。また、記憶手段のアクセスは、アドレスカウ
ンタの計数動作に応答して高速に行なわれるの
で、マイクロコンピユータに高速のものを用いる
必要がなく、装置を安価に構成することができ
る。
[Effects of the Invention] As explained above, according to the present invention, the microcomputer does not need to access the storage means multiple times when overwriting subcode data, and can simply control opening and closing of the gate means. This reduces the burden on the microcomputer. Furthermore, since the storage means is accessed at high speed in response to the counting operation of the address counter, there is no need to use a high-speed microcomputer, and the device can be constructed at low cost.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例の磁気記録再生装
置の記録系を示すブロツク図である。第2図は16
個のクロツクパルスに対するアドレスカウンタ6
1の4ビツトアドレス信号の変化状態を示した図
である。第3図は、第1図に示す実施例におい
て、サブコードデータを8重書き、4重書き、2
重書き、1重書きする場合の磁気テープ上の記録
状態および対応するゲート制御信号を示した図で
ある。第4図は従来のDATにおける磁気テープ
上の記録トラツクの構成を示した図である。第5
図は従来の磁気記録再生装置の記録系を示すブロ
ツク図である。第6図は第5図に示すメモリ4に
設けられるサブコードデータ記憶領域を示した図
である。 図において、1はローパスフイルタ、2はサン
プルホールド回路、3はA/D変換器、4はメモ
リ、7はヘツドアンプ、8は回転ドラム、9は磁
気テープ、11〜14はANDゲート、50はマ
イクロコンピユータ、60は信号処理回路、61
はアドレスカウンタを示す。
FIG. 1 is a block diagram showing a recording system of a magnetic recording/reproducing apparatus according to an embodiment of the present invention. Figure 2 is 16
address counter 6 for clock pulses
FIG. 1 is a diagram showing a change state of a 4-bit address signal of 1; FIG. 3 shows subcode data written in 8 layers, 4 layers, and 2 layers in the embodiment shown in FIG.
FIG. 4 is a diagram showing recording states on a magnetic tape and corresponding gate control signals in the case of overwriting and single writing. FIG. 4 is a diagram showing the configuration of recording tracks on a magnetic tape in a conventional DAT. Fifth
The figure is a block diagram showing a recording system of a conventional magnetic recording/reproducing device. FIG. 6 is a diagram showing a subcode data storage area provided in the memory 4 shown in FIG. 5. In the figure, 1 is a low-pass filter, 2 is a sample and hold circuit, 3 is an A/D converter, 4 is a memory, 7 is a head amplifier, 8 is a rotating drum, 9 is a magnetic tape, 11 to 14 are AND gates, and 50 is a micro computer, 60 is a signal processing circuit, 61
indicates an address counter.

Claims (1)

【特許請求の範囲】 1 磁気記録媒体上にPCM信号を記録するとと
もに、そこに記録されたPCM信号を再生するた
めの磁気記録再生装置であつて、 前記磁気記録媒体のサブコード領域に記録すべ
きサブコードデータを予め記憶する記憶手段、 与えられるクロツク信号を計数して、複数ビツ
トのアドレス信号を順次歩進しながら発生するア
ドレスカウンタ、 前記アドレス信号の各ビツトごとに設けられる
複数のゲート手段、および 前記各ゲート手段の開閉を制御するマイクロコ
ンピユータよりなるゲート制御手段を備え、 前記複数のゲート手段の出力が前記サブコード
データ読出のためのアドレス信号として前記記憶
手段に与えられることを特徴とする、磁気記録再
生装置。
[Scope of Claims] 1. A magnetic recording and reproducing device for recording a PCM signal on a magnetic recording medium and reproducing the PCM signal recorded thereon, which comprises: an address counter that counts applied clock signals and generates a plurality of bits of address signals while sequentially incrementing them; and a plurality of gate means provided for each bit of the address signal. , and gate control means comprising a microcomputer that controls opening and closing of each of the gate means, and outputs of the plurality of gate means are provided to the storage means as an address signal for reading the subcode data. A magnetic recording and reproducing device.
JP30106687A 1987-11-28 1987-11-28 Magnetic recording and reproducing device Granted JPH01143077A (en)

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